JPS60250659A - 複合形半導体装置 - Google Patents
複合形半導体装置Info
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- JPS60250659A JPS60250659A JP59106834A JP10683484A JPS60250659A JP S60250659 A JPS60250659 A JP S60250659A JP 59106834 A JP59106834 A JP 59106834A JP 10683484 A JP10683484 A JP 10683484A JP S60250659 A JPS60250659 A JP S60250659A
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- terminal
- external electrode
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- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
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- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
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- H10W72/5473—Dispositions of multiple bond wires multiple bond wires connected to a common bond pad
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- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
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- H10W72/874—On different surfaces
- H10W72/884—Die-attach connectors and bond wires
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- H10W72/921—Structures or relative sizes of bond pads
- H10W72/926—Multiple bond pads having different sizes
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- H10W90/731—Package configurations characterised by the relative positions of pads or connectors relative to package parts of die-attach connectors
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Landscapes
- Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
この発明は複合形半導体装置に関し、特に複合形半導体
装置における外部電極端子の位置配列の改良に係るもの
である。
装置における外部電極端子の位置配列の改良に係るもの
である。
従来例によるこの種の複合形半導体装置、こ工では複合
形サイリスタアレイにおける外部電極端子の位置配列を
第2図に示す。この第2図構成においては、各外部端子
の外部接続部が一方の側にあって同一ピッチ間隔で整列
された形状のリードフレームを用い、同外部端子のうち
、内外端部にある7ノード端子1.2のダイポンド部に
サイリスタチップ3.3を、それぞれに半田4などの導
電材料によりグイポンドし、かつこのサイリスタチップ
3.3の各ゲート部5,5と、両アノード端子1.2の
各内側のゲート端子6.7とをlワイヤ8.9などの導
電材料により、また同様にサイリスタチップ3.3の各
カソード部10.10と、両ゲート端子6,7間の共通
カソード端子11とをAnワイヤ12.13などの導電
材料によりそれぞれにワイヤポンドし、さらにこれらの
各端子の外部接続部を除いてエポキシ樹脂14などによ
り樹脂封止した上で、フレームのタイバーを切断除去し
て目的とする複合形サイリスタアレイを構成させるので
ある。すなわち、この構成により従来例での複合形サイ
リスタアレイにおいては、中央部に共通カソード端子1
1が、その両外側に各ゲート端子6.7が、さらにその
両外側に各7ノード端子1.2がそれぞれに等ピッチ間
隔で設けられた外部電極端子配列となっているのである
。− しかしながら、このような複合形サイリスタアレイの外
部電極端子配列では、各端子間の間隔が狭いと、高耐圧
素子の場合にゲート端子とアノード端子間で放電を生ず
ることがあつ・て、装置の絶縁耐力特性において信頼性
に欠けるという重大な欠点を有するものであった。
形サイリスタアレイにおける外部電極端子の位置配列を
第2図に示す。この第2図構成においては、各外部端子
の外部接続部が一方の側にあって同一ピッチ間隔で整列
された形状のリードフレームを用い、同外部端子のうち
、内外端部にある7ノード端子1.2のダイポンド部に
サイリスタチップ3.3を、それぞれに半田4などの導
電材料によりグイポンドし、かつこのサイリスタチップ
3.3の各ゲート部5,5と、両アノード端子1.2の
各内側のゲート端子6.7とをlワイヤ8.9などの導
電材料により、また同様にサイリスタチップ3.3の各
カソード部10.10と、両ゲート端子6,7間の共通
カソード端子11とをAnワイヤ12.13などの導電
材料によりそれぞれにワイヤポンドし、さらにこれらの
各端子の外部接続部を除いてエポキシ樹脂14などによ
り樹脂封止した上で、フレームのタイバーを切断除去し
て目的とする複合形サイリスタアレイを構成させるので
ある。すなわち、この構成により従来例での複合形サイ
リスタアレイにおいては、中央部に共通カソード端子1
1が、その両外側に各ゲート端子6.7が、さらにその
両外側に各7ノード端子1.2がそれぞれに等ピッチ間
隔で設けられた外部電極端子配列となっているのである
。− しかしながら、このような複合形サイリスタアレイの外
部電極端子配列では、各端子間の間隔が狭いと、高耐圧
素子の場合にゲート端子とアノード端子間で放電を生ず
ることがあつ・て、装置の絶縁耐力特性において信頼性
に欠けるという重大な欠点を有するものであった。
この発明は従来のこのような欠点に鑑み、ゲート端子と
アノード端子との各外部接続部が、共に反対側に形成さ
れる外部電極端子配列とすることにより、特に高耐圧素
子の場合にあって、装置の絶縁耐力特性の向上を図った
構成を提供するものである。
アノード端子との各外部接続部が、共に反対側に形成さ
れる外部電極端子配列とすることにより、特に高耐圧素
子の場合にあって、装置の絶縁耐力特性の向上を図った
構成を提供するものである。
以下この発明に係る複合形半導体装置の一実施例につき
第1図を参照して詳細に説明する。
第1図を参照して詳細に説明する。
第1図実施例は、この発明を複合形サイリスタアレイに
おける外部電極端子の位置配列に適用した場合の一例で
あって、前記第2図従来例と同一符号は同一または相当
部分を示しており、この実施例装置では、前記従来例装
置において共に一方の側に同一ピッチ間隔で配列されて
いた各外部電極端子、すなわち中央部の共通カソード端
子11と、その両外側の各ゲート端子6,7と、さらに
その両外側の各アノード端子1.2のうち、両液外側の
各アノード端子1.2に対応する。ご覧では各アノード
端子15.16のみを他方の側、つまり各ゲート端子6
,7および共通カソード端子11とは反対側に配列させ
た状態で、同様に樹脂封止して構成させたものである。
おける外部電極端子の位置配列に適用した場合の一例で
あって、前記第2図従来例と同一符号は同一または相当
部分を示しており、この実施例装置では、前記従来例装
置において共に一方の側に同一ピッチ間隔で配列されて
いた各外部電極端子、すなわち中央部の共通カソード端
子11と、その両外側の各ゲート端子6,7と、さらに
その両外側の各アノード端子1.2のうち、両液外側の
各アノード端子1.2に対応する。ご覧では各アノード
端子15.16のみを他方の側、つまり各ゲート端子6
,7および共通カソード端子11とは反対側に配列させ
た状態で、同様に樹脂封止して構成させたものである。
従ってこの実施例構成による高耐圧の複合形サイリスタ
アレイあって、各ゲート端子6.7およびに共通カソー
ド端子11と各7ノード端子l。
アレイあって、各ゲート端子6.7およびに共通カソー
ド端子11と各7ノード端子l。
2間に対し、高電圧1例えば1,0OOVを印加した場
合、これらの各ゲート端子6,7およびに共通カソード
端子11と各アノード端子1.2とが、相互に対向する
側に配置されていて、その絶縁距離が充分に大きくとら
れていることから、各端子間に放電などを生ずる惧れは
ない。
合、これらの各ゲート端子6,7およびに共通カソード
端子11と各アノード端子1.2とが、相互に対向する
側に配置されていて、その絶縁距離が充分に大きくとら
れていることから、各端子間に放電などを生ずる惧れは
ない。
なお、前記実施例においては、複合形サイリスタアレイ
について述べたが、同様に複合形トライアックアレイ、
複合形トランジスタアレイについても適用できることは
勿論である。
について述べたが、同様に複合形トライアックアレイ、
複合形トランジスタアレイについても適用できることは
勿論である。
以上詳述したようにこの発明によるときは、各外部電極
端子をもつリードフレームを用いて、このリードフレー
ムの各外部電極端子に対し、それぞれに半導体素子の該
当部を接続させ、かつこれらを各外部電極端子の外部接
続部を除き樹脂封止して構成する複合形半導体装置にお
いて、各外部電極端子のうち、端子間放電を生じ易い外
部電極端子の相互を、樹脂封止部の異なる側部に配設さ
せるようにしたので、□この外部電極端子相互間に充分
な絶縁距離を与えることができ、装置の絶縁耐力特性を
充分に維持し得て信頼性の向上に役立ち、しかも構成が
簡単で容易に実施できるなどの特長を有するものである
。
端子をもつリードフレームを用いて、このリードフレー
ムの各外部電極端子に対し、それぞれに半導体素子の該
当部を接続させ、かつこれらを各外部電極端子の外部接
続部を除き樹脂封止して構成する複合形半導体装置にお
いて、各外部電極端子のうち、端子間放電を生じ易い外
部電極端子の相互を、樹脂封止部の異なる側部に配設さ
せるようにしたので、□この外部電極端子相互間に充分
な絶縁距離を与えることができ、装置の絶縁耐力特性を
充分に維持し得て信頼性の向上に役立ち、しかも構成が
簡単で容易に実施できるなどの特長を有するものである
。
第1図はこの発明に係る複合形半導体装置の一実施例を
適用した複合形サイリスタアレイにおける外部電極端子
の位置配列を示す平面説明図、第2図は同上従来例での
複合形サイリスタアレイにおける外部電極端子の位置配
列を示す平面説明図である。 1.2および15.16・・・・アノード端子、3・・
・・サイリスタチップ、5およびlO・・・・サイリス
タチップのゲート部およびカソード部、6,7および1
1・・・・ゲート端子およびカソード端子、8.9およ
び12.13・・・・Anワイヤ、14・・・・エポキ
シ樹脂。 代□理人大 岩 増 雄
適用した複合形サイリスタアレイにおける外部電極端子
の位置配列を示す平面説明図、第2図は同上従来例での
複合形サイリスタアレイにおける外部電極端子の位置配
列を示す平面説明図である。 1.2および15.16・・・・アノード端子、3・・
・・サイリスタチップ、5およびlO・・・・サイリス
タチップのゲート部およびカソード部、6,7および1
1・・・・ゲート端子およびカソード端子、8.9およ
び12.13・・・・Anワイヤ、14・・・・エポキ
シ樹脂。 代□理人大 岩 増 雄
Claims (1)
- リードフレームを用い、このリードフレームの各外部電
極端子に各半導体素子を接続させると共に、各外部電極
端子の外部接続部を除いて樹脂封止した複合形半導体装
置において、前記各外部電極端子のうち、端子間放電を
生じ易い各外部電極端子の相互を、樹脂封止部の異なる
側部に配設させたことを特徴とする複合形半導体装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59106834A JPS60250659A (ja) | 1984-05-25 | 1984-05-25 | 複合形半導体装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59106834A JPS60250659A (ja) | 1984-05-25 | 1984-05-25 | 複合形半導体装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60250659A true JPS60250659A (ja) | 1985-12-11 |
Family
ID=14443751
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59106834A Pending JPS60250659A (ja) | 1984-05-25 | 1984-05-25 | 複合形半導体装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60250659A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6489453A (en) * | 1987-09-30 | 1989-04-03 | Toshiba Corp | Semiconductor device |
| US5821618A (en) * | 1994-08-12 | 1998-10-13 | Siemens Aktiengesellschaft | Semiconductor component with insulating housing |
-
1984
- 1984-05-25 JP JP59106834A patent/JPS60250659A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6489453A (en) * | 1987-09-30 | 1989-04-03 | Toshiba Corp | Semiconductor device |
| US5821618A (en) * | 1994-08-12 | 1998-10-13 | Siemens Aktiengesellschaft | Semiconductor component with insulating housing |
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