JPS6051290B2 - 周波数シンセサイザ - Google Patents
周波数シンセサイザInfo
- Publication number
- JPS6051290B2 JPS6051290B2 JP54127638A JP12763879A JPS6051290B2 JP S6051290 B2 JPS6051290 B2 JP S6051290B2 JP 54127638 A JP54127638 A JP 54127638A JP 12763879 A JP12763879 A JP 12763879A JP S6051290 B2 JPS6051290 B2 JP S6051290B2
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- frequency
- frequency divider
- phase
- voltage controlled
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
- H03L7/00—Automatic control of frequency or phase; Synchronisation
- H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
- H03L7/16—Indirect frequency synthesis, i.e. generating a desired one of a number of predetermined frequencies using a frequency- or phase-locked loop
- H03L7/22—Indirect frequency synthesis, i.e. generating a desired one of a number of predetermined frequencies using a frequency- or phase-locked loop using more than one loop
- H03L7/23—Indirect frequency synthesis, i.e. generating a desired one of a number of predetermined frequencies using a frequency- or phase-locked loop using more than one loop with pulse counters or frequency dividers
Landscapes
- Channel Selection Circuits, Automatic Tuning Circuits (AREA)
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
- Transmitters (AREA)
Description
【発明の詳細な説明】
本発明は周波数シンセサイザに関し、特に広帯域特性に
優れた周波数シンセサイザに関するものである。
優れた周波数シンセサイザに関するものである。
従来、ＦＭ無線機用の周波数シンセサイザとしては、電
圧制御発振回路に変調信号を印加し、周波数変調波を得
るものがある。
圧制御発振回路に変調信号を印加し、周波数変調波を得
るものがある。
第１図に、その周波数シンセサイザの構成をブロックで
示す。
示す。
第１図において、１は水晶発振回路、２は固定分周回路
、３は位相比較回路、４は低域通過ろ波回路、５は電圧
制御発振回路、６は可変分周回路である。
、３は位相比較回路、４は低域通過ろ波回路、５は電圧
制御発振回路、６は可変分周回路である。
電圧制御発振回路５の発振周波担。
を可変分周回路６で分周した後、水晶発振回路１の出力
を固定分周回路２により分周して得た基準周波数ｆＲと
位相比較回路３で位相比較し、その出力を低域通過ろ波
回路４を通して電圧制御発振回路５に印加し、その発振
周波数ｆ。を制御する。可変分周回路６の分周数をＮと
すれば、同期状態においてはち＝Ｎ−ｆＲ（１）となる
。
を固定分周回路２により分周して得た基準周波数ｆＲと
位相比較回路３で位相比較し、その出力を低域通過ろ波
回路４を通して電圧制御発振回路５に印加し、その発振
周波数ｆ。を制御する。可変分周回路６の分周数をＮと
すれば、同期状態においてはち＝Ｎ−ｆＲ（１）となる
。
ｆＲをチャネル間隔周波数と同一周波数に選定すれば、
Ｎを変えることにより、任意のチャネル周波数を選択で
きる。一方、変調信号Ｓｍによる、電圧制御発振回路５
の制御電圧の変化をΔＶとすれば、このとき、ちの周波
数偏移ΔｆｏはΔち＝−・ Ｋｏ・ΔＶ （２） １＋Ｇ（Ｓ） となる。
Ｎを変えることにより、任意のチャネル周波数を選択で
きる。一方、変調信号Ｓｍによる、電圧制御発振回路５
の制御電圧の変化をΔＶとすれば、このとき、ちの周波
数偏移ΔｆｏはΔち＝−・ Ｋｏ・ΔＶ （２） １＋Ｇ（Ｓ） となる。
ただし６）ＬＦ（５）
Ｇ（５）＝
Ｎ；−０１Γ
ωし・・・電圧制御発振回路のロック範囲〔ｒａｄ〕
ＪＫｏ・・・電圧制御発振回路の変換利得〔ｒａｄ／Ｖ
〕 Ｆ（Ｓ）・・・位相比較回路の電圧利得 変調信号Ｓｍの全周波数帯域にわたつて、Ｇ（Ｓ）〈１
（３） ７なる条件を満たせば、（２）は Δち＝に０・ΔＶ（４） となり、Ｓｍの周波数に関して、平担な周波数偏移が得
られる。
〕 Ｆ（Ｓ）・・・位相比較回路の電圧利得 変調信号Ｓｍの全周波数帯域にわたつて、Ｇ（Ｓ）〈１
（３） ７なる条件を満たせば、（２）は Δち＝に０・ΔＶ（４） となり、Ｓｍの周波数に関して、平担な周波数偏移が得
られる。
しかしながら、式（３）を満足するためにはとなり、ロ
ック範囲ω５を大きく出来ないので、広帯域化には適し
ていない。
ック範囲ω５を大きく出来ないので、広帯域化には適し
ていない。
例えば、Ｎ＝２０００，Ｆ（Ｓ）＝ー１０ｃ１８のとき
、３００Ｈｚ〜３０００Ｈｚの変調信号に対して平担な
周波数偏移を得ようとするならば、ロック周波数範囲ω
Ｌ．／２πはとなる。
、３００Ｈｚ〜３０００Ｈｚの変調信号に対して平担な
周波数偏移を得ようとするならば、ロック周波数範囲ω
Ｌ．／２πはとなる。
さらに、１００Ｈｚのトーン周波数で変調をかけるため
にはとなる。
にはとなる。
この種の周波数シンセサイザは広帯域化に適しておらず
、広帯域化を要するときは、複数個の電圧制御発振回路
を設け、それを切換えることにより、所要の帯域を得な
ければならないという欠点があつた。
、広帯域化を要するときは、複数個の電圧制御発振回路
を設け、それを切換えることにより、所要の帯域を得な
ければならないという欠点があつた。
本発明は、かかる欠点を解消するためになされたもので
、広帯域特性の優れた周波数シンセサイザを提供するこ
とを目的とする。
、広帯域特性の優れた周波数シンセサイザを提供するこ
とを目的とする。
第２図に、本発明の一実施例を示す。
第２図において、１は水晶発振回路、２は固定分周回路
、３は位相比較回路、４は低域通過ろ波回路、５は電圧
制御発振回路、６は可変分周回路、７は固定分周回路、
８はパルス位相変調回路、９は位相比較回路、１０は低
域通過ろ波回路、１０は電圧制．御発振回路、１２は固
定分周回路である。電圧制御発振回路５の発振周波数ｆ
１を可変分周回路６で分周した後、水晶発振回路１の出
力を固定分周回路２により分周して得た基準周波数ＦＲ
と位相比較回路３て位相比較し、その出力を低域！通過
ろ波回路４を通して電圧制御発振回路５に印加し、その
発振周波数ｆ１を制御する。
、３は位相比較回路、４は低域通過ろ波回路、５は電圧
制御発振回路、６は可変分周回路、７は固定分周回路、
８はパルス位相変調回路、９は位相比較回路、１０は低
域通過ろ波回路、１０は電圧制．御発振回路、１２は固
定分周回路である。電圧制御発振回路５の発振周波数ｆ
１を可変分周回路６で分周した後、水晶発振回路１の出
力を固定分周回路２により分周して得た基準周波数ＦＲ
と位相比較回路３て位相比較し、その出力を低域！通過
ろ波回路４を通して電圧制御発振回路５に印加し、その
発振周波数ｆ１を制御する。
可変分周回路６の分周比をＮとすれば、発振周波数ｆ１
は １に
１０１となる。ｆ１を固定分周回路７で分周した
後、パルス位置変調回路８を通して、位相比較回路９の
基準周波数Ｆ２を得る。
は １に
１０１となる。ｆ１を固定分周回路７で分周した
後、パルス位置変調回路８を通して、位相比較回路９の
基準周波数Ｆ２を得る。
固定分周回路７の分周数をＫとすればとなる。
電圧制御発振回路１１の発振周波数Ｆ。
を固定分周回路１２で分周し、位相比較回路９において
、Ｆ２と位相比較する。位相比較回路９の出力を低域通
過ろ波回路１０を通した後、電圧制御発振回路１１に印
加し、その発振周波数Ｆ。を制御する。固定分周回路１
２の分周数をＭとすれば、発振周波数ｔは −ｖ
リＶＩとなる。
、Ｆ２と位相比較する。位相比較回路９の出力を低域通
過ろ波回路１０を通した後、電圧制御発振回路１１に印
加し、その発振周波数Ｆ。を制御する。固定分周回路１
２の分周数をＭとすれば、発振周波数ｔは −ｖ
リＶＩとなる。
したがつて、式（８），（９），ＱＯよりとなる。
式（１１）においてとなるようにＦＲを選定すれば、Ｎ
を変えることにより、ｔを任意のチャネル周波数に設定
するこ”とができる。
を変えることにより、ｔを任意のチャネル周波数に設定
するこ”とができる。
一方、変調信号Ｓｍをパルス位相変調回路８に印加し、
位相比較回路９の基準周波数Ｆ２の位相をΔθｍだけ変
化させると、このとき、電圧制御発振回路１１の発振周
波数ちの位相偏移Δθｏは、となる。
位相比較回路９の基準周波数Ｆ２の位相をΔθｍだけ変
化させると、このとき、電圧制御発振回路１１の発振周
波数ちの位相偏移Δθｏは、となる。
ただし ωＪ・・・電圧制御発振回路１１のロック範
囲 〔Ｒａｄ〕 Ｈ（Ｓ）・・・低域通過ろ波
回路１０の電圧利得変調信号Ｓｍの全周波数帯域にわた
つて ｕ ＼ｖノ７ ふ
（卜Ｕなる条件を満たせば、式（１３）はとなり、
出力周波数Ｆ。
囲 〔Ｒａｄ〕 Ｈ（Ｓ）・・・低域通過ろ波
回路１０の電圧利得変調信号Ｓｍの全周波数帯域にわた
つて ｕ ＼ｖノ７ ふ
（卜Ｕなる条件を満たせば、式（１３）はとなり、
出力周波数Ｆ。
の位相偏移Δθｏは、パルス位相変調回路８での位相変
化分ΔθＭＯ）Ｍ倍となる。したがつて、パルス位相変
調回路８での位相変化分は、変調歪が希望する値より小
さくなる様に制限し、固定分周回路１２の分周数Ｍの選
定により、所要の変調度を得ることができる。また、条
件１４を満足するためにはとなり、電圧制御発振回路１
１のロック範囲ωＬ″を大きく出来るので、広帯域特性
の優れた周波数シンセサイザを提供できる。
化分ΔθＭＯ）Ｍ倍となる。したがつて、パルス位相変
調回路８での位相変化分は、変調歪が希望する値より小
さくなる様に制限し、固定分周回路１２の分周数Ｍの選
定により、所要の変調度を得ることができる。また、条
件１４を満足するためにはとなり、電圧制御発振回路１
１のロック範囲ωＬ″を大きく出来るので、広帯域特性
の優れた周波数シンセサイザを提供できる。
一方、式（９），［株］より
となる。
したがつて、固定分周回路７の分周数Ｋを、固定分周回
路１２の分周数Ｍより小さく選定することにより、電圧
制御発振回路５の発振周波数ｆ１を、出力周波数ちより
低くすることが出来るので、電圧制御発振回路５を簡単
な回路とすることが可能となる。また、式（１２）から
解るように、固定分周回路７の分周数Ｋの選定により、
位相比較回路３の基準周波数ＦＲを任意に設定できるの
で、設計上の利点をも有する。
路１２の分周数Ｍより小さく選定することにより、電圧
制御発振回路５の発振周波数ｆ１を、出力周波数ちより
低くすることが出来るので、電圧制御発振回路５を簡単
な回路とすることが可能となる。また、式（１２）から
解るように、固定分周回路７の分周数Ｋの選定により、
位相比較回路３の基準周波数ＦＲを任意に設定できるの
で、設計上の利点をも有する。
なお、上記実施例では、電圧制御発振回路１１の発振周
波数ちを、直接、固定分周回路１２の入力としているが
、ＦＯ周波数混合回路で周波数てい降した後、固定分周
回路１２の入力としても良い。
波数ちを、直接、固定分周回路１２の入力としているが
、ＦＯ周波数混合回路で周波数てい降した後、固定分周
回路１２の入力としても良い。
また、位相比較回路９がエッジトリガで動作する場合は
、パルス位置変調回路８の代りに、パルス幅変調回路を
使用しても良い。
、パルス位置変調回路８の代りに、パルス幅変調回路を
使用しても良い。
以上のように、本発明の周波数シンセサイザでは、出力
周波数を供給する電圧制御発振回路１１のロック周波数
範囲を大きく出来るのて、広帯域化することが出来る。
周波数を供給する電圧制御発振回路１１のロック周波数
範囲を大きく出来るのて、広帯域化することが出来る。
図面の簡単な説明第１図は、従来の周波数シンセサイザ
の構成を示すブロック図である。
の構成を示すブロック図である。
第２図は、本発明の一実施例による周波数シンセサイザ
の構成を示すブロック図である。なお、図中同一符号は
同一又は相当部分を示す。１・・・・・・水晶発振回路
、２・・・・・・固定分周回路、３・・・・・位相比較
回路、４・・・・・・低域通過ろ波回路、５・・・・・
電圧制御発振回路、６・・・・・・可変分周回路、７・
・・・固定分周回路、８・・・・・・パルス位相変調回
路、９・・・・・・位相比較回路、１０・・・・・・低
域通過ろ波回）路、１１・・・・・・電圧制御発振回路
、１２・・・・・・固定分周回路。
の構成を示すブロック図である。なお、図中同一符号は
同一又は相当部分を示す。１・・・・・・水晶発振回路
、２・・・・・・固定分周回路、３・・・・・位相比較
回路、４・・・・・・低域通過ろ波回路、５・・・・・
電圧制御発振回路、６・・・・・・可変分周回路、７・
・・・固定分周回路、８・・・・・・パルス位相変調回
路、９・・・・・・位相比較回路、１０・・・・・・低
域通過ろ波回）路、１１・・・・・・電圧制御発振回路
、１２・・・・・・固定分周回路。
Claims (1)
- １ 水晶発振回路、および、その出力を受けるように順
次接続した固定分周回路、位相比較回路、低域通過ろ波
回路、電圧制御発振回路、可変分周回路を備え、上記電
圧制御発振回路の出力周波数を上記可変分周回路で分周
して上記位相比較回路に入力するとともに、さらに、上
記電圧制御発振回路の出力を受けるように順次接続した
固定分周回路、パルス位相変調回路、位相比較回路、低
域通過ろ波回路、電圧制御発振回路、および固定分周回
路を備え、電圧制御発振回路の出力周波数を固定分周回
路で分周して位相比較回路に入力するようにしたことを
特徴とする周波数シンセサイザ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP54127638A JPS6051290B2 (ja) | 1979-10-02 | 1979-10-02 | 周波数シンセサイザ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP54127638A JPS6051290B2 (ja) | 1979-10-02 | 1979-10-02 | 周波数シンセサイザ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5651133A JPS5651133A (en) | 1981-05-08 |
| JPS6051290B2 true JPS6051290B2 (ja) | 1985-11-13 |
Family
ID=14965040
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP54127638A Expired JPS6051290B2 (ja) | 1979-10-02 | 1979-10-02 | 周波数シンセサイザ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6051290B2 (ja) |
-
1979
- 1979-10-02 JP JP54127638A patent/JPS6051290B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5651133A (en) | 1981-05-08 |
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