JPS61212980A - カラ−ビデオ信号処理回路 - Google Patents
カラ−ビデオ信号処理回路Info
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- JPS61212980A JPS61212980A JP5400685A JP5400685A JPS61212980A JP S61212980 A JPS61212980 A JP S61212980A JP 5400685 A JP5400685 A JP 5400685A JP 5400685 A JP5400685 A JP 5400685A JP S61212980 A JPS61212980 A JP S61212980A
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- Japan
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- signal processing
- circuit
- output
- signal
- processing circuit
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- Processing Of Color Television Signals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、コンポジット方式及びコンポーネント方式
の両者に対応できるカラービデオ信号処理回路に関する
ものである。
の両者に対応できるカラービデオ信号処理回路に関する
ものである。
この発明は、コンポジット方式及びコンポーネント方式
の両者に対応できるカラービデオ信号処理回路において
、コンポジット方式に対応した場合に、入力組み換え回
路を用いて全ての信号処理回路にコンポシフト信号を供
給し、全ての信号処理回路を用いて信号処理を行い、そ
の出力を出力組み換え回路を用いて選択的に共通のチャ
ンネルに出力させるようにしたことにより、高速な信号
処理または高度で複雑な信号処理を可能としたカラービ
デオ信号処理回路である。
の両者に対応できるカラービデオ信号処理回路において
、コンポジット方式に対応した場合に、入力組み換え回
路を用いて全ての信号処理回路にコンポシフト信号を供
給し、全ての信号処理回路を用いて信号処理を行い、そ
の出力を出力組み換え回路を用いて選択的に共通のチャ
ンネルに出力させるようにしたことにより、高速な信号
処理または高度で複雑な信号処理を可能としたカラービ
デオ信号処理回路である。
テレビジョン信号の方式としては、例えばNTS’c、
PAL、SEC’AMのようなコンポジット方式と、例
えばRGB方式のようなコンポーネント方式のものが知
られている。これら両者に対応したカラービデオ信号処
理回路においては、第6図に示すようにコンポーネント
方式の場合の各色成分(コンポーネント)信号に対応し
て独立して信号処理が行えるように、3個の信号処理回
路64.65.66が用いられる。
PAL、SEC’AMのようなコンポジット方式と、例
えばRGB方式のようなコンポーネント方式のものが知
られている。これら両者に対応したカラービデオ信号処
理回路においては、第6図に示すようにコンポーネント
方式の場合の各色成分(コンポーネント)信号に対応し
て独立して信号処理が行えるように、3個の信号処理回
路64.65.66が用いられる。
例えば、コンポーネント方式に対応する場合には、端子
61からR(赤色成分)信号が信号処理回路64に供給
され、信号処理がなされ出力される。端子62からG(
緑色成分)信号が信号処理回路65に供給され、信号処
理がなされ出力される。端子63からB(青色成分)信
号が信号処理回路66に供給され、信号処理がなされ出
力される。
61からR(赤色成分)信号が信号処理回路64に供給
され、信号処理がなされ出力される。端子62からG(
緑色成分)信号が信号処理回路65に供給され、信号処
理がなされ出力される。端子63からB(青色成分)信
号が信号処理回路66に供給され、信号処理がなされ出
力される。
また、コンポジット方式に対応する場合には、コンポー
ネント方式の各色成分(コンポーネント)信号に用いら
れる信号処理回路のいずれかにより、信号処理がなされ
る。例えばコンポーネント方式のG信号の信号処理回路
65にコンポジット信号が端子62から供給され、信号
処理がなされ出力される。
ネント方式の各色成分(コンポーネント)信号に用いら
れる信号処理回路のいずれかにより、信号処理がなされ
る。例えばコンポーネント方式のG信号の信号処理回路
65にコンポジット信号が端子62から供給され、信号
処理がなされ出力される。
しかし、上述のコンポーネント方式及びコンポジット方
式の両者に対応するカラービデオ信号処理回路において
は、コンポジット信号に対応した場合に、1個の信号処
理回路のみしか使用・Uず、他の2個の信号処理回路が
使用されない。このため、回路全体としての効率が悪い
という問題点があった。
式の両者に対応するカラービデオ信号処理回路において
は、コンポジット信号に対応した場合に、1個の信号処
理回路のみしか使用・Uず、他の2個の信号処理回路が
使用されない。このため、回路全体としての効率が悪い
という問題点があった。
また、信号処理を高速化したり、複雑で高度な信号処理
を行うためには、信号処理回路自体を大規模なものとし
なければならない問題点があった。
を行うためには、信号処理回路自体を大規模なものとし
なければならない問題点があった。
従って、この発明の目的は、コンポーネント方式及びコ
ンポジット方式の両者に対応することができ、コンポジ
ット方式に対応した場合に、信号処理回路を大規模なも
のとせずとも高速な信号処理または複雑で高度な信号処
理ができるカラービデオ信号処理回路を提供することに
ある。
ンポジット方式の両者に対応することができ、コンポジ
ット方式に対応した場合に、信号処理回路を大規模なも
のとせずとも高速な信号処理または複雑で高度な信号処
理ができるカラービデオ信号処理回路を提供することに
ある。
c問題点を解決するための手段〕
この発明は、第1の信号処理回路11.第2の信号処理
回路12及び第3の信号処理回路13と、第1.第2及
び第3の信号処理回路11.12゜13の入力側に設け
られ、コンポーネント信萼°の各コンポーネントの各々
を第1.第2及び第3の信号処理回路1’l、 12
. ’13に供給する状態と、コンポジット信号を第1
.第2及び第3の信号処理回路11,12.1’3に共
通に供給する状態とが切り替え可能な入力組み換え回路
4と、第1.第2及び第3の信号処理回路11,12゜
13の出力側に設けられ、コンポーネント信号の入力時
に、第1.第2及び第3の信号処理回路11’、12.
13からの出力信号を夫々出力する状態と、コンポジッ
ト信号の入力時に、第1.第2及び第3の信号処理回路
11.12.13の出力を選択的に切り換えて共通のチ
ャンネルとして出力する状態とが切り替え可能な出力組
み換え回路5と、 を備えたことを特徴とするカラービデオ信号処理回路で
ある。
回路12及び第3の信号処理回路13と、第1.第2及
び第3の信号処理回路11.12゜13の入力側に設け
られ、コンポーネント信萼°の各コンポーネントの各々
を第1.第2及び第3の信号処理回路1’l、 12
. ’13に供給する状態と、コンポジット信号を第1
.第2及び第3の信号処理回路11,12.1’3に共
通に供給する状態とが切り替え可能な入力組み換え回路
4と、第1.第2及び第3の信号処理回路11,12゜
13の出力側に設けられ、コンポーネント信号の入力時
に、第1.第2及び第3の信号処理回路11’、12.
13からの出力信号を夫々出力する状態と、コンポジッ
ト信号の入力時に、第1.第2及び第3の信号処理回路
11.12.13の出力を選択的に切り換えて共通のチ
ャンネルとして出力する状態とが切り替え可能な出力組
み換え回路5と、 を備えたことを特徴とするカラービデオ信号処理回路で
ある。
コンポーネント方式に対応する場合は、入力端子1,2
.3からの各コンポーネント信号が入力組み換え回路4
を介して信号処理回路11,12゜13に供給され、信
号処理が独立してなされ、信号処理回路11,12.1
3の夫々の出力が、出力組み換え回路5を介して出力端
子21,22゜23の夫々に出力される。また、コンポ
ジット方式に対応する場合は、入力端子1からのコンポ
ジット信号が入力組み換え回路4により振り分けられ、
信号処理回路z: 12.13の夫々に供給され、信
号処理回路11.12.’13の全てが使用されて信号
処理がなされ、信号処理回路11゜1’2.13の出力
が出力組み換え回路5により、選択的に取り出され出力
端子21に出力される。
.3からの各コンポーネント信号が入力組み換え回路4
を介して信号処理回路11,12゜13に供給され、信
号処理が独立してなされ、信号処理回路11,12.1
3の夫々の出力が、出力組み換え回路5を介して出力端
子21,22゜23の夫々に出力される。また、コンポ
ジット方式に対応する場合は、入力端子1からのコンポ
ジット信号が入力組み換え回路4により振り分けられ、
信号処理回路z: 12.13の夫々に供給され、信
号処理回路11.12.’13の全てが使用されて信号
処理がなされ、信号処理回路11゜1’2.13の出力
が出力組み換え回路5により、選択的に取り出され出力
端子21に出力される。
以下、この発明の一実施例を図面を参照して説明する。
第1図において、l、2.3で示されるのが入力端子で
ある。また、11.12.13で示されるのが同様の構
成の信号処理回路であり、フィルタ回路、高速フーリエ
変換回路、積和演算回路等である。これらの信号処理回
路11.”12゜13は、所定のタイミングで人力デー
タの取り込みが可能な構成とされている。
ある。また、11.12.13で示されるのが同様の構
成の信号処理回路であり、フィルタ回路、高速フーリエ
変換回路、積和演算回路等である。これらの信号処理回
路11.”12゜13は、所定のタイミングで人力デー
タの取り込みが可能な構成とされている。
第1図に示す一実施例がコンポーネント方式に対応する
場合は、入力端子1から例えばディジタルデータとされ
たR(赤色成分)信号が入力組み換え回路4を介して信
号処理回路11に供給される。また、入力端子2から例
えばディジタルデータとされたG(緑色成分)信号が入
力組み換え回路4を介して信号処理回路12に供給され
、入力端子3から例えばディジタルデータとされたB(
青色成分)信号が入力組み換え回路4を介して信号処理
回路】3に供給される。
場合は、入力端子1から例えばディジタルデータとされ
たR(赤色成分)信号が入力組み換え回路4を介して信
号処理回路11に供給される。また、入力端子2から例
えばディジタルデータとされたG(緑色成分)信号が入
力組み換え回路4を介して信号処理回路12に供給され
、入力端子3から例えばディジタルデータとされたB(
青色成分)信号が入力組み換え回路4を介して信号処理
回路】3に供給される。
信号処理回路11,12.13において、各コンポーネ
ント信号のデータが同時に取り込まれ、演算が行われ、
信号処理回路11..12.!3の夫々で信号処理がな
される。信号処理回路11の出力が出力組み換え回路5
を介して出力端子21に出力される。また、信号処理回
路12の出力が出力組み換え回路5を介して出力端子2
2に出力され、信号処理回路13の出力が出力組み換え
回路5を介して出力端子23に出力される。
ント信号のデータが同時に取り込まれ、演算が行われ、
信号処理回路11..12.!3の夫々で信号処理がな
される。信号処理回路11の出力が出力組み換え回路5
を介して出力端子21に出力される。また、信号処理回
路12の出力が出力組み換え回路5を介して出力端子2
2に出力され、信号処理回路13の出力が出力組み換え
回路5を介して出力端子23に出力される。
第1図に示ず一実施例がコンポーネント方式に対応する
場合は、例えば入力端子1からコンポジット信号が人力
組み換え回路4に供給される。人力組み換え回路4にお
いて、コンポジット信号が振り分けられ、信号処理回路
11,12.13の夫々に同一のコンポジット信号が供
給される。
場合は、例えば入力端子1からコンポジット信号が人力
組み換え回路4に供給される。人力組み換え回路4にお
いて、コンポジット信号が振り分けられ、信号処理回路
11,12.13の夫々に同一のコンポジット信号が供
給される。
信号処理回路If、12.13のコンポジット信号を取
り込むタイミングは、夫々違ったものとされ、例えば第
2図に示すように入力コンボジット信号(第2図A)に
対して1フレームを単位として夫々違ったフレームのデ
ータが各信号処理回路11,12.13に取り込まれる
。
り込むタイミングは、夫々違ったものとされ、例えば第
2図に示すように入力コンボジット信号(第2図A)に
対して1フレームを単位として夫々違ったフレームのデ
ータが各信号処理回路11,12.13に取り込まれる
。
即ち、信号処理回路11においては、コンポジット信号
の3n+1番目のフレーム(F+、Fz、・・・・)が
、第2図Bのタイミングで取り込まれ、第2図Cに示す
ように3フレ一ム分の時間をかけて信号処理が行われ、
この信号処理されたコンポジット信号が出力組み換え回
路5に供給される。
の3n+1番目のフレーム(F+、Fz、・・・・)が
、第2図Bのタイミングで取り込まれ、第2図Cに示す
ように3フレ一ム分の時間をかけて信号処理が行われ、
この信号処理されたコンポジット信号が出力組み換え回
路5に供給される。
信号処理回路12においては、コンポジット信号の3n
千2番目のフレーム(F2.F5.、、。
千2番目のフレーム(F2.F5.、、。
・)が、第2図りのタイミングで取り込まれ、第2図E
に示すように3フレ一ム分の時間をかけて信号処理が行
われ、この信号処理されたコンポジット信号が出力組み
換え回路5に供給される。
に示すように3フレ一ム分の時間をかけて信号処理が行
われ、この信号処理されたコンポジット信号が出力組み
換え回路5に供給される。
信号処理回路13においては、コンポジット信号の3n
番目のフレーム(FO+、F3 、・・・・)が、第2
図Fのタイミングで取り込まれ、第2図Gに示すように
3フレ一ム分の時間をかけて信号処理が行われ、この信
号処理されたコンポジット信号が出力組み換え回路5に
供給される。
番目のフレーム(FO+、F3 、・・・・)が、第2
図Fのタイミングで取り込まれ、第2図Gに示すように
3フレ一ム分の時間をかけて信号処理が行われ、この信
号処理されたコンポジット信号が出力組み換え回路5に
供給される。
出力組み換え回路5により、各信号処理回路11.12
.13からの出力の夫々が、順次1フレーム毎に選択さ
れ、信号処理がなされたコンポジット信号が連続化され
、出力端子21に出力される。
.13からの出力の夫々が、順次1フレーム毎に選択さ
れ、信号処理がなされたコンポジット信号が連続化され
、出力端子21に出力される。
第3図は、上述した一実施例の入力組み換え回路4の一
例を示したもので、4個のへソファ回路41〜44によ
り構成されている。
例を示したもので、4個のへソファ回路41〜44によ
り構成されている。
入力端子1からの入力信号がへソファ回路41及び43
に供給される。入力端子2からの入力信号がバッファ回
路42に供給される。入力端子3からの入力信号がバッ
ファ回路44に供給される。
に供給される。入力端子2からの入力信号がバッファ回
路42に供給される。入力端子3からの入力信号がバッ
ファ回路44に供給される。
バッファ回路41〜44の夫々は、アウトプットコント
ロール端子を有しており、このアウトプットコントロー
ル端子がローレベルとされると、その内容が出力さ−る
。バッファ回路41及び43のアウトプットコントロー
ル端子が端子45に接続され、また、バッファ回路42
及び44のアウトプットコントロール端子が端子46に
接続されている。
ロール端子を有しており、このアウトプットコントロー
ル端子がローレベルとされると、その内容が出力さ−る
。バッファ回路41及び43のアウトプットコントロー
ル端子が端子45に接続され、また、バッファ回路42
及び44のアウトプットコントロール端子が端子46に
接続されている。
コンポーネント方式に対応する場合は、端子45゛がハ
イレベルとされ、端子46がローレベルとされる。この
ため、入力端子1からのR信号が信号処理11のみに供
給され、入力端子2からのG信号がバッファ回路42を
介して信号処理回路12に供給され、入力端子3からの
B信号がバッファ回路44を介して信号処理回路13に
供給される。
イレベルとされ、端子46がローレベルとされる。この
ため、入力端子1からのR信号が信号処理11のみに供
給され、入力端子2からのG信号がバッファ回路42を
介して信号処理回路12に供給され、入力端子3からの
B信号がバッファ回路44を介して信号処理回路13に
供給される。
また、コンポジット方式に対応する場合は、端子45が
ローレベルとされ、端子46がハイレベルとされる。こ
のため、入力端子1からのコンポジット信号が信号処理
回路11に供給されると共に、バッファ回路41を介し
て信号処理回路12に供給され、またバッファ回路43
を介して信号処理回路13に供給される。
ローレベルとされ、端子46がハイレベルとされる。こ
のため、入力端子1からのコンポジット信号が信号処理
回路11に供給されると共に、バッファ回路41を介し
て信号処理回路12に供給され、またバッファ回路43
を介して信号処理回路13に供給される。
第4図は、上述した一実施例の出力組み換え回路5の一
例を示したもので、3個のバッファ回路51.52.5
3により構成されている。
例を示したもので、3個のバッファ回路51.52.5
3により構成されている。
信号処理回路11の出力がバッファ回路51に供給され
る。信号処理回路12の出力がハソファ回路52及び出
力端子22に供給される。信号処理回路13の出力がバ
ッファ回路53及び出力23に供給される。
る。信号処理回路12の出力がハソファ回路52及び出
力端子22に供給される。信号処理回路13の出力がバ
ッファ回路53及び出力23に供給される。
バッファ回路51.52.53の夫々は、アウトプット
コントロール端子を有しており、このアウトプットコン
トロール端子がローレベルとされると、バッファ回路の
内容が出力される。バッファ回路51のアウトプットコ
ントロール端子が端子54に接続され、バッファ回路5
2のアウトプットコントロール端子が端子55に接続さ
れ、バッファ回路53のアウトプットコントロ−ルが端
子56に接続されている。
コントロール端子を有しており、このアウトプットコン
トロール端子がローレベルとされると、バッファ回路の
内容が出力される。バッファ回路51のアウトプットコ
ントロール端子が端子54に接続され、バッファ回路5
2のアウトプットコントロール端子が端子55に接続さ
れ、バッファ回路53のアウトプットコントロ−ルが端
子56に接続されている。
コンポーネント方式に対応する場合は、端子54がロー
レベルとされ、端子55及び端子56がハイレベルとさ
れる。このため、信号処理回路11からの出力が、バッ
ファ回路51を介して出力端子21に出力され、信号処
理回路12からの出力がそのまま出力端子22に出力さ
れ、信号処理回路13からの出力がそのまま出力端子2
3に出力される。
レベルとされ、端子55及び端子56がハイレベルとさ
れる。このため、信号処理回路11からの出力が、バッ
ファ回路51を介して出力端子21に出力され、信号処
理回路12からの出力がそのまま出力端子22に出力さ
れ、信号処理回路13からの出力がそのまま出力端子2
3に出力される。
コンポジット方式に対応する場合は、端子54。
55、56が順次1フレーム毎にローレベルとされる。
このため、信号処理回路11.12.13の夫々の出力
が順次取り出され、信号処理されたコンポジット信号が
共通のチャンネルとして連続化され、出力端子21に出
力される。
が順次取り出され、信号処理されたコンポジット信号が
共通のチャンネルとして連続化され、出力端子21に出
力される。
第5図は、この発明の他の実施例を示すもので、信号処
理回路11,12.13の夫々の間においてデータの授
受が可能とされた例である。
理回路11,12.13の夫々の間においてデータの授
受が可能とされた例である。
第5図に示す他の実施例がコンポーネント方式に対応す
る場合は、一実施例と同様に入力組み換え回路4の端子
45がハイレベルとされ、端子46がローレベルとされ
ることにより、入力端子1。
る場合は、一実施例と同様に入力組み換え回路4の端子
45がハイレベルとされ、端子46がローレベルとされ
ることにより、入力端子1。
2、3からの各コンポーネント信号が信号処理回路11
,12.13の夫々に供給される。そして、信号処理回
路1t, 12.13の夫々において、独立して信号
処理がなされ、その夫々の出力が出力組み換え回路5の
端子54がローレベルとされ、端子5’5.56が共に
ハイレベルとされることにより、出力端子21,22.
23の夫々に出力される。
,12.13の夫々に供給される。そして、信号処理回
路1t, 12.13の夫々において、独立して信号
処理がなされ、その夫々の出力が出力組み換え回路5の
端子54がローレベルとされ、端子5’5.56が共に
ハイレベルとされることにより、出力端子21,22.
23の夫々に出力される。
第5図に示す他の実施例がコンポジット方式に対応する
場合は、入力端子1からコンポジット信号が人力組み換
え回路4に供給され、入力組み換え回路4の端子45が
ローレベルとされ、端子46がハイレベルとされること
により、コンポジット信号が振り分けられ、信号処理回
路11,12。
場合は、入力端子1からコンポジット信号が人力組み換
え回路4に供給され、入力組み換え回路4の端子45が
ローレベルとされ、端子46がハイレベルとされること
により、コンポジット信号が振り分けられ、信号処理回
路11,12。
13の夫々に同一のコンポジット信号が供給される。
信号処理回路11,12.13の夫々にコンポジット信
号のデータが1フレーム毎に同時に取り込まれ、データ
の授受が行われながら協働して演算が行われ、信号処理
がなされる。
号のデータが1フレーム毎に同時に取り込まれ、データ
の授受が行われながら協働して演算が行われ、信号処理
がなされる。
信号処理回路11,12.13の夫々の出力が出力組み
換え回路5に供給され、所定の信号処理回路の出力を選
択的に取り出すように出力組み換え回路5の端子54,
55.56のいずれか一つの端子がローレベルとされる
。例えば、信号処理回路11からの出力を取り出す場合
には、端子54がローレベルとされ、端子55.56が
ハイレヘルとされる。
換え回路5に供給され、所定の信号処理回路の出力を選
択的に取り出すように出力組み換え回路5の端子54,
55.56のいずれか一つの端子がローレベルとされる
。例えば、信号処理回路11からの出力を取り出す場合
には、端子54がローレベルとされ、端子55.56が
ハイレヘルとされる。
尚、この他の実施例においては、コンポジット方式に対
応した場合、コンポジット信号を各信号処理回路11,
12.13の夫々に供給するものであるが、入力組み換
え回路4の端子45及び46を共にハイレベルとし、信
号処理回路11にのみコンポジット信号を供給するよう
にしても良い。
応した場合、コンポジット信号を各信号処理回路11,
12.13の夫々に供給するものであるが、入力組み換
え回路4の端子45及び46を共にハイレベルとし、信
号処理回路11にのみコンポジット信号を供給するよう
にしても良い。
この発明では、コンポーネント方式に対応する場合に、
各コンポーネント信号に対応して独立して信号処理が行
え、その出力を夫々に得ることができる。また、コンポ
ジット方式に対応する場合には、入力端子からのコンポ
ジット信号が入力組み換え回路により振り分けられ、全
ての信号処理回路に供給され、従来、使用されなかった
信号処理回路をも含めて信号処理がなされ、その信号処
理回路の夫々の出力を出力組み換え回路により選択的に
取り出し、所定出力端子に出力することができる。
各コンポーネント信号に対応して独立して信号処理が行
え、その出力を夫々に得ることができる。また、コンポ
ジット方式に対応する場合には、入力端子からのコンポ
ジット信号が入力組み換え回路により振り分けられ、全
ての信号処理回路に供給され、従来、使用されなかった
信号処理回路をも含めて信号処理がなされ、その信号処
理回路の夫々の出力を出力組み換え回路により選択的に
取り出し、所定出力端子に出力することができる。
このため、この発明に依れば、コンポジット方式に対応
した場合、従来、例えば1フレーム毎にデータを信号処
理回路に取り込んで信号処理していたものが、3フレー
ム毎に信号処理回路にデータを取り込んで3倍の時間を
かけて信号処理ができるようになり、より複雑で高度な
信号処理が可能となる。また、逆に3フレーム毎にしか
できなかった信号処理が1フレーム毎に行うことができ
るようになり、高速な信号処理が可能となる。
した場合、従来、例えば1フレーム毎にデータを信号処
理回路に取り込んで信号処理していたものが、3フレー
ム毎に信号処理回路にデータを取り込んで3倍の時間を
かけて信号処理ができるようになり、より複雑で高度な
信号処理が可能となる。また、逆に3フレーム毎にしか
できなかった信号処理が1フレーム毎に行うことができ
るようになり、高速な信号処理が可能となる。
第1図はこの発明の一実施例のブロック図、第2図この
発明の一実施例の説明に用いるタイムチャート、第3図
はこの発明の一実施例における人力組み換え回路の一例
のブロック図、第4図はこの発明の一実施例における出
力組み換え回路の一例のブロック図、第5図はこの発明
の他の実施例のブロック図、第6図は従来の技術の説明
に用いるブロック図である。 図面における主要な符号の説明 1.2,3:入力端子、4:入力組み換え回路、5:出
力組み換え回路、11,12,13:信号処理回路、2
1,22,23:出力端子。
発明の一実施例の説明に用いるタイムチャート、第3図
はこの発明の一実施例における人力組み換え回路の一例
のブロック図、第4図はこの発明の一実施例における出
力組み換え回路の一例のブロック図、第5図はこの発明
の他の実施例のブロック図、第6図は従来の技術の説明
に用いるブロック図である。 図面における主要な符号の説明 1.2,3:入力端子、4:入力組み換え回路、5:出
力組み換え回路、11,12,13:信号処理回路、2
1,22,23:出力端子。
Claims (1)
- 【特許請求の範囲】 第1の信号処理回路、第2の信号処理回路及び第3の信
号処理回路と、 上記第1、第2及び第3の信号処理回路の入力側に設け
られ、コンポーネント信号の各コンポーネントの各々を
上記第1、第2及び第3の信号処理回路に供給する状態
と、コンポジット信号を上記第1、第2及び第3の信号
処理回路に共通に供給する状態とが切り替え可能な入力
組み換え回路と、 上記第1、第2及び第3の信号処理回路の出力側に設け
られ、上記コンポーネント信号の入力時に、上記第1、
第2及び第3の信号処理回路からの出力信号を夫々出力
する状態と、上記コンポジット信号の入力時に、上記第
1、第2及び第3の信号処理回路の出力を選択的に切り
換えて共通のチャンネルとして出力する状態とが切り替
え可能な出力組み換え回路と、 を備えたことを特徴とするカラービデオ信号処理回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5400685A JPS61212980A (ja) | 1985-03-18 | 1985-03-18 | カラ−ビデオ信号処理回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5400685A JPS61212980A (ja) | 1985-03-18 | 1985-03-18 | カラ−ビデオ信号処理回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61212980A true JPS61212980A (ja) | 1986-09-20 |
| JPH0584993B2 JPH0584993B2 (ja) | 1993-12-03 |
Family
ID=12958496
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5400685A Granted JPS61212980A (ja) | 1985-03-18 | 1985-03-18 | カラ−ビデオ信号処理回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61212980A (ja) |
-
1985
- 1985-03-18 JP JP5400685A patent/JPS61212980A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0584993B2 (ja) | 1993-12-03 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| EXPY | Cancellation because of completion of term |