JPS61255390A - 負捲り表示制御方法 - Google Patents
負捲り表示制御方法Info
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- JPS61255390A JPS61255390A JP60096961A JP9696185A JPS61255390A JP S61255390 A JPS61255390 A JP S61255390A JP 60096961 A JP60096961 A JP 60096961A JP 9696185 A JP9696185 A JP 9696185A JP S61255390 A JPS61255390 A JP S61255390A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概要〕
ディスプレイ装置において、二つのページの表示情報を
並行して表示する際に、各表示情報の表示範囲を指定す
る情報を持ち、この表示範囲の指定情報を順次に更新す
ることにより、自然なページ捲り表示を実現するもので
ある。
並行して表示する際に、各表示情報の表示範囲を指定す
る情報を持ち、この表示範囲の指定情報を順次に更新す
ることにより、自然なページ捲り表示を実現するもので
ある。
本発明はディスプレイ装置において、自然なページ捲り
表示を可能とするページ捲り表示制御方式に関する。
表示を可能とするページ捲り表示制御方式に関する。
ディスプレイ装置を具備する情報処理システムに複数ペ
ージから成る文書を記憶させ、ディスプレイ画面上に各
ページを順次表示させることが広く行われている。
ージから成る文書を記憶させ、ディスプレイ画面上に各
ページを順次表示させることが広く行われている。
かかる場合に、ディスプレイ画面上におけるページの更
新は、用紙に記載された資料のページを捲る状態に極力
近似していることが望ましい。
新は、用紙に記載された資料のページを捲る状態に極力
近似していることが望ましい。
第４図は従来あるディスプレイ装置の構成を例示する図
であり、第５図は従来あるページ更新を例示する図であ
る。
であり、第５図は従来あるページ更新を例示する図であ
る。
第４図において、メモリ１内には複数ページから成る表
示情報が、ページ単位に格納されている。
示情報が、ページ単位に格納されている。
当初第５図（ａｌに示す如き文字ｒＡＪを描いた第１ペ
ージを表示する指示が入力されると、プロセッサ２はメ
モリ１から第１ページに対応する表示情報ｐ１を続出し
、ディスプレイ制御回路３に伝達する。ディスプレイ制
御回路３は、メモリ１から読出された表示情報ｐ１を、
１ペ一ジ分の表示情報を記憶する容量を有するフレーム
メモリ４に格納した後、並直列変換回路５を介して順次
ディスプレイ６に伝達すると共に、バ・ノファメモリ７
に同情報が格納され、ディスプレイ６上に所定の画像が
表示される。
ージを表示する指示が入力されると、プロセッサ２はメ
モリ１から第１ページに対応する表示情報ｐ１を続出し
、ディスプレイ制御回路３に伝達する。ディスプレイ制
御回路３は、メモリ１から読出された表示情報ｐ１を、
１ペ一ジ分の表示情報を記憶する容量を有するフレーム
メモリ４に格納した後、並直列変換回路５を介して順次
ディスプレイ６に伝達すると共に、バ・ノファメモリ７
に同情報が格納され、ディスプレイ６上に所定の画像が
表示される。
次にディスプレイ６の画面を第２ページに更新する指示
が入力されると、プロセッサ２は現在表示中の第１ペー
ジの消去をディスプレイ制御回路３に指示する。ディス
プレイ制御回路３はフレームメモリ４の記憶内容（表示
情＠ｐ１）を一旦消去し、第５図（ｂ）に示す如くディ
スプレイ６上に表示中の第１ページを消去する。
が入力されると、プロセッサ２は現在表示中の第１ペー
ジの消去をディスプレイ制御回路３に指示する。ディス
プレイ制御回路３はフレームメモリ４の記憶内容（表示
情＠ｐ１）を一旦消去し、第５図（ｂ）に示す如くディ
スプレイ６上に表示中の第１ページを消去する。
次にプロセッサ２は、第５図ｔｃ）に示す如き、ページ
の一部が捲られた状態を示す直線図形情報をメモリ１か
ら読出し、ディスプレイ制御回路３に伝達する。ディス
プレイ制御回路３は、伝達された直線図形情報に基づき
、第５図（Ｃ）に示す如き図形をディスプレイ６上に表
示する。続いてプロセッサ２は、第５図（ｄ）に示す如
きページが約半分捲られた状態を示す直線図形情報をメ
モリ１から読出し、ディスプレイ制御回路３に伝達し、
ディスプレイ６上に表示させる。
の一部が捲られた状態を示す直線図形情報をメモリ１か
ら読出し、ディスプレイ制御回路３に伝達する。ディス
プレイ制御回路３は、伝達された直線図形情報に基づき
、第５図（Ｃ）に示す如き図形をディスプレイ６上に表
示する。続いてプロセッサ２は、第５図（ｄ）に示す如
きページが約半分捲られた状態を示す直線図形情報をメ
モリ１から読出し、ディスプレイ制御回路３に伝達し、
ディスプレイ６上に表示させる。
最後にプロセッサ２は、第５図ｔｅ＋に示す如く文字ｒ
ＸＪを描いた第２ページに対応する表示情報ｐ２をメモ
リ１から読出し、ディスプレイ制御回路３に伝達する。
ＸＪを描いた第２ページに対応する表示情報ｐ２をメモ
リ１から読出し、ディスプレイ制御回路３に伝達する。
ディスプレイ制御回路３は、メモリ１から読出された表
示情報ｐ２をフレームメモリ４に格納した後、並直列変
換回路５を介して順次ディスプレイ６に伝達する。以上
により、ディスプレイ６上には第５図ｔｅｌに示す如き
第２ページが表示される。
示情報ｐ２をフレームメモリ４に格納した後、並直列変
換回路５を介して順次ディスプレイ６に伝達する。以上
により、ディスプレイ６上には第５図ｔｅｌに示す如き
第２ページが表示される。
以上の説明から明らかな如く、従来あるディスプレイ装
置においては、ディスプレイ６上の画面を次ページに更
新する場合には、一旦前ページの画面を消去した後、ペ
ージ捲りを示す図形を表示した後、次ページの画面をデ
ィスプレイ７上に表示していた為、自然さに欠ける嫌い
があった。
置においては、ディスプレイ６上の画面を次ページに更
新する場合には、一旦前ページの画面を消去した後、ペ
ージ捲りを示す図形を表示した後、次ページの画面をデ
ィスプレイ７上に表示していた為、自然さに欠ける嫌い
があった。
本発明は下記の手段を講することにより、前記問題点を
解決する。
解決する。
第１図は本発明の原理ブロック図である。
第１図において、ｌは画像表示の為の複数のページ情報
等を格納するメモリ、２はそのページ情報を選択して画
像表示を行わせる制御部（プロセッサ）、３はディスプ
レイ制御回路、４０は第１のページの表示情報（例えば
前ページ情報）を出力する第１の画像情報出力手段、８
０は第２のページの表示情報（例えば次ページ情報）を
出力する第２の画像情報出力手段、９０は第１のページ
情報と第２のページ情報の出力とを同一画面出力上で表
示範囲を選択する為のマスク情報出力手段と、マスク情
報出力手段により画像情報を選択出力する選択出力手段
であり、例えばゲート１０．１１．１２．１３等から成
る。
等を格納するメモリ、２はそのページ情報を選択して画
像表示を行わせる制御部（プロセッサ）、３はディスプ
レイ制御回路、４０は第１のページの表示情報（例えば
前ページ情報）を出力する第１の画像情報出力手段、８
０は第２のページの表示情報（例えば次ページ情報）を
出力する第２の画像情報出力手段、９０は第１のページ
情報と第２のページ情報の出力とを同一画面出力上で表
示範囲を選択する為のマスク情報出力手段と、マスク情
報出力手段により画像情報を選択出力する選択出力手段
であり、例えばゲート１０．１１．１２．１３等から成
る。
プロセッサ２の制御の下、第１のページ情報および第２
のページ情報とがそれぞれ第１の画像情報出力手段４０
および第２の画像情報出力手段８０へ送られて保持され
ると共に、マスク情報出力手段９０に格納されたマスク
情報により、第１のページ情報および第２のページ情報
の内、指定された各範囲でディスプレイ６に画像表示さ
れる。
のページ情報とがそれぞれ第１の画像情報出力手段４０
および第２の画像情報出力手段８０へ送られて保持され
ると共に、マスク情報出力手段９０に格納されたマスク
情報により、第１のページ情報および第２のページ情報
の内、指定された各範囲でディスプレイ６に画像表示さ
れる。
即ち本発明によれば、第１のページ情報、例えば前ペー
ジのみがディスプレイ６上に表示されている状態から、
マスク情報出力手段９０の出力内容の変化に従い、順次
第１、第２の画像情報出力手段からの情報が変更出力さ
れ、マスク情報に従って第２のページ、例えば次ページ
に１替えられ、遂に総て第２の画像情報出力手段からの
出力内容、即ち次ページの情報表示へと移り、自然なペ
ージ捲りが実現可能となる。
ジのみがディスプレイ６上に表示されている状態から、
マスク情報出力手段９０の出力内容の変化に従い、順次
第１、第２の画像情報出力手段からの情報が変更出力さ
れ、マスク情報に従って第２のページ、例えば次ページ
に１替えられ、遂に総て第２の画像情報出力手段からの
出力内容、即ち次ページの情報表示へと移り、自然なペ
ージ捲りが実現可能となる。
以下、本発明の一実施例を図面により説明する。
第２図は本発明の一実施例によるディスプレイ装置の構
成を示す図であり、第３図は第２図におけるページ更新
を例示する図である。なお、全図を通じて同一符号は同
一対象物を示す。
成を示す図であり、第３図は第２図におけるページ更新
を例示する図である。なお、全図を通じて同一符号は同
一対象物を示す。
第２図においては、前ページの表示情報を格納する第一
のフレームメモリ４の他に、次ページの表示情報を格納
する第二のフレームメモリ８と、フレームメモリ４の記
憶内容の表示範囲とフレームメモリ８の記憶内容の表示
範囲とを指定する情報（以後マスク情報ｍと称する）を
格納するマスクフレームメモリ９と、マスクフレームメ
モリ９の記憶内容によりフレームメモリ４の記憶内容と
フレームメモリ８の記憶内容とを選択してディスプレイ
６に伝達する手段として反転回路１０およびゲート１１
および１２を設ける。プロセッサ２は、マスクフレーム
メモリ９の記憶内容をフレームメモリ４および８の記憶
内容の読出し範囲を順次変化する如く更新する。
のフレームメモリ４の他に、次ページの表示情報を格納
する第二のフレームメモリ８と、フレームメモリ４の記
憶内容の表示範囲とフレームメモリ８の記憶内容の表示
範囲とを指定する情報（以後マスク情報ｍと称する）を
格納するマスクフレームメモリ９と、マスクフレームメ
モリ９の記憶内容によりフレームメモリ４の記憶内容と
フレームメモリ８の記憶内容とを選択してディスプレイ
６に伝達する手段として反転回路１０およびゲート１１
および１２を設ける。プロセッサ２は、マスクフレーム
メモリ９の記憶内容をフレームメモリ４および８の記憶
内容の読出し範囲を順次変化する如く更新する。
第２図および第３図において、プロセッサ２は当初、１
ページが総て論理値１に設定されたマスク情報ｍａをマ
スクフレームメモリ９に格納する如くディスプレイ制御
回路３に指示する。その結果ディスプレイ制御回路３は
、マスクフレームメモリ９内に第３図（ａｌに示す如き
マスク情報ｍａを格納する。
ページが総て論理値１に設定されたマスク情報ｍａをマ
スクフレームメモリ９に格納する如くディスプレイ制御
回路３に指示する。その結果ディスプレイ制御回路３は
、マスクフレームメモリ９内に第３図（ａｌに示す如き
マスク情報ｍａを格納する。
先ず、第３図（ａ）に示す如き文字ｒＡＪを描いた第１
ページを表示する指示が入力されると、プロセッサ２は
メモリ１から第１ページに対応する表示情報ｐｌを読出
し、ディスプレイ制御回路３に伝達する。ディスプレイ
制御回路３は、メモリ１から読出された表示情報ｐ１を
フレームメモリ４に格納する。またディスプレイ制御回
路３は、フレームメモリ４の記憶内容（表示情報ｐｉ）
を順次読出し、並直列変換回路５を介してゲート１１に
伝達し、同時にフレームメモリ８の記憶内容を順次読出
し、並直列変換回路１４を介してゲート１２に伝達し、
更にマスクフレームメモリ９の記憶内容（マスク情報ｍ
ａ ）も順次読出し、並直列変換回路１５を介してゲ
ート１１、並びに反転回路１０を介してゲート１２に伝
達する。現段階では、マスクフレームメモリ９からは全
画面に亙って論理値１に設定されたマスク情報ｍａが読
出される為、ゲート１１が常に導通状態、ゲート１２が
遮断状態に設定される。その結果ディスプレイ６には全
画面に亙ってフレームメモリ４の記憶内容が伝達され、
第３図（ａ）に示す如く、第１ページのみがディスプレ
イ６上に表示される。
ページを表示する指示が入力されると、プロセッサ２は
メモリ１から第１ページに対応する表示情報ｐｌを読出
し、ディスプレイ制御回路３に伝達する。ディスプレイ
制御回路３は、メモリ１から読出された表示情報ｐ１を
フレームメモリ４に格納する。またディスプレイ制御回
路３は、フレームメモリ４の記憶内容（表示情報ｐｉ）
を順次読出し、並直列変換回路５を介してゲート１１に
伝達し、同時にフレームメモリ８の記憶内容を順次読出
し、並直列変換回路１４を介してゲート１２に伝達し、
更にマスクフレームメモリ９の記憶内容（マスク情報ｍ
ａ ）も順次読出し、並直列変換回路１５を介してゲ
ート１１、並びに反転回路１０を介してゲート１２に伝
達する。現段階では、マスクフレームメモリ９からは全
画面に亙って論理値１に設定されたマスク情報ｍａが読
出される為、ゲート１１が常に導通状態、ゲート１２が
遮断状態に設定される。その結果ディスプレイ６には全
画面に亙ってフレームメモリ４の記憶内容が伝達され、
第３図（ａ）に示す如く、第１ページのみがディスプレ
イ６上に表示される。
次にディスプレイ６の画面を第２ページに更新する指示
が入力されると、プロセッサ２はメモリ１から第２ペー
ジに対応する表示情報ｐ２を読出し、ディスプレイ制御
回路３に伝達する。ディスプレイ制御回路３は、メモリ
１から読出された表示情報ｐ２をフレームメモリ８に格
納する。ディスプレイ制御回路３は前述の如く、フレー
ムメモＵ ４および８の記憶内容を並行して順次読出し
、各々並直列変換回路５および１４を介してゲート１１
および１２に伝達するが、同時に読出されるマスクフレ
ームメモリ９の記憶内容が更新されぬ限り、依然として
ゲート１１が導通状態、ゲート１２が遮断状態に設定さ
れる。その結果ディスプレイ６には全画面に亙ってフレ
ームメモリ４の記憶内容（表示情報ｐｉ）が伝達され、
フレームメモリ８の記憶内容（表示情報ｐ２）は伝達さ
れぬ為、引続き第３図（ａｌに示す如く、第１ページの
みがディスプレイ６上に表示される。
が入力されると、プロセッサ２はメモリ１から第２ペー
ジに対応する表示情報ｐ２を読出し、ディスプレイ制御
回路３に伝達する。ディスプレイ制御回路３は、メモリ
１から読出された表示情報ｐ２をフレームメモリ８に格
納する。ディスプレイ制御回路３は前述の如く、フレー
ムメモＵ ４および８の記憶内容を並行して順次読出し
、各々並直列変換回路５および１４を介してゲート１１
および１２に伝達するが、同時に読出されるマスクフレ
ームメモリ９の記憶内容が更新されぬ限り、依然として
ゲート１１が導通状態、ゲート１２が遮断状態に設定さ
れる。その結果ディスプレイ６には全画面に亙ってフレ
ームメモリ４の記憶内容（表示情報ｐｉ）が伝達され、
フレームメモリ８の記憶内容（表示情報ｐ２）は伝達さ
れぬ為、引続き第３図（ａｌに示す如く、第１ページの
みがディスプレイ６上に表示される。
次にプロセッサ２は、第３図（ｂｌに示す如き、ページ
の一部が論理値Ｏ１他が論理値１に設定される直線図形
情報をメモリ１から読出し、ディスプレイ制御回路３に
伝達する。その結果ディスプレイ制御回路３は、マスク
フレームメモリ９内に第３図（ｂ）に示す如き、ページ
の一部が論理値０、他が論理値１に設定されるマスク情
報ｍｂを格納する。
の一部が論理値Ｏ１他が論理値１に設定される直線図形
情報をメモリ１から読出し、ディスプレイ制御回路３に
伝達する。その結果ディスプレイ制御回路３は、マスク
フレームメモリ９内に第３図（ｂ）に示す如き、ページ
の一部が論理値０、他が論理値１に設定されるマスク情
報ｍｂを格納する。
かかる状態で、ディスプレイ制御回路３は前述の如く、
フレームメモリ４および８の記憶内容を並行して順次読
出し、各々並直列変換回路５および１４を介してゲート
１１および１２に伝達し、同時にマスクフレームメモリ
９の記憶内容を順次読出し、並直列変換回路１５を介し
てゲート１１、並びに反転回路１０を介してゲート１２
に伝達する。マスクフレームメモリ９から論理値１が読
出される場合は前述の如くゲート１１が導通状態、ゲー
ト１２が遮断状態に設定されるが、論理値０が読出され
る場合は逆にゲート１１が遮断状態、ゲート１２が導通
状態となる。その結果マスク情報ｍｂが論理値１に設定
される範囲においては、ディスプレイ６にはフレームメ
モリ４の記憶内容（表示情報ｐｌ）が伝達され、フレー
ムメモリ８の記憶内容（表示情報ｐ２）は伝達されぬ為
、第１ページがディスプレイ６上に表示されるが、マス
ク情報ｍｂが論理値Ｏに設定される範囲においては、デ
ィスプレイ６にはフレームメモリ８の記憶内容（表示情
報ｐ２）が伝達され、フレームメモリ４の記憶内容（表
示情報ｐｉ）は伝達されぬ為、第２ページがディスプレ
イ６上に表示される。
フレームメモリ４および８の記憶内容を並行して順次読
出し、各々並直列変換回路５および１４を介してゲート
１１および１２に伝達し、同時にマスクフレームメモリ
９の記憶内容を順次読出し、並直列変換回路１５を介し
てゲート１１、並びに反転回路１０を介してゲート１２
に伝達する。マスクフレームメモリ９から論理値１が読
出される場合は前述の如くゲート１１が導通状態、ゲー
ト１２が遮断状態に設定されるが、論理値０が読出され
る場合は逆にゲート１１が遮断状態、ゲート１２が導通
状態となる。その結果マスク情報ｍｂが論理値１に設定
される範囲においては、ディスプレイ６にはフレームメ
モリ４の記憶内容（表示情報ｐｌ）が伝達され、フレー
ムメモリ８の記憶内容（表示情報ｐ２）は伝達されぬ為
、第１ページがディスプレイ６上に表示されるが、マス
ク情報ｍｂが論理値Ｏに設定される範囲においては、デ
ィスプレイ６にはフレームメモリ８の記憶内容（表示情
報ｐ２）が伝達され、フレームメモリ４の記憶内容（表
示情報ｐｉ）は伝達されぬ為、第２ページがディスプレ
イ６上に表示される。
以上によりディスプレイ６上に表示される画面は第３図
（ｂ）に示す如く、マスク情９１ｍｂに対応して第１ペ
ージと第２ページとが部分的に表示される。
（ｂ）に示す如く、マスク情９１ｍｂに対応して第１ペ
ージと第２ページとが部分的に表示される。
更にプロセッサ２は、第３図（Ｃ１、更に第３図（ｄ）
に示す如き、論理値０の範囲が約半分、続いて約２／３
と次第に多く設定される直線図形情報をメモリ１から読
出し、ディスプレイ制御４回路３に伝達することにより
、マスクフレームメモリ９内に第３図（Ｃ１、更に第３
図（ｄ）に示す如き、論理値０の範囲が約半分、続いて
約２／３と次第に増加したマスク情報ｍｃ、続いてｍｄ
を格納させる。
に示す如き、論理値０の範囲が約半分、続いて約２／３
と次第に多く設定される直線図形情報をメモリ１から読
出し、ディスプレイ制御４回路３に伝達することにより
、マスクフレームメモリ９内に第３図（Ｃ１、更に第３
図（ｄ）に示す如き、論理値０の範囲が約半分、続いて
約２／３と次第に増加したマスク情報ｍｃ、続いてｍｄ
を格納させる。
かかる状態で、ディスプレイ制御回路３は前述の如く、
フレームメモリ４および８の記憶内容を並行して順次読
出し、各々並直列変換回路５および１４を介してゲート
１１および１２に伝達し、並行してマスクフレームメモ
リ９の記憶内容を順次読出し、並直列変換回路１５を介
してゲート１１、並びに反転回路１０を介してゲート１
２に伝達する。その結果ディスプレイ６には、マスク情
報ｍｃ、更にはｍｄが論理値１に設定される範囲におい
てフレームメモリ４の記憶内容（表示情報ｐｉ）が伝達
されて第１ページが表示され、マスク情報ｍｅ、更には
ｍｄが論理値Ｏに設定される範囲においてフレームメモ
リ８の記憶内容（表示情報ｐ２）が伝達されて第２ペー
ジが表示される。
フレームメモリ４および８の記憶内容を並行して順次読
出し、各々並直列変換回路５および１４を介してゲート
１１および１２に伝達し、並行してマスクフレームメモ
リ９の記憶内容を順次読出し、並直列変換回路１５を介
してゲート１１、並びに反転回路１０を介してゲート１
２に伝達する。その結果ディスプレイ６には、マスク情
報ｍｃ、更にはｍｄが論理値１に設定される範囲におい
てフレームメモリ４の記憶内容（表示情報ｐｉ）が伝達
されて第１ページが表示され、マスク情報ｍｅ、更には
ｍｄが論理値Ｏに設定される範囲においてフレームメモ
リ８の記憶内容（表示情報ｐ２）が伝達されて第２ペー
ジが表示される。
以上によりディスプレイ６上に表示される画面は、第３
図（Ｃ１、更には第３図（ｄｌに示す如く、マスク情１
１ｍｃ更にはｍｄに対応して第１ページの表示範囲が次
第に減少し、第２ページの表示範囲が次第に増加する。
図（Ｃ１、更には第３図（ｄｌに示す如く、マスク情１
１ｍｃ更にはｍｄに対応して第１ページの表示範囲が次
第に減少し、第２ページの表示範囲が次第に増加する。
最後にプロセッサ２は、第３図（ｅ）に示す如きページ
の総てが論理値Ｏに設定される直線図形情報をメモリ１
から読出し、ディスプレイ制御回路３に伝達し、マスク
フレームメモリ９内に第２図（ｅ）に示す如き、ページ
の総てが論理値Ｏに設定されるマスク情報ｍｅを格納さ
せる。
の総てが論理値Ｏに設定される直線図形情報をメモリ１
から読出し、ディスプレイ制御回路３に伝達し、マスク
フレームメモリ９内に第２図（ｅ）に示す如き、ページ
の総てが論理値Ｏに設定されるマスク情報ｍｅを格納さ
せる。
かかる状態で、ディスプレイ制御回路３は前述の如く、
フレームメモリ４および８の記憶内容を並行して順次読
出し、各々並直列変換回路５および１４を介してゲート
１１および１２に伝達し、同時にマスクフレームメモリ
９の記憶内容を順次読出し、並直列変換回路１５を介し
てゲート１１、並びに反転回路１０を介してゲート１２
に伝達する。今回は、マスクフレームメモリ９からは全
画面に亙って論理値Ｏに設定されたマスク情報ｍｅが読
出される為、ゲート１１が常に導通状態、ゲート１２が
遮断状態に設定され、ディスプレイ６には全画面に亙っ
てフレームメモリ８の記憶内容（表示情報ｐ２）が伝達
され、第３図（ｅｌに示す如く、第２ページのみがディ
スプレイ６上に表示される。以上によりディスプレイ６
上に表示される画面は、完全に第１ページから第２ペー
ジに更新される。
フレームメモリ４および８の記憶内容を並行して順次読
出し、各々並直列変換回路５および１４を介してゲート
１１および１２に伝達し、同時にマスクフレームメモリ
９の記憶内容を順次読出し、並直列変換回路１５を介し
てゲート１１、並びに反転回路１０を介してゲート１２
に伝達する。今回は、マスクフレームメモリ９からは全
画面に亙って論理値Ｏに設定されたマスク情報ｍｅが読
出される為、ゲート１１が常に導通状態、ゲート１２が
遮断状態に設定され、ディスプレイ６には全画面に亙っ
てフレームメモリ８の記憶内容（表示情報ｐ２）が伝達
され、第３図（ｅｌに示す如く、第２ページのみがディ
スプレイ６上に表示される。以上によりディスプレイ６
上に表示される画面は、完全に第１ページから第２ペー
ジに更新される。
以上の説明から明らかな如く、本実施例によれば、ディ
スプレイ６上に表示されている第１ページを第２ページ
に更新する指示が入力されると、プロセッサ２はディス
プレイ制御回路３を制御して、フレームメモリ８に第２
ページの表示情報ｐ２を格納した後、マスクフレームメ
モリ９に格納されるマスク情報を、ページ全体が論理値
１の状態（ｍａ）から次第に論理値Ｏの範囲を拡大した
状態（ｍｂ乃至ｍｄ）に変更し、最後にページ全体が論
理値Ｏの状態（ｍｅ）に変更することにより、恰も第１
ページの用紙を捲って次第に第２ページが現れる如く、
自然に第２ページに移行することとなる。
スプレイ６上に表示されている第１ページを第２ページ
に更新する指示が入力されると、プロセッサ２はディス
プレイ制御回路３を制御して、フレームメモリ８に第２
ページの表示情報ｐ２を格納した後、マスクフレームメ
モリ９に格納されるマスク情報を、ページ全体が論理値
１の状態（ｍａ）から次第に論理値Ｏの範囲を拡大した
状態（ｍｂ乃至ｍｄ）に変更し、最後にページ全体が論
理値Ｏの状態（ｍｅ）に変更することにより、恰も第１
ページの用紙を捲って次第に第２ページが現れる如く、
自然に第２ページに移行することとなる。
なお、第１図乃至第３図はあく迄本発明の一実施例に過
ぎず、例えばマスク情報ｍの変更過程は図示されるもの
に限定されることは無（、他に幾多の変形が考慮される
が、何れの場合にも本発明の効果は変わらない。またデ
ィスプレイ装置の構成は図示されるものに限定されるこ
とは無く、他に幾多の変形が考慮されるが、何れの場合
にも本発明の効果は変わらない。更に前ページおよび後
ページの記載内容は図示されるものに限定されぬことは
云う迄も無い。
ぎず、例えばマスク情報ｍの変更過程は図示されるもの
に限定されることは無（、他に幾多の変形が考慮される
が、何れの場合にも本発明の効果は変わらない。またデ
ィスプレイ装置の構成は図示されるものに限定されるこ
とは無く、他に幾多の変形が考慮されるが、何れの場合
にも本発明の効果は変わらない。更に前ページおよび後
ページの記載内容は図示されるものに限定されぬことは
云う迄も無い。
以上、本発明によれば、前記ディスプレイ装置において
、前ページのみがディスプレイ上に表示されている状態
から、順次次ページに１替えられ、遂に総て次ページの
みが表示されることとなり、自然なページ捲りが実現可
能となる。
、前ページのみがディスプレイ上に表示されている状態
から、順次次ページに１替えられ、遂に総て次ページの
みが表示されることとなり、自然なページ捲りが実現可
能となる。
第１図は本発明の原理ブロック図、第２図は本発明の一
実施例によるディスプレイ装置の構成を示す図、第３図
は第２図におけるページ更新を例示する図、第４図は従
来あるディスプレイ装置の構成を例示する図、第５図は
従来あるページ更新を例示する図である。 図において、１はメモリ、２はプロセッサ、３はディス
プレイ制御回路、４および８はフレームメモリ、５．１
４および１５は並直列変換回路、６はディスプレイ、９
はマスクフレームメモリ、１０は反転回路、１１および
１２はゲート、４゜は第１の画像情報出力手段、８０は
第２の画像情報出力手段、９０はマスク情報出力手段、
１００は選択出力手段、ｍａ乃至ｍｅはマスク情報、ｐ
第 ２ 悶
実施例によるディスプレイ装置の構成を示す図、第３図
は第２図におけるページ更新を例示する図、第４図は従
来あるディスプレイ装置の構成を例示する図、第５図は
従来あるページ更新を例示する図である。 図において、１はメモリ、２はプロセッサ、３はディス
プレイ制御回路、４および８はフレームメモリ、５．１
４および１５は並直列変換回路、６はディスプレイ、９
はマスクフレームメモリ、１０は反転回路、１１および
１２はゲート、４゜は第１の画像情報出力手段、８０は
第２の画像情報出力手段、９０はマスク情報出力手段、
１００は選択出力手段、ｍａ乃至ｍｅはマスク情報、ｐ
第 ２ 悶
Claims (1)
- 【特許請求の範囲】 直線等を高速に描画可能なディスプレイ制御回路を具備
するディスプレイ装置において、 第１のページの表示情報を出力する第１の画像情報出力
手段（４０）と、 第２のページの表示情報を出力する第２の画像情報出力
手段（８０）と、 前記第１のページの表示情報の表示範囲と前記第２のペ
ージの表示情報の表示範囲とを指定する情報を出力する
マスク情報出力手段（９０）と、該マスク情報出力手段
の出力内容により前記第１の画像情報出力手段と前記第
２の画像情報出力手段との出力情報を選択してディスプ
レイに伝達する選択出力手段（１００）とを設け、 前記第１のページの表示情報と、前記第２のページの表
示情報とを順次変化する如く更新表示することを特徴と
するページ捲り表示制御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60096961A JPH0756587B2 (ja) | 1985-05-08 | 1985-05-08 | 負捲り表示制御方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60096961A JPH0756587B2 (ja) | 1985-05-08 | 1985-05-08 | 負捲り表示制御方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61255390A true JPS61255390A (ja) | 1986-11-13 |
| JPH0756587B2 JPH0756587B2 (ja) | 1995-06-14 |
Family
ID=14178845
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60096961A Expired - Lifetime JPH0756587B2 (ja) | 1985-05-08 | 1985-05-08 | 負捲り表示制御方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0756587B2 (ja) |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63174091A (ja) * | 1987-01-14 | 1988-07-18 | 株式会社日立製作所 | ビデオ動画表示機能を持つワ−クステ−シヨン |
| JPS6486191A (en) * | 1987-09-29 | 1989-03-30 | Toshiba Corp | Display controller |
| JPH02278285A (ja) * | 1989-04-19 | 1990-11-14 | Mitsubishi Electric Corp | 画像表示制御回路 |
| JPH0350595A (ja) * | 1989-07-18 | 1991-03-05 | Mitsubishi Electric Corp | 画像表示制御回路 |
| JPH03503218A (ja) * | 1987-08-21 | 1991-07-18 | ランダル，スティーブン | 個人用電子式書類ばさみ |
| JPH05224874A (ja) * | 1991-10-31 | 1993-09-03 | Internatl Business Mach Corp <Ibm> | ビデオ処理システムとデータを併合する方法およびシステム |
Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5666894A (en) * | 1979-11-02 | 1981-06-05 | Mitsubishi Electric Corp | Color image display unit |
| JPS58195833A (ja) * | 1982-05-11 | 1983-11-15 | Matsushita Tsushin Kogyo Kk | 刻印文字撮像装置 |
| JPS59114581A (ja) * | 1982-12-21 | 1984-07-02 | 三菱電機株式会社 | デイスプレイ装置 |
| JPS59173863A (ja) * | 1983-03-24 | 1984-10-02 | Fujitsu Ltd | マスクメモリ方式 |
-
1985
- 1985-05-08 JP JP60096961A patent/JPH0756587B2/ja not_active Expired - Lifetime
Patent Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5666894A (en) * | 1979-11-02 | 1981-06-05 | Mitsubishi Electric Corp | Color image display unit |
| JPS58195833A (ja) * | 1982-05-11 | 1983-11-15 | Matsushita Tsushin Kogyo Kk | 刻印文字撮像装置 |
| JPS59114581A (ja) * | 1982-12-21 | 1984-07-02 | 三菱電機株式会社 | デイスプレイ装置 |
| JPS59173863A (ja) * | 1983-03-24 | 1984-10-02 | Fujitsu Ltd | マスクメモリ方式 |
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63174091A (ja) * | 1987-01-14 | 1988-07-18 | 株式会社日立製作所 | ビデオ動画表示機能を持つワ−クステ−シヨン |
| JPH03503218A (ja) * | 1987-08-21 | 1991-07-18 | ランダル，スティーブン | 個人用電子式書類ばさみ |
| JPS6486191A (en) * | 1987-09-29 | 1989-03-30 | Toshiba Corp | Display controller |
| JPH02278285A (ja) * | 1989-04-19 | 1990-11-14 | Mitsubishi Electric Corp | 画像表示制御回路 |
| JPH0350595A (ja) * | 1989-07-18 | 1991-03-05 | Mitsubishi Electric Corp | 画像表示制御回路 |
| JPH05224874A (ja) * | 1991-10-31 | 1993-09-03 | Internatl Business Mach Corp <Ibm> | ビデオ処理システムとデータを併合する方法およびシステム |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0756587B2 (ja) | 1995-06-14 |
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