JPS6128143B2 - - Google Patents

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Publication number
JPS6128143B2
JPS6128143B2 JP56089041A JP8904181A JPS6128143B2 JP S6128143 B2 JPS6128143 B2 JP S6128143B2 JP 56089041 A JP56089041 A JP 56089041A JP 8904181 A JP8904181 A JP 8904181A JP S6128143 B2 JPS6128143 B2 JP S6128143B2
Authority
JP
Japan
Prior art keywords
rom
data
ram
address
memory
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired
Application number
JP56089041A
Other languages
English (en)
Other versions
JPS57203154A (en
Inventor
Takashi Sakao
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP56089041A priority Critical patent/JPS57203154A/ja
Publication of JPS57203154A publication Critical patent/JPS57203154A/ja
Publication of JPS6128143B2 publication Critical patent/JPS6128143B2/ja
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Description

【発明の詳細な説明】 本発明はマイクロコンピユータに関するもので
ある。
近年、半導体集積回路技術の進歩により安価か
つ超小型のプログラム制御装置であるマイクロコ
ンピユータが広く使われるようになつた。
マイクロコンピユータの中でも、プロセツサ
部、プログラムメモリ部、データメモリ部、及び
入出力インターフエイスを内蔵した1チツプマイ
クロコンピユータは、民生品を始めとし、各種機
器の制御部に使用されている。
さて、その1チツプマイクロコンピユータは通
常のコンピユータと比較すると、プログラムメモ
リ、及びデータメモリに関し、次に述べる特徴を
有する。
まず、1チツプマイクロコンピユータにおいて
制御プログラムを格納するプログラムメモリは
ROM化されて、1チツプ内に構成される。又デ
ータメモリとしてのRAMも勿論1チツプ内に設
けられる。
一般のノイマン型のコンピユータは、プログラ
ム及びデータを混在させてメモリに格納すること
を特徴とするが、上記1チツプ型のマイクロコン
ピユータでは、プログラムメモリとデータメモリ
は、独立なアドレス空間を有することが多い。そ
の理由としては、一般に内蔵されるRAMの語数
がROMに比較して、少ないため同一のアドレス
空間に設定すると、RAMのアドレツシングに必
要なビツト数が多くなり、命令効率が悪くなるこ
とがある。さらにはROMとRAMを独立な空間に
配置することによつて、ROM,RAMの同時アク
セスが可能となり、命令処理速度の向上が望める
からである。
また特に、ROM,RAMとも1チツプ中に構成
されるため、各々のアドレスライン、及びデータ
ラインを端子に出力する必要はなく、LSI設計の
際考えねばならないピン端子数の制限も受けない
ですむ。
ところが、ROM,RAMを独立な空間に配置し
た時に固定データ参照命令(又はテーブル参照命
令)があるため伴う制御動物に時間がかかると言
う問題がる。固定データ参照命令とは、1チツプ
マイクロコンピユータ中のデータポインタ等によ
つてROMのアドレスを指示し、その内容をデー
タとして使用することを可能とする命令である。
即ち、ROM中には、プログラムだけでなく、
定数データも記憶させているわけである。固定デ
ータは、符号変換、あるいは演算時の定数記憶用
として広く利用されている。
従来の1チツプマイクロコンピユータでは、デ
ータ処理命令は、ROMに格納されているデータ
中心に、演算、処理される構成になつているた
め、固定データ参照命令によつて、ROMの出力
データを一旦データ処理部のレジスタへ送り演算
処理をしている。
第1図に、従来の1チツプマイクロコンピユー
タの要部の一例を示す。1はRAMアドレス制御
部であり、内部レジスタ(図示せず)等によつて
データメモリであるRAM2をアクセスする。a
はBAR2の出力データで、ALUを主構成要素と
するデータ処理部3へ出力し、このデータ処理部
3では、演算を行ないその演算結果を再びRAM
書込機構(図示せず)へ出力する。4はROMア
ドレス制御部で、プログラムカウンタ(図示せ
ず)によつて、プログラムメモリであるROM5
とアクセスし、その出力データbを、命令制御部
6へ送出し、プロセツサの実行制御を行なう。一
方、固定データ参照命令実行時には、ROM出力
データbは、データ処理部3へ送出される。
ところで、RAM2をアクセスし、データを処
理している時には、ROM5も同時にアクセス可
能のため、命令の先取り制御を含めた、高速処理
が可能であるが、当然のことながら、固定データ
参照命令の場合は、命令のアクセスとデータのア
クセスが同時にできないため、高速処理が困認で
あるという欠点を有していた。
本発明は上記欠点を鑑み、マイクロコンピユー
タのRAM中のデータ処理命令は非常に豊富で充
実しているという点に注目し、先に述べた固定デ
ータ参照命令をなくし、固定データを格納してい
るROMをアクセスする時には、該当するRAM部
を、RAMのアドレス空間に変更し、本来有して
いる強力なRAMのデータ処理命令により、ROM
中のデータを直接演算処理させると同時に、プロ
グラムメモリとしても使用可能とするマイクロコ
ンピユータを提供するものである。以下本発明
を、一実施例とともに説明する。
第2図は、本実施例を説明するための要部ブロ
ツク図である。同図において、1,2,3,4,
6及びaは第1図に同符号に対応する。7はプロ
グラムメモリとして使用されるROM、8はプロ
グラムメモリ及びデータメモリとして使用される
ROMである。9はROM8をプログラムメモリと
して使用するか、データメモリとして使用するか
によりアドレス制御の選択を行なうアドレス選択
部で、プロセツサ制御部(図示せず)がROM8
の制御モード切換え命令を実行することにより選
択制御される。
上記構成において、ROM8をプログラムメモ
リとして使用する場合、ROMアドレス制御部4
からのアドレス信号cがアドレス選択部9に入力
される。そしてアドレス選択部9では、アドレス
信号cに基づいて、アドレス選択決定信号dを
ROM8に対し出力し、ROM8のプログラムメモ
リの使用を可能とする。プログラムメモリとして
利用されたROM8はその情報をROM出力データ
eとして命令制御部6に送出する。
一方、ROM8をデータメモリとして使用する
場合、RAMアドレス制御部1からのアドレス信
号fがアドレス選択部9に入力される。そしてア
ドレス選択部9では、アドレス信号fに基づい
て、アドレス選択決定信号dをROM8に出力
し、ROM8のデータメモリの使用を可能とす
る。データメモリとして利用されたROM8は、
その情報をROM出力データeとして、データ処
理部3に送出する。
なお、ROM7の出力データgが従来例と同様
に、データ処理部3へも出力されているのは、即
値データ処理命令実行時に、命令コードの次の番
地に格納されているデータを、データ処理部3へ
送出する必要があるからである。
以上のようにROM8は、データメモリとして
利用される際にはRAMアドレス空間に配置換え
されており、またROM8をデータメモリとして
利用するためのデータ処理プログラムがROM7
に格納されておれば、プログラムメモリとしても
使用可能となる。
なお、本発明の一実施例においては、RAMア
ドレス空間へ変更可能な固定データメモリとして
のROMは1つであるが、ROMをたとえばページ
分割し、いずれのページをもROMアドレス空間
へ配置変更することを可能とする1チツプマイク
ロコンピユータを構成することもできる。
このとき、各ページを同一のRAMアドレス空
間へ配置することも、また、それぞれのページが
異なるアドレス空間へ変換することも可能であ
る。
また本発明の実施例では特に1チツプマイクロ
コンピユータに関して説明を行なつたが、たとえ
ば1チツプマイクロコンピユータに対しROMを
外部接続して用いても本発明の効果は十分に達す
ることができるのは勿論のことである。
本発明は以上の説明から明らかなように、
ROMの一部を命令によつてRAMアドレス空間に
変更可能とすることにより、ROMに格納されて
いるデータに対し非常に効率のよいRAMデータ
処理命令を使用することが可能であり、プログラ
ミング効率の向上が実現できる。また定数メモリ
として使用しない場合においては、プログラムメ
モリとしても使用可能なことは勿論であり、メモ
リ構成上自由度のある1チツプマイクロコンピユ
ータが構成できる。かつ、従来のROM,RAMア
ドレス空間が独立なマイクロコンピユータに具備
されていた固定データ参照命令は不必要となる等
その効果大なるものがある。
【図面の簡単な説明】
第1図は従来の1チツプマイクロコンピユータ
の要部ブロツク図、第2図は本発明による1チツ
プマイクロコンピユータの実施例の要部ブロツク
図である。 1……RAMアドレス制御部、2……RAM、4
……ROMアドレス制御部、6……命令制御部、
7……ROM、8……ROM、9……アドレス選択
部。

Claims (1)

    【特許請求の範囲】
  1. 1 プログラムや定数を格納するROMと、デー
    タメモリであるRAMとを有し、かつROMアクセ
    ス機構と独立なRAMアクセス機構を有するマイ
    クロコンピユータにおいて、前記ROMのデータ
    領域として使用されるデータROM部を前記ROM
    アクセス機構によつてアクセスされるROMアド
    レス空間から、前記RAMアクセス機構によつて
    アクセスされるRAMアドレス空間に変換する変
    換手段を設けたことを特徴とするマイクロコンピ
    ユータ。
JP56089041A 1981-06-10 1981-06-10 Microcomputer Granted JPS57203154A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP56089041A JPS57203154A (en) 1981-06-10 1981-06-10 Microcomputer

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP56089041A JPS57203154A (en) 1981-06-10 1981-06-10 Microcomputer

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Publication Number Publication Date
JPS57203154A JPS57203154A (en) 1982-12-13
JPS6128143B2 true JPS6128143B2 (ja) 1986-06-28

Family

ID=13959802

Family Applications (1)

Application Number Title Priority Date Filing Date
JP56089041A Granted JPS57203154A (en) 1981-06-10 1981-06-10 Microcomputer

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US11666519B2 (en) 2016-12-21 2023-06-06 Conopco, Inc. Personal care compositions with cystine

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