JPS6180838A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
- Publication number
- JPS6180838A JPS6180838A JP20306984A JP20306984A JPS6180838A JP S6180838 A JPS6180838 A JP S6180838A JP 20306984 A JP20306984 A JP 20306984A JP 20306984 A JP20306984 A JP 20306984A JP S6180838 A JPS6180838 A JP S6180838A
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- interlayer insulating
- layer
- layer wiring
- insulating film
- wiring
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- Pending
Links
- 239000004065 semiconductor Substances 0.000 title claims description 9
- 238000004519 manufacturing process Methods 0.000 title claims description 7
- 239000010410 layer Substances 0.000 claims abstract description 56
- 239000011229 interlayer Substances 0.000 claims abstract description 25
- 239000011347 resin Substances 0.000 claims abstract description 18
- 229920005989 resin Polymers 0.000 claims abstract description 18
- 239000000758 substrate Substances 0.000 claims abstract description 13
- 238000000034 method Methods 0.000 claims abstract description 9
- 238000001020 plasma etching Methods 0.000 claims abstract description 4
- 238000009499 grossing Methods 0.000 claims description 4
- 238000005530 etching Methods 0.000 claims description 2
- 238000001039 wet etching Methods 0.000 abstract description 2
- 238000007796 conventional method Methods 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 230000001788 irregular Effects 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 210000004907 gland Anatomy 0.000 description 1
- 125000003563 glycoside group Chemical group 0.000 description 1
- 238000009413 insulation Methods 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
Landscapes
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は多層配糖構造ン有する半導体装置の製造方法に
関する。
関する。
第7図は基板上に従来の方法によって形成された21錯
配線の断面図で、図中りは基板、2は第1層配線、3は
層間絶縁膜、4は第2層配線、5はヒロックを表わす。
配線の断面図で、図中りは基板、2は第1層配線、3は
層間絶縁膜、4は第2層配線、5はヒロックを表わす。
図示のように、第1層配線のエツジ部やヒロック部では
第2層配線の形状が不規則となり、エツジ部における第
2層配線の段切ハや、ヒロック部における第1層配線と
第2〜配線の間の短線等が発生し、歩留り低下の原因と
なっていた。
第2層配線の形状が不規則となり、エツジ部における第
2層配線の段切ハや、ヒロック部における第1層配線と
第2〜配線の間の短線等が発生し、歩留り低下の原因と
なっていた。
本発明の目的は、パターン幅やヒロック発生等の下層配
線の形状に影響されない多層配線構造を有する半導体装
置の製造方法を提供することである。
線の形状に影響されない多層配線構造を有する半導体装
置の製造方法を提供することである。
上記目的を達成するために、本発明による半導体装置の
製造方法は、基板の一表面上に第1鳩配融乞設ける工程
と、上記第1層配線を含め、上記牛q体基板表面上に第
1の層間絶縁膜を形成する工程と、上記第11−配線上
の丁べである(・はエツジ部のみの上記第1の層間絶縁
膜を除去し、平滑化する工程と、そのように平滑化され
た表面上に第2の庖間絶縁農乞形成する工程と、該第2
の層間絶縁膜上に第2層配線を形成する工程と乞含むこ
とを渋旨とする。上記第1層配線上のすべてあるいはエ
ッジ部のみの上記第1の楡間絶縁膜暑除去し、平滑化す
る工程は、上記第1の眉間絶縁膜上に樹脂膜を形成し1
等方性のプラズマエツチングによって上記第1層配線上
の突起部ゴdよびエツジ部の薄い佃M&fiのみを除去
し、ついでそのようにし−〔形状された佃脂膜乞マスク
として上記第1層配線上のすべてあるいはエッジ部のみ
の上記Flの層間絶縁膜をエツチング除去することによ
って行なわれる。
製造方法は、基板の一表面上に第1鳩配融乞設ける工程
と、上記第1層配線を含め、上記牛q体基板表面上に第
1の層間絶縁膜を形成する工程と、上記第11−配線上
の丁べである(・はエツジ部のみの上記第1の層間絶縁
膜を除去し、平滑化する工程と、そのように平滑化され
た表面上に第2の庖間絶縁農乞形成する工程と、該第2
の層間絶縁膜上に第2層配線を形成する工程と乞含むこ
とを渋旨とする。上記第1層配線上のすべてあるいはエ
ッジ部のみの上記第1の楡間絶縁膜暑除去し、平滑化す
る工程は、上記第1の眉間絶縁膜上に樹脂膜を形成し1
等方性のプラズマエツチングによって上記第1層配線上
の突起部ゴdよびエツジ部の薄い佃M&fiのみを除去
し、ついでそのようにし−〔形状された佃脂膜乞マスク
として上記第1層配線上のすべてあるいはエッジ部のみ
の上記Flの層間絶縁膜をエツチング除去することによ
って行なわれる。
以下に1図面を参照しながら、実施例ケ用いて本発明を
一層詳111iIK説明するが、それらは例示に過き°
ず、本発明の枠を越えることなしにいろいろな変形や改
良があり得ることは勿論である。
一層詳111iIK説明するが、それらは例示に過き°
ず、本発明の枠を越えることなしにいろいろな変形や改
良があり得ることは勿論である。
第1図から第4図までは本発明による牛専体装九の製造
工程を示す断面図で、図中第7図と共通する引用番号は
第7図におけるものと同じ部分を表わし、6は第1の層
間絶縁膜、7は樹脂層、8は第2のIg!I間絶縁膜な
示す。
工程を示す断面図で、図中第7図と共通する引用番号は
第7図におけるものと同じ部分を表わし、6は第1の層
間絶縁膜、7は樹脂層、8は第2のIg!I間絶縁膜な
示す。
第1図に示すように、基&l上に第1層配線2乞設け、
その第1層配線2ヶ含め、基板lの表面全面に第1の層
間絶縁層6を形成し、さらにその上に樹脂層7乞スピン
ナ塗布すると、第1/冑配線 1パターンのエツジ部
とヒロック5の上の樹脂層7の厚さが小さくなる。
その第1層配線2ヶ含め、基板lの表面全面に第1の層
間絶縁層6を形成し、さらにその上に樹脂層7乞スピン
ナ塗布すると、第1/冑配線 1パターンのエツジ部
とヒロック5の上の樹脂層7の厚さが小さくなる。
第5図は基板l上に矩形断面の配線2があると仮定し、
その上に形成される樹脂層7の形状を模式的に示す。配
線パターン幅がある程度以上になると、その上の樹脂層
7の最大の厚みtlは基板l上の樹脂層7の厚みtlと
等しくなるが、配線パターンが〜1くなると厚みtlも
小さくなる。第6図は配線パターン幅とその上に形成さ
れる樹脂1ぐ17の最大の厚みtlのkl係?示す。し
たがって、第1図においてはA点およびB点にお(・て
樹脂層7は薄い。
その上に形成される樹脂層7の形状を模式的に示す。配
線パターン幅がある程度以上になると、その上の樹脂層
7の最大の厚みtlは基板l上の樹脂層7の厚みtlと
等しくなるが、配線パターンが〜1くなると厚みtlも
小さくなる。第6図は配線パターン幅とその上に形成さ
れる樹脂1ぐ17の最大の厚みtlのkl係?示す。し
たがって、第1図においてはA点およびB点にお(・て
樹脂層7は薄い。
第り図に示す装置を、夕11えはCF4 + 5%02
ケ雰囲気とする等方性プラズマエッチに曝らすと、第2
図に示すように、A戸とB、壱において第1の層間絶縁
層6は露出させられる。
ケ雰囲気とする等方性プラズマエッチに曝らすと、第2
図に示すように、A戸とB、壱において第1の層間絶縁
層6は露出させられる。
このときプラズマエッチχ停止し、樹脂層7をマヌクと
して一足時間通常のウェットエッチyt行なえばエツジ
部CB、6)およびヒロック5の近傍(A点)において
第1の層1口」絶縁膜6は除去され、樹Jii7 j+
j 7 <1″’h″r l!l’4除ムー・j″J【
ば、第3 tel ic示j 、l: 51c、表面は
平滑化される。
して一足時間通常のウェットエッチyt行なえばエツジ
部CB、6)およびヒロック5の近傍(A点)において
第1の層1口」絶縁膜6は除去され、樹Jii7 j+
j 7 <1″’h″r l!l’4除ムー・j″J【
ば、第3 tel ic示j 、l: 51c、表面は
平滑化される。
このように乎111r化された表面上に第2の1ψ間絶
縁膜8および第2層配線4を形成した粕呆乞第4図に示
す。第21−配線4は平滑化さハだ表面上に形成される
から、段切れが生じることはない。
縁膜8および第2層配線4を形成した粕呆乞第4図に示
す。第21−配線4は平滑化さハだ表面上に形成される
から、段切れが生じることはない。
0発4Jの効果〕
以上説明した辿り、本発明によれは、第2層配線の段切
れの原因である第1 lVj自C腺の形状によって生じ
る層間絶縁層のくびねは先金に除去されるから、第2層
配線の段切れはなくなり、委留り同上が達成される。
れの原因である第1 lVj自C腺の形状によって生じ
る層間絶縁層のくびねは先金に除去されるから、第2層
配線の段切れはなくなり、委留り同上が達成される。
第1図から第4図までは本発明による半導体装置の’j
Qm工株を示す断面図、第5図は基板上に矩形断面の配
線かあると仮定し、その上に形成さねる輌脂層の形状を
示1−模式図、第6図は配線パターン幅とその上に彫成
さねる樹脂層の最大の厚みの曲係ビ示すダイヤグラム、
第7図は基板上に従来の方法によって形成された2層ム
C緑の断面図である。 1・・・基板、2・・・第1心配紛、3・・・1口向絶
を象膜、4・°・第21匂自己趣、5・・・ヒロック、
6・・・第1の層間絶縁膜、7・・・樹脂I曽、8・・
・第2の層間絶縁膜。
Qm工株を示す断面図、第5図は基板上に矩形断面の配
線かあると仮定し、その上に形成さねる輌脂層の形状を
示1−模式図、第6図は配線パターン幅とその上に彫成
さねる樹脂層の最大の厚みの曲係ビ示すダイヤグラム、
第7図は基板上に従来の方法によって形成された2層ム
C緑の断面図である。 1・・・基板、2・・・第1心配紛、3・・・1口向絶
を象膜、4・°・第21匂自己趣、5・・・ヒロック、
6・・・第1の層間絶縁膜、7・・・樹脂I曽、8・・
・第2の層間絶縁膜。
Claims (2)
- (1)基板の一表面上に第1層配線を設ける工程と、上
記第1層配線を含め、上記半導体基板表面上に第1の層
間絶縁膜を形成する工程と、上記第1層配線上のすべて
あるいはエッジ部のみの上記第1の層間絶縁膜を除去し
、平滑化する工程と、そのように平滑化された表面上に
第2の層間絶縁膜を形成する工程と、該第2の層間絶縁
膜上に第2層配線を形成する工程とを含むことを特徴と
する半導体装置の製造方法。 - (2)上記第1層配線上のすべてあるいはエッジ部のみ
の上記第1の層間絶縁膜を除去し、平滑化する工程が、
上記第1の層間絶縁膜上に樹脂膜を形成し、等方性のプ
ラズマエッチングによつて上記第1層配線上の突起部お
よびエッジ部の薄い樹脂膜のみを除去し、ついでそのよ
うにして形成された樹脂膜をマスクとして上記第1層配
線上のすべてあるいはエッジ部のみの上記第1の層間絶
縁膜をエッチング除去することによつて行なわれること
を特徴とする特許請求の範囲第1項記載の半導体装置の
製造方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20306984A JPS6180838A (ja) | 1984-09-27 | 1984-09-27 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20306984A JPS6180838A (ja) | 1984-09-27 | 1984-09-27 | 半導体装置の製造方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6180838A true JPS6180838A (ja) | 1986-04-24 |
Family
ID=16467828
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP20306984A Pending JPS6180838A (ja) | 1984-09-27 | 1984-09-27 | 半導体装置の製造方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6180838A (ja) |
-
1984
- 1984-09-27 JP JP20306984A patent/JPS6180838A/ja active Pending
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