JPS6184972A - 映像信号の垂直方向エンフアシス回路 - Google Patents
映像信号の垂直方向エンフアシス回路Info
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- JPS6184972A JPS6184972A JP59206210A JP20621084A JPS6184972A JP S6184972 A JPS6184972 A JP S6184972A JP 59206210 A JP59206210 A JP 59206210A JP 20621084 A JP20621084 A JP 20621084A JP S6184972 A JPS6184972 A JP S6184972A
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- H04N5/00—Details of television systems
- H04N5/14—Picture signal circuitry for video frequency region
- H04N5/142—Edging; Contouring
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- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
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- H04N5/91—Television signal processing therefor
- H04N5/92—Transformation of the television signal for recording, e.g. modulation, frequency changing; Inverse transformation for playback
- H04N5/923—Transformation of the television signal for recording, e.g. modulation, frequency changing; Inverse transformation for playback using preemphasis of the signal before modulation and deemphasis of the signal after demodulation
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N9/00—Details of colour television systems
- H04N9/64—Circuits for processing colour signals
- H04N9/646—Circuits for processing colour signals for image enhancement, e.g. vertical detail restoration, cross-colour elimination, contour correction, chrominance trapping filters
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- Signal Processing (AREA)
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は、磁気記録再生装置ｔ（たとえばＶＴＲなど）
における映像信号の垂直方向エン７アシス回路に関する
ものである。
における映像信号の垂直方向エン７アシス回路に関する
ものである。
従来、ＶＴＲのＳ／Ｎ改善手段としては水平方向のエン
ファシスが用いられている。第２図はそのプリエンファ
シス回路の一列で、（ａ）は回路構成、（ｂ）は履波数
特性を示している。入力映像信号をプリエンファシスし
て記録し、再生信号を第２図Φ）の逆特性を有するディ
エンファシス回路を通すことにより、テープ、ヘッド系
で生じるノイズを抑圧し、Ｓ／Ｎを改善することができ
る。
ファシスが用いられている。第２図はそのプリエンファ
シス回路の一列で、（ａ）は回路構成、（ｂ）は履波数
特性を示している。入力映像信号をプリエンファシスし
て記録し、再生信号を第２図Φ）の逆特性を有するディ
エンファシス回路を通すことにより、テープ、ヘッド系
で生じるノイズを抑圧し、Ｓ／Ｎを改善することができ
る。
水平方向のエン７アシスによりノイズヲ抑ＩＥできるの
は比較的高周波帯域（たとえば２００ ＫＨｚ以上）で
あり、画面上目につきやすい低周波ノイズの抑圧は一般
に実現困難である。
は比較的高周波帯域（たとえば２００ ＫＨｚ以上）で
あり、画面上目につきやすい低周波ノイズの抑圧は一般
に実現困難である。
本発明の目的は、上記した従来技術の欠点を補って、信
号の低周波領域から全域にわたってノイズを抑圧する映
像信号の垂直方向エンファシス回路を提供することにあ
る。
号の低周波領域から全域にわたってノイズを抑圧する映
像信号の垂直方向エンファシス回路を提供することにあ
る。
本発明は、垂直方向の輪郭強調回路を発展させ、垂直方
向のプリエンファシス、ディエン７１シスを施すもので
ある。
向のプリエンファシス、ディエン７１シスを施すもので
ある。
第３図は従来の１Ｈ遅延Ｉ！（ＩＨは１水平期間ＮＴＳ
Ｃの場合６３．５μＳ）を用いたフィードバック形の映
像信号の垂直方向の輪郭強調回路の一例である。この回
路の動作原理を説明すると、入力映像信号ｅ、は１Ｈ遅
延＠１．減衰率α倍（αく１）の減衰器２．および加算
器３で構成されるポジティブフイドバックループに加え
られる。この回路の出力映像信号ｅ０は１Ｈ遅延１ｗ１
の入力信号ｅ、かも、その出力信号ｅ、を減衰率β倍（
β〈１）の減衰器４を経た信号を、減算器５により減算
することで得られる。各部の信号は、１Ｈ遅延線１の遅
延時間をτとして、ｅｓ ” ｅＸ９ （Ｓτ）・
ｅ、 ・・・・・・・・＠Ｓはラプラ
ス変換演算子 となり、回路総合の伝達関数Ｇ （Ｓ）はで与えられる
。ステップ入力ｅｌに対する応答ｅ。
Ｃの場合６３．５μＳ）を用いたフィードバック形の映
像信号の垂直方向の輪郭強調回路の一例である。この回
路の動作原理を説明すると、入力映像信号ｅ、は１Ｈ遅
延＠１．減衰率α倍（αく１）の減衰器２．および加算
器３で構成されるポジティブフイドバックループに加え
られる。この回路の出力映像信号ｅ０は１Ｈ遅延１ｗ１
の入力信号ｅ、かも、その出力信号ｅ、を減衰率β倍（
β〈１）の減衰器４を経た信号を、減算器５により減算
することで得られる。各部の信号は、１Ｈ遅延線１の遅
延時間をτとして、ｅｓ ” ｅＸ９ （Ｓτ）・
ｅ、 ・・・・・・・・＠Ｓはラプラ
ス変換演算子 となり、回路総合の伝達関数Ｇ （Ｓ）はで与えられる
。ステップ入力ｅｌに対する応答ｅ。
は、第４図に示すように時間τを経過する毎に減衰し、
ユニＬに漸近する。α〉βの場合、垂１−α 直方向の輪郭強調回路となり、αくβの場合、その逆特
性を有する回路となる。
ユニＬに漸近する。α〉βの場合、垂１−α 直方向の輪郭強調回路となり、αくβの場合、その逆特
性を有する回路となる。
本発明は上記のフィードバック形輪郭強調回路を基本に
これを等価変形し、さらに応用発展せしめたもので、こ
れにより次の特長を有する垂直方向エン７アシス回路を
実現することができる。
これを等価変形し、さらに応用発展せしめたもので、こ
れにより次の特長を有する垂直方向エン７アシス回路を
実現することができる。
（１） プリエンファシス、ディエンファシス両特性
の完全整合 （２）特性決定回路要素数の最小限化 （尋 エン７アシス量増大を可能とするノンリニア特性
の付加 （４） 輝度０色度両信号系に適用可能等価変形の形
態には数態考えられるが、本発明はその最も簡素な二つ
の形態に基づき、それぞれ実施例１および２に掲げて、
以下詳細に説明する。
の完全整合 （２）特性決定回路要素数の最小限化 （尋 エン７アシス量増大を可能とするノンリニア特性
の付加 （４） 輝度０色度両信号系に適用可能等価変形の形
態には数態考えられるが、本発明はその最も簡素な二つ
の形態に基づき、それぞれ実施例１および２に掲げて、
以下詳細に説明する。
第１図は、本発明の第１の実施例としての垂直方向エン
ファシス回路の基本構成を示したもので、入力信号ｅｌ
が輝度信号の場合である。第２図の基本形との相違点は
、減衰器４の定数βの要素をレベル調整回路６の定数ｒ
に含めたことと、加算器７を設けて追加演算を施こした
ことである。この等価変形によって後述のように、エン
７アシス定数が具体的に与え易くなり、さらにノンリニ
ア回路を挿入し易くなるなどの特長が生じる。
ファシス回路の基本構成を示したもので、入力信号ｅｌ
が輝度信号の場合である。第２図の基本形との相違点は
、減衰器４の定数βの要素をレベル調整回路６の定数ｒ
に含めたことと、加算器７を設けて追加演算を施こした
ことである。この等価変形によって後述のように、エン
７アシス定数が具体的に与え易くなり、さらにノンリニ
ア回路を挿入し易くなるなどの特長が生じる。
入力ｅ、に対し、ｅ、、ｅ、は前述した０、０式で与え
られ、その結果ｅ４は となる。レベル調整回路６のゲインをγとすると伝達関
数Ｇ （８）は、 ば、０式の示す特性と一致し、この回路が等価変形回路
なることを識る。ここにおいて、とすれば、両回路の伝
達特性はそれぞれ、プリエンファシス特性Ｇｐ （Ｓ）
は ディエン７１シス特性Ｇｄ （Ｓ）は となる。両特性間には Ｇｐ （Ｓ）・Ｑｄ （８） ＝ １ ・
・・・・・■なる関係があるため、両回路の整合条件を
完全に満足させることができる。エン７アシス係数に、
、に、およびエンファシス量Ｘは、上記整合条件関係式
より独立２変数で成立ち、両エン７アシス係数、或はそ
れらの一方とエンファシス量を定めることにより、回路
特性を決定できる。
られ、その結果ｅ４は となる。レベル調整回路６のゲインをγとすると伝達関
数Ｇ （８）は、 ば、０式の示す特性と一致し、この回路が等価変形回路
なることを識る。ここにおいて、とすれば、両回路の伝
達特性はそれぞれ、プリエンファシス特性Ｇｐ （Ｓ）
は ディエン７１シス特性Ｇｄ （Ｓ）は となる。両特性間には Ｇｐ （Ｓ）・Ｑｄ （８） ＝ １ ・
・・・・・■なる関係があるため、両回路の整合条件を
完全に満足させることができる。エン７アシス係数に、
、に、およびエンファシス量Ｘは、上記整合条件関係式
より独立２変数で成立ち、両エン７アシス係数、或はそ
れらの一方とエンファシス量を定めることにより、回路
特性を決定できる。
第５図にプリエンファシス、ティエンファシスの周波数
特性ＩＧｐ（ｊω）１，１Ｇｄ（ｊω）１ を示す。
特性ＩＧｐ（ｊω）１，１Ｇｄ（ｊω）１ を示す。
輝度信号の垂直周波数スペクトル成分は、水平スペクト
ルｎｆｎ（ｎは整数、 ｆａは水平周波数〕を中心とし
て存在し、第５図の特性から、プリエンファシス１Ｇｐ
（ｊω）１によりその垂直周波数スペクトル成分が強ｍ
され、ディエンファシス１Ｇｄ（ｊω）１により抑圧さ
れることがわかる。第１２図にプリエンファシスのステ
ップ応答１１１３図にディエンファシスのステクプ応答
を示す。
ルｎｆｎ（ｎは整数、 ｆａは水平周波数〕を中心とし
て存在し、第５図の特性から、プリエンファシス１Ｇｐ
（ｊω）１によりその垂直周波数スペクトル成分が強ｍ
され、ディエンファシス１Ｇｄ（ｊω）１により抑圧さ
れることがわかる。第１２図にプリエンファシスのステ
ップ応答１１１３図にディエンファシスのステクプ応答
を示す。
輝度信号をプリエンファシスしてテープ等に記録し、再
生時にディエンファシスすることにより、垂直周波数ス
ペクトル成分は原信号と一致し、再生系で混入したノイ
ズはディエンファシスにより抑圧されるのでＳ／Ｎが改
善される。
生時にディエンファシスすることにより、垂直周波数ス
ペクトル成分は原信号と一致し、再生系で混入したノイ
ズはディエンファシスにより抑圧されるのでＳ／Ｎが改
善される。
改善効果は低周波から高周波まで信号全帯域に及ぶ。
次に、この垂直エンファシス回路を色度信号に適用する
回路について述べる。まずＮＴＳＣの場合、色度信号は
輝度信号に対し周波＠２２７．５ｆｉ（ｆｕは水平周波
数）の色副搬送波により１／２ｆＨ周波数オフセットの
状態で多重されて、水平スペクトル（ｎ ＋ −） ｆ
ａを中心として垂直周波数スペクトル成分が存在する。
回路について述べる。まずＮＴＳＣの場合、色度信号は
輝度信号に対し周波＠２２７．５ｆｉ（ｆｕは水平周波
数）の色副搬送波により１／２ｆＨ周波数オフセットの
状態で多重されて、水平スペクトル（ｎ ＋ −） ｆ
ａを中心として垂直周波数スペクトル成分が存在する。
従ってその垂直方向エンファシスは第１図の構成回路が
（ｎ ＋ｊ−） ｆＨを中心とするスペクトル成分に対
し原理どおりの動作をするよう色副搬送波の位相を補正
してやる必要がある。すなわち１Ｈ遅延線１ に−１１
− ２゜７．５ｆｇの遅延補正を付加するか、ＩＨ遅延線１
の出力位相反転させる。次にＰＡＬの場合、色度信号は
輝度信号に対し周波数２８３．７５ｆＨの色ｉｌＩ搬送
波によりｊ／４ｆＨＪ＠波数オフセットの状態で多重さ
れ、Ｂ−Ｙ信号は水平スペクトル（ｎ ａ ） ｆＢ
を、几−Ｙ信号は同（ｎ＋７） ｆｌｌをそれぞれ
中心として垂直周波数スペクトル成分が存在する。従っ
てその垂直方向エン７アシスは第１図の構成回路が（ｎ
−１＝’）ｆＨを中心とするスペクトル成分に対して原
理どおりの・動作をするよう補正してやる必要がある。
（ｎ ＋ｊ−） ｆＨを中心とするスペクトル成分に対
し原理どおりの動作をするよう色副搬送波の位相を補正
してやる必要がある。すなわち１Ｈ遅延線１ に−１１
− ２゜７．５ｆｇの遅延補正を付加するか、ＩＨ遅延線１
の出力位相反転させる。次にＰＡＬの場合、色度信号は
輝度信号に対し周波数２８３．７５ｆＨの色ｉｌＩ搬送
波によりｊ／４ｆＨＪ＠波数オフセットの状態で多重さ
れ、Ｂ−Ｙ信号は水平スペクトル（ｎ ａ ） ｆＢ
を、几−Ｙ信号は同（ｎ＋７） ｆｌｌをそれぞれ
中心として垂直周波数スペクトル成分が存在する。従っ
てその垂直方向エン７アシスは第１図の構成回路が（ｎ
−１＝’）ｆＨを中心とするスペクトル成分に対して原
理どおりの・動作をするよう補正してやる必要がある。
すなわち９１図における１Ｈ遅延線を２Ｈ遅延線とし、
遅延線の出力位相を反転させる。
遅延線の出力位相を反転させる。
第６図はＮＴＳＣの色度信号の垂直方向エンファシス回
路の例である。この例は１Ｈ遅延線１の出力位相を反転
させた場合である具体化のため演算器３．５への１Ｈ遅
延線１の出力の加算減算を反対にして演算器８．９とし
た。これによって得られるプリエン７１シス、ディエン
ファシス両回路の伝達特性を数式表示すれば、プリエン
ファシス特性Ｇｐ（Ｓ） はディエンファシス％ 性
Ｇｄ （Ｓ） ハ、Ｇｄ （Ｓ） ＝ １厩・’：気：
ｅｘｐ２１：；、 、、、、、、◎となり、第７図にそ
れら両回路の周波数特性１Ｇｐ（ｊω）１．１Ｇｄ（７
０月を示す。色度信号の垂直周波数スペクトル成分は（
ｎ 十−） ｆＨ（ｎは整′ＩＩｋ）を中心に存在する
ため、前記輝度信号の場合と同様に８／Ｎ改善効果が得
られる。
路の例である。この例は１Ｈ遅延線１の出力位相を反転
させた場合である具体化のため演算器３．５への１Ｈ遅
延線１の出力の加算減算を反対にして演算器８．９とし
た。これによって得られるプリエン７１シス、ディエン
ファシス両回路の伝達特性を数式表示すれば、プリエン
ファシス特性Ｇｐ（Ｓ） はディエンファシス％ 性
Ｇｄ （Ｓ） ハ、Ｇｄ （Ｓ） ＝ １厩・’：気：
ｅｘｐ２１：；、 、、、、、、◎となり、第７図にそ
れら両回路の周波数特性１Ｇｐ（ｊω）１．１Ｇｄ（７
０月を示す。色度信号の垂直周波数スペクトル成分は（
ｎ 十−） ｆＨ（ｎは整′ＩＩｋ）を中心に存在する
ため、前記輝度信号の場合と同様に８／Ｎ改善効果が得
られる。
多量のエンファシスを施こす場合には、大信号に対して
はエン７アシス量小、小信号に対しティエンファシス量
大トなるエン７アシス特性をもたせるため、ノンリニア
回路が必要となる。
はエン７アシス量小、小信号に対しティエンファシス量
大トなるエン７アシス特性をもたせるため、ノンリニア
回路が必要となる。
輝度信号の場合、第８図に示すように減算器５とレベル
調整回路６との間にノンリニア回路１０を設ければよい
。レベル調整回路６と加算器７の間に設けることも可能
である。
調整回路６との間にノンリニア回路１０を設ければよい
。レベル調整回路６と加算器７の間に設けることも可能
である。
色度信号の場合も同様に第６図において、加算器９とレ
ベル調整回路６の間、あるいはレベル調整回路６と加算
器７の間に設ければよい。
ベル調整回路６の間、あるいはレベル調整回路６と加算
器７の間に設ければよい。
第９図は本発明の第２の実施例で、輝度信号の場合を示
したものである。この回路の第１図に示した第１の実施
例との相違点は、演算器３゜５の人出力を転置した形に
したことであり、動作の基本となるポジティブフィード
バックループは１Ｈ遅延［１、減算器１２．減衰器２．
および減算器１１で構成され、入力映像信号ｅ１は減算
器１１および１２に加えられる。信号ｅ４および伝達関
数Ｇ（Ｓ）は、前記第１の実施例と同じく■および０式
で表わされこれも等価変形回路なることを織る。同様に
これを二ン７アシス回路ならしめる条件■を与えれば、
プリエン７アシスーおよびディエンファシス特性はのお
よび０式となり、従って、第５図に示した周波数特性を
持つ垂直方向のプリエン７１シス、ディエンファシス回
路が得られる。
したものである。この回路の第１図に示した第１の実施
例との相違点は、演算器３゜５の人出力を転置した形に
したことであり、動作の基本となるポジティブフィード
バックループは１Ｈ遅延［１、減算器１２．減衰器２．
および減算器１１で構成され、入力映像信号ｅ１は減算
器１１および１２に加えられる。信号ｅ４および伝達関
数Ｇ（Ｓ）は、前記第１の実施例と同じく■および０式
で表わされこれも等価変形回路なることを織る。同様に
これを二ン７アシス回路ならしめる条件■を与えれば、
プリエン７アシスーおよびディエンファシス特性はのお
よび０式となり、従って、第５図に示した周波数特性を
持つ垂直方向のプリエン７１シス、ディエンファシス回
路が得られる。
第１０図は、本発明の第２の実施列をＮＴＳＣの色度信
号に適用した場合を示したもので、第１の実施例におい
て説明したように色度信号を１Ｈ遅延すると人出力の色
副搬送波の位相が反転するため、第９図の減算器１２の
代りに、第１０図では加算器１５を用いる。この場合も
第１の実施例と全く同様に第７図に示した周波数特性を
有する色度信号に対する垂直方向のプリエンファシス、
ディエンファシス回路カ得うレル。ＰＡＬの色度信号に
適用する場合も前記の第１の実施例において説明したよ
うな処理を施こすことによりその回路を得ることができ
る。
号に適用した場合を示したもので、第１の実施例におい
て説明したように色度信号を１Ｈ遅延すると人出力の色
副搬送波の位相が反転するため、第９図の減算器１２の
代りに、第１０図では加算器１５を用いる。この場合も
第１の実施例と全く同様に第７図に示した周波数特性を
有する色度信号に対する垂直方向のプリエンファシス、
ディエンファシス回路カ得うレル。ＰＡＬの色度信号に
適用する場合も前記の第１の実施例において説明したよ
うな処理を施こすことによりその回路を得ることができ
る。
第１１図は、第９図の輝度信号の垂直方向エン７アシス
回路において、ノンリニア回路１０ヲ設けた場合である
。
回路において、ノンリニア回路１０ヲ設けた場合である
。
色度信号に対しノンリニアエンファシストスる場合にも
、これに準じてノンＩＪ ニア回路を設ければよい。
、これに準じてノンＩＪ ニア回路を設ければよい。
以上述べたように、本発明による垂直方向の二ン７１シ
スをＶＴＲなどに適用することにより、信号全帯域のＳ
／Ｎ改善効果が得られる。
スをＶＴＲなどに適用することにより、信号全帯域のＳ
／Ｎ改善効果が得られる。
特に他の手段でＳ／Ｎを改善しにくい２００ ＫＨｚ以
下の低周波領域においても効果があるので、画質向上に
大きく寄与する。
下の低周波領域においても効果があるので、画質向上に
大きく寄与する。
さらに本発明による垂直エンファシス回路は、プリエン
ファシス回路とディエンファシス回路の基本構成が全く
同一形であり、かつ特性を決定する２変数に対応した最
小限の回路要素で構成できるため、ＩＣ化回路としても
好適である。
ファシス回路とディエンファシス回路の基本構成が全く
同一形であり、かつ特性を決定する２変数に対応した最
小限の回路要素で構成できるため、ＩＣ化回路としても
好適である。
シカモブリエン７アシス、テイエンフ１シスの両特性が
完全整合し、トラッキングエラーを有しない特長を有し
ている。
完全整合し、トラッキングエラーを有しない特長を有し
ている。
第１図は本発明の第１の実施例で、垂直エンファシス回
路を輝度信号に適用した場合のブロック図、第２図は従
来の水平方向エン７アシス回路及び特性図、第３図は従
来の垂直方向輪郭強調回路のブロック図、第４図は第３
図の入出力波形図、第５図は輝度信号・系における垂直
エンファシス特性図、第６図は本発明の垂直エン７アシ
ス回路を色度信号に適用した場合のブロック図、第７図
は色度信号系における垂直エン７アシス特性図、第８図
は本発明の第１の実施例において、ノンリニア回路を設
けた場合のブロック図、第９図、第１０図、第１１図は
本発明の第２の実施例を示すブロック図、第１２図は垂
直プリエンファシス回路のステップ応答特性図、第１３
図は垂直ディエンファシス回路のステップ応答特性図で
ある。 〔符号の説明〕 １・・・１Ｈ遅延線、 ２．４・・・減衰器、６・
・・レベル調整器、１０・・・ノンリニア回路。 躬 １え 躬３困 第２図 （α） 尺１ （ト） 同液狡 第４図 躬５ａ 第 ６犯 躬７圀 １＋に２ （ハ！！牧） Ｑ＝（Ｉ＋す・ □ １十に１ 第１０口 躬１７虐 躬ｔ２１Ｋｌ
路を輝度信号に適用した場合のブロック図、第２図は従
来の水平方向エン７アシス回路及び特性図、第３図は従
来の垂直方向輪郭強調回路のブロック図、第４図は第３
図の入出力波形図、第５図は輝度信号・系における垂直
エンファシス特性図、第６図は本発明の垂直エン７アシ
ス回路を色度信号に適用した場合のブロック図、第７図
は色度信号系における垂直エン７アシス特性図、第８図
は本発明の第１の実施例において、ノンリニア回路を設
けた場合のブロック図、第９図、第１０図、第１１図は
本発明の第２の実施例を示すブロック図、第１２図は垂
直プリエンファシス回路のステップ応答特性図、第１３
図は垂直ディエンファシス回路のステップ応答特性図で
ある。 〔符号の説明〕 １・・・１Ｈ遅延線、 ２．４・・・減衰器、６・
・・レベル調整器、１０・・・ノンリニア回路。 躬 １え 躬３困 第２図 （α） 尺１ （ト） 同液狡 第４図 躬５ａ 第 ６犯 躬７圀 １＋に２ （ハ！！牧） Ｑ＝（Ｉ＋す・ □ １十に１ 第１０口 躬１７虐 躬ｔ２１Ｋｌ
Claims (1)
- 【特許請求の範囲】 １、映像信号Ａを遅延する回路と、該遅延回路の出力映
像信号Ｂを入力映像信号Ｃに正帰還して映像信号Ａとす
る演算回路１と、映像信号Ａと映像信号Ｂの振幅差信号
Ｄを得る演算回路２と、振幅差信号Ｄの大きさを変化さ
せる線形回路と、該線形回路出力Ｅと入力映像信号Ｃを
演算する演算回路３とを有し、該演算回路３の出力を出
力映像信号とすることを特徴とする映像信号の垂直方向
エンファシス回路。 ２、前記演算回路２と演算回路３の間に、非線形回路を
設けたことを特徴とする特許請求の範囲第１項に記載さ
れた映像信号の垂直方向エンファシス回路。
Priority Applications (7)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59206210A JPS6184972A (ja) | 1984-10-03 | 1984-10-03 | 映像信号の垂直方向エンフアシス回路 |
| US06/777,288 US4647960A (en) | 1984-10-03 | 1985-09-18 | Vertical contour emphasis de-emphasis circuit |
| CA000491136A CA1228670A (en) | 1984-10-03 | 1985-09-19 | Video signal emphasis circuit |
| EP85111931A EP0176888A1 (en) | 1984-10-03 | 1985-09-20 | Video signal emphasis circuit |
| KR1019850006934A KR900004026B1 (ko) | 1984-10-03 | 1985-09-23 | 비디오 신호 엠퍼시스 회로 |
| CN198585107350A CN85107350A (zh) | 1984-10-03 | 1985-09-30 | 视频信号加重电路 |
| BR8504840A BR8504840A (pt) | 1984-10-03 | 1985-10-01 | Circuito de pre-acentuacao |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59206210A JPS6184972A (ja) | 1984-10-03 | 1984-10-03 | 映像信号の垂直方向エンフアシス回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6184972A true JPS6184972A (ja) | 1986-04-30 |
| JPH0464235B2 JPH0464235B2 (ja) | 1992-10-14 |
Family
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