JPS6231156A - 半導体装置及びその製造方法 - Google Patents

半導体装置及びその製造方法

Info

Publication number
JPS6231156A
JPS6231156A JP60170709A JP17070985A JPS6231156A JP S6231156 A JPS6231156 A JP S6231156A JP 60170709 A JP60170709 A JP 60170709A JP 17070985 A JP17070985 A JP 17070985A JP S6231156 A JPS6231156 A JP S6231156A
Authority
JP
Japan
Prior art keywords
film
conductivity type
aluminum
semiconductor
semiconductor substrate
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP60170709A
Other languages
English (en)
Inventor
Hiroshi Ito
浩 伊藤
Tatsuo Ishida
石田 達夫
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP60170709A priority Critical patent/JPS6231156A/ja
Publication of JPS6231156A publication Critical patent/JPS6231156A/ja
Pending legal-status Critical Current

Links

Landscapes

  • Electrodes Of Semiconductors (AREA)
  • Semiconductor Memories (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (産業上の利用分野) 本発明は半導体装置及びその製造方法に関し、特に半導
体装置の最終製造工程での内部回路の変更を可能とする
プログラマブルフユーズを有スる半導体装置及びその製
造方法に関する。
(従来の技術) 従来、半導体装置のプログラマブルフェーズとしては、
多結晶シリコンが多く使われておシ、例えばレーザー照
射によシ焼ききるか、あるいは多結晶シリコンに大量の
電流を流し発生する熱忙より多結晶シリコンを切る方法
が検討又は使用されてきた。
(発明が解決しようとする問題点) しかし上述した従来のプログラマブルフユーズにおいて
は熱によシ多結晶シリコンを溶断するためにガス成分が
蒸発する際建、多結晶シリコンをおおっている層間絶縁
膜またはパシベーシ目ン膜を破壊してしまい、製品の信
頼性をいちじるしく低下させる危険があった。
本発明は上記従来の欠点を除去し、パッシベーシッン膜
成長後パッシベーション膜を破壊することなしにヒユー
ズを構成することが出来る半導体装置及びその製造方法
を提供することを目的とする0 (問題点を解決するための手段) 本発明の第1の発明の半導体装置は、半導体基板内に形
成された一導電型半導体基体と、該半導体基体内に形成
された他導電型の半導体領域と、該半導体領域上に形成
された層間絶縁膜と、該層間絶縁膜に開口されたコンタ
クト孔と、該コンタクト孔を覆って形成された薄い高融
点金属膜と、該高融点金属膜を覆って形成されたアルミ
ニウム配線と、該アルミニウム配線を覆い表面に形成さ
れたバッジベージ冑ン用の絶縁膜とを有し、前記アルミ
ニウム配線のアルミニウムが少なくとも一部のコンタク
ト部において前記高融点金属と前記他導電型半導体領域
をつきぬけて前記一導電型半導体基体と電気的に接続さ
れている構造を有して構成される。
なお、高融点金属膜としては、タングステン又はTiW
又はTiNを用いることがよく、またアルミニウム配線
としてはシリコンを含まないアルミニウム又はシリコン
をO01〜0.5wt%含むアルミニウムを用いること
によシ目的を達成することができる。
また、本発明の第2の発明の半導体装置の製造方法は、
半導体基板内に一導電型半導体基体を形成する工程と、
該半導体基体内に他導電型の半導体領域を形成する工程
と、該半導体領域上に層間絶縁膜を形成する工程と、該
層間絶縁膜に他導電型の半導体領域に達する開口部を設
ける工程と、該開口部を覆う薄い高融点金属膜を形成す
る工程と、該高融点金属膜を覆うアルミニウム配線を形
成する工程と、該アルミニウム配線を覆い表面にバッジ
ページ目ン用の絶縁膜を形成する工程と、レーザ光によ
りコンタクト形成部分のコンタクト孔部分のみを加熱し
前記アルミニウム配線のアルミニウムを前記薄い高融点
金属膜および前記他導電型半導体領域をつきぬけさせ前
記一導電型半導体基体と電気的に接続せしめる工程とを
含んで構成される。
(実施例) を説明するために工程順に示した縦断面図である。
まず、第1図(a)に示すようにP型半導体シリコン基
板lにN 拡散層領域2をフィールド層間絶縁膜3をマ
スクとして形成する。次いで層間酸化膜4を形成した後
、さきに形成したN 拡散層領域2の領域内にN 拡散
層領域に達する開口部を層間酸化膜4に形成する。次に
開口部を覆う薄い高融点金属であるタングステン膜5を
形成する。
次いで厚いアルミニウムを形成パターン化した後、表面
にパッジベージ目ン用の酸化膜7を形成する。
次に第1図(blに示すようにアルミニウム配線とP型
シリコン基板1との電気的接続を形成する場所のさきに
形成したコンタクト孔部分のみにレーザ光19を照射し
加熱する。しかるときはその熱によシ局所的にダンゲス
テンのバリア膜が破壊され熱によりアルミニウムがシリ
コン基板にアロイスパイク8を生じN 拡散層領域2を
破壊し、PN接合をも破壊することによシアルミニウム
配線がP型シリコン基板1と短絡する。電気的接続を行
なわないコンタクト形成部分は第1図(a)のまま残さ
れ、バソア層並びにN+拡散層領域2によりアルミニウ
ム配線6とP型シリコン基板は絶縁が保たれる。
以上の製造方法により、半導体基板内に形成された−4
を型(P型)半導体基体1と半導体基体l内に形成され
た他導電型(N 型)半導体領域2と、半導体領域2上
に形成された層間絶縁@4と、層間絶縁膜4に開口され
たコンタクト孔と、そのコンタクト孔を覆って形成され
た薄い高融点金属膜としてのタングステン膜5と、その
高融点金属膜であるタンク・ステン膜5を覆って形成さ
れたアルミニウム配線6と、そのアルミニウム配線6を
覆って表面に形成されたパシベーション用の絶縁膜であ
る酸化膜7とを有し、アルミニウム配線6のアルミニウ
ムが少なくとも一部のコンタクト部において高融点金属
5と他導電型(N+型)半導体領域2をつきぬけて一導
電型半導体基体1と電気的に接続されて形成されている
半導体装置が得られる。
なお、第1の実施例においては、タングステンバリア膜
を用いたが、他にTiW、TiN等一般にバリアメタル
とよばれる種類の金属を用いてもよいO また、アルミニウム配線としては純粋なアルミニウムの
例を示したが、シリコンを添加したアルミニウムでも同
様の構造を構成することができる。
また、パッシベーション膜として酸化膜を用いたが、こ
れに限ることなく、レーザ光を透過できる膜であればよ
く、窒化膜の多層膜が適用可能である。
(発明の効果) 以上説明したように本発明はバリアメタル構造のコンタ
クト部分をパシベーション膜を通してレーザ光により加
熱することによシ、所望のコンタクト部分のみアルミニ
ウム配線が基板にアロイスパイクしている構造を提供す
ることによりパシベーション膜成長後、パシベーション
膜を破壊することなしにヒユーズを構成することができ
る。
【図面の簡単な説明】
第1図(a) 、 (blは本発明の一実施例及びその
製造方法を説明するために工程順に示した縦断面図で第
1図(b)はレーザ光によジオン状態とした後の縦断面
図、第1図(a)はオン状態以前又はオン状態にしない
部分の縦断面図である。 l・・・・・・P型シリコン基板、2・・・・・・N 
拡散層領域、3・・・・・・フィールドの層間絶縁膜、
4・・・・・・層間酸化膜、5・・・・・・高融点金属
膜としてのタングステン膜、6・・・・・・アルミニウ
ム配L  7・・、・・・・バッシヘーション用酸化膜
、8・・・・・・アルミニウムのアロイスパイク、9・
・・・・・レーザー光。 第1 図

Claims (4)

    【特許請求の範囲】
  1. (1)半導体基板内に形成された一導電型半導体基体と
    、該半導体基体内に形成された他導電型の半導体領域と
    、該半導体領域上に形成された層間絶縁膜と、該層間絶
    縁膜に開口されたコンタクト孔と、該コンタクト孔を覆
    って形成された薄い高融点金属膜と、該高融点金属膜を
    覆って形成されたアルミニウム配線と、該アルミニウム
    配線を覆い表面に形成されたパッシベーション用の絶縁
    膜とを有し、前記アルミニウム配線のアルミニウムが少
    なくとも一部のコンタクト部において前記高融点金属と
    前記他導電型半導体領域をつきぬけて前記一導電型半導
    体基体と電気的に接続されていることを特徴とする半導
    体装置。
  2. (2)高融点金属膜としてタングステン又はTiW又は
    TiNを用いる特許請求の範囲第(1)項記載の半導体
    装置。
  3. (3)アルミニウム配線としてシリコンを含まないアル
    ミニウム又はシリコンを0.1〜0.5wt%含んだア
    ルミニウムの何れかを用いる特許請求の範囲第(1)項
    記載の半導体装置。
  4. (4)半導体基板内に一導電型半導体基体を形成する工
    程と、該半導体基体内に他導電型の半導体領域を形成す
    る工程と、該半導体領域上に層間絶縁膜を形成する工程
    と、該層間絶縁膜に他導電型の半導体領域に達する開口
    部を設ける工程と、該開口部を覆う薄い高融点金属膜を
    形成する工程と、該高融点金属膜を覆うアルミニウム配
    線を形成する工程と、該アルミニウム配線を覆い表面に
    パッシベーション用の絶縁膜を形成する工程と、レーザ
    光によりコンタクト形成部分のコンタクト孔部分のみを
    加熱し前記アルミニウム配線のアルミニウムを前記薄い
    高融点金属膜および前記他導電型半導体領域をつきぬけ
    させ前記一導電型半導体基体と電気的に接続せしめる工
    程とを含むことを特徴とする半導体装置の製造方法。
JP60170709A 1985-08-02 1985-08-02 半導体装置及びその製造方法 Pending JPS6231156A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP60170709A JPS6231156A (ja) 1985-08-02 1985-08-02 半導体装置及びその製造方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP60170709A JPS6231156A (ja) 1985-08-02 1985-08-02 半導体装置及びその製造方法

Publications (1)

Publication Number Publication Date
JPS6231156A true JPS6231156A (ja) 1987-02-10

Family

ID=15909944

Family Applications (1)

Application Number Title Priority Date Filing Date
JP60170709A Pending JPS6231156A (ja) 1985-08-02 1985-08-02 半導体装置及びその製造方法

Country Status (1)

Country Link
JP (1) JPS6231156A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01285580A (ja) * 1988-05-10 1989-11-16 Hitachi Elevator Eng & Service Co Ltd エレベータの制御装置
EP1154438A3 (en) * 2000-05-01 2003-10-29 Xerox Corporation Programmable circuit with preview function

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5167081A (ja) * 1974-12-07 1976-06-10 Fujitsu Ltd
JPS5892252A (ja) * 1981-11-27 1983-06-01 Fujitsu Ltd 半導体装置の製造方法
JPS59124767A (ja) * 1983-01-04 1984-07-18 Nec Corp 半導体・集積回路装置の製造方法

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5167081A (ja) * 1974-12-07 1976-06-10 Fujitsu Ltd
JPS5892252A (ja) * 1981-11-27 1983-06-01 Fujitsu Ltd 半導体装置の製造方法
JPS59124767A (ja) * 1983-01-04 1984-07-18 Nec Corp 半導体・集積回路装置の製造方法

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01285580A (ja) * 1988-05-10 1989-11-16 Hitachi Elevator Eng & Service Co Ltd エレベータの制御装置
EP1154438A3 (en) * 2000-05-01 2003-10-29 Xerox Corporation Programmable circuit with preview function

Similar Documents

Publication Publication Date Title
US5485032A (en) Antifuse element with electrical or optical programming
US4960729A (en) Integrated circuits and a method for manufacture thereof
US5093710A (en) Semiconductor device having a layer of titanium nitride on the side walls of contact holes and method of fabricating same
JPS592352A (ja) 半導体装置の製造方法
US6551903B1 (en) Melt through contact formation method
JPH0249450A (ja) 集積回路を変更する方法
JPH02275624A (ja) オーミック電極の製造方法
JPS6231156A (ja) 半導体装置及びその製造方法
US3987217A (en) Metallization system for semiconductor devices, devices utilizing such metallization system and method for making devices and metallization system
US3945111A (en) Metallization system for semiconductor devices, devices utilizing such metallization system and method for making devices and metallization system
US3985515A (en) Metallization system for semiconductor devices, devices utilizing such metallization system and method for making devices and metallization system
US4077045A (en) Metallization system for semiconductive devices, devices utilizing such metallization system and method for making devices and metallization system
US5940727A (en) Technique for producing interconnecting conductive links
JPS6381948A (ja) 多層配線半導体装置
JP2577355B2 (ja) 半導体装置の製造方法
JPS62238658A (ja) 半導体集積回路装置の製造方法
JPH0387061A (ja) 半導体装置
JP3337758B2 (ja) 半導体装置の製造方法
JPH02170424A (ja) 半導体装置の製造方法
JPS6059678B2 (ja) プログラマブル・リ−ド・オンリ・メモリ素子
JPH04196526A (ja) 半導体装置及びその製造方法
JPH10223569A (ja) 半導体装置及び半導体装置の製造方法
JPS63111665A (ja) 半導体装置
JPS6348838A (ja) 半導体装置の製造方法
JPH0691088B2 (ja) 半導体装置の製造方法