JPS6239070A - トランジスタの製造法 - Google Patents
トランジスタの製造法Info
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- Y10S148/118—Oxide films
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- Recrystallisation Techniques (AREA)
- Thin Film Transistor (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、トランジスタの製造法に、詳しくは電界効
果薄膜トランジスタ(TPT)に適用できる製造法に関
するものである。
果薄膜トランジスタ(TPT)に適用できる製造法に関
するものである。
TPTを製造する場合に、経済的な理由で、その活性層
(ソース、ドレンおよびチャンネルの各領域を持った層
)として、非晶質(アモルファス)シリコン(a−81
)または「ポリシリコン」と呼ばれる多結晶シリコン(
p−Si)ft使用することが望まれている。更に、多
くの用途においてその様なTPTに印加される信号の周
波数という面から、移動度が高いことも必要である。活
性領域の上には2酸化シリコン(S’102)のような
材料から成る絶縁層が設けられ、またこの絶縁層の上に
は高濃度にドープされfca−SiまたはP−Siで形
成されたゲートが設けられている。もしこの絶縁層とし
て5102をa−6’xまたはp−8’x上に被着する
と、その絶縁層中にキャリヤ・トラップが存在すること
が判った。このトラップに捕捉された電子はTPTの閾
値電圧を偏位させる作用をする。もしp −Si上にS
iO2を成長させると、それは’p−3iの粒界(グレ
ン・バウンダリイ)に沿って優先的に成長するのでp−
3iの表面が粗くなる。この粗さは表面散乱を増加させ
るのでTPTのチャンネル領域におけるキャリヤの電界
効果(表面)移動度が低下することになる。もし、臨界
温度よシ相当低い温度でa−S:L上にSiO2を成長
させると、このa −Siは一般に結晶化するに足る時
間を持つことができない。このa−8i活性層は、p−
8iに比べると非秩序性(デグリ・オブ・ディスオーダ
)が大きいのでその電界効果移動度は低い。
(ソース、ドレンおよびチャンネルの各領域を持った層
)として、非晶質(アモルファス)シリコン(a−81
)または「ポリシリコン」と呼ばれる多結晶シリコン(
p−Si)ft使用することが望まれている。更に、多
くの用途においてその様なTPTに印加される信号の周
波数という面から、移動度が高いことも必要である。活
性領域の上には2酸化シリコン(S’102)のような
材料から成る絶縁層が設けられ、またこの絶縁層の上に
は高濃度にドープされfca−SiまたはP−Siで形
成されたゲートが設けられている。もしこの絶縁層とし
て5102をa−6’xまたはp−8’x上に被着する
と、その絶縁層中にキャリヤ・トラップが存在すること
が判った。このトラップに捕捉された電子はTPTの閾
値電圧を偏位させる作用をする。もしp −Si上にS
iO2を成長させると、それは’p−3iの粒界(グレ
ン・バウンダリイ)に沿って優先的に成長するのでp−
3iの表面が粗くなる。この粗さは表面散乱を増加させ
るのでTPTのチャンネル領域におけるキャリヤの電界
効果(表面)移動度が低下することになる。もし、臨界
温度よシ相当低い温度でa−S:L上にSiO2を成長
させると、このa −Siは一般に結晶化するに足る時
間を持つことができない。このa−8i活性層は、p−
8iに比べると非秩序性(デグリ・オブ・ディスオーダ
)が大きいのでその電界効果移動度は低い。
この発明は、平滑な表面を持った非晶質シリコン層を形
成し、この非晶質シリコンを臨界温度まt:はそれより
僅かに低い温度で酸化雰囲気中で加熱して上記の平滑表
面上に絶縁層を成長させると共に非晶質シリコン?多結
晶シリコンに変換させる過程を持った、トランジスタの
製造法である。
成し、この非晶質シリコンを臨界温度まt:はそれより
僅かに低い温度で酸化雰囲気中で加熱して上記の平滑表
面上に絶縁層を成長させると共に非晶質シリコン?多結
晶シリコンに変換させる過程を持った、トランジスタの
製造法である。
この結晶化はゆりくシと進行するので上記の平滑表面は
そのま一継持される。こうして得られた多、結晶体より
成るトランジスタは、平滑な界面が無く作られた多結晶
トランジスタや非晶質シリコントランジスタに比べて、
高い7界効果移動度金持つている。
そのま一継持される。こうして得られた多、結晶体より
成るトランジスタは、平滑な界面が無く作られた多結晶
トランジスタや非晶質シリコントランジスタに比べて、
高い7界効果移動度金持つている。
第1図には、たとえばガラスのような材料から成る基板
12上に形成された薄膜トランジスタ10が示されてい
る。その活性層14はp−3iより成り、基板12の表
面上にある。活性層14は、チャンキノ1/領域18を
間に挾んで各々p十導電型のソースおよびドレンの領域
16と20を持っている。活性層14の上および側方に
は、2酸化シリコン(5102)のような第1の絶縁層
23が設けられている。チャンネル領域18の上方で第
2の絶縁層22の内側にはp −8iゲート24がある
。金属化部26と28はそれぞれソース領域16とドレ
ン領域20に対する雷電的接触全形成している。
12上に形成された薄膜トランジスタ10が示されてい
る。その活性層14はp−3iより成り、基板12の表
面上にある。活性層14は、チャンキノ1/領域18を
間に挾んで各々p十導電型のソースおよびドレンの領域
16と20を持っている。活性層14の上および側方に
は、2酸化シリコン(5102)のような第1の絶縁層
23が設けられている。チャンネル領域18の上方で第
2の絶縁層22の内側にはp −8iゲート24がある
。金属化部26と28はそれぞれソース領域16とドレ
ン領域20に対する雷電的接触全形成している。
第2図は、約550’C〜570°C1好ましくは約5
60°Cの基板温度でシラン(S:LH4)から低圧化
学蒸着法(LPCVD )全周いて、約100〜500
ナノメ−) 、TI/(nu)の厚さとなるように活性
層14を被着すさせる第1工稈を示している。上記の温
度は、非晶質シリコンが多結晶シリコンに急速に変換す
る臨界温度Tc(約620°C)よシ低いので、活性層
14は平滑な上表面’L4ai有するa−6i、で構成
されている。低温でも結晶化は生じるがその速度は非常
に低いものである。詳しく言えば、結晶化時間は、核発
生が起るに必要な晶出誘導時間とそれからノリコンが生
じた核を中心としてそこから外方へエピタキシャル結晶
化する九めの時間とを含んでいる。これら両過程の速度
は温度が低くなると著しく遅くなる。この活性層上4は
、次いで周知の様にホトレジストとエツチング技法によ
って、形状が画定される。
60°Cの基板温度でシラン(S:LH4)から低圧化
学蒸着法(LPCVD )全周いて、約100〜500
ナノメ−) 、TI/(nu)の厚さとなるように活性
層14を被着すさせる第1工稈を示している。上記の温
度は、非晶質シリコンが多結晶シリコンに急速に変換す
る臨界温度Tc(約620°C)よシ低いので、活性層
14は平滑な上表面’L4ai有するa−6i、で構成
されている。低温でも結晶化は生じるがその速度は非常
に低いものである。詳しく言えば、結晶化時間は、核発
生が起るに必要な晶出誘導時間とそれからノリコンが生
じた核を中心としてそこから外方へエピタキシャル結晶
化する九めの時間とを含んでいる。これら両過程の速度
は温度が低くなると著しく遅くなる。この活性層上4は
、次いで周知の様にホトレジストとエツチング技法によ
って、形状が画定される。
第3図は、活性層14全酸化雰囲気中で臨界温度Tci
たはそれよシ僅かに低い温度で加熱する次の工程を示す
。この加熱工程を詳しく言えば、水蒸気100%の雰囲
気中で約580℃乃至620℃の温度に加熱して、5i
n2の第1絶縁層23を形成することである。たとえば
、厚さが60nmO層23を600℃で形成するには約
120時間を要する。もし必要とするなら、加熱時間を
これよυも長く或いは短くして、よシ厚いまたは薄い絶
縁層22aを作ることができる。この工程中に活性層1
4の結晶化(a−3iからp −S3への変換)が起る
が、それは充分ゆっくりと(600’Cで数時間か−る
)起るので表面14aの平滑さは変らない。従って、完
成したTFT 10ば、表面14aが平滑に保たれなか
った場合に比べて、より高い電界効果移動度を持つこと
になる。
たはそれよシ僅かに低い温度で加熱する次の工程を示す
。この加熱工程を詳しく言えば、水蒸気100%の雰囲
気中で約580℃乃至620℃の温度に加熱して、5i
n2の第1絶縁層23を形成することである。たとえば
、厚さが60nmO層23を600℃で形成するには約
120時間を要する。もし必要とするなら、加熱時間を
これよυも長く或いは短くして、よシ厚いまたは薄い絶
縁層22aを作ることができる。この工程中に活性層1
4の結晶化(a−3iからp −S3への変換)が起る
が、それは充分ゆっくりと(600’Cで数時間か−る
)起るので表面14aの平滑さは変らない。従って、完
成したTFT 10ば、表面14aが平滑に保たれなか
った場合に比べて、より高い電界効果移動度を持つこと
になる。
第4図は、LPCVD法を使用してSiH4から厚さが
500 nmの第2のa −Si一層を形成する、次の
工程を示す。この層は引続いて通常の方法で画定されて
ゲート24になる。pチャンネルTPTを製作するため
に、次にこの全構体に、矢印30で示されるように、3
5キロ軍子ポル) (keV )で単位面積当シの濃度
8×1015イオン/ cm2fもってほう素イオンの
注入を行なう。Nチャンネル装置を作る場合には、この
ほう素の代シに隣またはひ素のようなN型導電度変更剤
のイオン注入を行なえが良い。チャンネル領域18はゲ
ート24によって注入イオンからマスクされるが、ソー
ス領域16とドレン領域20はこのイオン注入によって
p十導電型領域となる。
500 nmの第2のa −Si一層を形成する、次の
工程を示す。この層は引続いて通常の方法で画定されて
ゲート24になる。pチャンネルTPTを製作するため
に、次にこの全構体に、矢印30で示されるように、3
5キロ軍子ポル) (keV )で単位面積当シの濃度
8×1015イオン/ cm2fもってほう素イオンの
注入を行なう。Nチャンネル装置を作る場合には、この
ほう素の代シに隣またはひ素のようなN型導電度変更剤
のイオン注入を行なえが良い。チャンネル領域18はゲ
ート24によって注入イオンからマスクされるが、ソー
ス領域16とドレン領域20はこのイオン注入によって
p十導電型領域となる。
このTPTIOは、次に約600°Cで4時間加熱され
て注入イオンを活性化しまたゲート242p−3j−に
変換してその抵抗を低下させる。この工程は、水蒸気ま
たは乾燥02のような酸化雰囲気中で行なうことが望ま
しい。そうすれば、ゲート24の頂部と側部とに非常に
清浄で(不純物を含まない)かつ非常に薄いSiO20
層(図示せず)?形成できる。水蒸気は酸化速度が速い
ので02よりも好ましい。
て注入イオンを活性化しまたゲート242p−3j−に
変換してその抵抗を低下させる。この工程は、水蒸気ま
たは乾燥02のような酸化雰囲気中で行なうことが望ま
しい。そうすれば、ゲート24の頂部と側部とに非常に
清浄で(不純物を含まない)かつ非常に薄いSiO20
層(図示せず)?形成できる。水蒸気は酸化速度が速い
ので02よりも好ましい。
上記以後の工程は普通の通りである。Si、H4と02
の1気圧雰囲気中でCVD法によりSiO2の層22を
約200乃至11000nの厚さに被着させる。次にソ
ース領域16とドレン領域20に対する接触用開孔を開
け、アルミニウム全スパッタまたは蒸着させた後これを
成形して金属化層26と28を形成する。最後に、LP
CVD法金使用してシリコン窒化物の密封層(図示せず
)を被着する。
の1気圧雰囲気中でCVD法によりSiO2の層22を
約200乃至11000nの厚さに被着させる。次にソ
ース領域16とドレン領域20に対する接触用開孔を開
け、アルミニウム全スパッタまたは蒸着させた後これを
成形して金属化層26と28を形成する。最後に、LP
CVD法金使用してシリコン窒化物の密封層(図示せず
)を被着する。
実施例
T、PCVD法により560’Cの温度で被着させ念厚
さが200 nmの活性層と、1気圧の水蒸気の雰囲気
中で600”Cで120時間成畏3せた厚さが60nl
llの絶縁層2有するTFT iこの発明により製造し
た。こうして得たTPTは、代表的な価として、その導
電率データから算定し−(15cm2/ v−s乃至5
0 am”/v−sの範囲の電界効果移動度2持ってい
た。
さが200 nmの活性層と、1気圧の水蒸気の雰囲気
中で600”Cで120時間成畏3せた厚さが60nl
llの絶縁層2有するTFT iこの発明により製造し
た。こうして得たTPTは、代表的な価として、その導
電率データから算定し−(15cm2/ v−s乃至5
0 am”/v−sの範囲の電界効果移動度2持ってい
た。
比較例
上記のこの発明の実施例と同じく、LPCVD法により
560°Cで被着した厚さが20011mの活性層を有
する幾つかのTPTを作成した。しかし、この発明によ
るTPTとは違ってこれらのTPTは、すべてその厚さ
は90[±5nmであるがそれぞれ’700’Cで15
時間、750℃で6時間、800℃で2.5時間および
850’Cで1時間かけて成長させた絶縁層を有するも
のであった。その他の製造パラメータは上記この発明に
よって製造したTPTのそれと同一であった。この様な
TPTの移動度は1〜4 cm2/v−sであった。
560°Cで被着した厚さが20011mの活性層を有
する幾つかのTPTを作成した。しかし、この発明によ
るTPTとは違ってこれらのTPTは、すべてその厚さ
は90[±5nmであるがそれぞれ’700’Cで15
時間、750℃で6時間、800℃で2.5時間および
850’Cで1時間かけて成長させた絶縁層を有するも
のであった。その他の製造パラメータは上記この発明に
よって製造したTPTのそれと同一であった。この様な
TPTの移動度は1〜4 cm2/v−sであった。
この発明は、液晶表示器用のおよびエレクトロルミネッ
センス表示器用の駆動トランジスタの製造に有効である
。この様な表示器は、標準テレビジョン信号全表示する
場合にその信号が含む周波数の関係で一般に少なくとも
100m2/v−Sの移動度をすることが必要である。
センス表示器用の駆動トランジスタの製造に有効である
。この様な表示器は、標準テレビジョン信号全表示する
場合にその信号が含む周波数の関係で一般に少なくとも
100m2/v−Sの移動度をすることが必要である。
更に、この様なトランジスタを多数必要とするので、そ
の製造方法は低原価のものでなくてはならない。この発
明方法ヲ使って製造したトランジスタは上記のような諸
要求に充分こたえ得るものである。
の製造方法は低原価のものでなくてはならない。この発
明方法ヲ使って製造したトランジスタは上記のような諸
要求に充分こたえ得るものである。
第1図はこの発明の製造法により製造された一例TPT
の横断面図、第2図、第3図および第4図はこの発明の
方法の各順次製造工程期間中における第1図のTPTの
状態2示す横断面図である。 12・・・基板、14・・・活性層、16・・・ソース
領域。 18・・・チャンネル領域、20・・・ドレン領域、2
4・・・・ゲート、23・・・第1の絶縁層、22−@
第2の絶縁層。
の横断面図、第2図、第3図および第4図はこの発明の
方法の各順次製造工程期間中における第1図のTPTの
状態2示す横断面図である。 12・・・基板、14・・・活性層、16・・・ソース
領域。 18・・・チャンネル領域、20・・・ドレン領域、2
4・・・・ゲート、23・・・第1の絶縁層、22−@
第2の絶縁層。
Claims (1)
- (1)形成される層表面が平滑になるように基板上に第
1の非晶質シリコン層を形成する工程と、この平滑な表
面を維持したまゝ上記の非晶質シリコン層を酸化雰囲気
中でシリコンの臨界温度または臨界温度より僅かに低い
温度で加熱して上記平滑な平面上に絶縁層を形成すると
共に上記非晶質シリコン層を多結晶シリコン層に変換す
る工程と、上記絶縁層上にゲートを形成する工程と、上
記シリコン層中に上記ゲートに近接してソース領域とド
レン領域を形成する工程と、より成るトランジスタの製
造法。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US763968 | 1985-08-09 | ||
| US06/763,968 US4597160A (en) | 1985-08-09 | 1985-08-09 | Method of fabricating a polysilicon transistor with a high carrier mobility |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6239070A true JPS6239070A (ja) | 1987-02-20 |
| JPH07105501B2 JPH07105501B2 (ja) | 1995-11-13 |
Family
ID=25069332
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61186703A Expired - Lifetime JPH07105501B2 (ja) | 1985-08-09 | 1986-08-07 | トランジスタの製造法 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US4597160A (ja) |
| JP (1) | JPH07105501B2 (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63307776A (ja) * | 1987-06-10 | 1988-12-15 | Hitachi Ltd | 薄膜半導体装置とその製造方法 |
| JPH0794751A (ja) * | 1993-09-16 | 1995-04-07 | Semiconductor Energy Lab Co Ltd | 半導体装置およびその作製方法 |
| JPH08186262A (ja) * | 1994-12-19 | 1996-07-16 | Korea Electron Telecommun | 薄膜トランジスタの製造方法 |
Families Citing this family (71)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2505736B2 (ja) * | 1985-06-18 | 1996-06-12 | キヤノン株式会社 | 半導体装置の製造方法 |
| US5962869A (en) * | 1988-09-28 | 1999-10-05 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor material and method for forming the same and thin film transistor |
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