JPH07105501B2 - トランジスタの製造法 - Google Patents
トランジスタの製造法Info
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- JPH07105501B2 JPH07105501B2 JP61186703A JP18670386A JPH07105501B2 JP H07105501 B2 JPH07105501 B2 JP H07105501B2 JP 61186703 A JP61186703 A JP 61186703A JP 18670386 A JP18670386 A JP 18670386A JP H07105501 B2 JPH07105501 B2 JP H07105501B2
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- tft
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- insulating layer
- amorphous silicon
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- H10D30/0312—Manufacture or treatment of FETs having insulated gates [IGFET] of thin-film transistors [TFT] characterised by the gate electrodes
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- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10S—TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
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- Y10S148/118—Oxide films
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- Thin Film Transistor (AREA)
Description
【発明の詳細な説明】 〔産業上の利用分野〕 この発明は、トランジスタの製造法に、詳しくは電界効
果薄膜トランジスタ(TFT)に適用できる製造法に関す
るものである。
果薄膜トランジスタ(TFT)に適用できる製造法に関す
るものである。
〔発明の背景〕 TFTを製造する場合に、経済的な理由で、その活性層
(ソース、ドレンおよびチヤンネルの各領域を持つた
層)として、非晶質(アモルフアス)シリコン(a−S
i)または「ポリシリコン」と呼ばれる多結晶シリコン
(p−Si)を使用することが望まれている。更に、多く
の用途においてその様なTFTに印加される信号の周波数
という面から、移動度が高いことも必要である。活性領
域の上には2酸化シリコン(SiO2)のような材料から成
る絶縁層が設けられ、またこの絶縁層の上には高濃度に
ドープされたa−SiまたはP−Siで形成されたゲートが
設けられている。もしこの絶縁層としてSiO2をa−Siま
たはp−Si上に被着すると、その絶縁層中にキヤリヤ・
トラツプが存在することが判つた。このトラツプに捕捉
された電子はTFTの閾値電圧を偏位させる作用をする。
もしp−Si上にSiO2を成長させると、それはp−Siの粒
界(グレン・バウンダリイ)に沿つて優先的に成長する
のでp−Siの表面が粗くなる。この粗さは表面散乱を増
加させるのでTFTのチヤンネル領域におけるキヤリヤ電
界効果(表面)移動度が低下することになる。もし、臨
界温度より相当低い温度でa−Si上にSiO2を成長させる
と、このa−Siは一般に結晶化するに足る時間を持つこ
とができない。このa−Si活性層は、p−Siに比べると
非秩序性(デグリ・オブ・デイスオーダ)が大きいので
その電界効果移動度は低い。
(ソース、ドレンおよびチヤンネルの各領域を持つた
層)として、非晶質(アモルフアス)シリコン(a−S
i)または「ポリシリコン」と呼ばれる多結晶シリコン
(p−Si)を使用することが望まれている。更に、多く
の用途においてその様なTFTに印加される信号の周波数
という面から、移動度が高いことも必要である。活性領
域の上には2酸化シリコン(SiO2)のような材料から成
る絶縁層が設けられ、またこの絶縁層の上には高濃度に
ドープされたa−SiまたはP−Siで形成されたゲートが
設けられている。もしこの絶縁層としてSiO2をa−Siま
たはp−Si上に被着すると、その絶縁層中にキヤリヤ・
トラツプが存在することが判つた。このトラツプに捕捉
された電子はTFTの閾値電圧を偏位させる作用をする。
もしp−Si上にSiO2を成長させると、それはp−Siの粒
界(グレン・バウンダリイ)に沿つて優先的に成長する
のでp−Siの表面が粗くなる。この粗さは表面散乱を増
加させるのでTFTのチヤンネル領域におけるキヤリヤ電
界効果(表面)移動度が低下することになる。もし、臨
界温度より相当低い温度でa−Si上にSiO2を成長させる
と、このa−Siは一般に結晶化するに足る時間を持つこ
とができない。このa−Si活性層は、p−Siに比べると
非秩序性(デグリ・オブ・デイスオーダ)が大きいので
その電界効果移動度は低い。
本発明によるトランジスタの製造方法によれば、まず、
基板上に低圧化学蒸着法により550℃〜570℃の基板温度
で非晶質シリコン層が形成される。次に、580℃〜620℃
の酸化雰囲気中で非晶質シリコン層の表面を酸化させる
ことにより絶縁層が形成されると共に非晶質シリコン層
が多結晶シリコン層に変換される。そして、絶縁層上に
ゲートが形成され、多結晶シリコン層中にソース領域お
よびドレイン領域が形成される。このような製造方法に
よれば、非晶質シリコン層の結晶化がゆっくりと進行す
るので、多結晶シリコン層の表面は平滑な表面となる。
こうして得られた多結晶体より成るトランジスタは、平
滑な界面が無く作られた多結晶トランジスタや非晶質シ
リコントランジスタに比べて、高い電界効果移動度を持
つている。
基板上に低圧化学蒸着法により550℃〜570℃の基板温度
で非晶質シリコン層が形成される。次に、580℃〜620℃
の酸化雰囲気中で非晶質シリコン層の表面を酸化させる
ことにより絶縁層が形成されると共に非晶質シリコン層
が多結晶シリコン層に変換される。そして、絶縁層上に
ゲートが形成され、多結晶シリコン層中にソース領域お
よびドレイン領域が形成される。このような製造方法に
よれば、非晶質シリコン層の結晶化がゆっくりと進行す
るので、多結晶シリコン層の表面は平滑な表面となる。
こうして得られた多結晶体より成るトランジスタは、平
滑な界面が無く作られた多結晶トランジスタや非晶質シ
リコントランジスタに比べて、高い電界効果移動度を持
つている。
第1図には、たとえばガラスのような材料から成る基板
12上に形成された薄膜トランジタ10が示されている。そ
の活性層14はp−Siより成り、基板12の表面上にある。
活性層14は、チヤンネル領域18を間に挾んで各々p+導
電型ソースおよびドレンの領域16と20を持つている。活
性層14の上および側方には、2酸化シリコン(SiO2)の
ような第1の絶縁層23が設けられている。チヤンネル領
域18の上方で第2の絶縁層22の内側にはp−Siゲート24
がある。金属化部26と28はそれぞれソース領域16とドレ
ン両20に対する電気的接触を形成している。
12上に形成された薄膜トランジタ10が示されている。そ
の活性層14はp−Siより成り、基板12の表面上にある。
活性層14は、チヤンネル領域18を間に挾んで各々p+導
電型ソースおよびドレンの領域16と20を持つている。活
性層14の上および側方には、2酸化シリコン(SiO2)の
ような第1の絶縁層23が設けられている。チヤンネル領
域18の上方で第2の絶縁層22の内側にはp−Siゲート24
がある。金属化部26と28はそれぞれソース領域16とドレ
ン両20に対する電気的接触を形成している。
第2図は、約550℃〜570℃、好ましくは約560℃の基板
温度でシラン(SiH4)から低圧化学蒸着法(LPCVD)を
用いて、約100〜500ナノメートル(nm)の厚さとなるよ
うに活性層14を被着すさせる第1工程を示している。上
記の温度は、非晶質シリコンが多結晶シリコンに急速に
変換する臨界温度TC(約620℃)より低いので、活性層1
4は平滑な上表面14aをするa−Siで構成されている。低
温でも結晶化は生じるがその速度は非常に低いものであ
る。詳しく言えば、結晶化時間は、核発生が起るに必要
な晶出誘導時間とそれからシリコンが生じた核を中心と
してそこから外方へエピタキシヤル結晶化するための時
間とを含んでいる。これら両過程の速度は温度が低くな
ると著しく遅くなる。この活性層14は、次いで周知の様
にホトレジストエツチング技法によつて、形状が画定さ
れる。
温度でシラン(SiH4)から低圧化学蒸着法(LPCVD)を
用いて、約100〜500ナノメートル(nm)の厚さとなるよ
うに活性層14を被着すさせる第1工程を示している。上
記の温度は、非晶質シリコンが多結晶シリコンに急速に
変換する臨界温度TC(約620℃)より低いので、活性層1
4は平滑な上表面14aをするa−Siで構成されている。低
温でも結晶化は生じるがその速度は非常に低いものであ
る。詳しく言えば、結晶化時間は、核発生が起るに必要
な晶出誘導時間とそれからシリコンが生じた核を中心と
してそこから外方へエピタキシヤル結晶化するための時
間とを含んでいる。これら両過程の速度は温度が低くな
ると著しく遅くなる。この活性層14は、次いで周知の様
にホトレジストエツチング技法によつて、形状が画定さ
れる。
第3図は、活性層14を酸化雰囲気中で臨界温度Tcまたは
それより僅かに低い温度で加熱する次の工程を示す。こ
の加熱工程を詳しく言えば、水蒸気100%の雰囲気中で
約580℃内620℃の温度に加熱して、SiO2の第1絶縁層23
を形成することである。たとえば、厚さが60nmの層23を
600℃で形成するには約120時間を要する。もし必要とす
るなら、加熱時間をこれよりも長く或いは短くして、よ
り厚いまたは薄い絶縁層22aを作ることができる。この
工程中に活性層14の結晶化(a−Siからp−Siへの変
換)が起るが、それは充分ゆつくりと(600℃で数時間
かかる)起るので表面14aの平滑さは変らない。従つ
て、完成したTFT10は、表面14aが平滑に保たれなかつた
場合に比べて、より高い電界効果移動度を持つことにな
る。
それより僅かに低い温度で加熱する次の工程を示す。こ
の加熱工程を詳しく言えば、水蒸気100%の雰囲気中で
約580℃内620℃の温度に加熱して、SiO2の第1絶縁層23
を形成することである。たとえば、厚さが60nmの層23を
600℃で形成するには約120時間を要する。もし必要とす
るなら、加熱時間をこれよりも長く或いは短くして、よ
り厚いまたは薄い絶縁層22aを作ることができる。この
工程中に活性層14の結晶化(a−Siからp−Siへの変
換)が起るが、それは充分ゆつくりと(600℃で数時間
かかる)起るので表面14aの平滑さは変らない。従つ
て、完成したTFT10は、表面14aが平滑に保たれなかつた
場合に比べて、より高い電界効果移動度を持つことにな
る。
第4図は、LPCVD法を使用してSiH4から厚さが500nmの第
2のa−Si層を形成する、次の工程を示す。この層は引
続いて通常の方法で画定されてゲート24になる。pチヤ
ンネルTFTを製作するために、次にこの全構体に、矢印3
0で示されるように、35キロ電子ボルト(kev)で単位面
積当りの濃度8×1015イオン/cm2をもつてほう素イオン
の注入を行なう。Nチヤンネル装置を作る場合には、こ
のほう素の代りに隣またひ素のようなN型導電度変更剤
のイオン注入を行なえが良い。チヤンネル領域18はゲー
ト24によつて注入イオンからマスクされるが、ソース領
域16とドレン領域20はこのイオン注入によつてp+導電型
領域となる。このTFT10は、次に約600℃で4時間加熱さ
れて注入イオンを活性化しまたゲート24をp−Siに変換
してその抵抗を低下させる。この工程は、水蒸気または
乾燥O2のような酸化雰囲気中で行なうことが望ましい。
そうすれば、ゲート24の頂部と側部とに非常に清浄で
(不純物を含まない)かつ非常に薄いSiO2の層(図示せ
ず)を形成できる。水蒸気は酸化速度が速いのでO2より
も好ましい。
2のa−Si層を形成する、次の工程を示す。この層は引
続いて通常の方法で画定されてゲート24になる。pチヤ
ンネルTFTを製作するために、次にこの全構体に、矢印3
0で示されるように、35キロ電子ボルト(kev)で単位面
積当りの濃度8×1015イオン/cm2をもつてほう素イオン
の注入を行なう。Nチヤンネル装置を作る場合には、こ
のほう素の代りに隣またひ素のようなN型導電度変更剤
のイオン注入を行なえが良い。チヤンネル領域18はゲー
ト24によつて注入イオンからマスクされるが、ソース領
域16とドレン領域20はこのイオン注入によつてp+導電型
領域となる。このTFT10は、次に約600℃で4時間加熱さ
れて注入イオンを活性化しまたゲート24をp−Siに変換
してその抵抗を低下させる。この工程は、水蒸気または
乾燥O2のような酸化雰囲気中で行なうことが望ましい。
そうすれば、ゲート24の頂部と側部とに非常に清浄で
(不純物を含まない)かつ非常に薄いSiO2の層(図示せ
ず)を形成できる。水蒸気は酸化速度が速いのでO2より
も好ましい。
上記以後の工程は普通の通りである。SiH4とO2の1気圧
雰囲気中でCVD法によりSiO2の層22を約200乃至1000nmの
厚さに被着させる。次にソース領域16とドレン領域20に
対する接触用開孔を開け、アルミニウムをスパツタまた
は蒸着させた後これを成形して金属化層26と28を形成す
る。最後に、LPCVD法を使用してシリコン窒化物の密封
層(図示せず)を被着する。
雰囲気中でCVD法によりSiO2の層22を約200乃至1000nmの
厚さに被着させる。次にソース領域16とドレン領域20に
対する接触用開孔を開け、アルミニウムをスパツタまた
は蒸着させた後これを成形して金属化層26と28を形成す
る。最後に、LPCVD法を使用してシリコン窒化物の密封
層(図示せず)を被着する。
実施例 LPCVD法により560℃の温度で被着させた厚さが200nmの
活性層と、1気圧の水蒸気の雰囲気中で600℃で120時間
成長させた厚さが60nmの絶縁層を有するTFTをこの発明
により製造した。こうして得たTFTは、代表的な価とし
て、その導電率データから算定して15cm2/v−s乃至50c
m2/v−sの範囲の電界効果移動度を持つていた。
活性層と、1気圧の水蒸気の雰囲気中で600℃で120時間
成長させた厚さが60nmの絶縁層を有するTFTをこの発明
により製造した。こうして得たTFTは、代表的な価とし
て、その導電率データから算定して15cm2/v−s乃至50c
m2/v−sの範囲の電界効果移動度を持つていた。
比較例 上記のこの発明の実施例と同じく、LPCVD法により560℃
で被着した厚さが200nmの活性層を有する幾つかのTFTを
作成した。しかし、この発明によるTFTとは違つてこれ
らのTFTは、すべてその厚さは90nm±5nmであるがそれぞ
れ700℃で15時間、750℃で6時間、800℃で2.5時間およ
び850℃で1時間かけて成長させた絶縁層を有するもの
であつた。その多の製造パラメータは上記この発明によ
つて製造したTFTのそれと同一であつた。この様なTFTの
移動度は1〜4cm2/v−sであつた。
で被着した厚さが200nmの活性層を有する幾つかのTFTを
作成した。しかし、この発明によるTFTとは違つてこれ
らのTFTは、すべてその厚さは90nm±5nmであるがそれぞ
れ700℃で15時間、750℃で6時間、800℃で2.5時間およ
び850℃で1時間かけて成長させた絶縁層を有するもの
であつた。その多の製造パラメータは上記この発明によ
つて製造したTFTのそれと同一であつた。この様なTFTの
移動度は1〜4cm2/v−sであつた。
この発明は、液晶表示器用のおよびエレクトロルミネツ
センス表示器用の駆動トランジスタの製造に有効であ
る。この様な表示器は、標準テレビジヨン信号を表示す
る場合にその信号が含む周波数の関係で一般に少なくと
も10cm2/v−sの移動度をすることが必要である。更
に、この様なトランジスタを多数必要とするので、その
製造方法は低原価のものでなくてはならない。この発明
方法を使つて製造したトランジスタは上記のような諸要
求に充分こたえ得るものである。
センス表示器用の駆動トランジスタの製造に有効であ
る。この様な表示器は、標準テレビジヨン信号を表示す
る場合にその信号が含む周波数の関係で一般に少なくと
も10cm2/v−sの移動度をすることが必要である。更
に、この様なトランジスタを多数必要とするので、その
製造方法は低原価のものでなくてはならない。この発明
方法を使つて製造したトランジスタは上記のような諸要
求に充分こたえ得るものである。
第1図はこの発明の製造法により製造された一例TFTの
横断面図、第2図、第3図および第4図はこの発明の方
法の各順次製造工程期間中における第1図のTFTの状態
を示す横断面図である。 12……基板、14……活性層、16……ソース領域、18……
チヤンネル領域、20……ドレン領域、24……ゲート、23
……第1の絶縁層、22……第2の絶縁層。
横断面図、第2図、第3図および第4図はこの発明の方
法の各順次製造工程期間中における第1図のTFTの状態
を示す横断面図である。 12……基板、14……活性層、16……ソース領域、18……
チヤンネル領域、20……ドレン領域、24……ゲート、23
……第1の絶縁層、22……第2の絶縁層。
Claims (1)
- 【請求項1】基板上に低圧化学蒸着法により550℃〜570
℃の基板温度で非晶質シリコン層を形成する工程と、58
0℃〜620℃の酸化雰囲気中で上記非晶質シリコン層の表
面を酸化させることにより絶縁層を形成すると共に上記
非晶質シリコン層を多結晶シリコン層に変換する工程
と、上記絶縁層上にゲートを形成する工程と、上記多結
晶シリコン層中にソース領域およびドレイン領域を形成
する工程と、よりなるトランジスタの製造法。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US06/763,968 US4597160A (en) | 1985-08-09 | 1985-08-09 | Method of fabricating a polysilicon transistor with a high carrier mobility |
| US763968 | 1985-08-09 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6239070A JPS6239070A (ja) | 1987-02-20 |
| JPH07105501B2 true JPH07105501B2 (ja) | 1995-11-13 |
Family
ID=25069332
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61186703A Expired - Lifetime JPH07105501B2 (ja) | 1985-08-09 | 1986-08-07 | トランジスタの製造法 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US4597160A (ja) |
| JP (1) | JPH07105501B2 (ja) |
Families Citing this family (74)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2505736B2 (ja) * | 1985-06-18 | 1996-06-12 | キヤノン株式会社 | 半導体装置の製造方法 |
| US5753542A (en) * | 1985-08-02 | 1998-05-19 | Semiconductor Energy Laboratory Co., Ltd. | Method for crystallizing semiconductor material without exposing it to air |
| US5962869A (en) * | 1988-09-28 | 1999-10-05 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor material and method for forming the same and thin film transistor |
| JPS63307776A (ja) * | 1987-06-10 | 1988-12-15 | Hitachi Ltd | 薄膜半導体装置とその製造方法 |
| US5248630A (en) * | 1987-07-27 | 1993-09-28 | Nippon Telegraph And Telephone Corporation | Thin film silicon semiconductor device and process for producing thereof |
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