JPS6266330A - 命令カウンタのロ−ド装置 - Google Patents
命令カウンタのロ−ド装置Info
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- JPS6266330A JPS6266330A JP60205202A JP20520285A JPS6266330A JP S6266330 A JPS6266330 A JP S6266330A JP 60205202 A JP60205202 A JP 60205202A JP 20520285 A JP20520285 A JP 20520285A JP S6266330 A JPS6266330 A JP S6266330A
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- JP
- Japan
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- segment
- descriptor
- instruction
- field
- segment descriptor
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- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F12/00—Accessing, addressing or allocating within memory systems or architectures
- G06F12/02—Addressing or allocation; Relocation
- G06F12/0223—User address space allocation, e.g. contiguous or non contiguous base addressing
- G06F12/0292—User address space allocation, e.g. contiguous or non contiguous base addressing using tables or multilevel address translation means
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- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Executing Machine-Instructions (AREA)
- Memory System (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
〔従来の技術〕
ある命令セグメント内の命令を実行中９分岐命令によっ
てその実行中の命令セグメントから別の命令セグメント
に移る場合がある。さらに、それらの命令セグメントを
規定しているセグメント記述子の集合から別のセグメン
ト記述子の集合に移る場合もある。そのときは新たに命
令セグメントレジスタの内容と命令カウンタの内容を変
更しなげればならない。このような場合には入口記述子
が使用される。
てその実行中の命令セグメントから別の命令セグメント
に移る場合がある。さらに、それらの命令セグメントを
規定しているセグメント記述子の集合から別のセグメン
ト記述子の集合に移る場合もある。そのときは新たに命
令セグメントレジスタの内容と命令カウンタの内容を変
更しなげればならない。このような場合には入口記述子
が使用される。
第５図は従来の入口記述子による命令語の指定を行って
命令カウンタヘロードする装置の構成を示す図である。
命令カウンタヘロードする装置の構成を示す図である。
入口記述子６１は、セグメント記述子セグメント６６の
開始アドレスを示す２６ビールド６４と、セグメント記
述子セグメント６６内のセグメント記述子を指定する１
０ビツトのｌ５ＥＧＮＯフイールド６３と、命令カウン
タ６７にロードされる１８ビツトのロケーションフィー
ルド６２とから構成されている。
開始アドレスを示す２６ビールド６４と、セグメント記
述子セグメント６６内のセグメント記述子を指定する１
０ビツトのｌ５ＥＧＮＯフイールド６３と、命令カウン
タ６７にロードされる１８ビツトのロケーションフィー
ルド６２とから構成されている。
まず入口記述子６１のスタートフィールド６５とサイズ
フィールド６４がセグメント記述子セグメント６６を規
定する。
フィールド６４がセグメント記述子セグメント６６を規
定する。
次に入口記述子６１のＩ ５ＥＣＮＯフイールド６３に
よって、セグメント記述子セグメント６６内からセグメ
ント記述子が読出され、命令セグメント記述子レジスタ
６８に格納される。命令セグメント記述子レジスタ６８
は、２０ビツトのバウンドフィールド６９と３６ビツト
のベースフィールド７０から構成されている。ベースフ
ィールド７゜とバウンドフィールド６９が命令セグメン
ト７１を規定する。
よって、セグメント記述子セグメント６６内からセグメ
ント記述子が読出され、命令セグメント記述子レジスタ
６８に格納される。命令セグメント記述子レジスタ６８
は、２０ビツトのバウンドフィールド６９と３６ビツト
のベースフィールド７０から構成されている。ベースフ
ィールド７゜とバウンドフィールド６９が命令セグメン
ト７１を規定する。
、を後に入口記述子６１のロケーションフィールド６２
が命令カウンタ６７にロードされる。命令カウンタ６７
は命令セグメント７１内の命令語の’７トｌ／スを示し
ている。
が命令カウンタ６７にロードされる。命令カウンタ６７
は命令セグメント７１内の命令語の’７トｌ／スを示し
ている。
上述した従来の命令セグメント記述子レジスタ６８のノ
ぐランドフィールド６９は、そのままバイトアドレスと
して使われ、最高２２°バイトまでしがセグメントを規
定できなかった。
ぐランドフィールド６９は、そのままバイトアドレスと
して使われ、最高２２°バイトまでしがセグメントを規
定できなかった。
そこで拡張セグメント記述子なるものが導入され、２０
ビツトのバウンドフィールドと３６ビツトのベースフィ
ールドを持たすことが提案され。
ビツトのバウンドフィールドと３６ビツトのベースフィ
ールドを持たすことが提案され。
２０ビツトのノぐランドフィールドは２１２バイト単位
で表されているので、最高２３２バイトの大きさのセグ
メントを規定できるはずである。
で表されているので、最高２３２バイトの大きさのセグ
メントを規定できるはずである。
しかしながら従来の命令カウンタのロード方法では１８
ビツトしか指定できないため、拡張した命令セグメント
内のすべての命令語をアクセスすることはできなかった
。
ビツトしか指定できないため、拡張した命令セグメント
内のすべての命令語をアクセスすることはできなかった
。
本発明の命令カウンタのロード装置は、命令語を含む命
令セグメントを規定するセグメント記述前記セグメント
記述子を含むセグメント記述子レジスタと、前記命令セ
グメント内にある前記命令語のアドレスを指定する命令
カウンタを有する演算処理装置とを含んでいるデータ処
理システムにおける前記命令カウンタのロードを行う装
置において、前記セグメント記述子が前記命令セグメン
トの開始アドレスを指定するヘースフィールドト、大き
さを指定するバウンドフィールドとを有しており課前記
入口記述子が前記セグメント記述子セグメントの開始ア
ドレスを指定するスタートフィールドと、大きさを指定
するサイズフィールドと、前記セグメント記述子セグメ
ント内にあるセグメント記述子を指定するＩ Ｓ ＥＧ
ＮＯフィールドと、 ＤＳＥＧＮＯフィールドとを有し
ていて、前記入口記述子の前記ｌ５ＥＧＮＯフイールド
によって前記セグメント記述子セグメントから前記セグ
メント記述子を読み出して前記命令セグメント記述子レ
ジスタに格納する手段と、前記入口記述子の前記Ｄ ５
ＥＧＮＯフイールドによって前記セグメント記述子セグ
メントから前記セグメント記述子を読出し。
令セグメントを規定するセグメント記述前記セグメント
記述子を含むセグメント記述子レジスタと、前記命令セ
グメント内にある前記命令語のアドレスを指定する命令
カウンタを有する演算処理装置とを含んでいるデータ処
理システムにおける前記命令カウンタのロードを行う装
置において、前記セグメント記述子が前記命令セグメン
トの開始アドレスを指定するヘースフィールドト、大き
さを指定するバウンドフィールドとを有しており課前記
入口記述子が前記セグメント記述子セグメントの開始ア
ドレスを指定するスタートフィールドと、大きさを指定
するサイズフィールドと、前記セグメント記述子セグメ
ント内にあるセグメント記述子を指定するＩ Ｓ ＥＧ
ＮＯフィールドと、 ＤＳＥＧＮＯフィールドとを有し
ていて、前記入口記述子の前記ｌ５ＥＧＮＯフイールド
によって前記セグメント記述子セグメントから前記セグ
メント記述子を読み出して前記命令セグメント記述子レ
ジスタに格納する手段と、前記入口記述子の前記Ｄ ５
ＥＧＮＯフイールドによって前記セグメント記述子セグ
メントから前記セグメント記述子を読出し。
読み出した前記セグメント記述子の前記ベースフ〔実施
例〕 次に本発明について図面を参照して説明する。
例〕 次に本発明について図面を参照して説明する。
第１図は本発明の概念を表している。入口記述子１は、
ＤＳＥＧＮＯフィールド２と、 ｌ５ＥＧＮＯフイー
ルド３と、サイズフィールド４と、スタートフィールド
５とから構成されている。スタートフィールド５はセグ
メント記述子セグメント６の開始アドレスを示している
。サイズフィールド４は、セグメント記述子セグメント
６の大きさをバイト単位で示している。Ｉ ５ＥＧＮＯ
フイールド３ば１０ビツトのフィールドであり、セグメ
ント記述子セグメント６の中のセグメント記述子の番号
を示している。
ＤＳＥＧＮＯフィールド２と、 ｌ５ＥＧＮＯフイー
ルド３と、サイズフィールド４と、スタートフィールド
５とから構成されている。スタートフィールド５はセグ
メント記述子セグメント６の開始アドレスを示している
。サイズフィールド４は、セグメント記述子セグメント
６の大きさをバイト単位で示している。Ｉ ５ＥＧＮＯ
フイールド３ば１０ビツトのフィールドであり、セグメ
ント記述子セグメント６の中のセグメント記述子の番号
を示している。
すなわち、 ｌ５ＥＧＮＯフイールド４は、２５バイト
単位で表されており、スタートフィールド５からの相対
アドレスとなる。ＤＳＥＧＮＯフィールド２は１０ビツ
トのフィールドであり、セグメント記述子セグメント６
の中のセグメント記述子の番号を示している。すなわち
、 ＤＳＥＧＮＯフィールド２は２３バイト単位で表さ
れており、スタートフィールド５がらの相対アドレスと
なる。
単位で表されており、スタートフィールド５からの相対
アドレスとなる。ＤＳＥＧＮＯフィールド２は１０ビツ
トのフィールドであり、セグメント記述子セグメント６
の中のセグメント記述子の番号を示している。すなわち
、 ＤＳＥＧＮＯフィールド２は２３バイト単位で表さ
れており、スタートフィールド５がらの相対アドレスと
なる。
さて、入口記述子１のＩ ５ＥＧＮＯフイールド３によ
ってセグメント記述子セグメント６内の拡張セグメント
記述子′７が読み出され、命令セグメント記述子レジス
タ８に格納される。命令セグメント記述子レジスタ８は
２０ビツトのバウンドフィールド９と３６ビツトのベー
スフィールド１０とから構成されている。バウンドフィ
ールド９は２ バイト単位で命令セグメント１４の大き
さを最大２３２バイトまで示し、ベースフィールＰ１０
は命令セグメント１４の開始アドレスを示している。
ってセグメント記述子セグメント６内の拡張セグメント
記述子′７が読み出され、命令セグメント記述子レジス
タ８に格納される。命令セグメント記述子レジスタ８は
２０ビツトのバウンドフィールド９と３６ビツトのベー
スフィールド１０とから構成されている。バウンドフィ
ールド９は２ バイト単位で命令セグメント１４の大き
さを最大２３２バイトまで示し、ベースフィールＰ１０
は命令セグメント１４の開始アドレスを示している。
次に入口記述子１のＤＳ ＥＧＮＯフィールド２によっ
てセグメント記述子セグメント６内の拡張セグメント記
述子１１が読み出される。拡張セグメント記述子１１は
２０ビツトのバウンドフィールド１２と３６ビツトのベ
ースフィールド１３とから構成されている。ベースフィ
ールド１３は命令語のアドレスを決定するため、命令カ
ウンタ１５にロードされる。
てセグメント記述子セグメント６内の拡張セグメント記
述子１１が読み出される。拡張セグメント記述子１１は
２０ビツトのバウンドフィールド１２と３６ビツトのベ
ースフィールド１３とから構成されている。ベースフィ
ールド１３は命令語のアドレスを決定するため、命令カ
ウンタ１５にロードされる。
最後に、命令セグメント記述子レジスタ８のペースフィ
ールド１０の内容と命令カウンタ１５の内容を加えるこ
とにより、命令語のアドレスが決定される。
ールド１０の内容と命令カウンタ１５の内容を加えるこ
とにより、命令語のアドレスが決定される。
第２図は２本発明の適用可能なデータ処理システムの一
例のブロック図であり、メモリ装置２１はプログラム実
行に必要な命令語おひびデータを格納している。演算装
置２２はメモリ装置２１がら命令語およびデータを読み
出してプログラムを実行する。入出力制御装置２３はメ
モリ装置２１と入出力装置２４，２５．２６間のデータ
転送の制御を行う。
例のブロック図であり、メモリ装置２１はプログラム実
行に必要な命令語おひびデータを格納している。演算装
置２２はメモリ装置２１がら命令語およびデータを読み
出してプログラムを実行する。入出力制御装置２３はメ
モリ装置２１と入出力装置２４，２５．２６間のデータ
転送の制御を行う。
第３図は第２図の演算装置２２の内部を表しており、入
口記述子３１と、拡張セグメント記述子４１．４４Ｊ−
を命令セグメント記述子レジスタ４８と、命令カウンタ
４７と、加算器３８ 、３９ 。
口記述子３１と、拡張セグメント記述子４１．４４Ｊ−
を命令セグメント記述子レジスタ４８と、命令カウンタ
４７と、加算器３８ 、３９ 。
４９と、バイトアドレス変換装置３６ 、’ ３７とか
ら構成されている。
ら構成されている。
入口記述子３１は１０ビツトのＤＳＥＧＮＯフィールド
３２と、１０ビツトのｌ５ＥＧＮＯフイールド３３と。
３２と、１０ビツトのｌ５ＥＧＮＯフイールド３３と。
１０ビツトのサイズフィールド３４と、２６ビツトのス
タートフィールド３５とから構成されている。また拡張
セグメント記述子４１は、２０ビツトのバウンドフィー
ルド４２と、３６ビツトのべ一スフイールド４３とから
構成され、拡張セグメント記述子４４は、２０ビツトの
バウンドフィールド４５と、３６ビツトのベースフィー
ルド４６から構成されている。
タートフィールド３５とから構成されている。また拡張
セグメント記述子４１は、２０ビツトのバウンドフィー
ルド４２と、３６ビツトのべ一スフイールド４３とから
構成され、拡張セグメント記述子４４は、２０ビツトの
バウンドフィールド４５と、３６ビツトのベースフィー
ルド４６から構成されている。
さて、入口記述子３１のｌ５ＥＧＮＯフイールド３３は
、バイトアドレス変換装置３７によってバイトアドレス
化され、スタートフィールド３５と加算器３９で加算さ
れ、その値によって記憶装置４０をアクセスする。アク
セスされ読み出された拡張セグメント記述子４４は、命
令セグメント記述子レジスタ４８に格納される。
、バイトアドレス変換装置３７によってバイトアドレス
化され、スタートフィールド３５と加算器３９で加算さ
れ、その値によって記憶装置４０をアクセスする。アク
セスされ読み出された拡張セグメント記述子４４は、命
令セグメント記述子レジスタ４８に格納される。
次に、入口記述子３１のＤＳＥＧＮＯフィールド３２は
、ツクイトアドレス変換装置３６によってバイトアドレ
ス化され、スタートフィールド３５と加算器３８で加算
され、その値によって記憶装置４０をアクセスする。ア
クセスされ読み出された拡張セグメント記述子４１のペ
ースフィールド４３が３２ビツトの命令カウンタ４７ヘ
ロードされる。
、ツクイトアドレス変換装置３６によってバイトアドレ
ス化され、スタートフィールド３５と加算器３８で加算
され、その値によって記憶装置４０をアクセスする。ア
クセスされ読み出された拡張セグメント記述子４１のペ
ースフィールド４３が３２ビツトの命令カウンタ４７ヘ
ロードされる。
最後に、命令セグメント記述子レジスタ４８に格納され
ている拡張セグメント記述子４４のぺ一スフイールド４
６が、命令カウンタ４７の内容と加算器４９によって加
算され、命令語アドレスが決定される。
ている拡張セグメント記述子４４のぺ一スフイールド４
６が、命令カウンタ４７の内容と加算器４９によって加
算され、命令語アドレスが決定される。
第４図は命令カウンタの生成される過程を示している。
第３図の入口記述子３１のＤＳＥＧＮＯフィールド３２
を下３ビット０で拡張した１３ビツトのフィールド５１
と、第３図の入口記述子３１のスタニトフィールド５２
とを加えたものでメモリをアクセスし、アクセスされた
拡張セグメント記述子のペースフィールド５３が命令カ
ウンタの内容５４となる。図において０内の数字はビッ
ト幅を表す・ 〔発明の効果〕 以上説明したように９本発明は命令カウンタのロード方
法を変更して命令カウンタの有効なビット数を３２ビツ
トとすることにより、拡張した命令セグメント内のすべ
ての命令語をアクセスできる効果がある。
を下３ビット０で拡張した１３ビツトのフィールド５１
と、第３図の入口記述子３１のスタニトフィールド５２
とを加えたものでメモリをアクセスし、アクセスされた
拡張セグメント記述子のペースフィールド５３が命令カ
ウンタの内容５４となる。図において０内の数字はビッ
ト幅を表す・ 〔発明の効果〕 以上説明したように９本発明は命令カウンタのロード方
法を変更して命令カウンタの有効なビット数を３２ビツ
トとすることにより、拡張した命令セグメント内のすべ
ての命令語をアクセスできる効果がある。
第１図は本発明の説明のための概念図、第２図は本発明
の適用可能なデータ処理装置の一例のシステムブロック
図、第３図は本発明の実施例のブロック図、第４図は拡
張命令カウンタの生成される過程を示す図、第５図は従
来の技術に関する図である。 記号の説明：１は入口記述子、６はセグメント記述子セ
グメント、７は拡張セグメント記述子。 ８は命令セグメントレジスタ、１１は拡散セグメント記
述子、１４は命令セグメント、１５は命令カウンタ、３
１は入口記述子、３６と３７はバイトアドレス変換装置
、３８と３９は加算器、４０は記憶装置、４１と４４は
拡張セグメント記述子。 ４７は命令カウンタ、４８は命令セグメント記述子、４
９は加算器をそれぞれあられしている。
の適用可能なデータ処理装置の一例のシステムブロック
図、第３図は本発明の実施例のブロック図、第４図は拡
張命令カウンタの生成される過程を示す図、第５図は従
来の技術に関する図である。 記号の説明：１は入口記述子、６はセグメント記述子セ
グメント、７は拡張セグメント記述子。 ８は命令セグメントレジスタ、１１は拡散セグメント記
述子、１４は命令セグメント、１５は命令カウンタ、３
１は入口記述子、３６と３７はバイトアドレス変換装置
、３８と３９は加算器、４０は記憶装置、４１と４４は
拡張セグメント記述子。 ４７は命令カウンタ、４８は命令セグメント記述子、４
９は加算器をそれぞれあられしている。
Claims (1)
- １、命令語を含む命令セグメントを規定するセグメント
記述子と、前記セグメント記述子を含むセグメント記述
子セグメントを規定する入口記述子を記憶したメモリと
、前記セグメント記述子を格納する命令セグメント記述
子レジスタと、前記命令セグメント内にある前記命令語
のアドレスを指定する命令カウンタを有する演算処理装
置とを含んでいるデータ処理システムにおける前記命令
カウンタのロードを行う装置において、前記セグメント
記述子が前記命令セグメントの開始アドレスを指定する
ベースフィールドと、大きさを指定するバウンドフィー
ルドとを有しており、前記入口記述子が前記セブメント
記述子セグメントの開始アドレスを指定するスタートフ
ィールドと、大きさを指定するサイズフィールドと、前
記セグメント記述子セグメント内にあるセグメント記述
子を指定するＩＳＥＧＮＯフィールドと、ＤＳＥＧＮＯ
フィールドとを有していており、且つ前記入口記述子の
前記ＩＳＥＧＮＯフィールドによって前記セグメント記
述子セグメントから前記セグメント記述子を読み出して
前記命令セグメント記述子レジスタに格納する手段と、
前記入口記述子の前記ＤＳＥＧＮＯフィールドによって
前記セグメント記述子セグメントから前記セグメント記
述子を読出し、読み出した前記セグメント記述子の前記
ベースフィールドを前記命令カウンタに格納する手段と
を有していることを特徴とする命令カウンタのロード装
置。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60205202A JPH087680B2 (ja) | 1985-09-19 | 1985-09-19 | 命令カウンタのロード装置 |
| US06/908,774 US4864493A (en) | 1985-09-19 | 1986-09-18 | Instruction address producing unit capable of accessing an instruction segment of an extended size |
| EP86307251A EP0216620B1 (en) | 1985-09-19 | 1986-09-19 | Instruction address producing unit capable of accessing an instruction segment of an extended size |
| DE8686307251T DE3683817D1 (de) | 1985-09-19 | 1986-09-19 | Befehlsadressengenerator mit zugriffsfaehigkeit auf ein befehlssegment erweiterten formats. |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60205202A JPH087680B2 (ja) | 1985-09-19 | 1985-09-19 | 命令カウンタのロード装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6266330A true JPS6266330A (ja) | 1987-03-25 |
| JPH087680B2 JPH087680B2 (ja) | 1996-01-29 |
Family
ID=16503090
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60205202A Expired - Lifetime JPH087680B2 (ja) | 1985-09-19 | 1985-09-19 | 命令カウンタのロード装置 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US4864493A (ja) |
| EP (1) | EP0216620B1 (ja) |
| JP (1) | JPH087680B2 (ja) |
| DE (1) | DE3683817D1 (ja) |
Families Citing this family (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2507756B2 (ja) * | 1987-10-05 | 1996-06-19 | 株式会社日立製作所 | 情報処理装置 |
| US5146579A (en) * | 1988-04-25 | 1992-09-08 | Nec Corporation | Data processing apparatus |
| US5442769A (en) * | 1990-03-13 | 1995-08-15 | At&T Corp. | Processor having general registers with subdivisions addressable in instructions by register number and subdivision type |
| US5390304A (en) * | 1990-09-28 | 1995-02-14 | Texas Instruments, Incorporated | Method and apparatus for processing block instructions in a data processor |
| US5895489A (en) * | 1991-10-16 | 1999-04-20 | Intel Corporation | Memory management system including an inclusion bit for maintaining cache coherency |
| US5692167A (en) * | 1992-07-31 | 1997-11-25 | Intel Corporation | Method for verifying the correct processing of pipelined instructions including branch instructions and self-modifying code in a microprocessor |
| US5442756A (en) * | 1992-07-31 | 1995-08-15 | Intel Corporation | Branch prediction and resolution apparatus for a superscalar computer processor |
| US6807617B2 (en) * | 2001-04-02 | 2004-10-19 | Advanced Micro Devices, Inc. | Processor, method and apparatus with descriptor table storing segment descriptors of varying size |
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| Publication number | Priority date | Publication date | Assignee | Title |
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| JPS6017130B2 (ja) * | 1980-06-06 | 1985-05-01 | 日本電気株式会社 | アドレス制御装置 |
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-
1985
- 1985-09-19 JP JP60205202A patent/JPH087680B2/ja not_active Expired - Lifetime
-
1986
- 1986-09-18 US US06/908,774 patent/US4864493A/en not_active Expired - Fee Related
- 1986-09-19 DE DE8686307251T patent/DE3683817D1/de not_active Expired - Lifetime
- 1986-09-19 EP EP86307251A patent/EP0216620B1/en not_active Expired
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS51141539A (en) * | 1975-05-31 | 1976-12-06 | Toshiba Corp | Calculation system by visionary memory method |
| JPS538525A (en) * | 1976-07-13 | 1978-01-26 | Toshiba Corp | Address designation system |
Also Published As
| Publication number | Publication date |
|---|---|
| EP0216620A3 (en) | 1989-05-24 |
| EP0216620A2 (en) | 1987-04-01 |
| US4864493A (en) | 1989-09-05 |
| JPH087680B2 (ja) | 1996-01-29 |
| DE3683817D1 (de) | 1992-03-19 |
| EP0216620B1 (en) | 1992-02-05 |
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