JPS6271311A - 可変利得回路 - Google Patents
可変利得回路Info
- Publication number
- JPS6271311A JPS6271311A JP21141585A JP21141585A JPS6271311A JP S6271311 A JPS6271311 A JP S6271311A JP 21141585 A JP21141585 A JP 21141585A JP 21141585 A JP21141585 A JP 21141585A JP S6271311 A JPS6271311 A JP S6271311A
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- JP
- Japan
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- differential amplifier
- voltage
- mirror circuit
- current mirror
- circuit
- Prior art date
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- Pending
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- Control Of Amplification And Gain Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［発明の技術分野］
二〇発明は、例えば種々の音響機器および電気測定器に
効果的に用いられる可変利得回路に関する。
効果的に用いられる可変利得回路に関する。
［発明の技術的背景とその問題点コ
例えば、可変利得回路は、制御電圧の変化に対応するよ
うにして、回路の利得を制御するものであって、このよ
うな可変利得回路は、特開昭５６−４６３１２号公報に
記載されている。第２図は、この可変利得回路の構成を
示すものである。
うにして、回路の利得を制御するものであって、このよ
うな可変利得回路は、特開昭５６−４６３１２号公報に
記載されている。第２図は、この可変利得回路の構成を
示すものである。
すなわち、入力電圧Ｖｉｎは、入力抵抗Ｒ１およびカレ
ントミラー回路１１を介して差動増幅器１３に、あるい
は、人力抵抗Ｒ１，演算増幅器１２を介してトランジス
タＱ１を制御し、差動増幅器１４に、それぞれ電流変換
された形で供給されるようになっている。これらの差動
増幅器１３あるいは１４は、可変制御電圧Ｖｃおよび制
御電圧Ｖｒによって決定される出力電流を、カレントミ
ラー回路１５を介して、帰還抵抗Ｒ２を備えた演算増幅
器１６に供給する。そして、この供給電流は、帰還抵抗
Ｒ２を備えた演算増幅器１６によって電圧変換され、出
力電圧Ｖ ｏｕｔとして出力されるようになっている。
ントミラー回路１１を介して差動増幅器１３に、あるい
は、人力抵抗Ｒ１，演算増幅器１２を介してトランジス
タＱ１を制御し、差動増幅器１４に、それぞれ電流変換
された形で供給されるようになっている。これらの差動
増幅器１３あるいは１４は、可変制御電圧Ｖｃおよび制
御電圧Ｖｒによって決定される出力電流を、カレントミ
ラー回路１５を介して、帰還抵抗Ｒ２を備えた演算増幅
器１６に供給する。そして、この供給電流は、帰還抵抗
Ｒ２を備えた演算増幅器１６によって電圧変換され、出
力電圧Ｖ ｏｕｔとして出力されるようになっている。
この場合の回路の利得Ｇは、
で表わされる。ただし、Ｖｔはトランジスタのサーマル
電圧である。
電圧である。
上記（ｒ）式ニヨレば、 Ｖｃ−Ｖｒ （Ｖｔの条件を
満たす場合に、利得Ｇのデシベル値が、可変制御電圧Ｖ
ｃに対して線形的に増加するようになっている。
満たす場合に、利得Ｇのデシベル値が、可変制御電圧Ｖ
ｃに対して線形的に増加するようになっている。
しかし、このように構成したのでは、可変制御電圧Ｖｅ
と制御電圧Ｖ「との差、すなわち、Ｖｃ−Ｖｒが上記の
領域以上の値を取る場合における利得特性は、しだいに
線形的でなくなる。このため、広範囲に渡って、線形的
な制御特性が得られる可変利得回路が要求される。
と制御電圧Ｖ「との差、すなわち、Ｖｃ−Ｖｒが上記の
領域以上の値を取る場合における利得特性は、しだいに
線形的でなくなる。このため、広範囲に渡って、線形的
な制御特性が得られる可変利得回路が要求される。
［発明の目的］
この発明は上記のような点に鑑みなされたもので、可変
制御電圧の広範囲な変化に対応するようにして、回路の
利得を線形的に制御できる可変利得回路を提供しようと
するものである。
制御電圧の広範囲な変化に対応するようにして、回路の
利得を線形的に制御できる可変利得回路を提供しようと
するものである。
［発明の概要〕
すなわち、この発明に係る可変利得回路にあっては、そ
れぞれ差動トランジスタ対によって構成され、入力信号
電圧の正電圧値および負電圧値に対応してそれぞれ独立
的に動作される２個の差動増幅器と、上記差動増幅器を
構成するトランジスタ対のうちの一方のコレクタ端子に
接続され、このコレクタ端子からの出力電流を上記差動
増幅器（７）共通エミッタ端子に帰還するカレントミラ
ー回路と、上記２組の差動増幅器のベース端子に制御電
圧を供給する手段と、上記差動増幅器からの出力電流を
電圧に変換して出力する手段とを具備するようにしたも
のである。
れぞれ差動トランジスタ対によって構成され、入力信号
電圧の正電圧値および負電圧値に対応してそれぞれ独立
的に動作される２個の差動増幅器と、上記差動増幅器を
構成するトランジスタ対のうちの一方のコレクタ端子に
接続され、このコレクタ端子からの出力電流を上記差動
増幅器（７）共通エミッタ端子に帰還するカレントミラ
ー回路と、上記２組の差動増幅器のベース端子に制御電
圧を供給する手段と、上記差動増幅器からの出力電流を
電圧に変換して出力する手段とを具備するようにしたも
のである。
［発明の実施例］
以下、図面を参照してこの発明の一実施例を説明する。
第１図は、この発明に係る可変利得回路の構成を示すも
のであって、第１の差動増幅器１３および第２の差動増
幅器１４は、トランジスタＱ２゜Ｑ３およびＱ４、およ
びトランジスタＱ５．ＱＢおよびＱ７からそれぞれ構成
されている。そして、トランジスタＱ４およびＱ７のそ
れぞれのエミッタおよびベースは、トランジスタＱ２お
よびＱ７のそれぞれのエミッタおよびベースに対して並
列に接続されている。このトランジスタＱ４のコレクタ
は、トランジスタＱＩＯおよびＱｌｌから成る帰還用カ
レントミラー回路１７．およびトランジスタＱ１２およ
びＱ１３から成る帰還用カレントミラー回路■８を介し
て、第１の差動増幅器１３の共通エミッタ端子に帰還接
続される。同様に、トランジスタＱ７のコレクタは、ト
ランジスタＱ１４およびＱ１５から成る帰還用カレント
ミラー回路１９．およびトランジスタＱ１ＢおよびＱ１
０から成る帰還用力１．・ントミラー回路２０を介して
、第２の差動増幅器１４の共通エミッタ端子に帰還接続
されている。
のであって、第１の差動増幅器１３および第２の差動増
幅器１４は、トランジスタＱ２゜Ｑ３およびＱ４、およ
びトランジスタＱ５．ＱＢおよびＱ７からそれぞれ構成
されている。そして、トランジスタＱ４およびＱ７のそ
れぞれのエミッタおよびベースは、トランジスタＱ２お
よびＱ７のそれぞれのエミッタおよびベースに対して並
列に接続されている。このトランジスタＱ４のコレクタ
は、トランジスタＱＩＯおよびＱｌｌから成る帰還用カ
レントミラー回路１７．およびトランジスタＱ１２およ
びＱ１３から成る帰還用カレントミラー回路■８を介し
て、第１の差動増幅器１３の共通エミッタ端子に帰還接
続される。同様に、トランジスタＱ７のコレクタは、ト
ランジスタＱ１４およびＱ１５から成る帰還用カレント
ミラー回路１９．およびトランジスタＱ１ＢおよびＱ１
０から成る帰還用力１．・ントミラー回路２０を介して
、第２の差動増幅器１４の共通エミッタ端子に帰還接続
されている。
すなわち、人力信号電圧ＶＩｎは、人力抵抗Ｒ１により
電流変換された後、トランジスタＱ１のエミッタ、演算
増幅器１２の反転入力、トランジスタＱ１９のコレクタ
およびベースにそれぞれ印加５れ、入力信号電圧Ｖｌｎ
が正電圧である場合には、演算増幅器Ｉ２の出力が負と
なり、トランジスタＱ１はオフとなる。このため、電流
変換された入力信号は、トランジスタＱ１ｇおよびＱ１
９から成るカレントミラー回路１１を介して、第１の差
動増幅２ｉ３１３の共通エミッタ端子に電流１１として
供給される。
電流変換された後、トランジスタＱ１のエミッタ、演算
増幅器１２の反転入力、トランジスタＱ１９のコレクタ
およびベースにそれぞれ印加５れ、入力信号電圧Ｖｌｎ
が正電圧である場合には、演算増幅器Ｉ２の出力が負と
なり、トランジスタＱ１はオフとなる。このため、電流
変換された入力信号は、トランジスタＱ１ｇおよびＱ１
９から成るカレントミラー回路１１を介して、第１の差
動増幅２ｉ３１３の共通エミッタ端子に電流１１として
供給される。
また、入力信号電圧Ｖｌｎが負電圧である場合には、演
算増幅器１２の出力は正となるので、トランジスタＱｌ
はオンとなる。このため、電流変換された入力信号は、
第２の差動増幅器の共通エミッタ端子に電流Ｉ２として
供給される。第１の差動増幅器１３および第２の差動増
幅器１４は、この供給電ｉＡε１１およびＩ２を、可変
制御電圧ＶＣと制御電圧Ｖｒとによって定められる分流
比で分流し、トランジスタＱ２〜Ｑ４およびトランジス
タＱ５〜Ｑ７のコレクタ電流、すなわち、工３〜Ｉ５お
よび１６〜■８として出力するようになっている。
算増幅器１２の出力は正となるので、トランジスタＱｌ
はオンとなる。このため、電流変換された入力信号は、
第２の差動増幅器の共通エミッタ端子に電流Ｉ２として
供給される。第１の差動増幅器１３および第２の差動増
幅器１４は、この供給電ｉＡε１１およびＩ２を、可変
制御電圧ＶＣと制御電圧Ｖｒとによって定められる分流
比で分流し、トランジスタＱ２〜Ｑ４およびトランジス
タＱ５〜Ｑ７のコレクタ電流、すなわち、工３〜Ｉ５お
よび１６〜■８として出力するようになっている。
この場合、トランジスタＱ４のコレクタ電流■５は、上
記帰還用カレントミラー回路１７および１８によって、
第１の差動増幅器１３の共通エミッタ端子に帰還型１ｆ
ＥＩｓとして帰還され、同様に、トランジスタＱ７のコ
レクタ電流Ｉ８は、上記帰還用力！／ントミラー回路１
９および２０によって、第２の差動増幅器１４の共通エ
ミッタに帰還電流ＩＩＩとして帰還される。また、トラ
ンジスタＱ２あるいはＱ６のコレクタ電流Ｉ３あるいは
Ｉ７は、トランジスタＱ８およびＱ９から成るカレント
ミラー回路１５を介して、帰還抵抗Ｒ２を備えた演算増
幅器Ｉ６に出力電流１ ｏｕｔとして供給される。そし
て、この出力電流１０ＬＩｔは、演算増幅器１６によっ
て電圧変換され、出力信号電圧ｖ ｏｕｔとして出力さ
れる。
記帰還用カレントミラー回路１７および１８によって、
第１の差動増幅器１３の共通エミッタ端子に帰還型１ｆ
ＥＩｓとして帰還され、同様に、トランジスタＱ７のコ
レクタ電流Ｉ８は、上記帰還用力！／ントミラー回路１
９および２０によって、第２の差動増幅器１４の共通エ
ミッタに帰還電流ＩＩＩとして帰還される。また、トラ
ンジスタＱ２あるいはＱ６のコレクタ電流Ｉ３あるいは
Ｉ７は、トランジスタＱ８およびＱ９から成るカレント
ミラー回路１５を介して、帰還抵抗Ｒ２を備えた演算増
幅器Ｉ６に出力電流１ ｏｕｔとして供給される。そし
て、この出力電流１０ＬＩｔは、演算増幅器１６によっ
て電圧変換され、出力信号電圧ｖ ｏｕｔとして出力さ
れる。
次に、この可変利得回路の利得Ｇを、入力信号電圧Ｖｌ
ｎが正の電圧の場合について示す。すなわち、この場合
には第１の差動増幅器１３が動作されるので、上記電流
Ｉｔ、１３〜Ｉ５およびＩ９には以下の関係が成り立つ
。
ｎが正の電圧の場合について示す。すなわち、この場合
には第１の差動増幅器１３が動作されるので、上記電流
Ｉｔ、１３〜Ｉ５およびＩ９には以下の関係が成り立つ
。
１３ ＋Ｉａ ＋Ｉｓ −Ｉ＋ ＋Ｉｓ■５繻１３．ｌ
９−２１５ Ｖｃ−Ｖｒ ］ １３ ＝ Ｉ ４ ｅｘｐ［−下ｒ ｃ−Ｖｒ これから・Ｉ ３−１１ｅｘｐ［−ＶＴ−１−（１）で
ある。ただし、Ｖｔはトランジスタのサーマル電圧であ
る。
９−２１５ Ｖｃ−Ｖｒ ］ １３ ＝ Ｉ ４ ｅｘｐ［−下ｒ ｃ−Ｖｒ これから・Ｉ ３−１１ｅｘｐ［−ＶＴ−１−（１）で
ある。ただし、Ｖｔはトランジスタのサーマル電圧であ
る。
１３−１ｏｕｔなので
Ｖｏｕｔ ＝ Ｒ２１ｏｕｔ ＝１２）また、Ｉ １
− Ｖ ｉｎ／ Ｒ１−（３）（１）、 ＜２）および
（３）からこの回路の利得Ｇは、となる。同様に、入力
信号電圧Ｖｌｎが負の電圧値の場合における利得Ｇも同
じ結果となる。上記の利得式によれば、利得Ｇのデシベ
ル値は、可変制御電圧Ｖｃに対して、広範囲に渡り線形
的に増加するようになる。
− Ｖ ｉｎ／ Ｒ１−（３）（１）、 ＜２）および
（３）からこの回路の利得Ｇは、となる。同様に、入力
信号電圧Ｖｌｎが負の電圧値の場合における利得Ｇも同
じ結果となる。上記の利得式によれば、利得Ｇのデシベ
ル値は、可変制御電圧Ｖｃに対して、広範囲に渡り線形
的に増加するようになる。
［発明の効果コ
以ヒのようにこの発明によれば、それぞれ差動トランジ
スタ対によって構成され、人力信号電圧の正電圧値およ
び負電圧値に対応してそれぞれ独立に動作される２組の
差動増幅器と、上記差動増幅器を構成するトランジスタ
対のうちの一方のコレクタ端子に接続し、このコレクタ
端子からの出力電流を上記差動増幅器の共通エミッタ端
子に帰還するカレントミラー回路と、上記２組の差動増
幅器のベース端子に制御電圧を供給する手段と、」−２
差動増幅器からの出力電流を電圧に変換して出力する手
段とを具備することによって、可変制御電圧の広範囲な
変化に対応して、回路の利得を線形的に制御できるよう
になるものである。
スタ対によって構成され、人力信号電圧の正電圧値およ
び負電圧値に対応してそれぞれ独立に動作される２組の
差動増幅器と、上記差動増幅器を構成するトランジスタ
対のうちの一方のコレクタ端子に接続し、このコレクタ
端子からの出力電流を上記差動増幅器の共通エミッタ端
子に帰還するカレントミラー回路と、上記２組の差動増
幅器のベース端子に制御電圧を供給する手段と、」−２
差動増幅器からの出力電流を電圧に変換して出力する手
段とを具備することによって、可変制御電圧の広範囲な
変化に対応して、回路の利得を線形的に制御できるよう
になるものである。
【図面の簡単な説明】
第１図はこの発明の一実施例に係る可変利得回路を説明
する構成図、第２図は従来の可変利得回路を説明する構
成図である。 １１．１５．１７〜２０・・・カレントミラー回路、１
２．１８・・・演算増幅器、１３．１４・・・差動増幅
器、Ｑ１〜Ｑ１９・・・トランジスタ。
する構成図、第２図は従来の可変利得回路を説明する構
成図である。 １１．１５．１７〜２０・・・カレントミラー回路、１
２．１８・・・演算増幅器、１３．１４・・・差動増幅
器、Ｑ１〜Ｑ１９・・・トランジスタ。
Claims (1)
- 【特許請求の範囲】 それぞれ差動トランジスタ対によって構成され、入力信
号電圧の正電圧値および負電圧値に対応してそれぞれ独
立的に動作される２組の差動増幅器と、 上記差動増幅器を構成するトランジスタ対のうちの一方
のコレクタ端子に接続され、このコレクタ端子からの出
力電流を上記差動増幅器の共通エミッタ端子に帰還する
カレントミラー回路と、上記２組の差動増幅器のベース
端子に制御電圧を供給する手段と、 上記差動増幅器からの出力電流を電圧に変換して出力す
る手段と、 を具備することを特徴とする可変利得回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21141585A JPS6271311A (ja) | 1985-09-25 | 1985-09-25 | 可変利得回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21141585A JPS6271311A (ja) | 1985-09-25 | 1985-09-25 | 可変利得回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6271311A true JPS6271311A (ja) | 1987-04-02 |
Family
ID=16605575
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP21141585A Pending JPS6271311A (ja) | 1985-09-25 | 1985-09-25 | 可変利得回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6271311A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04117710A (ja) * | 1990-09-03 | 1992-04-17 | Nec Ic Microcomput Syst Ltd | 利得可変増幅器 |
| US6177839B1 (en) * | 1998-02-20 | 2001-01-23 | Nec Corporation | Variable gain amplifier circuit |
-
1985
- 1985-09-25 JP JP21141585A patent/JPS6271311A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04117710A (ja) * | 1990-09-03 | 1992-04-17 | Nec Ic Microcomput Syst Ltd | 利得可変増幅器 |
| US6177839B1 (en) * | 1998-02-20 | 2001-01-23 | Nec Corporation | Variable gain amplifier circuit |
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