JPS6295013A - 可変等化器 - Google Patents
可変等化器Info
- Publication number
- JPS6295013A JPS6295013A JP23564185A JP23564185A JPS6295013A JP S6295013 A JPS6295013 A JP S6295013A JP 23564185 A JP23564185 A JP 23564185A JP 23564185 A JP23564185 A JP 23564185A JP S6295013 A JPS6295013 A JP S6295013A
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- JP
- Japan
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- transistor
- variable
- base
- grounded
- resistor
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- 238000010586 diagram Methods 0.000 description 5
- 230000005540 biological transmission Effects 0.000 description 1
- 238000006243 chemical reaction Methods 0.000 description 1
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は回路構成が簡単な広帯域可変等化器に関する。
可変等化器はＨ−Ｗ、 Ｂｏｄｅにより発明され、以後
０〜・ｉｄ型、種部・前回型など種々の拡張が行われて
きた。まず、Ｂｏｄｅ型の可変等化器について説明する
と、第２図はその基本構成を示すもので、この第２図に
おいて１，１′は信号入力端子、２，２′は信号出力端
子、３は３端子回路網、４は可変抵抗器、５，５′は可
変抵抗器接続端子である。
０〜・ｉｄ型、種部・前回型など種々の拡張が行われて
きた。まず、Ｂｏｄｅ型の可変等化器について説明する
と、第２図はその基本構成を示すもので、この第２図に
おいて１，１′は信号入力端子、２，２′は信号出力端
子、３は３端子回路網、４は可変抵抗器、５，５′は可
変抵抗器接続端子である。
ところで、Ｈ，Ｗ、 Ｂｏｄｅによれば、信号入力端子
１．１′より信号出力端子２，２′への伝達アドミタン
スＹは である。ただし Ｒは可変抵抗値、 ＹＳばＲ＝ＯとしたときのＹ、 ＹｏばＲ−■とじたときのＹ、 Ｚは接続端子５，５′より３端子回路網３をみたインピ
ーダンス、 である。
１．１′より信号出力端子２，２′への伝達アドミタン
スＹは である。ただし Ｒは可変抵抗値、 ＹＳばＲ＝ＯとしたときのＹ、 ＹｏばＲ−■とじたときのＹ、 Ｚは接続端子５，５′より３端子回路網３をみたインピ
ーダンス、 である。
ここで、Ｒｏを基準抵抗値としてＺ ＝ Ｊ Ｙｏ ／
Ｙｓ−＆を３端子回路網３が満足している場合には、ｅ
−Ｙ ＋ ｅ−００＝ｎ 、 ｚ＝Ｒ／Ｒｏ
＋ ｅ−ψ”）＝ ｚ ／ Ｒｏと変数変換を行え
ば、（１）式より が得られる。
Ｙｓ−＆を３端子回路網３が満足している場合には、ｅ
−Ｙ ＋ ｅ−００＝ｎ 、 ｚ＝Ｒ／Ｒｏ
＋ ｅ−ψ”）＝ ｚ ／ Ｒｏと変数変換を行え
ば、（１）式より が得られる。
（２）式のθをψ（ω）についてψ（ω）−〇のまわり
にテーラ−展開して表すと、窩次の項を無視でき、と近
似される。
にテーラ−展開して表すと、窩次の項を無視でき、と近
似される。
（３）式は可変等化器としてのネーパー表示の伝達’！
！ｆ’ｊ牛 Ｆ（ω）＝Ｆ、（ω）＋Ｆ２（Ｒ）・Ｆ３（ω）
・・ ・・・（４）を涜り足する。
！ｆ’ｊ牛 Ｆ（ω）＝Ｆ、（ω）＋Ｆ２（Ｒ）・Ｆ３（ω）
・・ ・・・（４）を涜り足する。
ここで、
Ｆｌ（ω）は固定等化特性、
Ｆ２ （Ｒ）は周波数によらない可変抵抗値のみの関数
、 Ｆ、（ω）は可変等化特性、 を表す。
、 Ｆ、（ω）は可変等化特性、 を表す。
なお、Ｑ、、、、Ｌｉ型、筒部・重囲型なども同様の原
理による。
理による。
以上、 Ｂｏｄｅの示した可変等化器の理論に基づき（
２）式を実現する回路構成が特５願昭５６−１２２２６
６号の明細書に開示されている。第３図はこの公報に開
示された実施例図である。第３図において、６゜６′は
信号入力端子であり、１５ 、１．５’は信号出力端子
である。７ 、１１ 、１３はトランジスタで、８．ｔ
４ｑ＋司定抵抗器であり、１０は可変抵抗器であり、９
，１２はインピーダンス素子である。インピーダンス素
子９と１２は、互いの位相が等しく設定されており信号
入力端子６，６′から信号出力端子１５ 、１５’への
伝達関数の等化特性を可変抵抗器１ｏにより可変とする
構成である。
２）式を実現する回路構成が特５願昭５６−１２２２６
６号の明細書に開示されている。第３図はこの公報に開
示された実施例図である。第３図において、６゜６′は
信号入力端子であり、１５ 、１．５’は信号出力端子
である。７ 、１１ 、１３はトランジスタで、８．ｔ
４ｑ＋司定抵抗器であり、１０は可変抵抗器であり、９
，１２はインピーダンス素子である。インピーダンス素
子９と１２は、互いの位相が等しく設定されており信号
入力端子６，６′から信号出力端子１５ 、１５’への
伝達関数の等化特性を可変抵抗器１ｏにより可変とする
構成である。
上記可変等化器ｊは回路構成が簡単でフィードバック回
路を含まず、また片側接地の単一な可変抵抗により実現
できるという秀れた特徴を有している・ 〔発明が解決しようとする問題点〕 ところが、上述した可変等化器はインピーダンス素子を
２組具備する必翌がある。一般にインピーダンス素子は
所望の周波数特性をもたせるために、構成素子数が多く
、回路規模が太きいため、このようなインピーダンス素
子を２組使用することは製造性において問題である。
路を含まず、また片側接地の単一な可変抵抗により実現
できるという秀れた特徴を有している・ 〔発明が解決しようとする問題点〕 ところが、上述した可変等化器はインピーダンス素子を
２組具備する必翌がある。一般にインピーダンス素子は
所望の周波数特性をもたせるために、構成素子数が多く
、回路規模が太きいため、このようなインピーダンス素
子を２組使用することは製造性において問題である。
また、２つのインピーダンス素子を精度よく設定するこ
とは調子工数がかかるという欠点がある集積回路化を図
るうえでも同様に問題である。
とは調子工数がかかるという欠点がある集積回路化を図
るうえでも同様に問題である。
本発明は前記問題点を屓消した可変等化器を提供するも
のである。
のである。
本発明は第１のトランジスタのベースとアースを信号入
力端子とし、該第１のトランジスタのエミッタと第２の
トランジスタのベースを第１の可変抵抗器を介して接続
するとともに、該第２のトランジスタのベースをインピ
ーダンス素子を介して接地し、第２のトランジスタのコ
レクタを第１の可変抵抗器と等しい値を有する第２の可
変抵抗器を介して接地するとともに、第３のトランジス
タのベースに接続し、さらに第３のトランジスタのコレ
クタを接地し、第１のトランジスタのコレクタと第３の
トランジスタのエミッタを第１の固定抵抗器を介して接
続し、第２のトランジスタのエミッタを第１の固定抵抗
器と等しい値を有する第２の固定抵抗器を介して接地し
、第１のトランジスタのコレクタとアースを信号出力端
子としたことを特徴とする可変等化器である。
力端子とし、該第１のトランジスタのエミッタと第２の
トランジスタのベースを第１の可変抵抗器を介して接続
するとともに、該第２のトランジスタのベースをインピ
ーダンス素子を介して接地し、第２のトランジスタのコ
レクタを第１の可変抵抗器と等しい値を有する第２の可
変抵抗器を介して接地するとともに、第３のトランジス
タのベースに接続し、さらに第３のトランジスタのコレ
クタを接地し、第１のトランジスタのコレクタと第３の
トランジスタのエミッタを第１の固定抵抗器を介して接
続し、第２のトランジスタのエミッタを第１の固定抵抗
器と等しい値を有する第２の固定抵抗器を介して接地し
、第１のトランジスタのコレクタとアースを信号出力端
子としたことを特徴とする可変等化器である。
次に図面を参照して本発明の実施例について説明する。
第１図は本発明の一実施例を示す回路図である。
一方の信号入力端子６はトランジスタ７０ベースに接続
さハ、他方の信号入カシ１１”４子６′は接地されてい
る。トランジスタ７のエミッタは可変抵抗器１０を介し
てｌ・ランジメタ１３０ベースに接続され１、トランジ
スタ１３０ベースはインピーダンス素子９を介して接地
されている。トランジスタ１３のエミッタは固定抵抗器
１４を介し接地され、トランジスタ１３のコレクタは可
変抵抗器１０と等しい値を有する可変抵抗器１６を介し
て接地されるとともにトランジスタ１１のベースに接続
されている。トランジスタ１１のコレクタは検地され、
トランジスタ１１のエミッタは固定抵抗器１４と等しい
値を有する固定抵抗器８を介してトランジスタ７のコレ
クタに接続されている。出力端子］５はトランジスタ７
のコｌ／クタに接続され、出力端子１５′は接地されて
いる。
さハ、他方の信号入カシ１１”４子６′は接地されてい
る。トランジスタ７のエミッタは可変抵抗器１０を介し
てｌ・ランジメタ１３０ベースに接続され１、トランジ
スタ１３０ベースはインピーダンス素子９を介して接地
されている。トランジスタ１３のエミッタは固定抵抗器
１４を介し接地され、トランジスタ１３のコレクタは可
変抵抗器１０と等しい値を有する可変抵抗器１６を介し
て接地されるとともにトランジスタ１１のベースに接続
されている。トランジスタ１１のコレクタは検地され、
トランジスタ１１のエミッタは固定抵抗器１４と等しい
値を有する固定抵抗器８を介してトランジスタ７のコレ
クタに接続されている。出力端子］５はトランジスタ７
のコｌ／クタに接続され、出力端子１５′は接地されて
いる。
嘔で４１図において、固定抵抗器８，１４の抵抗値をＲ
８、可変抵抗器１０ 、１６の抵抗値をＲ、インピーダ
ンス素子９のインピーダンスをＺ（ω）とすると、信号
入力端子６，６′から信号出力端子１５ 、１５’への
伝達関数Ｔ（ω）は次式となる。
８、可変抵抗器１０ 、１６の抵抗値をＲ、インピーダ
ンス素子９のインピーダンスをＺ（ω）とすると、信号
入力端子６，６′から信号出力端子１５ 、１５’への
伝達関数Ｔ（ω）は次式となる。
ここで、
ｘ＝Ｒ／Ｒ６，ｅ−ψ（（“）−Ｚ（ω）、’ Ｒ６と
おけば（５）式は となって第１図に示す回路に、Ｂｏｄｅによって示され
た可変等化特性を１足することがわかる。
おけば（５）式は となって第１図に示す回路に、Ｂｏｄｅによって示され
た可変等化特性を１足することがわかる。
変えることのできる可変等化器として動作する。
以上説明したように本発明はインピーダンス素子を１個
のみ用いて可変等化器を（：ｒ７成できる効果がある。
のみ用いて可変等化器を（：ｒ７成できる効果がある。
第１図は本発明の一実施例を示す回路図、第２図、第３
図は従来の可変等化器を示す回路図である。
図は従来の可変等化器を示す回路図である。
Claims (1)
- （１）第１のトランジスタのベースとアースを信号入力
端子とし、該第１のトランジスタのエミッタと第２のト
ランジスタのベースを第１の可変抵抗器を介して接続す
るとともに該第２のトランジスタのベースをインピーダ
ンス素子を介して接地し、第２のトランジスタのコレク
タを第１の可変抵抗器と等しい値を有する第２の可変抵
抗器を介して接地するとともに、第３のトランジスタの
ベースに接続し、さらに第３のトランジスタのコレクタ
を接地し、第１のトランジスタのコレクタと第３のトラ
ンジスタのエミッタを第１の固定抵抗器を介して接続し
、第２のトランジスタのエミッタを第１の固定抵抗器と
等しい値を有する第２の固定抵抗器を介して接地し、第
１のトランジスタのコレクタとアースを信号出力端子と
したことを特徴とする可変等化器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23564185A JPS6295013A (ja) | 1985-10-22 | 1985-10-22 | 可変等化器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23564185A JPS6295013A (ja) | 1985-10-22 | 1985-10-22 | 可変等化器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6295013A true JPS6295013A (ja) | 1987-05-01 |
Family
ID=16989024
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP23564185A Pending JPS6295013A (ja) | 1985-10-22 | 1985-10-22 | 可変等化器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6295013A (ja) |
-
1985
- 1985-10-22 JP JP23564185A patent/JPS6295013A/ja active Pending
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