JPS63166236A - 電子装置 - Google Patents

電子装置

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JPS63166236A
JPS63166236A JP61315341A JP31534186A JPS63166236A JP S63166236 A JPS63166236 A JP S63166236A JP 61315341 A JP61315341 A JP 61315341A JP 31534186 A JP31534186 A JP 31534186A JP S63166236 A JPS63166236 A JP S63166236A
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JP
Japan
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film
alloy
oxide
tpt
insulating film
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JP61315341A
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English (en)
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Mitsushi Ikeda
光志 池田
Masayuki Dojiro
堂城 政幸
Yasuhisa Oana
保久 小穴
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Toshiba Corp
Original Assignee
Toshiba Corp
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Publication date
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    • H10D30/00—Field-effect transistors [FET]
    • H10D30/60—Insulated-gate field-effect transistors [IGFET]
    • H10D30/67—Thin-film transistors [TFT]
    • H10D30/6729—Thin-film transistors [TFT] characterised by the electrodes
    • H10D30/6737—Thin-film transistors [TFT] characterised by the electrodes characterised by the electrode materials
    • H10D30/6739—Conductor-insulator-semiconductor electrodes
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    • H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
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    • H10P14/69396—Inorganic materials composed of oxides, glassy oxides or oxide-based glasses the material containing at least one metal element, e.g. metal oxides, metal oxynitrides or metal oxycarbides characterised by the metal the material containing at least one rare earth metal element, e.g. oxides of lanthanides, scandium or yttrium

Landscapes

  • Liquid Crystal (AREA)
  • Thin Film Transistor (AREA)
  • Formation Of Insulating Films (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [発明の目的] (産業上の利用分野) 本発明は、金属の酸化物からなる絶縁膜を用いた電子装
置に関する。
(従来の技術) 単純マトリクス型液晶表示装置は、アドレスラインの増
加と共に各画素に印加される電圧のデユーティ比が小さ
くなるため、コントラスト比や視野角等の表示特性が劣
化する。この問題を解決するため、液晶表示素子の各画
素にMIM(金属−絶縁膜−金属)素子や薄膜トランジ
スタ(TPT)などの非線形素子を設けて実質的なデユ
ーティ比を上げることが行なわれている。これらのms
電子素子に用いられる絶縁膜としては、タンタル酸化1
1(TaOx)やこれとシリコン酸化膜の二層構造l1
I(Ta0xll i Ox )を用いることが既に提
案されている。しかし、TaOx膜は抵抗率が小さく、
MIM素子やTPTに用いた場合にリーク電流が大きい
。また、TPTでは、ゲート耐圧が小さいために動作電
圧を十分に上げることができず、オン電流を十分に流す
ことができない。600℃程度の熱処理を行なうことに
より、Ta0xllの膜質は改善されるが、このような
温度ではガラス基板が変形するため、これを避けるには
石英等の高価な基板を用いなければならない。
〈発明が解決しようとする問題点〉 以上のように従来の薄膜電子素子では、低温形成が可能
で十分に抵抗率が高く、また十分に耐圧が高い絶縁膜が
用いられていない。
本発明は上記の点に鑑み、低温形成が可能で優れた特性
をもつ絶縁膜をもった電子装置を提供することを目的と
する。
[発明の構成] (問題点を解決するための手段) 本発明にかかる電子装置は、絶縁膜として、タンタルの
組成比が50〜97原子%であるモリブデンとタンタル
の合金(MO−Ta合金)の酸化物を用いたことを特徴
とする。
(作用) 本発明におけるMo−Ta合金の酸化物薄膜は、Taの
酸化物より抵抗率が高く、耐圧も高い。
またこの酸化膜は陽極酸化により低温で形成して、高温
の熱処理を行なうことなくこの様な優れた特性を示′g
。しかも加工性、耐薬品性等はTaの酸化物と同等であ
る。
後に示すデータから明らかなように、l”aが50原子
%より少なくなると絶縁耐圧がTaの酸化膜よりも小さ
くなるので、50原子%がTa組成比の下限である。ま
たMOは極く僅かに含まれているだけで、Taglのみ
の場合に比べて優れた特性が得られるので、この意味で
Ta組成比の上限は97原子%とする。
(実施例) 以下、本発明の詳細な説明する。
具体的な素子への適用例に先立ち、MO−Ta合金の酸
化膜の特性を種々の条件で測定したデータを説明する。
ガラス基板上にTaとM oの組成比を種々変えたMO
−Ta合金膜をスパッタ法により堆積した。得られたM
O−Ta合金膜を、クエン酸0.01重石%水溶液で室
温から70℃程度の温度で陽極酸化して酸化膜を形成し
た。陽極酸化の条件は、100■までは電流密度0.5
m A / crtt 2の定電流酸化とし、引続き1
00■で1時間の定電圧酸化を行なった。
第6図はこの様にして得られたMO−Ta合金の陽極酸
化膜の絶縁耐圧を測定した結果であり、第7図は同じく
抵抗率(30■印加時)を測定した結果である。これら
のデータから、この陽極酸化膜はTaの組成比の増大と
共に絶縁耐圧、抵抗率共に増加し、Taの組成比が50
〜97原子%の範囲でTa自身の陽極酸化膜より優れた
特性が得られていることがわかる。比誘電率は、10k
lb〜IMHzの周波数範囲で約30であった。陽1[
化の条件を異ならせても同様の結果が得られた。
この合金の酸化膜の薬品耐性を調べた結果、HF以外に
はNH4F、HNO3,H2804。
HCβ、H202等の酸に侵されないことが確認された
。加工性に関しては、CF4と02ガス中でのプラズマ
・エツチングにより容易にエツチングでき、そのガスの
混合比を選択することによりテーパ・エツチングも可能
であった。これらの耐薬品性および加工性はTaの陽極
酸化膜と同一である。
Taが84原子%以上のMo−Ta合金は、立方晶(α
)と正方晶(β)の二種の結晶構造をとるが、両者の酸
化膜の特性は、第6図、第7図に示したように殆ど差は
認められない。
次に本発明を具体的な素子に適用した実施例を説明する
。
第1図は、TPTに適用した実施例を示す。これを製造
工程に従って説明すると、ガラス基板11に先ず、MO
(5原子%)−Ta (95%)のMo−Ta合金膜1
2を2000人スパッタし、これをCF4と02を用い
たプラズマ・エツチングによりテーバ・エツチングして
ゲート電極をパターン形成した。次に、ゲート電極のコ
ンタクト部をカバーして、このゲート電極に対し、0.
01%クエン酸中で100Vまでの定電流陽極酸化を行
ない、引続き100Vで1時間の定電圧陽極酸化を行な
って、ゲート絶縁g113を形成した。次いで強酸によ
り表面処理を行い、プラズマCVD法によりアンド−プ
ロ−81g114を3000人堆積し、続いてn+型a
−3i膜15(15r 、152 )を500人堆積し
、これらをパターニングしてa−3i島を形成した。そ
してMo/Anl!16をスパッタしパターン形成した
ソース、ドレイン74極161.162を形成し、チャ
ネル部のn+型a−8i膜をCD口によりエツチング除
去してTPTを完成した。
第3図は、得られたTPTのゲート電圧V。−ドレイン
電流Io特性である。破線は、ゲート電極としてTa膜
を用い、その陽極酸化膜をゲート絶縁膜として用いた従
来例の特性である。この従来例に比べて実施例1ではオ
フ時のリーク電流が約3桁小さくなっている。またゲー
ト絶縁膜としてSiO2膜を用いたものに比Nて大きい
オン電流が得られているが、これはゲート絶縁膜の比誘
電率が大きい結果である。
ところで第1図の構造において、a−3i膜14をCD
E法により島状にエツチングする際、島状領域より外部
の陽極酸化膜およびゲート電極配線部分も僅かにエツチ
ングされる。
第2図はこの点を改善した実施例のTPTを示す。即ち
先の実施例と@様にゲート電極のm極酸化1113を形
成した後、この上にSiO2膜17を例えばプラズマC
VDにより堆積する。それ以外は先の実施例と同様であ
る。この実施例2のTPTの特性を第3図に一点鎖線で
示した。
5iO21!117を重ねた分だけゲート容量が小さく
なり、オン電流が減少しているが、はぼ先の実施例1と
同様の良好な特性が得られている。
上記二つの実施例共、ゲート耐圧は100V以上の大き
いものであった。
第4図は、本発明をMIM素子に適用した実施例である
。ガラス基板21にMo5原子%−Ta95原子%の合
金膜2.2を2500A堆積し、これをCDEによりパ
ターニングして下部電極配線を形成した。この下部電極
配線のコンタクト部をフォトレジストでガバーした状態
で合金膜22の表面に陽極酸化膜23を形成した。陽極
酸化の条件は、0.01%クエン酸を用い、25Vまで
定電流酸化とし、続いて25Vで1時間の定電圧酸化を
行なった。この後AI2膜24を1μm堆積し、これを
パターニングして上部電極配線を形成した。
第5図は、この実施例3のリーク電流特性を従来例と比
較して示す。この実施例3では従来例と比べてリーク電
流は大幅に減少し、また高い耐圧が得られている。
以上の実施例において、M O−’ T 8合金薄膜の
電極配線は、例えばTa薄膜に比べて抵抗率が小さい。
これは、実施例のTPTやMIM素子を大面積の液晶表
示素子に適用した場合にパルス電圧波形の歪みが小さく
なる、という点で非常に有利である。
以上では、代表的な実施例としてTPTとM I M素
子に適用した場合を説明したが、その他本発明は各種の
電子素子の絶縁膜として利用して大きい効果が得られる
。
[発明の効果] 以上述べたように本発明によれば、抵抗率が高く、且つ
耐圧の高いMo−Ta合金の酸化膜を用いることにより
、各種電子素子の特性向上を図ることかできる。
【図面の簡単な説明】
第1図は本発明の一実施例によるTPTを示す図、第2
図′は他の実施例のTPTを示す図、第3図はこれら実
施例のTPTの特性を従来例と比較して示す図、第4因
は本発明の他の実施例によるMIM素子を示す図、第5
図はそのリーク電流特性を従来例と比較して示す図、第
6図は本発明に用いるMo−Ta合金膜の組成比と絶縁
耐圧の関係を測定した結果を示す図、第7図は同じく抵
抗率を測定した結果を示す図である。 11・・・ガラス基板、12・・・Mo−Ta合金膜、
13・・・vA極酸酸化膜14・・・アンド−プロ−3
i膜、15 ・n+型a−5igl、16−M0//l
膜、21・・・ガラス基板、22・・・MO−Ta合金
膜、23・・・陽極酸化膜、24・・・AN膜。 出願人代理人 弁理士 鈴江武彦 第1図 第2図 ■ 第3図 第4図 第5図 第6図

Claims (3)

    【特許請求の範囲】
  1. (1)タンタルの組成比が50〜97原子%であるモリ
    ブデンとタンタルの合金の酸化物からなる絶縁膜を有す
    ることを特徴とする電子装置。
  2. (2)前記酸化物が陽極酸化膜である特許請求の範囲1
    項記載の電子装置。
  3. (3)前記合金の薄膜をゲート電極とし、このゲート電
    極の表面を酸化して形成した絶縁膜をゲート絶縁膜の少
    なくとも一層として薄膜トランジスタを構成した特許請
    求の範囲第1項記載の電子装置。
JP61315341A 1986-12-23 1986-12-26 電子装置 Pending JPS63166236A (ja)

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