JPS6384800U - - Google Patents

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JPS6384800U
JPS6384800U JP17658886U JP17658886U JPS6384800U JP S6384800 U JPS6384800 U JP S6384800U JP 17658886 U JP17658886 U JP 17658886U JP 17658886 U JP17658886 U JP 17658886U JP S6384800 U JPS6384800 U JP S6384800U
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JP
Japan
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arithmetic processing
battery voltage
processing means
level
detection means
Prior art date
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JP17658886U
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Description

【図面の簡単な説明】
第１図は本考案に係る不揮発性メモリ誤書込防
止回路の実施例を示す回路図、第２図ａ乃至ｃは
第１図においてバツテリ電圧正常状態におけるイ
グニツシヨンキーオン、オフ時の各部波形図、第
３図ａ乃至ｅはイグニツシヨンキーオン時におけ
るバツテリ電圧低下時の各部波形図、第４図は第
１図におけるバツテリ電圧低下時のＣＰＵが実行
するプログラムのフローチヤートを示す図、第５
図は従来の構成を示す回路図、第６図ａ，ｂは第
５図におけるイグニツシヨンキーオン、オフ時の
各部波形図である。 １……演算処理手段、２……不揮発性メモリ、
３……イグニツシヨンキー検出回路、４……第１
のバツテリ電圧検出回路、５……第２のバツテリ
電圧検出回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. 所定のプログラムに従つて演算処理を行なう演
    算処理手段と、該演算処理手段の処理データが書
    込まれる不揮発性メモリと、イグニツシヨンキー
    のオン、オフ状態を検出してオフの場合前記演算
    処理手段をスタンバイ（待機）状態にするイグニ
    ツシヨンキー検出手段と、バツテリの電圧を検出
    し該電圧が第１のレベルに低下したときに前記演
    算処理手段をリセツト（初期）状態にする第１の
    バツテリ電圧検出手段と、バツテリの電圧を検出
    し該電圧が前記第１のレベルより高い第２のレベ
    ルに低下したときに前記演算処理手段をスタンバ
    イ状態にする第２のバツテリ電圧検出手段とを備
    え、演算処理手段が不揮発性メモリに書込みを行
    なつているとき、バツテリ電圧が前記第２のレベ
    ルに低下したときに第２のバツテリ電圧検出手段
    より演算処理手段にスタンバイ信号を供給すると
    共に該書込み動作を続行させ、第１のレベルまで
    低下したときに前記第１のバツテリ電圧検出手段
    により演算処理手段をリセツト状態にするように
    構成したことを特徴とする不揮発生メモリ誤書込
    防止回路。
JP17658886U 1986-11-19 1986-11-19 Pending JPS6384800U (ja)

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JP17658886U JPS6384800U (ja) 1986-11-19 1986-11-19

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JP17658886U JPS6384800U (ja) 1986-11-19 1986-11-19

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JPS6384800U true JPS6384800U (ja) 1988-06-03

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2007162586A (ja) * 2005-12-14 2007-06-28 Denso Corp 車載制御装置

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5841246A (ja) * 1981-09-04 1983-03-10 Nissan Motor Co Ltd 車両情報記憶装置
JPS6120162A (ja) * 1984-07-06 1986-01-28 Nec Corp Ｃｍｏｓ　ｒａｍ　保護回路

Patent Citations (2)

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