JPS6412189B2 - - Google Patents
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- JPS6412189B2 JPS6412189B2 JP55035521A JP3552180A JPS6412189B2 JP S6412189 B2 JPS6412189 B2 JP S6412189B2 JP 55035521 A JP55035521 A JP 55035521A JP 3552180 A JP3552180 A JP 3552180A JP S6412189 B2 JPS6412189 B2 JP S6412189B2
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- Japan
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- commutation
- abnormality
- detection means
- time
- commutation overlap
- Prior art date
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- Expired
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Classifications
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M7/00—Conversion of AC power input into DC power output; Conversion of DC power input into AC power output
- H02M7/66—Conversion of AC power input into DC power output; Conversion of DC power input into AC power output with possibility of reversal
- H02M7/68—Conversion of AC power input into DC power output; Conversion of DC power input into AC power output with possibility of reversal by static converters
- H02M7/72—Conversion of AC power input into DC power output; Conversion of DC power input into AC power output with possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode
- H02M7/75—Conversion of AC power input into DC power output; Conversion of DC power input into AC power output with possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a thyratron or thyristor type requiring extinguishing means
- H02M7/757—Conversion of AC power input into DC power output; Conversion of DC power input into AC power output with possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a thyratron or thyristor type requiring extinguishing means using semiconductor devices only
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Protection Of Static Devices (AREA)
- Power Conversion In General (AREA)
- Inverter Devices (AREA)
Description
【発明の詳細な説明】
本発明は転流異常検出装置に係り、特に順変換
運転及び逆変換運転を行なう電力変換装置におい
て通常運転時の転流重なり時間を常時検出監視
し、異常転流を未然に予知検出するようにした電
力変換装置の転流異常検出装置に関する。
運転及び逆変換運転を行なう電力変換装置におい
て通常運転時の転流重なり時間を常時検出監視
し、異常転流を未然に予知検出するようにした電
力変換装置の転流異常検出装置に関する。
従来の転流異常検出装置の一例を第１図のブロ
ツク図に示す。同図中Ｕ，Ｖ，Ｗは交流側母線、
CTU，CTV，CTWは線電流検出用変換器、
THU，THV，THW，THX，THY，THZは
３相全波整流回路を構成する６個のサイリスタ、
XDCは直流側の平滑用直流リアクトル、DCCT
は直流側電流を検出する直流変流器、CD1は線電
流検出用変換器CTU，CTV，CTWから交流電
流IAC′を検出する交流側電流検出器、CD２は前
記直流変流器DCCTから直流電流IDC′を検出する
直流側電流検出器、DET１は前記各電流検出器
CD１，CD２の各検出信号IAC′とIDC′を比較して
転流異常による差電流を検出する差電流検出装置
である。
ツク図に示す。同図中Ｕ，Ｖ，Ｗは交流側母線、
CTU，CTV，CTWは線電流検出用変換器、
THU，THV，THW，THX，THY，THZは
３相全波整流回路を構成する６個のサイリスタ、
XDCは直流側の平滑用直流リアクトル、DCCT
は直流側電流を検出する直流変流器、CD1は線電
流検出用変換器CTU，CTV，CTWから交流電
流IAC′を検出する交流側電流検出器、CD２は前
記直流変流器DCCTから直流電流IDC′を検出する
直流側電流検出器、DET１は前記各電流検出器
CD１，CD２の各検出信号IAC′とIDC′を比較して
転流異常による差電流を検出する差電流検出装置
である。
かかる構成に於いて、この電力変換系統は交流
側が交流側母線Ｕ，Ｖ，Ｗから線電流検出用変流
器CTU，CTV，CTWを設置された線路を通し
て６個のサイリスタTHU〜THZで構成した３相
全波整流回路の交流側に接続される系統で構成さ
れ、直流側が前記３相全波整流回路の直流側から
平滑用直流リアクトルXDCを通して直流側母線
Ｐ，Ｎに接続される系統で構成されるという一般
的な構成の主回路から成る。ここで、変流器
CTU，CTV，CTW及び交流側電流検出装置CD
１によつて検出された交流側線電流検出信号
IAC′と、直流変流器DCCT及び直流側電流検出装
置CD２によつて検出された直流側電流検出信号
IDC′を差電流検出装置DET１によつて比較して、
転流異常による差電流を検出し転流異常を検出す
る。その結果得られた転流異常検出信号Ｓにより
図示しない交流側、直流側母線のしや断器を開放
する等して保護連動動作を行なわせていた。
側が交流側母線Ｕ，Ｖ，Ｗから線電流検出用変流
器CTU，CTV，CTWを設置された線路を通し
て６個のサイリスタTHU〜THZで構成した３相
全波整流回路の交流側に接続される系統で構成さ
れ、直流側が前記３相全波整流回路の直流側から
平滑用直流リアクトルXDCを通して直流側母線
Ｐ，Ｎに接続される系統で構成されるという一般
的な構成の主回路から成る。ここで、変流器
CTU，CTV，CTW及び交流側電流検出装置CD
１によつて検出された交流側線電流検出信号
IAC′と、直流変流器DCCT及び直流側電流検出装
置CD２によつて検出された直流側電流検出信号
IDC′を差電流検出装置DET１によつて比較して、
転流異常による差電流を検出し転流異常を検出す
る。その結果得られた転流異常検出信号Ｓにより
図示しない交流側、直流側母線のしや断器を開放
する等して保護連動動作を行なわせていた。
しかしながら、かかる方法では転流異常が発生
してから検出動作が行なわれるため、しや断器開
放までの動作時間に遅れが生じ、その間に転流異
常による事故電流、例えば直流短絡電流Isが流れ
る等して主回路器機を破損する危険を伴うという
欠点があつた。
してから検出動作が行なわれるため、しや断器開
放までの動作時間に遅れが生じ、その間に転流異
常による事故電流、例えば直流短絡電流Isが流れ
る等して主回路器機を破損する危険を伴うという
欠点があつた。
従つて、本発明の目的は上記従来技術の欠点を
なくし、検出応答性に優れ、機器保護の上で効果
的な転流異常検出装置を提供することにある。
なくし、検出応答性に優れ、機器保護の上で効果
的な転流異常検出装置を提供することにある。
この目的を達成するために本発明の転流異常検
出装置は、電力変換装置を構成する各アームの電
気弁に流れる電流の通電区間を検出する通電区間
検出手段と、この通電区間検出手段の出力から前
記各アーム間の転流重なり時間を検出する転流重
なり時間検出手段と、この転流重なり時間検出手
段の出力信号が予め定められた一定時間以上の転
流重なり時間を示した時に転流重なり時間異常信
号を出力する異常検出手段と、この異常検出手段
が転流重なり時間異常信号を出力した時に転流重
なり時間異常を生じたアームを記憶する記憶手段
とを備え、転流失敗等の異常状態に至る前に警
報、保護等の連動動作を可能としたことを特徴と
するものである。
出装置は、電力変換装置を構成する各アームの電
気弁に流れる電流の通電区間を検出する通電区間
検出手段と、この通電区間検出手段の出力から前
記各アーム間の転流重なり時間を検出する転流重
なり時間検出手段と、この転流重なり時間検出手
段の出力信号が予め定められた一定時間以上の転
流重なり時間を示した時に転流重なり時間異常信
号を出力する異常検出手段と、この異常検出手段
が転流重なり時間異常信号を出力した時に転流重
なり時間異常を生じたアームを記憶する記憶手段
とを備え、転流失敗等の異常状態に至る前に警
報、保護等の連動動作を可能としたことを特徴と
するものである。
以下、図面に従つて本発明を更に詳細に説明す
る。
る。
第２図は本発明の一実施例に係る転流異常検出
装置のブロツク図で、同図中CDは変流器CTU、
CTV、CTWを通じて各サイリスタTHU，
THV，THW，THX，THY，THZの通電区間
を通電中、信号CDU，CDV，CDW，CDX，
CDY，CDZとして検出する通電区間検出装置、
BMは各サイリスタTHU、THV，THW，
THX，THY，THZの通電状態をメモリーする
バツフアーメモリー回路で通常はバツフアーとし
て動作し、ゲートブロツク信号GBによりブロツ
ク直前の通電状態をメモリーする。このメモリー
作用は異常が検出され通電中にゲート信号がブロ
ツクされたときもその状態をメモリーして異常原
因の発見を容易に行なわせるためのものである。
FDな前記バツフアーメモリー回路BMの出力信
号CDU′，CDZ′、CDV′CDX′，CDW′，CDY′に
基いて転流異常を検出する転流異常検出回路、
GBは前記バツフアーメモリー回路BMに与えら
れるゲートブロツク信号である。
装置のブロツク図で、同図中CDは変流器CTU、
CTV、CTWを通じて各サイリスタTHU，
THV，THW，THX，THY，THZの通電区間
を通電中、信号CDU，CDV，CDW，CDX，
CDY，CDZとして検出する通電区間検出装置、
BMは各サイリスタTHU、THV，THW，
THX，THY，THZの通電状態をメモリーする
バツフアーメモリー回路で通常はバツフアーとし
て動作し、ゲートブロツク信号GBによりブロツ
ク直前の通電状態をメモリーする。このメモリー
作用は異常が検出され通電中にゲート信号がブロ
ツクされたときもその状態をメモリーして異常原
因の発見を容易に行なわせるためのものである。
FDな前記バツフアーメモリー回路BMの出力信
号CDU′，CDZ′、CDV′CDX′，CDW′，CDY′に
基いて転流異常を検出する転流異常検出回路、
GBは前記バツフアーメモリー回路BMに与えら
れるゲートブロツク信号である。
かかる構成に於いて、順変換運転のときは交流
側から直流側へ、逆変換運転のときは直流側から
交流側へ電力変換が行なわれるのは周知の通りで
ある。今、交流側母線Ｕ，Ｖ，Ｗに電圧に印加し
６個のサイリスタTHU〜THZにゲートパルスを
加え、直流側母線Ｐ，Ｎに一定の電流を通電して
いる場合を考える。通常の運転状態では直流側電
流Idは断続しない様に平滑用直流リアクトル
XDCが決めてあり、また交流側には図示しない
転流インダクタンスがあるのでサイリスタが転流
するとき、重なり電流の流れる期間が発生する。
側から直流側へ、逆変換運転のときは直流側から
交流側へ電力変換が行なわれるのは周知の通りで
ある。今、交流側母線Ｕ，Ｖ，Ｗに電圧に印加し
６個のサイリスタTHU〜THZにゲートパルスを
加え、直流側母線Ｐ，Ｎに一定の電流を通電して
いる場合を考える。通常の運転状態では直流側電
流Idは断続しない様に平滑用直流リアクトル
XDCが決めてあり、また交流側には図示しない
転流インダクタンスがあるのでサイリスタが転流
するとき、重なり電流の流れる期間が発生する。
かかる運転状態における各部の波形のタイムチ
ヤートを第３図に示す。同図中GPU，GPZ，
GPV，GPX，GPW、GPYはサイリスタTHU，
THZ，THV，THX，THW、THYに加わるゲ
ートパルス、IU，IV，IWは交流側母線Ｕ，Ｖ，Ｗ
に流れる線電流、LCU，LCZ，LCV，LCX，
LCW，LCYは導通開始時の転流重なり期間、
LCDは転流重なり期間検出のオア信号をそれぞ
れ示すものである。
ヤートを第３図に示す。同図中GPU，GPZ，
GPV，GPX，GPW、GPYはサイリスタTHU，
THZ，THV，THX，THW、THYに加わるゲ
ートパルス、IU，IV，IWは交流側母線Ｕ，Ｖ，Ｗ
に流れる線電流、LCU，LCZ，LCV，LCX，
LCW，LCYは導通開始時の転流重なり期間、
LCDは転流重なり期間検出のオア信号をそれぞ
れ示すものである。
転流異常検出装置FDの具体的な構成例を第４
図のブロツク図に示す。同図中、GU１，GZ１，
GV１、GX１，GW１，GY１は各バツフアーメ
モリー回路BMの出力信号CDU′，CDZ′，CDV′，
CDX′，CDW′，CDY′から転流重なり期間LCU，
LCZ，LCV，LCX，LCW，LCYを検出するため
のアンドゲート、GSは前記転流重なり期間のオ
ア条件LCDを得るためのオアゲート、DETは転
流重なり期間が所定の判定時間を超えた時、転流
重なり時間の異常を検出する異常検出装置、
FFAは前記異常検出装置DETの出力によつてセ
ツトされ、転流重なり時間異常信号Ｓを出力する
フリツプフロツプ、GU２，GZ２，GV２，GX
２、GW２、GY２は転流重なり期間信号LCU、
LCZ、LCV，LCX、LCW、LCYと前記転流重な
り時間異常信号を受けているワンシヨツト回路
SSの出力信号とそれぞれアンド条件をとるアン
ドゲート、FFU，FFZ，FFV，FFX、FFW，
FFYは前記アンドゲートGU２，GZ２，GV２，
GX２、GW２，GY２の各出力によつてセツトさ
れるフリツプフロツプ、ADは前記フリツプフロ
ツプFFU，FFZ，FFV，FFX，FFW，FFY，
FFAの各出力を受けて異常発生警告を行うと共
に異常アームを表示する異常警報表示装置であ
る。
図のブロツク図に示す。同図中、GU１，GZ１，
GV１、GX１，GW１，GY１は各バツフアーメ
モリー回路BMの出力信号CDU′，CDZ′，CDV′，
CDX′，CDW′，CDY′から転流重なり期間LCU，
LCZ，LCV，LCX，LCW，LCYを検出するため
のアンドゲート、GSは前記転流重なり期間のオ
ア条件LCDを得るためのオアゲート、DETは転
流重なり期間が所定の判定時間を超えた時、転流
重なり時間の異常を検出する異常検出装置、
FFAは前記異常検出装置DETの出力によつてセ
ツトされ、転流重なり時間異常信号Ｓを出力する
フリツプフロツプ、GU２，GZ２，GV２，GX
２、GW２、GY２は転流重なり期間信号LCU、
LCZ、LCV，LCX、LCW、LCYと前記転流重な
り時間異常信号を受けているワンシヨツト回路
SSの出力信号とそれぞれアンド条件をとるアン
ドゲート、FFU，FFZ，FFV，FFX、FFW，
FFYは前記アンドゲートGU２，GZ２，GV２，
GX２、GW２，GY２の各出力によつてセツトさ
れるフリツプフロツプ、ADは前記フリツプフロ
ツプFFU，FFZ，FFV，FFX，FFW，FFY，
FFAの各出力を受けて異常発生警告を行うと共
に異常アームを表示する異常警報表示装置であ
る。
かかる構成において、CDU′，CDZ′，CDV′，
CDX′，CDW′，CDY′はバツフアーメモリー装置
BMの出力信号を示し、通常は通電区間検出装置
CDの検出信号CDU，CDZ，CDV，CDX，
CDW，CDYと同じタイミングで発生している。
今サイリスタTHWとサイリスタTHYが導通し
ているとき、サイリスタTHUとTHYにゲート
パルスGPUとGPYを与えると、サイリスタ
THUが導通しサイリスタTHWが非導通となり
サイリスタTHWからサイリスタTHUに転流が
行なわれる。このときサイリスタTHUとサイリ
スタTHWが同時に導通している区間、即ち転流
重なり区間t1が発生する。以下同様に転流の順序
でt2，t3，…t6の転流重なり区間が発生する。転
流メカニズムについては周知であるのでその詳細
については省略する。
CDX′，CDW′，CDY′はバツフアーメモリー装置
BMの出力信号を示し、通常は通電区間検出装置
CDの検出信号CDU，CDZ，CDV，CDX，
CDW，CDYと同じタイミングで発生している。
今サイリスタTHWとサイリスタTHYが導通し
ているとき、サイリスタTHUとTHYにゲート
パルスGPUとGPYを与えると、サイリスタ
THUが導通しサイリスタTHWが非導通となり
サイリスタTHWからサイリスタTHUに転流が
行なわれる。このときサイリスタTHUとサイリ
スタTHWが同時に導通している区間、即ち転流
重なり区間t1が発生する。以下同様に転流の順序
でt2，t3，…t6の転流重なり区間が発生する。転
流メカニズムについては周知であるのでその詳細
については省略する。
アンドゲートGU１〜GY１は通電区間検出信
号CDU′〜CDY′から各サイリスタTHU〜THY
の導通開始時の転流重なり期間をLCU〜LCYと
して検出する。これらの信号の論理和をオアゲー
トGSにて信号LCDとして検出し、異常検出装置
DETに印加する。
号CDU′〜CDY′から各サイリスタTHU〜THY
の導通開始時の転流重なり期間をLCU〜LCYと
して検出する。これらの信号の論理和をオアゲー
トGSにて信号LCDとして検出し、異常検出装置
DETに印加する。
前記異常検出装置DETは、正常転流重なり時
間の判定値t0を設定するオンデイレータイマー要
素で構成され、信号LCDのどれか１つでもt0を越
えればフリツプフロツプFFAをセツトして、異
常警報表示装置ADに転流重なり時間異常信号を
送り警報を出す。同時にワンシヨツト回路SSの
出力信号によりアンドゲートGU２〜GY2を開い
て異常を検出したアームのフリツプフロツプ
FFU〜FFYをセツトし異常警報表示装置ADに表
示信号として伝達し異常アームを表示する。例え
ば、サイリスタTHVからサイリスタTHWに転
流するとき、何等かの原因で重なり期間が増加
し、第３図中t5に示す如く重なり期間の異常が検
出されると、転流重なり期間異常検出装置DET
の設定時間t0後に転流重なり時間異常信号Ｓが発
生して保護連動動作を行なうことが可能である。
なお、異常の原因除去後は各フリツプフロツプ
FFA，FFU〜FFYのリセツト側にリセツト信号
RESETを与え次の異常検出に備える。
間の判定値t0を設定するオンデイレータイマー要
素で構成され、信号LCDのどれか１つでもt0を越
えればフリツプフロツプFFAをセツトして、異
常警報表示装置ADに転流重なり時間異常信号を
送り警報を出す。同時にワンシヨツト回路SSの
出力信号によりアンドゲートGU２〜GY2を開い
て異常を検出したアームのフリツプフロツプ
FFU〜FFYをセツトし異常警報表示装置ADに表
示信号として伝達し異常アームを表示する。例え
ば、サイリスタTHVからサイリスタTHWに転
流するとき、何等かの原因で重なり期間が増加
し、第３図中t5に示す如く重なり期間の異常が検
出されると、転流重なり期間異常検出装置DET
の設定時間t0後に転流重なり時間異常信号Ｓが発
生して保護連動動作を行なうことが可能である。
なお、異常の原因除去後は各フリツプフロツプ
FFA，FFU〜FFYのリセツト側にリセツト信号
RESETを与え次の異常検出に備える。
以上述べた如く、本発明によれば、電力変換装
置の転流異常を転流失敗等の異常が発生する前に
予知検出し、警報または保護連動動作を行うこと
が可能となるため、高い信頼性のもとに電力変換
装置の保護を行うことのできる転流異常検出装置
を得ることができる。
置の転流異常を転流失敗等の異常が発生する前に
予知検出し、警報または保護連動動作を行うこと
が可能となるため、高い信頼性のもとに電力変換
装置の保護を行うことのできる転流異常検出装置
を得ることができる。
第１図は従来の転流異常検出装置のブロツク
図、第２図は本発明の一実施例に係る転流異常検
出装置のブロツク図、第３図は第２図の構成の動
作を説明するためのタイムチヤート、第４図は第
２図に示した転流異常検出回路の具体的な構成例
を示すブロツク図である。 CD……通電区間検出装置、BM……バツフア
ーメモリー回路、FD……転流異常検出回路、
DET……異常検出装置、SS……ワンシヨツト回
路、GU１〜GY１……アンドゲート、GU２〜
GY２……アンドゲート、GS……オアゲート、
FFA，FFU〜FFY……フリツプフロツプ、AD
……異常警報表示装置。
図、第２図は本発明の一実施例に係る転流異常検
出装置のブロツク図、第３図は第２図の構成の動
作を説明するためのタイムチヤート、第４図は第
２図に示した転流異常検出回路の具体的な構成例
を示すブロツク図である。 CD……通電区間検出装置、BM……バツフア
ーメモリー回路、FD……転流異常検出回路、
DET……異常検出装置、SS……ワンシヨツト回
路、GU１〜GY１……アンドゲート、GU２〜
GY２……アンドゲート、GS……オアゲート、
FFA，FFU〜FFY……フリツプフロツプ、AD
……異常警報表示装置。
Claims (1)
- １ 電力変換装置を構成する各アームの電気弁に
流れる電流の通電区間を検出する通電区間検出手
段と、この通電区間検出手段の出力から前記各ア
ーム間の転流重なり時間を検出する転流重なり時
間検出手段と、この転流重なり時間検出手段の出
力信号が予め定められた一定時間以上の転流重な
り時間を示した時に転流重なり時間異常信号を出
力する異常検出手段と、この異常検出手段が転流
重なり時間異常信号を出力した時に転流重なり時
間異常を生じたアームを記憶する記憶手段とを備
え、転流失敗等の異常状態に至る前に警報、保護
等の連動動作を可能としたことを特徴とする転流
異常検出装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3552180A JPS56132166A (en) | 1980-03-19 | 1980-03-19 | Commutation abnormality detection device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3552180A JPS56132166A (en) | 1980-03-19 | 1980-03-19 | Commutation abnormality detection device |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS56132166A JPS56132166A (en) | 1981-10-16 |
| JPS6412189B2 true JPS6412189B2 (ja) | 1989-02-28 |
Family
ID=12444045
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3552180A Granted JPS56132166A (en) | 1980-03-19 | 1980-03-19 | Commutation abnormality detection device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS56132166A (ja) |
-
1980
- 1980-03-19 JP JP3552180A patent/JPS56132166A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS56132166A (en) | 1981-10-16 |
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