JPS641857B2 - - Google Patents
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- JPS641857B2 JPS641857B2 JP11209583A JP11209583A JPS641857B2 JP S641857 B2 JPS641857 B2 JP S641857B2 JP 11209583 A JP11209583 A JP 11209583A JP 11209583 A JP11209583 A JP 11209583A JP S641857 B2 JPS641857 B2 JP S641857B2
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- signal
- output
- pulse
- tracking error
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B7/00—Recording or reproducing by optical means, e.g. recording using a thermal beam of optical radiation by modifying optical properties or the physical structure, reproducing using an optical beam at lower power by sensing optical properties; Record carriers therefor
- G11B7/08—Disposition or mounting of heads or light sources relatively to record carriers
- G11B7/09—Disposition or mounting of heads or light sources relatively to record carriers with provision for moving the light beam or focus plane for the purpose of maintaining alignment of the light beam relative to the record carrier during transducing operation, e.g. to compensate for surface irregularities of the latter or for track following
- G11B7/0901—Disposition or mounting of heads or light sources relatively to record carriers with provision for moving the light beam or focus plane for the purpose of maintaining alignment of the light beam relative to the record carrier during transducing operation, e.g. to compensate for surface irregularities of the latter or for track following for track following only
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- Optical Recording Or Reproduction (AREA)
Description
【発明の詳細な説明】
(イ) 産業上の利用分野
本発明は、光学式のピツクアツプを用いてデイ
スク上の信号を読み取るDAD（デジタルオーデイ
オデイスク）プレーヤの如き再生装置に利用され
るトラツキングエラー検出回路に関するものであ
る。
スク上の信号を読み取るDAD（デジタルオーデイ
オデイスク）プレーヤの如き再生装置に利用され
るトラツキングエラー検出回路に関するものであ
る。
(ロ) 従来技術
デイスク上に配設されたデジタル信号に対応す
る凹凸に、光（レーザー光線）を投射して再生を
行うDADプレーヤが知られている。この様な
DADプレーヤにおいては、光を正確に前記凹凸
に投射する必要があり、トラツク（前記凹凸の
列）から投射光がはずれない様に制御する為のト
ラツキングサーボ機構を備えている。
る凹凸に、光（レーザー光線）を投射して再生を
行うDADプレーヤが知られている。この様な
DADプレーヤにおいては、光を正確に前記凹凸
に投射する必要があり、トラツク（前記凹凸の
列）から投射光がはずれない様に制御する為のト
ラツキングサーボ機構を備えている。
トラツキングサーボ機構には、トラツクとピツ
クアツプとの相対位置関係に応じてトラツキング
エラー信号を発生するトラツキングエラー検出回
路を必要とする。しかして、従来、１ビーム方式
のピツクアツプにおいては、ヘテロダイン方式と
言われる第１図に示す如きトラツキングエラー検
出回路が使用されていた。第１図において、１
は、第１乃至第４の部分２乃至５に４分割された
光検出器である。この光検出器１は、受光された
光量に応じて第１乃至第４の部分４乃至５から信
号を発生するもので、対角線方向の２つの部分
（第１の部分２と第３の部分４、第２の部分３と
第４の部分５）の加算信号が、トラツキングエラ
ーが無い時等しくなる様に設定されている。光検
出器１の各部分から得られる信号のうち、第１の
部分(2)から得られる信号ａと第３の部分４から得
られる信号ｃとは、第１加算回路６に印加されて
加算され、第２の部分３から得られる信号ｂと第
４の部分５から得られる信号ｄとは、第２加算回
路７に印加されて加算される。その為、第１加算
回路６の出力端には、和信号（ａ＋ｃ）が、第２
加算回路７の出力端には、和信号（ｂ＋ｄ）がそ
れぞれ得られる。和信号（ａ＋ｃ）及び（ｂ＋
ｄ）は、第３加算回路８に印加されて更に加算さ
れるとともに、第１減算回路９で減算される。そ
の結果、第３加算回路８の出力端には、HF信号
（ａ＋ｂ＋ｃ＋ｄ）が得られ、第１減算回路９の
出力端には、DL信号（（ａ＋ｃ）−（ｂ＋ｄ））が
得られる。第３加算回路８の出力端に得られる
HF信号は、立上りパルス発生回路１０及び立下
りパルス発生回路１１に印加され、前記HF信号
の立上りに応じたパルスが前記立上りパルス発生
回路１０から、また前記HF信号の立下りに応じ
たパルスが前記立下りパルス発生回路１１から発
生する。一方、第１減算回路９の出力信号である
DL信号は、第１及び第２サンプリング回路１２
及び１３に印加され、前記第１サンプリング回路
１２に印加されたDL信号は、前記立上りパルス
発生回路１０の出力パルスで、前記第２サンプリ
ング回路１３に印加されたDL信号は、前記立下
りパルス発生回路１１の出力パルスでそれぞれサ
ンプリングされる。更に、前記第１サンプリング
回路１２の出力信号は、第１ホールド回路１４に
印加され、前記第２サンプリング回路１３の出力
信号は、第２ホールド回路１５に印加されて信号
レベルの保持が行なわれる。前記第１及び第２ホ
ールド回路１４及び１５の出力信号は、互いに逆
相の関係にあり、それぞれがトラツキングエラー
に対応したものであるが、信号の確実性を増す為
に、第２減算回路１６に印加され、該第２減算回
路１６の出力端に接続された出力端子１７にトラ
ツキングエラー信号が発生する。
クアツプとの相対位置関係に応じてトラツキング
エラー信号を発生するトラツキングエラー検出回
路を必要とする。しかして、従来、１ビーム方式
のピツクアツプにおいては、ヘテロダイン方式と
言われる第１図に示す如きトラツキングエラー検
出回路が使用されていた。第１図において、１
は、第１乃至第４の部分２乃至５に４分割された
光検出器である。この光検出器１は、受光された
光量に応じて第１乃至第４の部分４乃至５から信
号を発生するもので、対角線方向の２つの部分
（第１の部分２と第３の部分４、第２の部分３と
第４の部分５）の加算信号が、トラツキングエラ
ーが無い時等しくなる様に設定されている。光検
出器１の各部分から得られる信号のうち、第１の
部分(2)から得られる信号ａと第３の部分４から得
られる信号ｃとは、第１加算回路６に印加されて
加算され、第２の部分３から得られる信号ｂと第
４の部分５から得られる信号ｄとは、第２加算回
路７に印加されて加算される。その為、第１加算
回路６の出力端には、和信号（ａ＋ｃ）が、第２
加算回路７の出力端には、和信号（ｂ＋ｄ）がそ
れぞれ得られる。和信号（ａ＋ｃ）及び（ｂ＋
ｄ）は、第３加算回路８に印加されて更に加算さ
れるとともに、第１減算回路９で減算される。そ
の結果、第３加算回路８の出力端には、HF信号
（ａ＋ｂ＋ｃ＋ｄ）が得られ、第１減算回路９の
出力端には、DL信号（（ａ＋ｃ）−（ｂ＋ｄ））が
得られる。第３加算回路８の出力端に得られる
HF信号は、立上りパルス発生回路１０及び立下
りパルス発生回路１１に印加され、前記HF信号
の立上りに応じたパルスが前記立上りパルス発生
回路１０から、また前記HF信号の立下りに応じ
たパルスが前記立下りパルス発生回路１１から発
生する。一方、第１減算回路９の出力信号である
DL信号は、第１及び第２サンプリング回路１２
及び１３に印加され、前記第１サンプリング回路
１２に印加されたDL信号は、前記立上りパルス
発生回路１０の出力パルスで、前記第２サンプリ
ング回路１３に印加されたDL信号は、前記立下
りパルス発生回路１１の出力パルスでそれぞれサ
ンプリングされる。更に、前記第１サンプリング
回路１２の出力信号は、第１ホールド回路１４に
印加され、前記第２サンプリング回路１３の出力
信号は、第２ホールド回路１５に印加されて信号
レベルの保持が行なわれる。前記第１及び第２ホ
ールド回路１４及び１５の出力信号は、互いに逆
相の関係にあり、それぞれがトラツキングエラー
に対応したものであるが、信号の確実性を増す為
に、第２減算回路１６に印加され、該第２減算回
路１６の出力端に接続された出力端子１７にトラ
ツキングエラー信号が発生する。
第１図の如きトラツキングエラー検出回路を用
いれば、トラツキングエラーの有無及び左右いず
れの方向へのトラツキングエラーが発生したかが
検出出来る。例えば、トラツキングエラーが無い
場合には、第１加算回路６の出力信号（ａ＋ｃ）
と第２加算回路７の出力信号（ｂ＋ｄ）とが等し
くなり、DL信号が零となるから、出力端子１７
にトラツキングエラー信号が発生しない。また、
トラツキングが第１図ＡもしくはＢ方向にずれる
と、第１図の第１加算回路６の出力信号（ａ＋
ｃ）の大きさと、第２加算回路７の出力信号（ｂ
＋ｄ）の大きさに違いが生じ、所定値のDL信号
が生じるのでトラツキングエラーが生じたことが
解かり、かつその極性によりＡ方向のトラツキン
グエラーか、Ｂ方向のトラツキングエラーかが判
定される。
いれば、トラツキングエラーの有無及び左右いず
れの方向へのトラツキングエラーが発生したかが
検出出来る。例えば、トラツキングエラーが無い
場合には、第１加算回路６の出力信号（ａ＋ｃ）
と第２加算回路７の出力信号（ｂ＋ｄ）とが等し
くなり、DL信号が零となるから、出力端子１７
にトラツキングエラー信号が発生しない。また、
トラツキングが第１図ＡもしくはＢ方向にずれる
と、第１図の第１加算回路６の出力信号（ａ＋
ｃ）の大きさと、第２加算回路７の出力信号（ｂ
＋ｄ）の大きさに違いが生じ、所定値のDL信号
が生じるのでトラツキングエラーが生じたことが
解かり、かつその極性によりＡ方向のトラツキン
グエラーか、Ｂ方向のトラツキングエラーかが判
定される。
この第１図のトラツキングエラー検出回路は、
正確なトラツキングエラー信号を発生させること
が出来るという利点を有するが、高速のサンプリ
ング回路及びホールド回路を必要とする為、価格
が高くなり、かつ回路構成が複雑となるという欠
点を有していた。
正確なトラツキングエラー信号を発生させること
が出来るという利点を有するが、高速のサンプリ
ング回路及びホールド回路を必要とする為、価格
が高くなり、かつ回路構成が複雑となるという欠
点を有していた。
(ハ) 発明の目的
本発明は、上述の点に鑑み成されたもので、構
成が簡単でしかも正確にトラツキングエラーを検
出出来るトラツキングエラー検出回路を提供せん
とするものである。
成が簡単でしかも正確にトラツキングエラーを検
出出来るトラツキングエラー検出回路を提供せん
とするものである。
(ニ) 発明の構成
本発明に係るトラツキングエラー検出回路は、
４分割センサーの対角線方向の２つの部分から得
られる信号同志を加算して作成された第１及び第
２和信号を加算する第１加算回路と、前記第１及
び第２和信号を減算する第１減算回路と、前記第
１加算回路の出力信号の立上りに応じた立上りパ
ルスを発生する立上りパルス発生回路と、前記第
１加算回路の出力信号の立下りに応じた立下りパ
ルスを発生する立下りパルス発生回路と、前記第
１減算回路の出力信号と前記立上りパルスとを加
算する第２加算回路と、前記第１減算回路の出力
信号と前記立下りパルスとを加算する第３加算回
路と、前記第２加算回路の出力信号を検波する第
１検波回路と、前記第３加算回路の出力信号を検
波する第２検波回路と、前記第１及び第２検波回
路の出力信号を減算する第２減算回路とによつて
構成される。
４分割センサーの対角線方向の２つの部分から得
られる信号同志を加算して作成された第１及び第
２和信号を加算する第１加算回路と、前記第１及
び第２和信号を減算する第１減算回路と、前記第
１加算回路の出力信号の立上りに応じた立上りパ
ルスを発生する立上りパルス発生回路と、前記第
１加算回路の出力信号の立下りに応じた立下りパ
ルスを発生する立下りパルス発生回路と、前記第
１減算回路の出力信号と前記立上りパルスとを加
算する第２加算回路と、前記第１減算回路の出力
信号と前記立下りパルスとを加算する第３加算回
路と、前記第２加算回路の出力信号を検波する第
１検波回路と、前記第３加算回路の出力信号を検
波する第２検波回路と、前記第１及び第２検波回
路の出力信号を減算する第２減算回路とによつて
構成される。
(ホ) 実施例
第２図は、本発明の一実施例を示す回路ブロツ
ク図で、１８は第１和信号（ａ＋ｃ）が印加され
る第１入力端子、１９は第２和信号（ｂ＋ｄ）が
印加される第２入力端子、２０は前記第１和信号
と第２和信号とを加算する第１加算回路、２１は
前記第１和信号と第２和信号とを減算する第１減
算回路、２２は前記第１加算回路２０の出力端に
得られるHF信号（ａ＋ｂ＋ｃ＋ｄ）の立上りに
応じたパルスを発生させる立上りパルス発生回
路、２３は前記HF信号の立下りに応じたパルス
を発生させる立下りパルス発生回路、２４は前記
立上りパルス発生回路２２の出力パルスと前記第
１減算回路２１の出力であるDL信号（（ａ＋ｃ）
−（ｂ＋ｄ））とを加算する第２加算回路、２５は
前記立下りパルス発生回路２３の出力パルスと前
記DL信号とを加算する第３加算回路、２６及び
２７は前記第２加算回路２４の出力信号を包絡線
検波する第１検波ダイオード及び第１保持コンデ
ンサ、２８及び２９は前記第３加算回路２５の出
力信号を包絡線検波する第２検波ダイオード及び
第２保持コンデンサ、３０は前記第１保持コンデ
ンサ２７の一端に得られる信号と前記第２保持コ
ンデンサ２９の一端に得られる信号とを減算する
第２減算回路、及び３１は該第２減算回路３０の
出力端に接続され、トラツキングエラーに対応す
る出力信号が得られる出力端子である。
ク図で、１８は第１和信号（ａ＋ｃ）が印加され
る第１入力端子、１９は第２和信号（ｂ＋ｄ）が
印加される第２入力端子、２０は前記第１和信号
と第２和信号とを加算する第１加算回路、２１は
前記第１和信号と第２和信号とを減算する第１減
算回路、２２は前記第１加算回路２０の出力端に
得られるHF信号（ａ＋ｂ＋ｃ＋ｄ）の立上りに
応じたパルスを発生させる立上りパルス発生回
路、２３は前記HF信号の立下りに応じたパルス
を発生させる立下りパルス発生回路、２４は前記
立上りパルス発生回路２２の出力パルスと前記第
１減算回路２１の出力であるDL信号（（ａ＋ｃ）
−（ｂ＋ｄ））とを加算する第２加算回路、２５は
前記立下りパルス発生回路２３の出力パルスと前
記DL信号とを加算する第３加算回路、２６及び
２７は前記第２加算回路２４の出力信号を包絡線
検波する第１検波ダイオード及び第１保持コンデ
ンサ、２８及び２９は前記第３加算回路２５の出
力信号を包絡線検波する第２検波ダイオード及び
第２保持コンデンサ、３０は前記第１保持コンデ
ンサ２７の一端に得られる信号と前記第２保持コ
ンデンサ２９の一端に得られる信号とを減算する
第２減算回路、及び３１は該第２減算回路３０の
出力端に接続され、トラツキングエラーに対応す
る出力信号が得られる出力端子である。
次に動作を説明する。第１図の場合と同様に、
第２図の実施例においても、４分割センサーのそ
れぞれから得られる信号ａ，ｂ，ｃ及びｄのう
ち、対角線方向の信号同志が加算され、第１及び
第２和信号（ａ＋ｃ）及び（ｂ＋ｄ）が作成さ
れ、それぞれ第１及び第２入力端子１８及び１９
に印加される。第１及び第２入力端子１８及び１
９に印加された第１及び第２和信号は、第１加算
回路２０で加算され、その出力端に、第３図イに
示す如きHF信号（ａ＋ｂ＋ｃ＋ｄ）が発生す
る。そして、前記HF信号は、立上りパルス発生
回路２２及び立下りパルス発生回路２３に印加さ
れるので、前記立上りパルス発生回路２２の出力
端に、第３図ハに示す如き立上りパルスが、前記
立下りパルス発生回路２３の出力端に、第３図ニ
に示す如き立下りパルスがそれぞれ発生する。一
方、前記第１及び第２入力端子１８及び１９に印
加された第１及び第２和信号は、第１減算回路２
１で減算され、その出力端に、第３図ロに示す如
きDL信号（（ａ＋ｃ）−（ｂ＋ｄ））が発生する。
そして、前記DL信号は、第２加算回路２４にお
いて前記立上りパルスと加算され、第３加算回路
２５において前記立下りパルスと加算される。第
２及び第３加算回路２４及び２５の出力端に得ら
れる信号を、それぞれ第３図ホ及びヘに示す。第
２加算回路２４の出力端に得られる第３図ホに示
される信号は、第１検波ダイオード２６及び第１
保持コンデンサ２７により包絡線検波されるの
で、第２減算回路３０の一方の入力端には、第３
図トに示される如き信号が得られ、また、第３加
算回路２５の出力端に得られる第３図ヘに示され
る信号は、第２検波ダイオード２８及び第２保持
コンデンサ２９により包絡線検波されるので、第
２減算回路３１の他方の入力端には、第３図チに
示される如き信号が得られる。第２減算回路３０
に印加された第３図ト及びチに示される信号は、
該第２減算回路３０で減算され、出力端子３１に
第３図リに示す如き出力信号が発生する。ところ
で、光検出器に受光される光のデイスクの凹凸に
よる強度分布の変化の仕方からDL信号の振幅は、
トラツキングエラーの度合いによつて大きさが変
化し、DL信号の位相は、トラツキングエラーの
方向によつてHF信号に対して90゜の進みあるいは
遅れを伴う。その為、第３図リに示される信号
は、トラツキングエラーに対応したものとなる。
しかも、デイスクへの投射光は、トラツキングサ
ーボ回路（図示せず）が有するサーボ帯域の為に
第３図リに示される信号を平滑させた信号で駆動
されるのと同等に滑らかに変移されることにな
る。したがつて、第３図リに示される信号を用い
てトラツキングサーボを行うことができる。尚、
第３図リに示される信号は、トラツキングエラー
が無いときに基準レベルとなり、トラツキングエ
ラーの度合いによつて基準レベルとのレベル差が
現われ、トラツキングエラーの方向によつて基準
レベルに対して正あるいは負となる。
第２図の実施例においても、４分割センサーのそ
れぞれから得られる信号ａ，ｂ，ｃ及びｄのう
ち、対角線方向の信号同志が加算され、第１及び
第２和信号（ａ＋ｃ）及び（ｂ＋ｄ）が作成さ
れ、それぞれ第１及び第２入力端子１８及び１９
に印加される。第１及び第２入力端子１８及び１
９に印加された第１及び第２和信号は、第１加算
回路２０で加算され、その出力端に、第３図イに
示す如きHF信号（ａ＋ｂ＋ｃ＋ｄ）が発生す
る。そして、前記HF信号は、立上りパルス発生
回路２２及び立下りパルス発生回路２３に印加さ
れるので、前記立上りパルス発生回路２２の出力
端に、第３図ハに示す如き立上りパルスが、前記
立下りパルス発生回路２３の出力端に、第３図ニ
に示す如き立下りパルスがそれぞれ発生する。一
方、前記第１及び第２入力端子１８及び１９に印
加された第１及び第２和信号は、第１減算回路２
１で減算され、その出力端に、第３図ロに示す如
きDL信号（（ａ＋ｃ）−（ｂ＋ｄ））が発生する。
そして、前記DL信号は、第２加算回路２４にお
いて前記立上りパルスと加算され、第３加算回路
２５において前記立下りパルスと加算される。第
２及び第３加算回路２４及び２５の出力端に得ら
れる信号を、それぞれ第３図ホ及びヘに示す。第
２加算回路２４の出力端に得られる第３図ホに示
される信号は、第１検波ダイオード２６及び第１
保持コンデンサ２７により包絡線検波されるの
で、第２減算回路３０の一方の入力端には、第３
図トに示される如き信号が得られ、また、第３加
算回路２５の出力端に得られる第３図ヘに示され
る信号は、第２検波ダイオード２８及び第２保持
コンデンサ２９により包絡線検波されるので、第
２減算回路３１の他方の入力端には、第３図チに
示される如き信号が得られる。第２減算回路３０
に印加された第３図ト及びチに示される信号は、
該第２減算回路３０で減算され、出力端子３１に
第３図リに示す如き出力信号が発生する。ところ
で、光検出器に受光される光のデイスクの凹凸に
よる強度分布の変化の仕方からDL信号の振幅は、
トラツキングエラーの度合いによつて大きさが変
化し、DL信号の位相は、トラツキングエラーの
方向によつてHF信号に対して90゜の進みあるいは
遅れを伴う。その為、第３図リに示される信号
は、トラツキングエラーに対応したものとなる。
しかも、デイスクへの投射光は、トラツキングサ
ーボ回路（図示せず）が有するサーボ帯域の為に
第３図リに示される信号を平滑させた信号で駆動
されるのと同等に滑らかに変移されることにな
る。したがつて、第３図リに示される信号を用い
てトラツキングサーボを行うことができる。尚、
第３図リに示される信号は、トラツキングエラー
が無いときに基準レベルとなり、トラツキングエ
ラーの度合いによつて基準レベルとのレベル差が
現われ、トラツキングエラーの方向によつて基準
レベルに対して正あるいは負となる。
(ヘ) 発明の効果
以上述べた如く、本発明に依れば、高価な高速
動作型のサンプリング回路を用いること無く、簡
単な回路構成でトラツキングエラー検出回路を作
成出来るという大きな利点が生じる。
動作型のサンプリング回路を用いること無く、簡
単な回路構成でトラツキングエラー検出回路を作
成出来るという大きな利点が生じる。
第１図は、従来のトラツキングエラー検出回路
を示す回路ブロツク図、第２図は本発明の一実施
例を示す回路ブロツク図及び第３図はその各部の
波形を示す特性図である。 主な図番の説明、２０，２４，２５……加算回
路、２１，３０……減算回路、２６，２８……検
波ダイオード。
を示す回路ブロツク図、第２図は本発明の一実施
例を示す回路ブロツク図及び第３図はその各部の
波形を示す特性図である。 主な図番の説明、２０，２４，２５……加算回
路、２１，３０……減算回路、２６，２８……検
波ダイオード。
Claims (1)
- １ ピツクアツプからデイスク面に光を投射し、
前記デイスク面で反射する光を検知することによ
り、トラツキングエラーを検出するトラツキング
エラー検出回路において、センサーを４分割し、
対角線方向の２つの部分から得られる信号同志を
それぞれ加算して、第１及び第２和信号を作成す
る手段と、前記第１及び第２和信号を加算する第
１加算回路と、前記第１及び第２和信号を減算す
る第１減算回路と、前記第１加算回路の出力信号
の立上りに応じたパルスを発生させる立上りパル
ス発生回路と、前記第１加算回路の出力信号の立
下りに応じたパルスを発生させる立下りパルス発
生回路と、前記第１減算回路の出力信号と前記立
上りパルス発生回路の出力パルスとを加算する第
２加算回路と、前記第１減算回路の出力信号と前
記立下りパルス発生回路の出力パルスとを加算す
る第３加算回路と、前記第２加算回路の出力信号
を検波する第１検波回路と、前記第３加算回路の
出力信号を検波する第２検波回路と、前記第１及
び第２検波回路の出力信号を減算する第２減算回
路とから成り、該第２減算回路の出力端にトラツ
キングエラーに応じた信号を発生させる様にした
ことを特徴とするトラツキングエラー検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11209583A JPS605426A (ja) | 1983-06-21 | 1983-06-21 | トラツキングエラ−検出回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11209583A JPS605426A (ja) | 1983-06-21 | 1983-06-21 | トラツキングエラ−検出回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS605426A JPS605426A (ja) | 1985-01-12 |
| JPS641857B2 true JPS641857B2 (ja) | 1989-01-12 |
Family
ID=14577991
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11209583A Granted JPS605426A (ja) | 1983-06-21 | 1983-06-21 | トラツキングエラ−検出回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS605426A (ja) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63216681A (ja) * | 1987-03-04 | 1988-09-08 | エヌオーケー株式会社 | ねじの締付け方法とその締付け装置 |
| JPS63300876A (ja) * | 1987-05-29 | 1988-12-08 | 不二空機株式会社 | エアモ−タの回転主軸の停止検出装置 |
| JPH0546829Y2 (ja) * | 1988-01-06 | 1993-12-08 | ||
| US6619368B1 (en) | 1997-12-15 | 2003-09-16 | Pcc Structurals, Inc. | Method for imaging inclusions in investment castings |
-
1983
- 1983-06-21 JP JP11209583A patent/JPS605426A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS605426A (ja) | 1985-01-12 |
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