JPS648833U - - Google Patents
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- Publication number
- JPS648833U JPS648833U JP1670588U JP1670588U JPS648833U JP S648833 U JPS648833 U JP S648833U JP 1670588 U JP1670588 U JP 1670588U JP 1670588 U JP1670588 U JP 1670588U JP S648833 U JPS648833 U JP S648833U
- Authority
- JP
- Japan
- Prior art keywords
- delay line
- capacitance diode
- variable capacitance
- inductance element
- control signal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 6
- 239000003990 capacitor Substances 0.000 description 1
Landscapes
- Networks Using Active Elements (AREA)
Description
第１図は本考案に係る可変遅延線およびこれを
用いたプログラマブル遅延線の一実施例を示す回
路図、第２図は第１図の非直線回路の一例を示す
回路図、第３図は第２図の非直線回路の特性図、
第４図は従来の可変遅延線を示す回路図、第５図
は第４図の可変遅延線の特性図、第６図は遅延線
の入力側で観測したパルス信号波形図である。 １……入力端子、３……出力端子、５……非直
線回路、Ｃｐ……バイパスコンデンサ、ＤＬ……
遅延線、ＤＬ１……遅延線素子、ＤＡＣ……Ｄ／
Ａコンバータ、Ｄｖ……可変容量ダイオード、Ｄ
ａ，Ｄｂ……ダイオード、Ｉ……バツフア回路（
インバータ）、Ｌ，Ｌ１……インダクタンス素子
。
用いたプログラマブル遅延線の一実施例を示す回
路図、第２図は第１図の非直線回路の一例を示す
回路図、第３図は第２図の非直線回路の特性図、
第４図は従来の可変遅延線を示す回路図、第５図
は第４図の可変遅延線の特性図、第６図は遅延線
の入力側で観測したパルス信号波形図である。 １……入力端子、３……出力端子、５……非直
線回路、Ｃｐ……バイパスコンデンサ、ＤＬ……
遅延線、ＤＬ１……遅延線素子、ＤＡＣ……Ｄ／
Ａコンバータ、Ｄｖ……可変容量ダイオード、Ｄ
ａ，Ｄｂ……ダイオード、Ｉ……バツフア回路（
インバータ）、Ｌ，Ｌ１……インダクタンス素子
。
Claims (1)
- 【実用新案登録請求の範囲】 (1) 捲線されたインダクタンス素子と、 このインダクタンス素子に一端が梯子状に接続
されかつアナログ制御信号が制御電圧として印加
される可変容量ダイオードと、 を具備し、前記可変容量ダイオードに前記制御信
号の変化によつて遅延時間が変化される可変遅延
線において、 前記インダクタンス素子が複数に分割され、分
割された各インダクタンス素子に前記可変容量ダ
イオードが梯子状に接続されて複数の遅延線素子
が形成されるとともに、 これら複数の遅延線素子がバツフア回路を介し
て直列接続されてなることを特徴とする可変遅延
線。 (2) アナログ信号を入力して前記可変容量ダイ
オードの容量変化による遅延特性変化とは反対の
非直線特性で変化させて前記制御信号として出力
する非直線回路が、前記可変容量ダイオードに接
続されてなる実用新案登録請求の範囲第１項記載
の可変遅延線。 (3) 捲線されたインダクタンス素子と、このイ
ンダクタンス素子に一端が梯子状に接続されかつ
アナログ制御信号が制御電圧として印加される可
変容量ダイオードと、を有する遅延線と、 入力された多ビツトデジタル信号に対応するア
ナログ電圧を前記可変容量ダイオードへの前記制
御信号として出力するＤ／Ａコンバータと、 を具備し、前記デジタル信号によつて遅延時間を
デジタル的に変化させるよう構成したプログラマ
ブル遅延線において、 前記インダクタンス素子が複数に分割され、分
割された各インダクタンス素子に前記可変容量ダ
イオードが梯子状に接続されて複数の遅延線素子
が形成されるとともに、 これら複数の遅延線素子がバツフア回路を介し
て直列接続されてなることを特徴とするプログラ
マブル遅延線。 (4) 前記Ｄ／Ａコンバータが、前記Ｄ／Ａコン
バータからのアナログ電圧変化を前記可変容量ダ
イオードの容量変化による遅延特性変化とは反対
の非直線特性で変化させて前記可変容量ダイオー
ドへ出力する非直線回路を介して前記可変容量ダ
イオードに接続されてなる実用新案登録請求の範
囲第３項記載のプログラマブル遅延線。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1670588U JPS648833U (ja) | 1987-02-20 | 1988-02-10 |
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2467587 | 1987-02-20 | ||
| JP1670588U JPS648833U (ja) | 1987-02-20 | 1988-02-10 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS648833U true JPS648833U (ja) | 1989-01-18 |
Family
ID=31717348
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1670588U Pending JPS648833U (ja) | 1987-02-20 | 1988-02-10 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS648833U (ja) |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS54162945A (en) * | 1978-06-14 | 1979-12-25 | Mitsubishi Electric Corp | Programable delay circuit |
| JPS56152311A (en) * | 1980-04-24 | 1981-11-25 | Derufuai:Kk | Delay device |
| JPS6044844A (ja) * | 1983-08-23 | 1985-03-11 | Toshiba Corp | 漏洩検出装置 |
-
1988
- 1988-02-10 JP JP1670588U patent/JPS648833U/ja active Pending
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS54162945A (en) * | 1978-06-14 | 1979-12-25 | Mitsubishi Electric Corp | Programable delay circuit |
| JPS56152311A (en) * | 1980-04-24 | 1981-11-25 | Derufuai:Kk | Delay device |
| JPS6044844A (ja) * | 1983-08-23 | 1985-03-11 | Toshiba Corp | 漏洩検出装置 |
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