JPH01115203A - カレントミラー回路 - Google Patents
カレントミラー回路Info
- Publication number
- JPH01115203A JPH01115203A JP62274201A JP27420187A JPH01115203A JP H01115203 A JPH01115203 A JP H01115203A JP 62274201 A JP62274201 A JP 62274201A JP 27420187 A JP27420187 A JP 27420187A JP H01115203 A JPH01115203 A JP H01115203A
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- JP
- Japan
- Prior art keywords
- constant current
- transistor
- noise
- current mirror
- low
- Prior art date
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明はカレントミラー回路に関し、特に定電流源に
雑音が乗った場合の出力の低雑音化に関するものである
。
雑音が乗った場合の出力の低雑音化に関するものである
。
第３図は従来のカレントミラー回路を示す回路図である
。図において、Ｑ 及びＱ２はＮＰＮトランジスタであ
る。これらのＮＰＮトランジスタＱ１及びＱ２のベース
は共通接続され、その共通接続点はＮＰＮトランジスタ
Ｑ１のコレクタに接続されている。またこれらのＮＰＮ
トランジスタＱ１及びＱ２のエミッタは接地されている
。ＮＰＮトランジスタＱ１のコレクタは定電流′ａ１を
介し電源電圧■。０に接続されている。ＮＰＮＩ−ラン
ジスタＱ２のコレクタは図示していない他の回路に接続
されている。
。図において、Ｑ 及びＱ２はＮＰＮトランジスタであ
る。これらのＮＰＮトランジスタＱ１及びＱ２のベース
は共通接続され、その共通接続点はＮＰＮトランジスタ
Ｑ１のコレクタに接続されている。またこれらのＮＰＮ
トランジスタＱ１及びＱ２のエミッタは接地されている
。ＮＰＮトランジスタＱ１のコレクタは定電流′ａ１を
介し電源電圧■。０に接続されている。ＮＰＮＩ−ラン
ジスタＱ２のコレクタは図示していない他の回路に接続
されている。
従来のカレントミラー回路は以上のように構成され′て
おり、例えばＮＰＮ）−ランジスタＱ、及びＱ２各々の
エミッタ接合面積が同一の場合、そのコレクタ電流は等
しくなる。すなわち、定電流源１より供給されるトラン
ジスタＱ１のコレクタ電流をＩとすると、図示していな
い他の回路を通じて流れるトランジスタＱ２のコレクタ
電流もＩとなる。つまり第３図の回路（よ、上記図示し
ていない他の回路の定電流源用カレントミラー回路とし
て動作する。トランジスタＱ２のコレクタ電流はトラン
ジスタＱ、Ｑ２のエミッタ接合面積比に応じて変化する
。
おり、例えばＮＰＮ）−ランジスタＱ、及びＱ２各々の
エミッタ接合面積が同一の場合、そのコレクタ電流は等
しくなる。すなわち、定電流源１より供給されるトラン
ジスタＱ１のコレクタ電流をＩとすると、図示していな
い他の回路を通じて流れるトランジスタＱ２のコレクタ
電流もＩとなる。つまり第３図の回路（よ、上記図示し
ていない他の回路の定電流源用カレントミラー回路とし
て動作する。トランジスタＱ２のコレクタ電流はトラン
ジスタＱ、Ｑ２のエミッタ接合面積比に応じて変化する
。
第４図はＰ Ｎ １つトランジスタＱ３及びＱ４により
カレントミラー回路を構成した場合の回路図である。Ｐ
ＮＰトランジスタＱ３及びＱ４のエミッタは共に電源電
圧■。０に接続されている。ＰＮＰトランジスタＱ３の
コレクタは定電流源１を介して接地され、ＰＮＰトラン
ジスタＱ４のコレクタは図示しない他の回路に接続され
ている。この回路も第３図の回路と同様に、図示してい
ない他の回路の定電流源用カレントミラー回路として動
作する。
カレントミラー回路を構成した場合の回路図である。Ｐ
ＮＰトランジスタＱ３及びＱ４のエミッタは共に電源電
圧■。０に接続されている。ＰＮＰトランジスタＱ３の
コレクタは定電流源１を介して接地され、ＰＮＰトラン
ジスタＱ４のコレクタは図示しない他の回路に接続され
ている。この回路も第３図の回路と同様に、図示してい
ない他の回路の定電流源用カレントミラー回路として動
作する。
従来のカレントミラー回路は以上のように構成されてい
るので、定電流源１に雑音が乗るとトランジスタＱ１の
コレクタ電流である定電流■にも雑音が乗り、そのため
カレントミラー出力であるトランジスタＱ２のコレクタ
電流にも同様の雑音が乗るという問題点があった。
るので、定電流源１に雑音が乗るとトランジスタＱ１の
コレクタ電流である定電流■にも雑音が乗り、そのため
カレントミラー出力であるトランジスタＱ２のコレクタ
電流にも同様の雑音が乗るという問題点があった。
この発明は上記のような問題点を解消するためになされ
たもので、定電流源に雑音が乗っても、低雑音化した電
流を出力することのできるカレントミラー回路を得るこ
とを目的とする。
たもので、定電流源に雑音が乗っても、低雑音化した電
流を出力することのできるカレントミラー回路を得るこ
とを目的とする。
この発明に係るカレントミラー回路は、複数のトランジ
スタから成り、前記複数のうちの１つの基準用トランジ
スタに定電流源を通じて定電流を供給することにより、
前記複数のトランジスタのエミッタ接合面積比に応じた
電流を残りのトランジスタを介して出力するカレントミ
ラー回路において、前記定電流の供給経路にローパスフ
ィルターを設けた構成としでいる。
スタから成り、前記複数のうちの１つの基準用トランジ
スタに定電流源を通じて定電流を供給することにより、
前記複数のトランジスタのエミッタ接合面積比に応じた
電流を残りのトランジスタを介して出力するカレントミ
ラー回路において、前記定電流の供給経路にローパスフ
ィルターを設けた構成としでいる。
この発明におけるローパスフィルターは、定電流源に雑
音が乗った場合、その惟＆の比較的高い周波数領域を遮
断することにより、低雑音化した定電流をカレン１−ミ
ラー回路を構成する基準用トランジスタに供給する。
音が乗った場合、その惟＆の比較的高い周波数領域を遮
断することにより、低雑音化した定電流をカレン１−ミ
ラー回路を構成する基準用トランジスタに供給する。
第１図はこの発明の一実施例であるカレントミラー回路
を示す回路図である。図において従来例との相違点は、
定電流ｍ１に雑音が乗った場合、雑音帯域を狭くするた
めのローパスフィルター２を基準用ＮＰＮトランジスタ
Ｑ１と定電流源１との間に介挿したことである。ローパ
スフィルター２は時定数用抵抗３及びコンデンサ４によ
り構成されている。時定数用抵抗３はＮＰＮトランジス
タＱ１と定電流源１との間に介挿されており、コンデン
サ４は定電流源１と接地間に介挿されている。その他の
構成は第３図の従来例と同様である。
を示す回路図である。図において従来例との相違点は、
定電流ｍ１に雑音が乗った場合、雑音帯域を狭くするた
めのローパスフィルター２を基準用ＮＰＮトランジスタ
Ｑ１と定電流源１との間に介挿したことである。ローパ
スフィルター２は時定数用抵抗３及びコンデンサ４によ
り構成されている。時定数用抵抗３はＮＰＮトランジス
タＱ１と定電流源１との間に介挿されており、コンデン
サ４は定電流源１と接地間に介挿されている。その他の
構成は第３図の従来例と同様である。
次に動作について説明する。例えばトランジスタＱ１．
Ｑ２のエミッタ接合面積が等しい場合、トランジスタＱ
１及びＱ２のコレクタ電流が等しくなり、トランジスタ
Ｑ２のコレクタに接続された図示していない池の回路に
対する定電源用カレントミラー回路として動作するのは
従来例と同様である。
Ｑ２のエミッタ接合面積が等しい場合、トランジスタＱ
１及びＱ２のコレクタ電流が等しくなり、トランジスタ
Ｑ２のコレクタに接続された図示していない池の回路に
対する定電源用カレントミラー回路として動作するのは
従来例と同様である。
定電流源１に雑音が乗ると、ローパスフィルター２は時
定＠ｃＲの大きさにより決定されるカットオフ周波数以
上の周波数を持つ雑音を遮断する。
定＠ｃＲの大きさにより決定されるカットオフ周波数以
上の周波数を持つ雑音を遮断する。
その結果、雑音の帯域幅が狭められ定電流Ｉがトランジ
スタＱ１のコレクタに供給され、カレントミラー出力で
あるトランジスタＱ２の］レクタ電流の低雑音化が図れ
ることになる。
スタＱ１のコレクタに供給され、カレントミラー出力で
あるトランジスタＱ２の］レクタ電流の低雑音化が図れ
ることになる。
例えば抵抗３の抵抗値Ｒを３０にΩ、コンデンサ４の容
量Ｃを３０ＰＦとすると、ローパスフィルターのカット
オフ周波数ｆｃは ＝ １７６ Ｋ １−１ｚ ・
（１）となり、１７６ＫＨｚ以上の周波数成分は遮断さ
れることになる。上記のようなローパスフィルター２を
、定電流源１としてバンドギャップ定電流源を用いたカ
レントミラー回路に備えたとする。
量Ｃを３０ＰＦとすると、ローパスフィルターのカット
オフ周波数ｆｃは ＝ １７６ Ｋ １−１ｚ ・
（１）となり、１７６ＫＨｚ以上の周波数成分は遮断さ
れることになる。上記のようなローパスフィルター２を
、定電流源１としてバンドギャップ定電流源を用いたカ
レントミラー回路に備えたとする。
この場合、バンドギャップ定電流源の雑音帯域が０〜８
Ｍ ｌ−１ｚ程度であり６ＭＨｚ付近に９ｆｔ音のピ
ークがあるため、上記に示したローパスフィルターで十
分カレントミラー出力の低雑音化が図れる。
Ｍ ｌ−１ｚ程度であり６ＭＨｚ付近に９ｆｔ音のピ
ークがあるため、上記に示したローパスフィルターで十
分カレントミラー出力の低雑音化が図れる。
となり、ローパスフィルター２を備えない場合に比し、
１６．６ｄＢの雑音軽減効果が得られる。
１６．６ｄＢの雑音軽減効果が得られる。
このため、広帯域アンプ、ビデオアンプ等の定電流源用
カレントミラー回路として非常に有効である。
カレントミラー回路として非常に有効である。
第２図はこの発明による他の実施例を示す回路図である
。この実施例ではカレントミラー回路を構成するトラン
ジスタをＰＮＰトランジスタＱ３及びＱ４にし、コンデ
ンサ４を基準用トランジスタＱ３と抵抗３との直列回路
体と並列に接続した。
。この実施例ではカレントミラー回路を構成するトラン
ジスタをＰＮＰトランジスタＱ３及びＱ４にし、コンデ
ンサ４を基準用トランジスタＱ３と抵抗３との直列回路
体と並列に接続した。
このような構成でも上記実施例と同様の効果が得られる
。
。
なお、上記実施例において、ＮＰＮＩ−ランジスタＱ
及びＱ２のエミッタ接合面積比をｍ：ｎとしても、同様
の効果が得られる。
及びＱ２のエミッタ接合面積比をｍ：ｎとしても、同様
の効果が得られる。
また、第１図及び第２図の回路においてコンデンサ４を
定電流源１と抵抗３の直列回路体と並列に接続しても上
記実施例と同様の効果が得られる。
定電流源１と抵抗３の直列回路体と並列に接続しても上
記実施例と同様の効果が得られる。
以上のように、この発明によれば、カレントミラー回路
を構成する基準用トランジスタへの定電流の供給経路に
ローパスフィルターを設りたので、定電流源に雑音が乗
った場合でも、その雑音の乗った定電流をそのまま出力
せず、低′１１音化して出力することができるという効
果がある。
を構成する基準用トランジスタへの定電流の供給経路に
ローパスフィルターを設りたので、定電流源に雑音が乗
った場合でも、その雑音の乗った定電流をそのまま出力
せず、低′１１音化して出力することができるという効
果がある。
第１図はこの発明の一実施例を示す回路図、第２図はこ
の発明の他の実施例を示す回路図、第３図は従来のカレ
ントミラー回路を示す回路図、第４図は従来の他のカレ
ントミラー回路を示す回路図である。 図において、１は定電流源、２はローパスフィルター、
Ｑｌは基準用ＮＰＮトランジスタである。 なお、各図中同一符号は同一または相当部分を示す。 代理人 大 岩 増 雄 第１図 Ｑｌ−一一耳４準尼ＮＰＮ）ラノシースタ第２図
の発明の他の実施例を示す回路図、第３図は従来のカレ
ントミラー回路を示す回路図、第４図は従来の他のカレ
ントミラー回路を示す回路図である。 図において、１は定電流源、２はローパスフィルター、
Ｑｌは基準用ＮＰＮトランジスタである。 なお、各図中同一符号は同一または相当部分を示す。 代理人 大 岩 増 雄 第１図 Ｑｌ−一一耳４準尼ＮＰＮ）ラノシースタ第２図
Claims (3)
- （１）複数のトランジスタから成り、前記複数のうちの
１つの基準用トランジスタに定電流源を通じて定電流を
供給することにより、前記複数のトランジスタのエミッ
タ接合面積比に応じた電流を残りのトランジスタを介し
て出力するカレントミラー回路において、 前記定電流の供給経路にローパスフィルターを設けたこ
とを特徴とするカレントミラー回路。 - （２）前記ローパスフィルターは、前記定電流源と前記
基準用トランジスタの一方電極との間に直列に接続され
た抵抗と、前記基準用トランジスタと前記抵抗との直列
回路体と並列に接続されたコンデンサより成る特許請求
の範囲第１項記載のカレントミラー回路。 - （３）前記ローパスフィルターは、前記定電流源と前記
基準用トランジスタの一方電極との間に直列に接続され
た抵抗と、前記定電流源と前記抵抗との直列回路体と並
列に接続されたコンデンサより成る特許請求の範囲第１
項記載のカレントミラー回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62274201A JPH01115203A (ja) | 1987-10-29 | 1987-10-29 | カレントミラー回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62274201A JPH01115203A (ja) | 1987-10-29 | 1987-10-29 | カレントミラー回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01115203A true JPH01115203A (ja) | 1989-05-08 |
Family
ID=17538441
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62274201A Pending JPH01115203A (ja) | 1987-10-29 | 1987-10-29 | カレントミラー回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01115203A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008166904A (ja) * | 2006-12-27 | 2008-07-17 | Sanyo Electric Co Ltd | 定電流回路 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57208708A (en) * | 1981-06-18 | 1982-12-21 | Pioneer Electronic Corp | Amplifying circuit having dc feedback |
-
1987
- 1987-10-29 JP JP62274201A patent/JPH01115203A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57208708A (en) * | 1981-06-18 | 1982-12-21 | Pioneer Electronic Corp | Amplifying circuit having dc feedback |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008166904A (ja) * | 2006-12-27 | 2008-07-17 | Sanyo Electric Co Ltd | 定電流回路 |
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