JPH01244584A - 図形表示装置 - Google Patents

図形表示装置

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JPH01244584A
JPH01244584A JP7149488A JP7149488A JPH01244584A JP H01244584 A JPH01244584 A JP H01244584A JP 7149488 A JP7149488 A JP 7149488A JP 7149488 A JP7149488 A JP 7149488A JP H01244584 A JPH01244584 A JP H01244584A
Authority
JP
Japan
Prior art keywords
cross
section
buffer memory
data
memory
Prior art date
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Pending
Application number
JP7149488A
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English (en)
Inventor
Masashi Nishide
西出 政司
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
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Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP7149488A priority Critical patent/JPH01244584A/ja
Publication of JPH01244584A publication Critical patent/JPH01244584A/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 この発明は、図形表示装置、特に、3次元図形表示装置
の断面表示処理方式に関するものである。
〔従来の技術〕
第2図に、デプスバッファメモリを用いて隠面処理を行
う従来のこの種のラスラスキャン形3次元図形表示装置
の一例のブロック構成図を示す。
図において、1は、不図示のコンピュータとのインタフ
ェース信号、2はインタフェース回路、3は、このイン
タフェース回路2を通じて前記コンピュータより送られ
た表示データや表示コマンド等を内部フォーマットに変
換するだめの制御装置、4は、内部フォーマットに変換
された上記表示データや表示コマンド等を記憶するため
の記憶回路である。記憶回路4に記憶された上記テーク
は、制御装置3の指示に基つき、座標変換回路5および
クリップ処理回路6を介して直線発生器7に人力される
。また、8はデプスバッファメモリ、9はフレームバッ
ファメモリ、10は、表示用CRT(陰極線管)11の
インタフェース回路、12は、制御装置3への人力機器
である。
第3図は、隠面処理アルゴリスムを実行するためのデプ
スバッファメモリ8の詳細ブロック構成図であり、符号
1〜12は、それぞれ第2図におけると同一または相当
構成要素を示す。31゜32.33は、それ−eれX−
Y−23次元座標系において直線発生器7か発生する各
座標データで、座標データ31はxc、座標データ32
はYo、座標データ33はZ。である。34は、各座標
データ31,32.33をサンプリングするためのスト
ローブ信号である。35は、デプスバッファメモリ8か
ら読出されるZ座標データ値Z、36は、Z座標値の比
較器で、各座標データZc33とZ35とを比較して出
力37を出力する。この出力37はZc≦Zを示すフラ
グ信号で、デプスバッファメモリ8に対する書込み信号
及びフレームバッファメモリ9に対する書込みフラグと
なる。
次に動作について説明する。直線発生器7は、始点座標
データ(Xs 、Ys 、  Zs )および終点デー
タ(XE 、YE 、Zr:)に基づき、始点より終点
に向い順次座標データを発生して、それらを隠面処理ア
ルゴリズムを実行するためのデプスバッファメモリ8に
与える。デプスバッファメモリ8は、直線発生器7か発
生ずる座標データ(Xc 、  Yc 、  Zc )
のうち座標データXc31、Y、、32によりアドレス
されるデプスバッファメモリ位置より座標データ235
を読出し、Zc≦Zである場合、座標データZ。33を
そのメモリ位置に書込み、座標データXC1Ycとデプ
スバッファメモリ8を更新したことを示ず更新フラグ3
7どをフレームバッファメモリ9に与える。な45、デ
プスバッファメモリ8を更新しなかった場合には、座標
データと更新フラグ゛とは、フレームバッファメモリ9
には人力されない。
フレームバッファメモリ9は、上記更新フラグを受取る
と、座標データX c 、 Y cによりアドレスされ
るフレームバッファメモリ9の位置に、予め設定されて
いた輝度あるいは色などの表示情報を書込む。フレーム
バッファメモリ9に書込まれたデータは、CRTインタ
フェース回路10か発生ずる表示アドレスに従って読出
され、順次CRTIIに送られて表示される。また、人
力機器12により、必要に応じて制御装置3にデータが
与えられるよう構成されていた。
〔発明が解決しようとする課題] しかしながら、従来例のこの種の図形表示装置のデプス
バッファメモリ8は、上記のように表示データのうち、
見える側(オペレータの目に近い側)の各ピクセル(画
素)データをフレームバッファメモリ9に書込むため、
新に書込むデータのZ値と対応するピクセルの以前のZ
値とを屯純に比較する機能しか備えていなかったため、
物体の任意断面はプログラムにより処理して表示する必
要があり、その分、処理時間が長くかかるという問題点
があった。
この発明は、上記のような従来例の問題点を解消するた
めになされたもので、簡易かつ高速に物体の任意断面表
示処理を行うことのできるこの種の3次元図形表示装置
の提イノ(を目的としている。
(課題を解決するだめの手段〕 このため、この発明に係る3次元図形表示装置において
は、デプスバッファメモリと同様の構成で物体断面のZ
座標値を記憶する断面Zメモリを備え、該Z座標値より
手前の図形情報を表示しないよう構成することにより物
体の断面表示を行うようにして前記目的を達成しようと
するものである。
(作用) 以上のような構成により、従来例のように、物体の任意
の断面をブロクラムにより処理して表示する必要がなく
なり、その分たり、表示処理が迅速化される。
〔実施例〕
以ドに、この発明を実施例に基ついて説明する。
第1図に、この発明に係るこの種のラスウスキャン形3
次元図形表示装置の一実施例のフロック構成図を示す。
(構成) 図中、各符号1〜12.31〜37は、面述した従来例
装置第2,3図におけるとそれぞわ同一または相当構成
要素を示し、重複説明は省略する。50は、物体断面の
Z座標値Z3を記憶する断面Zメモリで、デプスバッフ
ァメモリ8と実質的に同様の構成を有する。51は、物
体断面の処理モートを制御するためのフラグで、断面Z
メモリ50に断面のZ座標値ZSを書込む場合には、°
°断面書込みモード゛′フラク53が出力され、断面処
理モートの場合には、“′断面比較モード″フラク52
か出力される。
物体断面Z座標値は直線発生器7か出力するX座標31
、Y座標32に従い、その時のZ座標33がストローブ
信号34に従って断面Zメモリ50に書込まれる。°°
断面比較モード″においては、直線発生器7の出力する
Z座標データ2c33と、デプスバッファメモリ8の出
力データZ35と断面Zメモリ50の出力データZs5
4とが比較器36で比較され、Zs≦Zc≦Zの場合の
み、デプスバッファメモリ8およびフレームバッファメ
モリ9への書込みフラグ信号37が出力されるように構
成しである。
(処理の流れ) 要約すると、処理の流れは以下のようになる。
1、まず、デプスバッファメモリ8.断面Zメモリ50
.フレームバッファメモリ9を初期化する。デプスバッ
ファメモリ8は、このときすべてのビクセルのZ座標値
が最大値に初期化される。
2、断面処理モードを“°断面Z値書込みモード″′に
設定し、断面のデータを断面Zメモリ50に書込む。
3、断面処理モードを“断面比較モード″に設定し、す
べての表示データの処理を行う。
この結果、比較器36によるzs≦Zc≦Zの比較によ
り、断面より遠方のデータで見える側(目に近い側)の
データのみがフレームバッファメモリ9に書込まれ、隠
面処理とともに断面処理が実行される。
以上により、前記断面のZ座標値より手前の図面情報は
表示されないのて、任意の面での該物体の断面/表示が
迅速に実行される。
(他の実施例) なお、上記実施例においては断面Zメモリ50を、デプ
スバッファメモリ8と実質的に同様の構成としたが、水
平あるいは垂直の1列のピクセルデータのみ記憶するメ
モリ構成として、X−Z平面あるいは、Y−Z平面に垂
直な断面のみ処理することも可能である。
また、前記実施例においては、断面Zメモリ20は、単
純に物体断面のZ座標値を書込むメモリとしたが、デプ
スバッファメモリ8の比較器36と同様の比較器を備え
るか、あるいは、デプスバッファメモリ8の比較器36
を流用することにより、複数の物体断面を通常の隠面処
理により書込むことにより複数断面による断面処理を簡
単に実施することができる。
さらにまた、比較器36より、Zs>ZCの場合にのみ
、専用の信号を出力することにより、あらかじめ定めた
断面専用のデータをフレームバッファメモリ9に書込む
ことも容易に実現可能である。
〔発明の効果〕
以上、説明したように、この発明によれば、この種のx
−y−z座標系3次元図形表示装置において、物体断面
のZ座標値の記憶手段を備えると共に、デプスバッファ
メモリにより隠面処理を行う際、前記Z座標値より手前
の情報を表示しないよう構成したため、物体の任意の切
断面を迅速に表示し得るようになった。
【図面の簡単な説明】
第1図は、この発明に係る図形表示装置の一実施例のフ
ロック構成図、第2図は、従来の図形表示装置の一例の
ブロック構成図、第3図は、第2図のデプスバッファメ
モリの詳細ブロック構成図である。 8・・・・・・デプスバッファメモリ 9・・・・・・クレームハ゛ツファメそり11・・・・
・・CRT 50・・・・・・断面Zメモリ Z5・・・・・・断面のZ座標値 なお、各図1八同−符号は、同一または相当構成要素を
表わす。

Claims (1)

  1. 【特許請求の範囲】 デプスバッファメモリを備え隠面処理を行う3次元図形
    表示装置において、物体断面の X−Y−Z座標系におけるZ座標値を記憶する記憶手段
    を備えるとともに、前記デプスバッファメモリにより隠
    面処理を実行する際に、前記断面の該Z座標値より手前
    の図形情報は表示しないよう構成することにより、任意
    の面で該物体を切断し表示することを特徴とする図形表
    示装置。
JP7149488A 1988-03-25 1988-03-25 図形表示装置 Pending JPH01244584A (ja)

Priority Applications (1)

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JP7149488A JPH01244584A (ja) 1988-03-25 1988-03-25 図形表示装置

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JP7149488A JPH01244584A (ja) 1988-03-25 1988-03-25 図形表示装置

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JPH01244584A true JPH01244584A (ja) 1989-09-28

Family

ID=13462275

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JP7149488A Pending JPH01244584A (ja) 1988-03-25 1988-03-25 図形表示装置

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JP (1) JPH01244584A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH03269687A (ja) * 1990-03-19 1991-12-02 Nec Corp マルチzバッファによるセクショニング方式
JPH0447385A (ja) * 1990-06-12 1992-02-17 Seiko Instr Inc 画像処理装置

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JPH03269687A (ja) * 1990-03-19 1991-12-02 Nec Corp マルチzバッファによるセクショニング方式
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