JPH01273147A - データ処理装置 - Google Patents

データ処理装置

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JPH01273147A
JPH01273147A JP63100249A JP10024988A JPH01273147A JP H01273147 A JPH01273147 A JP H01273147A JP 63100249 A JP63100249 A JP 63100249A JP 10024988 A JP10024988 A JP 10024988A JP H01273147 A JPH01273147 A JP H01273147A
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JP
Japan
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step counter
executed
segment
descriptor
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JP63100249A
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JPH0831055B2 (ja
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Hirotaka Nakano
中野　裕隆
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NEC Corp
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NEC Corp
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    • G06—COMPUTING OR CALCULATING; COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F15/00—Digital computers in general; Data processing equipment in general

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  • Theoretical Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
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  • Debugging And Monitoring (AREA)
  • Stored Programmes (AREA)
  • Storage Device Security (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明はデータ処理装置のステップカウンタ歩進制御に
関するものである。
〔従来の技術〕
近年、デジタル電子計算機の応用分野が飛躍的拡大をと
げるに伴い、ユーザの機能要求も多様化しており、従っ
てソフトウェアのオペレーティングシステムは非常に複
雑化している。このため、オペレーティングシステムの
構造分析はもはや机上だけでは困難となってきた。この
構造分析を行なう１つの手段として、データ処理装置に
機械命令の動的実行数を計数するステップカウンタを内
蔵することがある。
従来、このようなデータ処理装置では、ステップカウン
タはプロセス単位で機械命令を計数するが、−ｉにソフ
トウェアのプログラムはサブルーチンを用いた階層構造
をしているので、特定のサブルーチンについての構造分
析のような細かな分析を行なう場合などは、あらかじめ
ソフトウェアのプログラム中にステップカウンタの歩進
または停止を行なう歩進制御命令を挿入しておく方法が
とられていた。
〔発明が解決しようとする課題〕
上述した従来のステップカウンタは、プロセス単位で機
械命令を計数するので、細かな構造分析を行なう場合な
どは、あらかじめソフトウェアのプログラム中にステッ
プカウンタの歩進または停止を行なう歩道制御命令を挿
入しておく必要があって、柔軟性に欠けると共に処理速
度が低下するという欠点があった。
〔課題を解決するための手段〕
このような欠点を除去するために本発明は、論理アドレ
スを実現するための制御構造体としてセグメント記述子
およびページ記述子を有するデータ処理装置において、
機械命令を実行する毎に加算または減算を行なうステッ
プカウンタと、実行に供せられる機械命令が存在するセ
グメントまたはページのセグメント記述子またはページ
記述子の中にある情報に従ってステップカウンタの歩進
または停止を行なう歩進制御手段とを設けるようにした
ものである。
〔作用〕
本発明によるデータ処理装置においては、測定対象の限
定が柔軟に行なわれ、装置の性能も低下しない。
〔実施例〕
図は、本発明に係わるデータ処理装置の一実施例を説明
するための説明図である。図において、１は論理アドレ
ス、２はセグメント記述子、３はページ記述子、４は物
理空間、５はＴ　Ｌ　Ｂ　（Ｔｒａｎ−ｓｌａｔｉｏｎ
　Ｌｏｏｋ−ａｓｉｄｅ　Ｂｕｆｆｅｒ）、６はフリッ
プフロップ（Ｆ／Ｆ）　、７はアンド回路、８はステッ
プカウンタ（ＳＴＰＣ）である。
本実施例は、論理アドレス１を実現するための制御構造
体としてセグメント記述子２およびページ記述子３を有
するデータ処理装置で、ステップカウンタ８の歩進また
は停止を行なう歩進制御情報２１をセグメント記述子２
の中に有する。
論理アドレス１から物理アドレスへの変換は、主記憶中
に存在するセグメント記述子２、ページ記述子３などの
“表”からなる制御構造体を介してデータ処理装置のア
ドレス変換部が行なう。この変換を高速で行なう目的で
ＴＬＢ５を備えている。
セグメント記述子２の中にある情報２１はステップカウ
ンタ８の歩進または停止を行なう歩道制御情報で、ＴＬ
Ｂ５の中に情報５１として蓄えられる。この情報５１は
プログラムリード信号ａによりプログラムリードが行な
われる際にフリップフロップ６に蓄えられ、アンド回路
７の一方の入力データｂとなる０機械命令開始信号Ｃが
アンド回路７に加えられると、フリップフロップ６に蓄
えられた情報が“オン”であれば、ステップカウンタ８
の加算または減算が行なわれ、蓄えられた情報が“オフ
”であれば、ステップカウンタ８の加算または減算は行
なわれない。このようにしてセグメント機械命令２の中
にある情報でステップカウンタ８の歩進制御が行なわれ
る。
なお、本実施例では、ステップカウンタ８の歩道または
停止を行なう歩進制御情報がセグメント記述子２の中に
存在する場合について述べたが、この情報がページ記述
子３の中に存在する場合も同様に考えれる。
〔発明の効果〕
以上説明したように本発明は、機械命令を実行する毎に
加算または減算を行なうステップカウンタの歩進または
停止を行なう歩道制御をセグメント記述子またはページ
記述子の中にある情報で行なうことにより、測定対象の
限定を柔軟に行なわせしめることを可能にし、装置の性
能を低下させずに容易にオペレーティングシステムの構
造分析等の利用に供することができる効果がある。
【図面の簡単な説明】
図は本発明に係わるデータ処理装置の一実施例を説明す
るための説明図である。 ｌ・・・論理アドレス、２・・・セグメント記述子、３
・・・ページ記述子、４・・・物理空間、５・・・ＴＬ
Ｂ、６・・・フリップフロップ、７・・・アンド回路、
８・・・ステップカウンタ。 特許出願人　　　　日本電気株式会社

Claims (1)

    【特許請求の範囲】
  1. 論理アドレスを実現するための制御構造体としてセグメ
    ント記述子およびページ記述子を有するデータ処理装置
    において、機械命令を実行する毎に加算または減算を行
    なうステップカウンタと、実行に供せられる機械命令が
    存在するセグメントまたはページの前記セグメント記述
    子またはページ記述子の中にある情報に従って前記ステ
    ップカウンタの歩進または停止を行なわせる歩進制御手
    段とを備えたデータ処理装置。
JP63100249A 1988-04-25 1988-04-25 データ処理装置 Expired - Fee Related JPH0831055B2 (ja)

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AU33191/89A AU609284B2 (en) 1988-04-25 1989-04-19 Data processing apparatus
KR1019890005350A KR920003455B1 (ko) 1988-04-25 1989-04-24 데이타 처리 장치
CN89102838A CN1010899B (zh) 1988-04-25 1989-04-25 数据处理装置
US07/837,602 US5146579A (en) 1988-04-25 1992-02-21 Data processing apparatus

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CN (1) CN1010899B (ja)
AU (1) AU609284B2 (ja)

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Publication number Priority date Publication date Assignee Title
JPH08292903A (ja) * 1995-04-21 1996-11-05 Nec Corp 情報処理装置

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JPS60136837A (ja) * 1983-12-26 1985-07-20 Hitachi Ltd 計算機システムの処理能力評価方式

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KR890016479A (ko) 1989-11-29
JPH0831055B2 (ja) 1996-03-27
AU3319189A (en) 1989-10-26
AU609284B2 (en) 1991-04-26
KR920003455B1 (ko) 1992-05-01
CN1037415A (zh) 1989-11-22
CN1010899B (zh) 1990-12-19

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