JPH01320870A - Tv用同期コントローラ - Google Patents
Tv用同期コントローラInfo
- Publication number
- JPH01320870A JPH01320870A JP63155493A JP15549388A JPH01320870A JP H01320870 A JPH01320870 A JP H01320870A JP 63155493 A JP63155493 A JP 63155493A JP 15549388 A JP15549388 A JP 15549388A JP H01320870 A JPH01320870 A JP H01320870A
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- Granted
Links
- 238000000926 separation method Methods 0.000 claims description 10
- 230000001360 synchronised effect Effects 0.000 claims description 10
- 229920000747 poly(lactic acid) Polymers 0.000 claims description 8
- 230000000630 rising effect Effects 0.000 claims description 8
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 claims description 6
- 230000003111 delayed effect Effects 0.000 abstract description 4
- 238000003491 array Methods 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 4
- 230000000694 effects Effects 0.000 description 2
- 230000005540 biological transmission Effects 0.000 description 1
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- 238000004804 winding Methods 0.000 description 1
Landscapes
- Synchronizing For Television (AREA)
- Television Signal Processing For Recording (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はTV用同期コントローラに関し、特に垂直同期
信号が欠落した時にプログラマブル論理アレイで設定し
た値により垂直カウンタをリセットする機能を有するT
V用同期コントローラに関する。
信号が欠落した時にプログラマブル論理アレイで設定し
た値により垂直カウンタをリセットする機能を有するT
V用同期コントローラに関する。
従来、この種のTV用コントローラは垂直同期信号が欠
落した時に垂直カウンタをリセットする値を決定するた
めのプログラマフル論理アレイ(以下、PLAと称す)
を−っ有している。
落した時に垂直カウンタをリセットする値を決定するた
めのプログラマフル論理アレイ(以下、PLAと称す)
を−っ有している。
第2図は、かかる従来の一例を説明するためのTV用同
期コントローラのブロック図である。
期コントローラのブロック図である。
第2図に示すように、かがる従来のTV用同期コントロ
ーラは、ビデオ信号からなる水平および垂直の同期パル
スを分離する同期分離回路1と、その分離された水平同
期パルスと入力ビデオ信号とを同期させるための位相比
較器2.ローパスフィルタ(LPF)3および電圧制御
発振器(VCO)4からなる位相固定ループ(PLL)
回路と、VCO4により発信させた基本クロックを計数
する水平カウンタ5と、水平カウンタ5の出力を受けて
位相比較器2への一水平同期の信号を作成する1/2分
周器6と、水平カウンタ5がら出力される水平パルスを
計数する垂直カウンタ9と、水平系および垂直系出力信
号の立上がりおよび立下り位置をそれぞれ指定する水平
系および垂直系のPLA7,10と、それらPLA出力
に基ずき水平系および垂直系出力信号を作成する水平お
よび垂直出力用J−にフリップ・フロップ8゜11と、
同期分離回路1がらの垂直同期パルスにより垂直カウン
タ9をリセットする信号を作成するリセット信号作成回
路コ2と、垂直カウンタ9の出力に基ずきリセット信号
作成回路12がらのリセット信号を作成するためのリセ
ット値を設定するリセット値設定用PLA13とを有し
て構成される。
ーラは、ビデオ信号からなる水平および垂直の同期パル
スを分離する同期分離回路1と、その分離された水平同
期パルスと入力ビデオ信号とを同期させるための位相比
較器2.ローパスフィルタ(LPF)3および電圧制御
発振器(VCO)4からなる位相固定ループ(PLL)
回路と、VCO4により発信させた基本クロックを計数
する水平カウンタ5と、水平カウンタ5の出力を受けて
位相比較器2への一水平同期の信号を作成する1/2分
周器6と、水平カウンタ5がら出力される水平パルスを
計数する垂直カウンタ9と、水平系および垂直系出力信
号の立上がりおよび立下り位置をそれぞれ指定する水平
系および垂直系のPLA7,10と、それらPLA出力
に基ずき水平系および垂直系出力信号を作成する水平お
よび垂直出力用J−にフリップ・フロップ8゜11と、
同期分離回路1がらの垂直同期パルスにより垂直カウン
タ9をリセットする信号を作成するリセット信号作成回
路コ2と、垂直カウンタ9の出力に基ずきリセット信号
作成回路12がらのリセット信号を作成するためのリセ
ット値を設定するリセット値設定用PLA13とを有し
て構成される。
上述した従来のTV用同期コントローラは、垂直同期信
号が欠落した時に垂直カウンタ9をリセットする値を決
定するPLAIOが−っしがない構成となっているので
、VTRの巻戻し再生等て垂直の周期が遅くなりリセッ
ト値設定用PLA13の設定値後に垂直同期信号が入っ
てくと、垂直カウンタ9が2回リセットされることにな
り、アドレスの小さい垂直系出力が2発分出力されると
いう欠点がある。
号が欠落した時に垂直カウンタ9をリセットする値を決
定するPLAIOが−っしがない構成となっているので
、VTRの巻戻し再生等て垂直の周期が遅くなりリセッ
ト値設定用PLA13の設定値後に垂直同期信号が入っ
てくと、垂直カウンタ9が2回リセットされることにな
り、アドレスの小さい垂直系出力が2発分出力されると
いう欠点がある。
本発明の目的は、かがる垂直同期信号が欠落したときで
も垂直系信号が数多く出力されるのを防止するTV用同
期コントローラを提供することにある。
も垂直系信号が数多く出力されるのを防止するTV用同
期コントローラを提供することにある。
本発明のTV用同期コントローラは、ビデオ信号から水
平および垂直の同期パルスを分離する同期分離回路と、
その分離された水平同期パルスと入力ビデオ信号とを同
期させるための位相比較器、LPFおよびVCOからな
るPLL回路と、前記vCOにより発振させた基本クロ
ックを計数する水平カウンタと、前記水平カウンタから
出力される水平パルスを計数する垂直カウンタと、水平
系および垂直系出力信号の立上りおよび立下り位置をそ
れぞれ指定する水平系および垂直系のPLAと、これら
PLA出力に基づき水平系および垂直系出力信号を作成
する水平および垂直出力用J−にフリップ・フロップと
、前記同期分離回路からの垂直同期パルスにより前記垂
直カウンタをリセットする信号を作成するリセット信号
作成回路と、前記垂直カウンタ出力に基ずき前期リセッ
ト信号作成回路からのリセット信号を作成するなめのリ
セット値を設定するリセット値設定用PLAとを有する
TV用同期コントローラにおいて、前記垂直カウンタの
複数のリセット値を設定する第一および第二のPLAと
、これらのリセット値を入力ビデオ信号の状況により切
換えるスイッチを設け、前記ビデオ信号の垂直周期の変
動による垂直系出力信号の乱れを防止するように構成さ
れる。
平および垂直の同期パルスを分離する同期分離回路と、
その分離された水平同期パルスと入力ビデオ信号とを同
期させるための位相比較器、LPFおよびVCOからな
るPLL回路と、前記vCOにより発振させた基本クロ
ックを計数する水平カウンタと、前記水平カウンタから
出力される水平パルスを計数する垂直カウンタと、水平
系および垂直系出力信号の立上りおよび立下り位置をそ
れぞれ指定する水平系および垂直系のPLAと、これら
PLA出力に基づき水平系および垂直系出力信号を作成
する水平および垂直出力用J−にフリップ・フロップと
、前記同期分離回路からの垂直同期パルスにより前記垂
直カウンタをリセットする信号を作成するリセット信号
作成回路と、前記垂直カウンタ出力に基ずき前期リセッ
ト信号作成回路からのリセット信号を作成するなめのリ
セット値を設定するリセット値設定用PLAとを有する
TV用同期コントローラにおいて、前記垂直カウンタの
複数のリセット値を設定する第一および第二のPLAと
、これらのリセット値を入力ビデオ信号の状況により切
換えるスイッチを設け、前記ビデオ信号の垂直周期の変
動による垂直系出力信号の乱れを防止するように構成さ
れる。
次に、本発明の実施例について図面を参照して説明する
。
。
第1図は本発明の一実施例を説明するためのTV用同期
コントローラのブロック回路図である。
コントローラのブロック回路図である。
第1図に示すように、ががるコントローラにおける同期
分離回路1は外部がらりビデオ信号を入力し、水平同期
パルスと垂直同期パルスとを出方する。このうち水平同
期パルスと一水平同期信号との位相を比較器2で比較し
、その出力をLPF3を介してVCO4へ送出する。尚
、この位相比較器2とL P F 3およびvCO4に
よりPLL (フェース ロック・ループ)を形成して
いる。このvCO4は水平出力信号の分解能に見合うク
ロックを発振するので、水平カウンタ5はこのvCO4
の発振出力をカウントして水平系PLA7のアドレスを
与えるとともに、1/2分周器6により垂直カウンタ9
のクロック(水平パルスに対し周期が1/2の信号)を
作成する。水平系PLAYは水平系出力信号の立上りア
ドレスと立下りアドレスとに相当するパルスを発生する
ので、これを水平出力用J−にフリップ・フロップ8に
より立上がりパルスから立下りパルスまでの位置がハイ
レベルとなる水平系信号を出力する。尚、前述した位相
比較器2.LPF3.vCO4は水平カウンタ5および
1/2分周器6を含めた形でフェイズ・ロック・ループ
を組み、外部ビデオ信号と出力信号の同期をとっている
。
分離回路1は外部がらりビデオ信号を入力し、水平同期
パルスと垂直同期パルスとを出方する。このうち水平同
期パルスと一水平同期信号との位相を比較器2で比較し
、その出力をLPF3を介してVCO4へ送出する。尚
、この位相比較器2とL P F 3およびvCO4に
よりPLL (フェース ロック・ループ)を形成して
いる。このvCO4は水平出力信号の分解能に見合うク
ロックを発振するので、水平カウンタ5はこのvCO4
の発振出力をカウントして水平系PLA7のアドレスを
与えるとともに、1/2分周器6により垂直カウンタ9
のクロック(水平パルスに対し周期が1/2の信号)を
作成する。水平系PLAYは水平系出力信号の立上りア
ドレスと立下りアドレスとに相当するパルスを発生する
ので、これを水平出力用J−にフリップ・フロップ8に
より立上がりパルスから立下りパルスまでの位置がハイ
レベルとなる水平系信号を出力する。尚、前述した位相
比較器2.LPF3.vCO4は水平カウンタ5および
1/2分周器6を含めた形でフェイズ・ロック・ループ
を組み、外部ビデオ信号と出力信号の同期をとっている
。
一方、水平系と同様に垂直カウンタ9は水平カウンタ5
の出力(水平パルスに対し周期が1/2の信号)をカウ
ントし、垂直系PLAIOのアドレスを与える信号を出
力する。この垂直系PLA10は垂直系出力信号の立上
りアドレスと立下りアドレスに相当するパルスを出力す
るので、これを垂直出力用J−にフリップ・フロップ1
1により立上りパルスから立下りパルスまでの位置がハ
イレベルとなる垂直系信号を出力する。
の出力(水平パルスに対し周期が1/2の信号)をカウ
ントし、垂直系PLAIOのアドレスを与える信号を出
力する。この垂直系PLA10は垂直系出力信号の立上
りアドレスと立下りアドレスに相当するパルスを出力す
るので、これを垂直出力用J−にフリップ・フロップ1
1により立上りパルスから立下りパルスまでの位置がハ
イレベルとなる垂直系信号を出力する。
ここで、垂直カウンタ9へのリセットをかけるリセット
信号作成回路12では、通常同期分離回路1で分離した
垂直同期パルスにより垂直カウンタ9にリセットをかけ
るが、弱電界等で同期分前回IIから垂直同期パルスが
出力されなかった場合は、第1のリセット値設定用PL
A13からの信号でリセットをかける。しかし、先に外
部からの垂直同期パルスが入った場合はリセット値設定
用PLA13からのパルスによるリセットは行なわない
。また、VTRの巻も戻し再生等で垂直の同期が遅れる
場合はリセット値切換えスイッチ15を切換えることに
より行なうが、かかる上記の動作は第二のリセット値設
定用PLA14からの信号により行う。通常、第一のリ
セット値設定用PLA13には一垂直周期に相当するカ
ウント数(国際TV送信方式:NTSCのシステムでは
525) 、第二のリセット値設定用PLA14には垂
直周期の遅れ率をN%としたときの第一のリセット値設
定用PLAの値x(1+N/100)の値を設定してお
く。
信号作成回路12では、通常同期分離回路1で分離した
垂直同期パルスにより垂直カウンタ9にリセットをかけ
るが、弱電界等で同期分前回IIから垂直同期パルスが
出力されなかった場合は、第1のリセット値設定用PL
A13からの信号でリセットをかける。しかし、先に外
部からの垂直同期パルスが入った場合はリセット値設定
用PLA13からのパルスによるリセットは行なわない
。また、VTRの巻も戻し再生等で垂直の同期が遅れる
場合はリセット値切換えスイッチ15を切換えることに
より行なうが、かかる上記の動作は第二のリセット値設
定用PLA14からの信号により行う。通常、第一のリ
セット値設定用PLA13には一垂直周期に相当するカ
ウント数(国際TV送信方式:NTSCのシステムでは
525) 、第二のリセット値設定用PLA14には垂
直周期の遅れ率をN%としたときの第一のリセット値設
定用PLAの値x(1+N/100)の値を設定してお
く。
以上説明したように、本発明のTV用同期コントローラ
は、複数のリセット値設定用PLAと自走リセット信号
切換え用スイッチとを付は加えることにより、VTRの
特殊再生等で垂直の同期が遅れた時でも自走のリセット
値を切換えて垂直系信号が2発出力されるといった乱れ
を防止する効果がある。
は、複数のリセット値設定用PLAと自走リセット信号
切換え用スイッチとを付は加えることにより、VTRの
特殊再生等で垂直の同期が遅れた時でも自走のリセット
値を切換えて垂直系信号が2発出力されるといった乱れ
を防止する効果がある。
第1図は本発明の一実施例を説明するためのTV用同期
コントローラのブロック回路図、第2図は従来の一例を
説明するためのTV用同期コントローラのブロック回路
図である。 一9= 1・・・同期分離回路1.2・・・位相比較器、3・・
・ローパスフィルタ(LPF)、4・・・電圧制御発振
器(vCO)、5・・・水平カウンタ、6・・・1/2
分周器、7・・・水平系プログラマブル論理アレイ(P
LA)、8・・・水平出力用J−にフリップ・フロップ
、9・・・垂直カウンタ、10・・・垂直系プログラマ
ブル論理アレイ(PLA)、11・・・垂直出力用J−
にフリップフロップ、12・・・リセット信号作成回路
、13・・・第一のリセット値設定用PLA、14・・
・第二のリセット値設定用PLA、15・・・リセット
値切え換え用スイッチ。 21ハ〇−
コントローラのブロック回路図、第2図は従来の一例を
説明するためのTV用同期コントローラのブロック回路
図である。 一9= 1・・・同期分離回路1.2・・・位相比較器、3・・
・ローパスフィルタ(LPF)、4・・・電圧制御発振
器(vCO)、5・・・水平カウンタ、6・・・1/2
分周器、7・・・水平系プログラマブル論理アレイ(P
LA)、8・・・水平出力用J−にフリップ・フロップ
、9・・・垂直カウンタ、10・・・垂直系プログラマ
ブル論理アレイ(PLA)、11・・・垂直出力用J−
にフリップフロップ、12・・・リセット信号作成回路
、13・・・第一のリセット値設定用PLA、14・・
・第二のリセット値設定用PLA、15・・・リセット
値切え換え用スイッチ。 21ハ〇−
Claims (1)
- ビデオ信号から水平および垂直の同期パルスを分離す
る同期分離回路と、その分離された水平同期パルスと入
力ビデオ信号とを同期させるための位相比較器、LPF
およびVCOからなるPLL回路と、前記VCOにより
発振させた基本クロックを計数する水平カウンタと、前
記水平カウンタから出力される水平パルスを計数する垂
直カウンタと、水平系および垂直系出力信号の立上りお
よび立下り位置をそれぞれ指定する水平系および垂直系
のPLAと、これらPLA出力に基づき水平系および垂
直系出力信号を作成する水平および垂直出力用J−Kフ
リップ・フロップと、前記同期分離回路からの垂直同期
パルスにより前記垂直カウンタをリセットする信号を作
成するリセット信号作成回路と、前記垂直カウンタ出力
に基ずき前期リセット信号作成回路からのリセット信号
を作成するためのリセット値を設定するリセット値設定
用PLAとを有するTV用同期コントローラにおいて、
前記垂直カウンタの複数のリセット値を設定する第一お
よび第二のPLAと、これらのリセット値を入力ビデオ
信号の状況により切換えるスイッチを設け、前記ビデオ
信号の垂直周期の変動による垂直系出力信号の乱れを防
止したことを特徴とするTV用同期コントローラ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63155493A JPH0738687B2 (ja) | 1988-06-22 | 1988-06-22 | Tv用同期コントローラ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63155493A JPH0738687B2 (ja) | 1988-06-22 | 1988-06-22 | Tv用同期コントローラ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01320870A true JPH01320870A (ja) | 1989-12-26 |
| JPH0738687B2 JPH0738687B2 (ja) | 1995-04-26 |
Family
ID=15607254
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63155493A Expired - Lifetime JPH0738687B2 (ja) | 1988-06-22 | 1988-06-22 | Tv用同期コントローラ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0738687B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03107290A (ja) * | 1989-09-20 | 1991-05-07 | Canon Inc | 同期信号発生器 |
| US6195130B1 (en) | 1997-08-22 | 2001-02-27 | Nec Corporation | Vertical timing signal generating circuit |
-
1988
- 1988-06-22 JP JP63155493A patent/JPH0738687B2/ja not_active Expired - Lifetime
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03107290A (ja) * | 1989-09-20 | 1991-05-07 | Canon Inc | 同期信号発生器 |
| US6195130B1 (en) | 1997-08-22 | 2001-02-27 | Nec Corporation | Vertical timing signal generating circuit |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0738687B2 (ja) | 1995-04-26 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080426 Year of fee payment: 13 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090426 Year of fee payment: 14 |
|
| EXPY | Cancellation because of completion of term | ||
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090426 Year of fee payment: 14 |