JPH0163227U - - Google Patents

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JPH0163227U
JPH0163227U JP1987156566U JP15656687U JPH0163227U JP H0163227 U JPH0163227 U JP H0163227U JP 1987156566 U JP1987156566 U JP 1987156566U JP 15656687 U JP15656687 U JP 15656687U JP H0163227 U JPH0163227 U JP H0163227U
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JP
Japan
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Description

【図面の簡単な説明】
第１図は本考案の第１実施例のタイマ装置の回
路図、第２図は同、タイマ装置のセツト時の作動
を示すタイムチヤート、第３図は同、タイマ装置
のキヤンセル時の作動を示すタイムチヤート、第
４図は本考案の第２実施例のタイマ装置の回路図
、第５図は従来のタイマ回路の回路図、第６図は
従来のタイマ用ＩＣを用いたタイマ装置の回路図
である。 １０……タイマＩＣ（比較判定手段）、Ｐ１…
…接地端子、Ｐ２……トリガ端子、Ｐ３……出力
端子、Ｐ４……リセツト端子、Ｐ５……制御端子
、Ｐ６……スレシヨルド端子、Ｐ７……放電端子
、Ｐ８……電源端子、ＣＭ１……第１コンパレー
タ（第１比較手段）、ＣＭ２……第２コンパレー
タ（第２比較手段）、ＦＦ……ＲＳフリツプフロ
ツプ（出力手段）、２０……遅延スイツチ（スイ
ツチ手段）、２１……第１スイツチ、２１ａ……
第１固定接点、２１ｂ……第１固定接点、２１ｃ
……第１可動接点、２２……第２スイツチ、２２
ａ……第２固定接点、２２ｂ……第２固定接点、
２２ｃ……第２可動接点、３０……遅延手段、４
０……第１設定手段、５０……第２設定手段、６
０……減光回路、７０……スイツチ（スイツチ手
段）、Ｌ……ヒータ、ＲＹ……リレー、＋Ｂ……
電源。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) 入力信号に応じ第１の状態と第２の状態の
    何れか一方をとり第１の状態と第２の状態とで高
    低異なるレベルの信号を出力する出力手段と、第
    １の入力信号を入力して第１の基準値と比較し該
    第１の基準値を超えたときは前記出力手段を第２
    の状態に反転する第１比較手段と、第２の入力信
    号を入力して前記第１の基準値より低レベルの第
    ２の基準値と比較し該第２の基準値を下回つたと
    きは前記出力手段を第１の状態に反転する第２比
    較手段とを有する比較判定手段と、該比較判定手
    段への入力信号をオンオフ制御するスイツチ手段
    と、該スイツチ手段を介し前記出力手段の出力信
    号を入力端から導入し所定値に至るまで蓄積し、
    前記スイツチ手段の作動に応じ所定時間で放出し
    て蓄積値に応じた信号を前記入力端から前記第１
    比較手段に前記第１の入力信号として出力すると
    共に前記第２比較手段に前記第２の入力信号とし
    て出力する遅延手段と、前記スイツチ手段を介し
    て接続される前記出力手段と前記遅延手段の前記
    入力端との間に介装し、前記スイツチ手段の作動
    に応じ前記所定値を前記出力手段の高レベル出力
    信号より低く且つ前記第１の基準値より高レベル
    に設定する第１設定手段と、前記遅延手段の前記
    入力端に接続し前記遅延手段に蓄積された信号の
    放出完了後に前記第２比較手段に前記第２の入力
    信号として出力される出力信号を前記第２の基準
    値より低レベルの所定値に維持する第２設定手段
    とを備えたことを特徴とするタイマ装置。 (2) 前記スイツチ手段が、第１のスイツチと該
    第１のスイツチに連動し該第１のスイツチに対し
    遅延して閉成し先行して開放する第２のスイツチ
    とを備え、前記第１のスイツチを介して前記出力
    手段を前記第１比較手段の前記第１の基準値を設
    定する入力端子に共通に接続し、前記第２のスイ
    ツチを介して前記第１設定手段を前記遅延手段の
    入力端に接続し、且つ前記第１設定手段を前記出
    力手段に接続してなり、前記第１設定手段が前記
    出力手段の出力を所定の割合で分圧する複数の抵
    抗を備えたこと特徴とする実用新案登録請求の範
    囲第１項記載のタイマ装置。 (3) 前記第２設定手段が前記遅延手段の入力端
    と前記第２比較手段との間に介装したツエナーダ
    イオードであることを特徴とする実用新案登録請
    求の範囲第２項記載のタイマ装置。 (4) 前記スイツチ手段が、共通固定接点を有す
    ると共に、第１固定接点との間で継続する第１可
    動接点と、第２固定接点との間で継続し前記第１
    可動接点と連動する第２可動接点とを有するスイ
    ツチから成り、前記共通固定接点を前記第１比較
    手段の前記第１の基準値を設定する入力端子に共
    通に接続すると共に、前記第１固定接点を前記出
    力手段に接続し、前記第２固定接点を前記第１設
    定手段を介して前記遅延手段の入力端に接続して
    なり、前記第１設定手段及び前記第２設定手段が
    アノード側を前記遅延手段の入力端にカソード側
    を前記共通固定接点に接続したダイオードを含む
    ことを特徴とする実用新案登録請求の範囲第１項
    記載のタイマ装置。 (5) 前記遅延手段が、コンデンサと該コンデン
    サが蓄積した電荷を放電する抵抗とからなること
    を特徴とする実用新案登録請求の範囲第１項乃至
    第４項の何れか１項に記載のタイマ装置。
JP1987156566U 1987-10-13 1987-10-13 Expired - Lifetime JPH051157Y2 (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP1987156566U JPH051157Y2 (ja) 1987-10-13 1987-10-13

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Application Number Priority Date Filing Date Title
JP1987156566U JPH051157Y2 (ja) 1987-10-13 1987-10-13

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Publication Number Publication Date
JPH0163227U true JPH0163227U (ja) 1989-04-24
JPH051157Y2 JPH051157Y2 (ja) 1993-01-13

Family

ID=31435221

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Application Number Title Priority Date Filing Date
JP1987156566U Expired - Lifetime JPH051157Y2 (ja) 1987-10-13 1987-10-13

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JP (1) JPH051157Y2 (ja)

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS50108862A (ja) * 1974-01-31 1975-08-27
JPS56145145U (ja) * 1980-03-31 1981-11-02

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS50108862A (ja) * 1974-01-31 1975-08-27
JPS56145145U (ja) * 1980-03-31 1981-11-02

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Publication number Publication date
JPH051157Y2 (ja) 1993-01-13

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