JPH02238639A - 半導体パッケージ - Google Patents
半導体パッケージInfo
- Publication number
- JPH02238639A JPH02238639A JP1059017A JP5901789A JPH02238639A JP H02238639 A JPH02238639 A JP H02238639A JP 1059017 A JP1059017 A JP 1059017A JP 5901789 A JP5901789 A JP 5901789A JP H02238639 A JPH02238639 A JP H02238639A
- Authority
- JP
- Japan
- Prior art keywords
- semiconductor element
- semiconductor
- die pad
- mounting part
- fixing plate
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/50—Bond wires
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/071—Connecting or disconnecting
- H10W72/075—Connecting or disconnecting of bond wires
- H10W72/07541—Controlling the environment, e.g. atmosphere composition or temperature
- H10W72/07551—Controlling the environment, e.g. atmosphere composition or temperature characterised by changes in properties of the bond wires during the connecting
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/50—Bond wires
- H10W72/541—Dispositions of bond wires
- H10W72/5449—Dispositions of bond wires not being orthogonal to a side surface of the chip, e.g. fan-out arrangements
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/50—Bond wires
- H10W72/541—Dispositions of bond wires
- H10W72/547—Dispositions of multiple bond wires
- H10W72/5473—Dispositions of multiple bond wires multiple bond wires connected to a common bond pad
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
- H10W90/751—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires
- H10W90/756—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires between a chip and a stacked lead frame, conducting package substrate or heat sink
Landscapes
- Die Bonding (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は半導体装置の改良されたパッケージの構造に関
する。
する。
〔従来の技術]
従来、半導体パッケージに使用されているリードフレー
ムを用いたパッケージ構造の一例を第3図の断面図に示
す。即ち、リードフレーム11は素子搭載部12とリー
ド部13を有しており、素子搭載部12上に半導体素子
15をマウント用ロー材14によって搭載し、半導体素
子15の電極とリード部13とをボンディング用金属綿
16で接続している。
ムを用いたパッケージ構造の一例を第3図の断面図に示
す。即ち、リードフレーム11は素子搭載部12とリー
ド部13を有しており、素子搭載部12上に半導体素子
15をマウント用ロー材14によって搭載し、半導体素
子15の電極とリード部13とをボンディング用金属綿
16で接続している。
上述した従来の半導体パッケージは、半導体素子15を
素子搭載部12にマウントする際にロー材14が跳ね上
がり、このロー材14が半導体素子15の表面に付着し
て半導体素子を汚染することがある。また、ボンディン
グ用金属線16が変形し、半導体素子15の上縁部に接
触して電気的に短絡し易い。このため、半導体装置の製
造歩留りが低下され、かつ信頼性が低下されるという問
題が生じている。
素子搭載部12にマウントする際にロー材14が跳ね上
がり、このロー材14が半導体素子15の表面に付着し
て半導体素子を汚染することがある。また、ボンディン
グ用金属線16が変形し、半導体素子15の上縁部に接
触して電気的に短絡し易い。このため、半導体装置の製
造歩留りが低下され、かつ信頼性が低下されるという問
題が生じている。
本発明は上述した問題を解消した半導体パッケージを提
供することを目的とする。
供することを目的とする。
本発明の半導体パッケージは、導電性材料からなるリー
ドフレームの素子搭載部に空洞部を設け、この空洞部内
には電気的絶縁材料からなる素子固定板の一端部を挿入
し、素子搭載部上に搭載された半導体素子を該素子固定
板の他端部で抱持して素子搭載部に支持させている。
ドフレームの素子搭載部に空洞部を設け、この空洞部内
には電気的絶縁材料からなる素子固定板の一端部を挿入
し、素子搭載部上に搭載された半導体素子を該素子固定
板の他端部で抱持して素子搭載部に支持させている。
上述した構成では、半導体素子を素子搭載部に固定する
ロー材を不要とし、かつ半導体素子の上縁部を素子固定
体で覆ってボンディング用金属線との接触を防止する。
ロー材を不要とし、かつ半導体素子の上縁部を素子固定
体で覆ってボンディング用金属線との接触を防止する。
次に、本発明を図面を参照して説明する。
(第1実施例)
第1回は本発明の第1実施例の断面図である。
導電性材料からなるリードフレーム1は、半導体素子搭
載部2とリード部3とで構成される。前記素子搭載部2
は、その両側の側面に中心方向に向かっての空洞部2a
を設けてあり、この空洞部2a内には概ねコ字状をした
電気的絶縁材料からなる素子固定板4の一側端を挿入し
ている。そして、前記素子搭載部2上には半導体素子5
を搭載し、この半導体素子5の両側部を前記素子固定板
4の他側端で抱持し、素子搭載部2への固定を行ってい
る。
載部2とリード部3とで構成される。前記素子搭載部2
は、その両側の側面に中心方向に向かっての空洞部2a
を設けてあり、この空洞部2a内には概ねコ字状をした
電気的絶縁材料からなる素子固定板4の一側端を挿入し
ている。そして、前記素子搭載部2上には半導体素子5
を搭載し、この半導体素子5の両側部を前記素子固定板
4の他側端で抱持し、素子搭載部2への固定を行ってい
る。
しかる上で、半導体素子5の電極とり一ト部3とをボン
ディング用金属線6によって相互に電気接続している。
ディング用金属線6によって相互に電気接続している。
この構成によれば、半導体素子5は素子固定板4のみに
よって素子搭載部2に固定されているため、マウント用
のロー材は不要となり、ロー材の跳ね上がりによる半導
体素子5の表面のlη染は防止される。更に、素子固定
板4は半導体素子5の両側縁及び側面を保護しているた
め、変形されたボンディング用金属線6が半導体素子5
6こ接触して電気的に短絡することが防止できる。これ
により、半導体装置の製造上の歩留向上と信頼性の改善
を図ることができる。
よって素子搭載部2に固定されているため、マウント用
のロー材は不要となり、ロー材の跳ね上がりによる半導
体素子5の表面のlη染は防止される。更に、素子固定
板4は半導体素子5の両側縁及び側面を保護しているた
め、変形されたボンディング用金属線6が半導体素子5
6こ接触して電気的に短絡することが防止できる。これ
により、半導体装置の製造上の歩留向上と信頼性の改善
を図ることができる。
(第2実施例)
第2図は本発明の第2実施例の平面図である。
この第2実施例の断面構造は第1実施例と同しであり、
同一部分には同一符号を付してある。
同一部分には同一符号を付してある。
この実施例では、素子搭載部2の空洞部2a内にその一
部を挿入した電気的絶縁材料からなる素子固定板4の表
面に、インダクタンスを構成するメタルパターン7を形
成している。そして、素子搭載部2に素子固定板4で固
定した半導体素子5の電極の一部をポンディングヮイヤ
6Aでメタルパターン7の一端に接続し、該メタルパタ
ーン7の他端をボンディングワイヤ6によりリード部3
に接続している。
部を挿入した電気的絶縁材料からなる素子固定板4の表
面に、インダクタンスを構成するメタルパターン7を形
成している。そして、素子搭載部2に素子固定板4で固
定した半導体素子5の電極の一部をポンディングヮイヤ
6Aでメタルパターン7の一端に接続し、該メタルパタ
ーン7の他端をボンディングワイヤ6によりリード部3
に接続している。
この実施例では、第1実施例と同様にロー材の跳ね上が
りによる半導体素子5の汚れを防止し、かつボンディン
グワイヤ6と半導体素子5との電気的短絡を防止できる
とともに、半導体パッケージ内に一体的にインダクタン
スが形成でき、半導体装置の小型化が実現できるという
効果もある。
りによる半導体素子5の汚れを防止し、かつボンディン
グワイヤ6と半導体素子5との電気的短絡を防止できる
とともに、半導体パッケージ内に一体的にインダクタン
スが形成でき、半導体装置の小型化が実現できるという
効果もある。
なお、前記実施例では半導体装置内にインダクタンスを
構成した例を説明したが、抵抗,コンデンサ等を構成し
てもよい。
構成した例を説明したが、抵抗,コンデンサ等を構成し
てもよい。
〔発明の効果]
以上説明したように本発明は、リードフレームの素子搭
載部に空洞部を設けて電気的絶縁材料からなる素子固定
板の一端部を挿入し、素子搭載部上に搭載された半導体
素子を該素子固定板の他端部で抱持して素子搭載部に支
持させているので、半導体素子を素子搭載部に固定する
ロー材を不要とし、マウント時におけるロー材の跳ね上
がりによる半導体素子表面の汚染を防止することができ
る効果がある。また、素子固定板で半導体素子の上縁部
を覆うため、ポンディング用金属線との接触を防止して
ボンディング用金属線との電気的短絡を防止できる効果
がある。
載部に空洞部を設けて電気的絶縁材料からなる素子固定
板の一端部を挿入し、素子搭載部上に搭載された半導体
素子を該素子固定板の他端部で抱持して素子搭載部に支
持させているので、半導体素子を素子搭載部に固定する
ロー材を不要とし、マウント時におけるロー材の跳ね上
がりによる半導体素子表面の汚染を防止することができ
る効果がある。また、素子固定板で半導体素子の上縁部
を覆うため、ポンディング用金属線との接触を防止して
ボンディング用金属線との電気的短絡を防止できる効果
がある。
第1図は本発明の第1実施例の縦断面図、第2図は本発
明の第2実施例の平面図、第3図は従来構造の縦断面図
である。 1 11・・・リードフレーム、2.12・・・素子搭
載部、3.13・・・リード部、4・・・素子固定板、
5,15・・・半導体素子、6.6A,16・・・ボン
ディング用金属線、7・・・インダクタンス、14・・
・ロー材。 5半薄体素チ 第2 図 第3 図
明の第2実施例の平面図、第3図は従来構造の縦断面図
である。 1 11・・・リードフレーム、2.12・・・素子搭
載部、3.13・・・リード部、4・・・素子固定板、
5,15・・・半導体素子、6.6A,16・・・ボン
ディング用金属線、7・・・インダクタンス、14・・
・ロー材。 5半薄体素チ 第2 図 第3 図
Claims (1)
- 1、導電性材料からなるリードフレームの素子搭載部に
空洞部を設け、この空洞部内には電気的絶縁材料からな
る素子固定板の一端部を挿入し、前記素子搭載部上に搭
載された半導体素子を該素子固定板の他端部で抱持して
素子搭載部に支持させたことを特徴とする半導体パッケ
ージ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1059017A JPH02238639A (ja) | 1989-03-10 | 1989-03-10 | 半導体パッケージ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1059017A JPH02238639A (ja) | 1989-03-10 | 1989-03-10 | 半導体パッケージ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02238639A true JPH02238639A (ja) | 1990-09-20 |
Family
ID=13101102
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1059017A Pending JPH02238639A (ja) | 1989-03-10 | 1989-03-10 | 半導体パッケージ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02238639A (ja) |
-
1989
- 1989-03-10 JP JP1059017A patent/JPH02238639A/ja active Pending
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| US6888231B2 (en) | Surface mounting semiconductor device | |
| JP2001036000A (ja) | チップサイズスタックパッケージ及びメモリモジュールとその製造方法 | |
| JPH0479141B2 (ja) | ||
| JPH03169062A (ja) | 半導体装置 | |
| JPH0770641B2 (ja) | 半導体パッケージ | |
| JPH0239097B2 (ja) | ||
| JPH02238639A (ja) | 半導体パッケージ | |
| JP2003124251A5 (ja) | ||
| JP2545964B2 (ja) | 磁気抵抗効果素子 | |
| JPH04237154A (ja) | 半導体パッケージ | |
| JP2503646B2 (ja) | リ―ドフレ―ムおよび半導体集積回路装置 | |
| JPH0451056B2 (ja) | ||
| JPH11317428A5 (ja) | ||
| KR100487464B1 (ko) | 리드프레임을이용한반도체칩패키지 | |
| JPH02268459A (ja) | 半導体パッケージ | |
| JP2587722Y2 (ja) | 半導体装置 | |
| JPH03129840A (ja) | 樹脂封止型半導体装置 | |
| JPH083018Y2 (ja) | 半導体パッケージ用連結型リードフレーム | |
| JP2725719B2 (ja) | 電子部品及びその製造方法 | |
| JPH0366150A (ja) | 半導体集積回路装置 | |
| JPH04188660A (ja) | リードフレーム | |
| JPH11340373A (ja) | 薄小型樹脂封止パッケージ | |
| JPS62183155A (ja) | 半導体集積回路装置 | |
| JPH01124227A (ja) | 半導体装置 | |
| JPH01173747A (ja) | 樹脂封止形半導体装置 |