JPH0284947U - - Google Patents

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JPH0284947U
JPH0284947U JP1989095504U JP9550489U JPH0284947U JP H0284947 U JPH0284947 U JP H0284947U JP 1989095504 U JP1989095504 U JP 1989095504U JP 9550489 U JP9550489 U JP 9550489U JP H0284947 U JPH0284947 U JP H0284947U
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  • Control Of Vehicles With Linear Motors And Vehicles That Are Magnetically Levitated (AREA)
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Description

【図面の簡単な説明】
第１図は本考案によるバスにおけるコントロー
ラ−ドライブ通信チヤンネルの図面である。第２
図は第１図のバス１０の情報の全体的な特徴を要
約する表であり、コントローラに関係するドライ
ブ状態の機能である。第３図は第１図のライン１
８のＲＴＣＳ信号のフオーマツトを図示する。第
４図は第１図のライン１２のＲＴＤＳ信号のフオ
ーマツトを図示する。第５図はコントローラに関
係するドライブ状態および状態の変化を示す状態
図である。第６図はドライブコマンドタイマーの
操作を図示する。第７図は本考案によるレベル０
（即ち、最低のプロトコルレベル）の制御送信の
ためのフオーマツトを図示する。第８Ａから８Ｉ
図はバス１０を送信される各可能なレベル１（即
ち、中間プロトコルレベル）のフレームのフオー
マツトを図示する。第９図はレベル１送信に対す
るコントローラの動作のフローチヤートである。
第１０Ａから１０Ｃ図はドライブのレベル１の受
信処理のフローチヤートである。第１１図はドラ
イブのレベル１の送信処理のフローチヤートであ
る。第１２図はコントローラのレベル１の受信処
理のフローチヤートである。第１３図はレベル２
（即ち最高のプロトコルレベル）のメツセージの
フオーマツトを図示する。第１４図はコントロー
ラでレベル２のコマンド処理を達成するための方
法を図示するフローチヤートである。第１５図は
ドライブおよびコントローラのレベル２のメツセ
ージ送信処理用のフローチヤートである。第１６
図はドライブのレベル２メツセージ受信処理を示
すフローチヤートである。第１７図はコントロー
ラのレベル２のメツセージ受信処理を図示するフ
ローチヤートである。第１８図は以下で記述され
るいわゆるモード変換コマンドのコントローラの
処理を図示するフローチヤートである。第１９図
はモード変換コマンドのドライブの処理を図示す
るフローチヤートである。第２０図はモード変換
コマンドのフオーマツトを図示する。第２１図は
以下で記述されるいわゆるコントローラ−フラグ
変換コマンドのコントローラの処理を説明するフ
ローチヤートである。第２２図はコントローラ−
フラグ変換コマンドのドライブの処理を説明する
フローチヤートである。第２３図はコントローラ
−フラグ変換コマンドのフオーマツトを図示する
。第２４図は以下で記述されるコントローラによ
るいわゆる切断コマンドの処理のフローチヤート
である。第２５図はドライブによる切断コマンド
の処理のフローチヤートである。第２６図は切断
コマンドのフオーマツトを図示する。第２７図は
以下で記述されるいわゆるエラー回復コマンドの
コントローラの処理のフローチヤートである。第
２８図はエラー回復コマンドのドライブの処理の
フローチヤートである。第２９図はエラー回復コ
マンドのフオーマツトを図示する。第３０図は以
下で記述されるいわゆる共通特性取得コマンドの
コントローラのフオーマツトを図示する。第３１
図は共通特性取得コマンドのコントローラの処理
のフローチヤートである。第３２図は共通特性取
得コマンドのドライブの処理のフローチヤートで
ある。第３３図は共通特性取得応答のフオーマツ
トを図示する。第３４図は以下で記述されるいわ
ゆるサブユニツト特性取得コマンドのフオーマツ
トを図示する。第３５図はサブユニツト特性取得
コマンドのコントローラの処理のフローチヤート
である。第３６図はサブユニツト特性取得コマン
ドのドライバの処理のフローチヤートである。第
３７Ａおよび３７Ｂ図はサブユニツト特性取得応
答のフオーマツトを図示する。第３８図は以下で
記述されるいわゆるステータス取得コマンドのフ
オーマツトを図示する。第３９図はステータス取
得コマンドのコントローラの処理のフローチヤー
トである。第４０図はステータス取得コマンドの
ドライバの処理のフローチヤートである。第４１
図はステータス取得コマンドに対する応答のフオ
ーマツトを図示する。第４２図は以下で記述され
るいわゆるオンラインコマンドのフオーマツトを
図示す。第４３図はオンラインコマンドのコント
ローラの処理のフローチヤートである。第４４図
はオンラインコマンドのドライバの処理のフロー
チヤートである。第４５図は以下で記述されるい
わゆるトポロジーコマンドのフオーマツトを図示
する。第４６図はトポロジーコマンドのコントロ
ーラの処理のフローチヤートである。第４７図は
トポロジーコマンドのドライブの処理のフローチ
ヤートである。第４８図はトポロジーコマンドに
対する応答のフオーマツトを図示する。第４９図
は総称完了応答のフオーマツトを図示する。第５
０図は総称失敗応答のフオーマツトを図示する。 １０……ケーブル、１２，１４，１６，１８…
…ライン、２０……コントローラ、３０……ドラ
イブ。
補正 平１．９．１３ 実用新案登録請求の範囲を次のように補正する
。
【実用新案登録請求の範囲】 (1) 大容量記憶装置と、該大容量記憶装置の動
作を達成するためのコントローラと、該コントロ
ーラと前記大容量記憶装置との間の通信パスを確
立するための通信パス確立装置とを備えているデ
ータ処理システムのための二次記憶装置において
、通信パスを確立するための標準の装置では、コ
マンド、応答、データおよび状態情報のような情
報は、ある装置とコントローラとの間で、通常、
４つより多い単一方向性チヤンネルにて通信され
るのであるが、前記通信パス確立装置は、４つの
単一方向性チヤンネルのみにてコマンド、応答、
データおよび状態情報を通信することができ、前
記通信パス確立装置は、 前記コントローラから前記大容量記憶装置へ信
号を搬送するための第１および第２の単一方向性
チヤンネルと、前記大容量記憶装置から前記コン
トローラへ信号を搬送するための第３および第４
の単一方向性チヤンネルとのみから実質的になる
放射状バスと、 前記コントローラに関連付けられて前記コント
ローラの状態を定める状態変数のセツトをそれぞ
れ示すビツト多重化されたビツトシリアル実時間
信号のシーケンスの連続的伝送を発生して前記第
１の単一方向性チヤンネルに加える手段および前
記大容量記憶装置に関連付けられて前記コントロ
ーラの状態を定める状態変数のセツトをそれぞれ
示すビツト多重化されたビツトシリアル実時間信
号のシーケンスの連続的伝送を前記第１の単一方
向性チヤンネルから受ける手段と、 前記コントローラに関連付けられてビツトシリ
アルコマンドメツセージおよび書込みデータを発
生して前記第２の単一方向性チヤンネルに加える
手段および前記大容量記憶装置に関連付けられて
ビツトシリアルコマンドメツセージおよび書込み
データを前記第２の単一方向性チヤンネルから受
ける手段と、 前記大容量記憶装置に関連付けられて前記大容
量記憶装置の状態を定める状態変数のセツトをそ
れぞれ示すビツト多重化されたビツトシリアル実
時間信号のシーケンスの連続的伝送を発生して前
記第３の単一方向性チヤンネルに加える手段およ
び前記コントローラに関連付けられて前記大容量
記憶装置の状態を定める状態変数のセツトをそれ
ぞれ示すビツト多重化されたビツトシリアル実時
間信号のシーケンスの連続的伝送を前記第３の単
一方向性チヤンネルから受ける手段と、 前記大容量記憶装置に関連付けられてビツトシ
リアル応答メツセージおよび読取りデータを発生
して前記第４の単一方向性チヤンネルに加える手
段および前記コントローラに関連付けられてビツ
トシリアル応答メツセージおよび読取りデータを
前記第４の単一方向性チヤンネルから受ける手段
と、 前記コントローラに関連付けられて前記大容量
記憶装置の状態変数のセツトを示す信号の前記シ
ーケンスに応答しておよび前記応答メツセージお
よび読取りデータに応答して前記コントローラの
動作を達成するための手段と、 前記大容量記憶装置に関連付けられて前記コン
トローラの状態変数のセツトを示す信号の前記シ
ーケンスに応答しておよび前記コマンドメツセー
ジおよび書込みデータに応答して前記大容量記憶
装置の動作を達成するための手段とを備えており
、 前記大容量記憶装置の状態を示す前記シーケン
スの各々は、あるビツトパターンであり、前記大
容量記憶装置の状態を示す前記ビツトパターン内
において、 Ａ 所定の第１のビツトが同期ビツトを与えて
おり、 Ｂ 所定の第２のビツトがレシーバレデイ信号
を与えており、 Ｃ 所定の第３のビツトがアテンシヨン信号を
与えており、 Ｄ 所定の第４のビツトが読取り／書込みレデ
イ信号を与えており、 Ｅ 所定の第５のビツトがセクタパルス信号を
与えており、 Ｆ 所定の第６のビツトが使用可能ステータス
信号を与える、 ことを特徴とする二次記憶装置。 (2) 前記コントローラの状態を示す前記シーケ
ンスの各々は、所定の長さのビツトパターンであ
る実用新案登録請求の範囲第(1)項記載の二次記
憶装置。 (3) 前記コントローラの状態を示す前記ビツト
パターン内において、 Ａ 所定の第１のビツトが同期ビツトを与えて
おり、 Ｂ 所定の第２のビツトがレシーバレデイ信号
を与えており、 Ｃ 所定の第３のビツトが書込みゲート信号を
与えており、 Ｄ 所定の第４のビツトが読取りゲート信号を
与えており、 Ｅ 所定の第５のビツトが初期化信号を与えて
いる、 実用新案登録請求の範囲第(2)項記載の二次記
憶装置。 (4) 前記コントローラの状態を示す前記ビツト
パターンは、 Ｆ パリテイビツトとして機能する第６のビツ
ト をさらに含む実用新案登録請求の範囲第(3)項
記載の二次記憶装置。 (5) 前記コントローラの状態を示す前記ビツト
パターンは、前記第１のビツトの前にプリアンブ
ルを構成する所定の値の複数のビツトをさらに含
む実用新案登録請求の範囲第(4)項記載の二次記
憶装置。 (6) 前記プリアンブルは、所定の数の０値ビツ
トからなる実用新案登録請求の範囲第(5)項記載
の二次記憶装置。 (7) 前記大容量記憶装置の状態を示す前記ビツ
トパターンは、 Ｇ インデツクスパルス信号として機能する所
定の第７のビツトと、 Ｈ パリテイビツトとして機能する所定の第８
のビツトと、 を含む実用新案登録請求の範囲第(1)項記載の
二次記憶装置。 (8) 前記大容量記憶装置の状態を示す前記ビツ
トパターンは、前記第１のビツトの前にプリアン
ブルを構成する所定の値の複数のビツトをさらに
含む実用新案登録請求の範囲第(7)項記載の二次
記憶装置。 (9) 大容量記憶装置と、 コントローラと、 前記大容量記憶装置と前記コントローラとの間
の通信パスを確立するための相互接続手段とを備
える大容量記憶サブシステムにおいて、 前記コントローラは、 操作コードを含む情報の１つまたはそれ以上の
バイトを含むレベル２コマンドメツセージを通信
するためのレベル２コマンドメツセージ通信手段
を備えており、 該レベル２コマンドメツセージ通信手段は、 前記レベル２コマンドメツセージからレベル１
フレームを構成するためのレベル１フレーム構成
手段であつて、前記レベル２コマンドメツセージ
を別々のバイトに分割するための手段と、前記別
々のバイトを個々のレベル１フレームに組み込む
ための手段とを備えるレベル１フレーム構成手段
と、 個々のレベル１フレームのレベル０伝送を送信
するためのレベル０伝送送信手段であつて、前記
個々のレベル１フレームを前記相互接続手段を介
して送信するための手段と、同期ワードを前記相
互接続手段を介して送信するための手段とを備え
るレベル０伝送送信手段とを備えており、 前記大容量記憶装置は、 前記コントローラからレベル１フレームの前記
個々のレベル０伝送を受信し且つ前記レベル２コ
マンドメツセージを再構成する手段と、 前記レベル２コマンドメツセージの操作コード
およびサイズのバリデイテイおよびパリテイをチ
エツクするための手段と、 前記レベル２コマンドメツセージを実行するた
めの手段と、 情報の１つまたはそれ以上のバイトを含むレベ
ル２応答メツセージを通信するためのレベル２応
答メツセージ通信手段とを備えており、 前記レベル２応答メツセージの内容は、前記レ
ベル２コマンドメツセージの実行の結果の関数で
あり、 前記レベル２応答メツセージ通信手段は、 前記レベル２応答メツセージからレベル１フレ
ームを構成するためのレベル１フレーム構成手段
であつて、前記レベル２応答メツセージを別々の
バイトに分割するための手段と、前記別々のバイ
トを個々のレベル１フレームに組み込むための手
段とを備えるレベル１フレーム構成手段と、 個々のレベル１フレームのレベル０伝送を送信
するためのレベル０伝送送信手段であつて、前記
個々のレベル１応答フレームを前記相互接続手段
を介して送信するための手段と、同期ワードを前
記相互接続手段を介して送信するための手段とを
備えるレベル０伝送送信手段とを備えており、 前記コントローラは、更に、 前記大容量記憶装置からレベル１フレームの前
記レベル０伝送を受信し且つ前記レベル２応答メ
ツセージを再構成するための手段と、 前記再構成されたレベル２応答メツセージが前
記レベル２コマンドメツセージの前記大容量記憶
装置による実行が首尾よく行われたことを示して
いるかどうかを決定するための手段とを備えるこ
とを特徴とする大容量記憶サブシステム。 (10) コントローラへ接続するための大容量記憶
装置であつて、前記コントローラは、レベル２コ
マンドメツセージをレベル１フレームのレベル０
伝送として前記大容量記憶装置に通信し且つレベ
ル２応答メツセージからなるレベル１フレームの
レベル０伝送を前記大容量記憶装置から受信する
ことができるようになつている大容量記憶装置に
おいて、 Ａ 前記コントローラからレベル１フレームの
前記レベル０伝送を受信し且つ前記受信したレベ
ル０伝送から前記レベル２コマンドメツセージを
構成するための手段と、 Ｂ 前記再構成されたレベル２コマンドメツセ
ージの操作コードおよびサイズのバリデイテイを
チエツクするための手段と、 Ｃ 前記構成されたレベル２コマンドメツセー
ジを実行するための手段と、 Ｄ 前記再構成されたレベル２コマンドメツセ
ージが首尾よく実行されたかどうかを指示するレ
ベル２応答メツセージを、レベル１フレームのレ
ベル０伝送として前記コントローラへ通信するた
めの手段と、 を備えることを特徴とする大容量記憶装置。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) 大容量記憶装置と、該大容量記憶装置の動
    作を達成するためのコントローラと、該コントロ
    ーラと前記大容量記憶装置との間の通信パスを確
    立するための通信パス確立装置とを備えているデ
    ータ処理システムのための二次記憶装置において
    、通信パスを確立するための標準の装置では、コ
    マンド、応答、データおよび状態情報のような情
    報は、ある装置とコントローラとの間で、通常、
    ４つより多い単一方向性チヤンネルにて通信され
    るのであるが、前記通信パス確立装置は、４つの
    単一方向性チヤンネルのみにてコマンド、応答、
    データおよび状態情報を通信することができ、前
    記通信パス確立装置は、 前記コントローラから前記大容量記憶装置へ信
    号を搬送するための第１および第２の単一方向性
    チヤンネルと、前記大容量記憶装置から前記コン
    トローラへ信号を搬送するための第３および第４
    の単一方向性チヤンネルとのみから実質的になる
    放射状バスと、 前記コントローラに関連付けられて前記コント
    ローラの状態を定める状態変数のセツトをそれぞ
    れ示すビツト多量化されたビツトシリアル実時間
    信号のシーケンスの連続的伝送を発生して前記第
    １の単一方向性チヤンネルに加える手段および前
    記大容量記憶装置に関連付けられて前記コントロ
    ーラの状態を定める状態変数のセツトをそれぞれ
    示すビツト多重化されたビツトシリアル実時間信
    号のシーケンスの連続的伝送を前記第１の単一方
    向性チヤンネルから受ける手段と、 前記コントローラに関連付けられてビツトシリ
    アルコマンドメツセージおよび書込みデータを発
    生して前記第２の単一方向性チヤンネルに加える
    手段および前記大容量記憶装置に関連付けられて
    ビツトシリアルコマンドメツセージおよび書込み
    データを前記第２の単一方向性チヤンネルから受
    ける手段と、 前記大容量記憶装置に関連付けられて前記大容
    量記憶装置の状態を定める状態変数のセツトをそ
    れぞれ示すビツト多重化されたビツトシリアル実
    時間信号のシーケンスの連続的伝送を発生して前
    記第３の単一方向性チヤンネルに加える手段およ
    び前記コントローラに関連付けられて前記大容量
    記憶装置の状態を定める状態変数のセツトをそれ
    ぞれ示すビツト多重化されたビツトシリアル実時
    間信号のシーケンスの連続的伝送を前記第３の単
    一方向性チヤンネルから受ける手段と、 前記大容量記憶装置に関連付けられてビツトシ
    リアル応答メツセージおよび読取りデータを発生
    して前記第４の単一方向性チヤンネルに加える手
    段および前記コントローラに関連付けられてビツ
    トシリアル応答メツセージおよび読取りデータを
    前記第４の単一方向性チヤンネルから受ける手段
    と、 前記コントローラに関連付けられて前記大容量
    記憶装置の状態変数のセツトを示す信号の前記シ
    ーケンスに応答しておよび前記応答メツセージお
    よび読取りデータに応答して前記コントローラの
    動作を達成するための手段と、 前記大容量記憶装置に関連付けられて前記コン
    トローラの状態変数のセツトを示す信号の前記シ
    ーケンスに応答しておよび前記コマンドメツセー
    ジおよび書込みデータに応答して前記大容量記憶
    装置の動作を達成するための手段とを備えており
    、 前記大容量記憶装置の状態を示す前記シーケン
    スの各々は、あるビツトパターンであり、前記大
    容量記憶装置の状態を示す前記ビツトパターン内
    において、 Ａ 所定の第１のビツトが同期ビツトを与えて
    おり、 Ｂ 所定の第２のビツトがレシーバレデイ信号
    を与えており、 Ｃ 所定の第３のビツトがアテンシヨン信号を
    与えており、 Ｄ 所定の第４のビツトが読取り／書込みレデ
    イ信号を与えており、 Ｅ 所定の第５のビツトがセクタパルス信号を
    与えており、 Ｆ 所定の第６のビツトが使用可能ステータス
    信号を与える、 ことを特徴とする二次記憶装置。 (2) 前記コントローラの状態を示す前記シーケ
    ンスの各々は、所定の長さのビツトパターンであ
    る実用新案登録請求の範囲第(1)項記載の二次記
    憶装置。 (3) 前記コントローラの状態を示す前記ビツト
    パターン内において、 Ａ 所定の第１のビツトが同期ビツトを与えて
    おり、 Ｂ 所定の第２のビツトがレシーバレデイ信号
    を与えており、 Ｃ 所定の第３のビツトが書込みゲート信号を
    与えており、 Ｄ 所定の第４のビツトが読取りゲート信号を
    与えており、 Ｅ 所定の第５のビツトが所期化信号を与えて
    いる、 実用新案登録請求の範囲第(2)項記載の二次記
    憶装置。 (4) 前記コントローラの状態を示す前記ビツト
    パターンは、 Ｆ パリテイビツトとして機能する第６のビツ
    ト をさらに含む実用新案登録請求の範囲第(3)項
    記載の二次記憶装置。 (5) 前記コントローラの状態を示す前記ビツト
    パターンは、前記第１のビツトの前にプリアンブ
    ルを構成する所定の値の複数のビツトをさらに含
    む実用新案登録請求の範囲第(4)項記載の二次記
    憶装置。 (6) 前記プリアンブルは、所定の数の０値ビツ
    トからなる実用新案登録請求の範囲第(5)項記載
    の二次記憶装置。 (7) 前記大容量記憶装置の状態を示す前記ビツ
    トパターンは、 Ｇ インデツクスパルス信号として機能する所
    定の第７のビツトと、 Ｈ パリテイビツトとして機能する所定の第８
    のビツトと、 を含む実用新案登録請求の範囲第(1)項記載の
    二次記憶装置。 (8) 前記大容量記憶装置の状態を示す前記ビツ
    トパターンは、前記第１のビツトの前にプリアン
    ブルを構成する所定の値の複数のビツトをさらに
    含む実用新案登録請求の範囲第(7)項記載の二次
    記憶装置。
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