JPH0285949A - Ｇｐｉｂ制御装置 - Google Patents
Ｇｐｉｂ制御装置Info
- Publication number
- JPH0285949A JPH0285949A JP23790688A JP23790688A JPH0285949A JP H0285949 A JPH0285949 A JP H0285949A JP 23790688 A JP23790688 A JP 23790688A JP 23790688 A JP23790688 A JP 23790688A JP H0285949 A JPH0285949 A JP H0285949A
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- JP
- Japan
- Prior art keywords
- gpib
- controller
- disconnection
- bus
- connection
- Prior art date
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- Granted
Links
- 238000010586 diagram Methods 0.000 description 4
- 230000000694 effects Effects 0.000 description 2
- 238000000926 separation method Methods 0.000 description 2
Landscapes
- Bus Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
Ｃ産業上の利用分野）
本発明はＩＥＥＥ ８ｔｄ ４８８−１９７８で規
定された汎用インターフェースバス（ＧＰＩＢ）の制御
装置に廚する。
定された汎用インターフェースバス（ＧＰＩＢ）の制御
装置に廚する。
（従来の技術）
汎用インターフェースバス（以後、ＧＰＩＢと称する。
）は汎用のバスであり、１本のバス上に複数の装置が接
続され、５ち１台がコントローラとなつてバスを制御す
るものである。−般に、ＧＰＩＢに接続される装置はト
ーカおよびリスナの機能をもち、コントローラの制御の
もとでトーカとして指定された１台の装置からリスナと
して指定された１台以上の装置へ３線ハンドシエイクに
よりデータ転送が行われている。
続され、５ち１台がコントローラとなつてバスを制御す
るものである。−般に、ＧＰＩＢに接続される装置はト
ーカおよびリスナの機能をもち、コントローラの制御の
もとでトーカとして指定された１台の装置からリスナと
して指定された１台以上の装置へ３線ハンドシエイクに
よりデータ転送が行われている。
（発明が解決しようとする課題）
上述した従来のＧＰＩＢでは、すべての装置が１本のバ
スに接続されているため、−時的にはトーカとなる１台
の装置からリスナとなるｎ台の装置へデータｐ′−転送
されるのみである。そのため、それ以外の装置間で阻デ
ータ転送の必要件が生じても、現在、実行されているデ
ータの転送が終了するまで待たされることになる。
スに接続されているため、−時的にはトーカとなる１台
の装置からリスナとなるｎ台の装置へデータｐ′−転送
されるのみである。そのため、それ以外の装置間で阻デ
ータ転送の必要件が生じても、現在、実行されているデ
ータの転送が終了するまで待たされることになる。
従りて、高い処理速度が要求されるようなシステムでは
、バスネックのために所望の処理能力が得られない場合
があるという欠点がある。
、バスネックのために所望の処理能力が得られない場合
があるという欠点がある。
本発明の目的は、トーカ／リスナとして動作する第１の
ＧＰＩＢ制御部を備えてシステムのコントロー２から送
出されるコマンドに従りて接続／切離しを制御するとと
もに、ＧＰＩＢが接続されている状態では機能を停止し
、切離されている状態では：ｌｌ ｙ トローラとして
動作する第２のＧＰＩＢＩＩ（４１１部を備えることに
よって上記欠点を除去し、処理能力の低下することがな
いよ５に構成したＧＰＩＢ制御装置を提供することにあ
る。
ＧＰＩＢ制御部を備えてシステムのコントロー２から送
出されるコマンドに従りて接続／切離しを制御するとと
もに、ＧＰＩＢが接続されている状態では機能を停止し
、切離されている状態では：ｌｌ ｙ トローラとして
動作する第２のＧＰＩＢＩＩ（４１１部を備えることに
よって上記欠点を除去し、処理能力の低下することがな
いよ５に構成したＧＰＩＢ制御装置を提供することにあ
る。
（課題を解決するための手段）
本発明によるＧＰＩＢ制御装置は第１および第２のＧＰ
ＩＢ制御部と、ＧＰＩＢ接続／切離し部とを具備して構
成したものである。
ＩＢ制御部と、ＧＰＩＢ接続／切離し部とを具備して構
成したものである。
第１のＧＰＩＢ制御部はトーカ／リスナとして動作し、
システムコントローラからのコマンドにより直列接続さ
れた一対のＧＰＩＢの接続／切離しを制御するためのも
のである。
システムコントローラからのコマンドにより直列接続さ
れた一対のＧＰＩＢの接続／切離しを制御するためのも
のである。
第２のＧＰＩＢ制御部は、第１のＧＰＩＢ制御部より制
御され、上記一対のＧＰＩＢが接続されている状態では
機能を停止し、上記一対のＧＰＩＢが切離されている状
態ではコントローラとして動作するためのものである。
御され、上記一対のＧＰＩＢが接続されている状態では
機能を停止し、上記一対のＧＰＩＢが切離されている状
態ではコントローラとして動作するためのものである。
ＧＰＩＢ接！！／切離し部は、第１および第２のＧＰＩ
Ｂ制御部の制御の下で、上記一対のＧＰＩＢＯ接続／切
離しを実行するためのものである。
Ｂ制御部の制御の下で、上記一対のＧＰＩＢＯ接続／切
離しを実行するためのものである。
（実施例）
次に、本発明について図面を参照して説明する。
第１図は、本発明によるＧＰ Ｉ Ｂ制御装置の一実施
例を示すブロック図である。
例を示すブロック図である。
第１図において、１１は第１ＯＧＩ’ＩＢ制御部、１２
は第２０ＧＰＩＢ制御部、１３はＧＰＩＢ接続／切離し
部、１４．１５はそれぞれＧＦＩＢである。
は第２０ＧＰＩＢ制御部、１３はＧＰＩＢ接続／切離し
部、１４．１５はそれぞれＧＦＩＢである。
第１図のＧＰ Ｉ Ｂ接続／切離し部３はＧＦＩＢ４，
５間を物理的に接続／切離し機能を有し、バスを接続し
ている状態では第２のＧＰＩＢ制御部１２は動作を停止
し、第１のＧＰＩＢ制御部１１がＧＦＩＢ４側のコント
ローラのもとく動作する。
５間を物理的に接続／切離し機能を有し、バスを接続し
ている状態では第２のＧＰＩＢ制御部１２は動作を停止
し、第１のＧＰＩＢ制御部１１がＧＦＩＢ４側のコント
ローラのもとく動作する。
コントローラよりパス切離しコマンドを受けると、ＧＦ
ＩＢ４．５間を切離し、第２のＧＰＩＢ制御部１２に対
してコントローラとしての動作を行うように指示する。
ＩＢ４．５間を切離し、第２のＧＰＩＢ制御部１２に対
してコントローラとしての動作を行うように指示する。
再び、第２のＧＰＩＢ制御部１２がバス接続コマンドを
受取ると、第２のＧＰ Ｉ Ｂ制術部１２の動作を停止
させた後、ＧＰＩＢ接続／切離し部１３を制御してＧＰ
ＩＢの切離しを行う。
受取ると、第２のＧＰ Ｉ Ｂ制術部１２の動作を停止
させた後、ＧＰＩＢ接続／切離し部１３を制御してＧＰ
ＩＢの切離しを行う。
第２図は、第１図のＧＰＩＢ制御装置の接続されたシス
テム例を示すブロック図である。第２図において、２１
は上述したコントローラ機能の付加された装置、２２は
ＧＰＩＢ制御装置、２３〜２７はそれぞれ上述したコン
トローラ機能のない装置、２８．２９はそれぞれＧＰＩ
Ｂである。
テム例を示すブロック図である。第２図において、２１
は上述したコントローラ機能の付加された装置、２２は
ＧＰＩＢ制御装置、２３〜２７はそれぞれ上述したコン
トローラ機能のない装置、２８．２９はそれぞれＧＰＩ
Ｂである。
第２図において、例えば装置１２３〜２５の間、および
装置２６．２７の間のデータ転送頻度が高く、装置２３
〜２５と装［２６，２７との間のデータ転送頻度が低い
ようなシステムであるとする。このようなシステムでは
、ＧＰ Ｉ Ｂ２８゜２９を切離した状態でＧＦＩＢ２
８内のデータ転送と、ＧＦＩＢ２９内のデータ転送とを
独立に動作させ、ＧＦＩＢ２８側の装置と、ＧＦＩＢ２
９側の装置との間でデータ転送の必要性が生じたときに
限ってＧＦＩＢ２８．２９を接続し、データ転送を行う
ことによりシステムの処理能力を向上させることができ
る。
装置２６．２７の間のデータ転送頻度が高く、装置２３
〜２５と装［２６，２７との間のデータ転送頻度が低い
ようなシステムであるとする。このようなシステムでは
、ＧＰ Ｉ Ｂ２８゜２９を切離した状態でＧＦＩＢ２
８内のデータ転送と、ＧＦＩＢ２９内のデータ転送とを
独立に動作させ、ＧＦＩＢ２８側の装置と、ＧＦＩＢ２
９側の装置との間でデータ転送の必要性が生じたときに
限ってＧＦＩＢ２８．２９を接続し、データ転送を行う
ことによりシステムの処理能力を向上させることができ
る。
（発明の効果）
以上説明したように本発明は、ＧＰＩＢにバスの切離し
／接続の機能をもった装置を付加することにより、局所
的なデータ転送を独立に行うことができるので、システ
ム処理能力を向上できるという効果がある。
／接続の機能をもった装置を付加することにより、局所
的なデータ転送を独立に行うことができるので、システ
ム処理能力を向上できるという効果がある。
第１図は、本発明によるＧＰＩＢ制御装置の一実施例を
示すブロック図である。 第２図は、第１図のＧＰＩＢ制御装置の接続されたシス
テム例を示すブロック図である。 １１．１２−・・ＧＰ Ｉ Ｂ制御部 １３・・・ＧＰＩＢ接続／切離し部 １４．１５，２８．２９・・・ＧＰＩＢ２１〜２７・・
・装置 特許出願人 日本電気株式会社
示すブロック図である。 第２図は、第１図のＧＰＩＢ制御装置の接続されたシス
テム例を示すブロック図である。 １１．１２−・・ＧＰ Ｉ Ｂ制御部 １３・・・ＧＰＩＢ接続／切離し部 １４．１５，２８．２９・・・ＧＰＩＢ２１〜２７・・
・装置 特許出願人 日本電気株式会社
Claims (1)
- トーカ／リスナとして動作し、システムコントローラか
らのコマンドにより直列接続された一対のＧＰＩＢの接
続／切離しを制御するための第１のＧＰＩＢ制御部と、
前記第１のＧＰＩＢ制御部より制御され前記一対のＧＰ
ＩＢが接続されている状態では機能を停止し、前記一対
のＧＰＩＢが切離されている状態ではコントローラとし
て動作するための第２のＧＰＩＢ制御部と、前記第１お
よび第２のＧＰＩＢ制御部の制御の下で前記一対のＧＰ
ＩＢの接続／切離しを実行するためのＧＰＩＢ接続／切
離し部とを具備して構成したことを特徴とするＧＰＩＢ
制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63237906A JP2545950B2 (ja) | 1988-09-22 | 1988-09-22 | Ｇｐｉｂ制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63237906A JP2545950B2 (ja) | 1988-09-22 | 1988-09-22 | Ｇｐｉｂ制御装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0285949A true JPH0285949A (ja) | 1990-03-27 |
| JP2545950B2 JP2545950B2 (ja) | 1996-10-23 |
Family
ID=17022185
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63237906A Expired - Lifetime JP2545950B2 (ja) | 1988-09-22 | 1988-09-22 | Ｇｐｉｂ制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2545950B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH05145980A (ja) * | 1991-11-21 | 1993-06-11 | Nec Corp | データ伝送回路 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5533214A (en) * | 1978-08-31 | 1980-03-08 | Oki Electric Ind Co Ltd | Information processing system |
| JPS575140A (en) * | 1980-06-10 | 1982-01-11 | Toshiba Corp | Data processing system equipped with standard bus |
-
1988
- 1988-09-22 JP JP63237906A patent/JP2545950B2/ja not_active Expired - Lifetime
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5533214A (en) * | 1978-08-31 | 1980-03-08 | Oki Electric Ind Co Ltd | Information processing system |
| JPS575140A (en) * | 1980-06-10 | 1982-01-11 | Toshiba Corp | Data processing system equipped with standard bus |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH05145980A (ja) * | 1991-11-21 | 1993-06-11 | Nec Corp | データ伝送回路 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2545950B2 (ja) | 1996-10-23 |
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