JPH0286331A - Ｄ／ａ変換器 - Google Patents
Ｄ／ａ変換器Info
- Publication number
- JPH0286331A JPH0286331A JP23920588A JP23920588A JPH0286331A JP H0286331 A JPH0286331 A JP H0286331A JP 23920588 A JP23920588 A JP 23920588A JP 23920588 A JP23920588 A JP 23920588A JP H0286331 A JPH0286331 A JP H0286331A
- Authority
- JP
- Japan
- Prior art keywords
- converter
- output
- switch
- analog signal
- outputs
- Prior art date
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- Pending
Links
- 239000000872 buffer Substances 0.000 abstract description 7
- 238000006243 chemical reaction Methods 0.000 abstract 2
- 238000010586 diagram Methods 0.000 description 2
- 239000003795 chemical substances by application Substances 0.000 description 1
Landscapes
- Analogue/Digital Conversion (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、Ｄ／Ａ変換器に関し、特に複数のチャネル出
力を有するＤ／Ａ変換器に関する。
力を有するＤ／Ａ変換器に関する。
従来例について、第２図を参照して説明する。
第２図において、２１〜２３はディジタル入力、２４〜
２６は、Ｄ／Ａ変換器、２７〜２９は出力バッファ、３
０〜３２は出力である。
２６は、Ｄ／Ａ変換器、２７〜２９は出力バッファ、３
０〜３２は出力である。
ディジタル入力２１〜２３から入力したディジタル信号
は、Ｄ／Ａ変換器２４〜２６でＤ／Ａ変換され、出力バ
ッファ２７〜２９を経て、出力３０〜３２から出力され
る。
は、Ｄ／Ａ変換器２４〜２６でＤ／Ａ変換され、出力バ
ッファ２７〜２９を経て、出力３０〜３２から出力され
る。
上述した従来のＤ／Ａ変換器は、１つの出力に対して、
１つのＤ／Ａ変換器を必要とするので、複数個の出力を
得ようとすると、複数個のＤ／Ａ変換器を必要とし、ま
た、そのため面積が大きくなり、ＩＣ化に適さないとい
う欠点がある。
１つのＤ／Ａ変換器を必要とするので、複数個の出力を
得ようとすると、複数個のＤ／Ａ変換器を必要とし、ま
た、そのため面積が大きくなり、ＩＣ化に適さないとい
う欠点がある。
本発明の多チヤネル出力のＤ／Ａ変換器は、１個のＤ／
Ａ変換器とその出力に接続された複数個のスイッチと、
各々のスイッチに接続された複数個のサンプル＆ホール
ド回路と、１個のＤ／Ａ変換器及び複数個のスイッチを
制御する制御回路を有している。
Ａ変換器とその出力に接続された複数個のスイッチと、
各々のスイッチに接続された複数個のサンプル＆ホール
ド回路と、１個のＤ／Ａ変換器及び複数個のスイッチを
制御する制御回路を有している。
次に本発明について第１図を参照して説明する。
第１図において、１はディジタル入力、２はＤ／Ａ変換
器、３〜５はスイッチ、６〜８はサンプル長ホール１回
路、９〜１１は出力バッファ。
器、３〜５はスイッチ、６〜８はサンプル長ホール１回
路、９〜１１は出力バッファ。
１２〜１４は出力、１５は制御回路である。
ディジタル入力１から入力したディジタル信号は、制御
回路１５からの制御信号によりＤ／Ａ変換器２でＤ／Ａ
変換される。
回路１５からの制御信号によりＤ／Ａ変換器２でＤ／Ａ
変換される。
Ｄ／Ａ変換されたアナログ信号を出力１２から出力させ
たいとき、スイッチ３が制御回路１５からの制御信号に
より選択されオンし、サンプル長ホール１回路６により
サンプルされ、スイッチ３がオフしたとき、ホールドさ
れる。次に、スイッチ３が選択されオンする迄、出力バ
ッファ９を経て、出力１２から同じ出力が出力される。
たいとき、スイッチ３が制御回路１５からの制御信号に
より選択されオンし、サンプル長ホール１回路６により
サンプルされ、スイッチ３がオフしたとき、ホールドさ
れる。次に、スイッチ３が選択されオンする迄、出力バ
ッファ９を経て、出力１２から同じ出力が出力される。
Ｄ／Ａ変換されたアナログ信号を出力１３及び１４から
出力させたいときも同様である。
出力させたいときも同様である。
以上説明したように本発明は、１個のＤ／Ａ変換器とそ
の出力に接続された複数個のスイッチと、各々のスイッ
チに接続された複数個のサンプル長ホール１回路と、１
個のＤ／Ａ変換器及び複数個のスイッチを制御する制御
回路を有することにより、１個のＤ／Ａ変換器で複数個
の出力を得ることができるという効果があり、面積を小
さくできるのでＩＣ化にも適する。
の出力に接続された複数個のスイッチと、各々のスイッ
チに接続された複数個のサンプル長ホール１回路と、１
個のＤ／Ａ変換器及び複数個のスイッチを制御する制御
回路を有することにより、１個のＤ／Ａ変換器で複数個
の出力を得ることができるという効果があり、面積を小
さくできるのでＩＣ化にも適する。
第１図は本発明の一実施例のブロック図、第２図は従来
例ブロック図である。 １・・・・・・ディジタル入力、２・・・・・・Ｄ／Ａ
変換器、３．４．５・・・・・・スイッチ、６，７．８
・・・・・・サンプル長ホール１回路、９，１０．１１
・・・・・・出力バッファ、１２．１３．１４・・・・
・：出力、１５・・・・・・制御回路、２１，２２．２
３・・・・・・ディジタル入力、２４゜２５．２６・・
・・・・Ｄ／Ａ変換器、２７，２８．２９・・・・・・
出力バッファ、３０，３１．３２・・・・・・出力。 代理人 弁理士 内 原 晋 （ト″：へ＼→べく
例ブロック図である。 １・・・・・・ディジタル入力、２・・・・・・Ｄ／Ａ
変換器、３．４．５・・・・・・スイッチ、６，７．８
・・・・・・サンプル長ホール１回路、９，１０．１１
・・・・・・出力バッファ、１２．１３．１４・・・・
・：出力、１５・・・・・・制御回路、２１，２２．２
３・・・・・・ディジタル入力、２４゜２５．２６・・
・・・・Ｄ／Ａ変換器、２７，２８．２９・・・・・・
出力バッファ、３０，３１．３２・・・・・・出力。 代理人 弁理士 内 原 晋 （ト″：へ＼→べく
Claims (1)
- １個のＤ／Ａ変換器の出力に接続された複数個のスイッ
チと、前記複数個のスイッチの各々に接続された複数個
のサンプル・ホールド回路と、前記Ｄ／Ａ変換器と前記
複数個のスイッチを制御する制御回路とを有するＤ／Ａ
変換器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23920588A JPH0286331A (ja) | 1988-09-22 | 1988-09-22 | Ｄ／ａ変換器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23920588A JPH0286331A (ja) | 1988-09-22 | 1988-09-22 | Ｄ／ａ変換器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0286331A true JPH0286331A (ja) | 1990-03-27 |
Family
ID=17041298
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP23920588A Pending JPH0286331A (ja) | 1988-09-22 | 1988-09-22 | Ｄ／ａ変換器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0286331A (ja) |
-
1988
- 1988-09-22 JP JP23920588A patent/JPH0286331A/ja active Pending
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