JPH0325829B2 - - Google Patents
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- Publication number
- JPH0325829B2 JPH0325829B2 JP56032062A JP3206281A JPH0325829B2 JP H0325829 B2 JPH0325829 B2 JP H0325829B2 JP 56032062 A JP56032062 A JP 56032062A JP 3206281 A JP3206281 A JP 3206281A JP H0325829 B2 JPH0325829 B2 JP H0325829B2
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- JP
- Japan
- Prior art keywords
- data
- storage
- section
- shape
- intersection
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Description
【発明の詳細な説明】
本発明は輪郭制御用の図形データからラスタ用
の画素列データを生成する装置に関するものであ
る。
の画素列データを生成する装置に関するものであ
る。
輪郭制御用の図形データからラスタ用の画素列
データを生成することは同一出願人により出願さ
れた特願昭54−57268号の特許出願により開示さ
れた画素列データ生成装置で実現させることがで
きるが、該装置にはより効率よく高速に画素列デ
ータを生成するための手段が講じられていなかつ
た。
データを生成することは同一出願人により出願さ
れた特願昭54−57268号の特許出願により開示さ
れた画素列データ生成装置で実現させることがで
きるが、該装置にはより効率よく高速に画素列デ
ータを生成するための手段が講じられていなかつ
た。
本発明の目的はプリント配線板等の原画等通常
出現する図形を作画するための画素列データを効
率よく高速で生成する画素列データ生成装置を提
供することにある。
出現する図形を作画するための画素列データを効
率よく高速で生成する画素列データ生成装置を提
供することにある。
以下本発明について図に従つて詳細に説明す
る。図は本発明の１実施例を示す構成図である。
る。図は本発明の１実施例を示す構成図である。
副走査方向の生起順に整列された形状記述デー
タ（以下FDDという）群を記憶する第１の形状
記述データ記憶部（以下新規FDD記憶部という）
は第１新規FDD記憶部１と第２新規FDD記憶部
２の２つに分かれており、FDDは副走査方向の
生起順に交互に第１新規FDD記憶部１と第２新
規FDD記憶部２に記憶されている。
タ（以下FDDという）群を記憶する第１の形状
記述データ記憶部（以下新規FDD記憶部という）
は第１新規FDD記憶部１と第２新規FDD記憶部
２の２つに分かれており、FDDは副走査方向の
生起順に交互に第１新規FDD記憶部１と第２新
規FDD記憶部２に記憶されている。
第１交点データ生成部３には第１新規FDD記
憶部１と継続的処理過程にあるFDD群を記憶す
る第２の形状記述データ記憶部（以下継続FDD
記憶部という）６からのFDDが送られる。第１
交点データ生成部３ではFDDのモードデータに
従い検索モードの場合には、登録形状とラスタと
の交点の相対位置を示す登録形状データ（以下
RFD）群を記憶する第１登録形状データ記憶部
４のRFDを参照し、演算モードの場合には内部
演算により交点データを生成する。
憶部１と継続的処理過程にあるFDD群を記憶す
る第２の形状記述データ記憶部（以下継続FDD
記憶部という）６からのFDDが送られる。第１
交点データ生成部３ではFDDのモードデータに
従い検索モードの場合には、登録形状とラスタと
の交点の相対位置を示す登録形状データ（以下
RFD）群を記憶する第１登録形状データ記憶部
４のRFDを参照し、演算モードの場合には内部
演算により交点データを生成する。
第１交点データ生成部３で交点データが１つ生
成されると、前記第１の形状記述データ記憶部と
第２の形状記述データ記憶部６を制御する記憶制
御部５に信号３ｃを送り、第１新規FDD記憶部
１から次のFDDの読出しが行われる。
成されると、前記第１の形状記述データ記憶部と
第２の形状記述データ記憶部６を制御する記憶制
御部５に信号３ｃを送り、第１新規FDD記憶部
１から次のFDDの読出しが行われる。
第１記憶選択部８は交点データを受けて画素列
データを発生し、第１画素列データ記憶部９の交
点データで指定された範囲の画素に図形が存在す
ることを示す信号を第１画素列データ記憶部９に
記憶させる。
データを発生し、第１画素列データ記憶部９の交
点データで指定された範囲の画素に図形が存在す
ることを示す信号を第１画素列データ記憶部９に
記憶させる。
次にラスタ１本分の画素列データが第１画素列
データ記憶部９に生成されると１ラスタ生成終了
信号８ａが出力され、記憶制御部５は新たなラス
タのためのFDDの読出し制御を行う。
データ記憶部９に生成されると１ラスタ生成終了
信号８ａが出力され、記憶制御部５は新たなラス
タのためのFDDの読出し制御を行う。
第１継続判定部７は交点データ生成部３から
FDD中の副走査方向のライン数のデータ信号３
ａを受けとりその値によつて次に続くラスタと交
差するか否かを判定し、交差すると判定した時は
継続形状記述データパイプライン記憶部１１に信
号を出し、第１交点データ生成部３からのFDD
を受けとらせる。継続形状記述データパイプライ
ン記憶部１１は第２交点データ生成部１２へ順次
FDDを送る。一方前記１ラスタ生成終了信号８
ａを受けた記憶制御部５は第２新規FDD記憶部
２を制御して第２交点データ生成部１２へFDD
を送る。
FDD中の副走査方向のライン数のデータ信号３
ａを受けとりその値によつて次に続くラスタと交
差するか否かを判定し、交差すると判定した時は
継続形状記述データパイプライン記憶部１１に信
号を出し、第１交点データ生成部３からのFDD
を受けとらせる。継続形状記述データパイプライ
ン記憶部１１は第２交点データ生成部１２へ順次
FDDを送る。一方前記１ラスタ生成終了信号８
ａを受けた記憶制御部５は第２新規FDD記憶部
２を制御して第２交点データ生成部１２へFDD
を送る。
以下第２交点データ生成部１２、第２登録形状
データ記憶部１３、第２記憶選択部１５第２画素
列データ記憶部１６の動作はそれぞれ第１交点デ
ータ生成部３、第１登録形状データ記憶部４第１
記憶選択部８、第１画素列データ記憶部９と同様
である。１２ｃは第２交点データ生成部１２で交
点データか１つ生成されると、記憶制御部５に出
力される信号を示す。
データ記憶部１３、第２記憶選択部１５第２画素
列データ記憶部１６の動作はそれぞれ第１交点デ
ータ生成部３、第１登録形状データ記憶部４第１
記憶選択部８、第１画素列データ記憶部９と同様
である。１２ｃは第２交点データ生成部１２で交
点データか１つ生成されると、記憶制御部５に出
力される信号を示す。
第２継続判定部１４は第２交点データ生成部１
２のFDD中の副走査方向のライン数のデータ信
号１２ａを受けとり、次に続くラスタと交差する
か否かを判定し、交差すると判定した時は記憶制
御部５に信号を出して継続FDD記憶部６に第２
交点データ生成部１２のFDDを記憶させる。
２のFDD中の副走査方向のライン数のデータ信
号１２ａを受けとり、次に続くラスタと交差する
か否かを判定し、交差すると判定した時は記憶制
御部５に信号を出して継続FDD記憶部６に第２
交点データ生成部１２のFDDを記憶させる。
第１画素列データ記憶部９と第２画素列データ
記憶部１６に生成された画素列データは副走査方
向のラスタ順に画素列データ選択部１０で選択さ
れ、画素列データは後続の供給部１７を通して処
理機械に出力される。
記憶部１６に生成された画素列データは副走査方
向のラスタ順に画素列データ選択部１０で選択さ
れ、画素列データは後続の供給部１７を通して処
理機械に出力される。
以上説明したように本発明の如く構成すればプ
リント配線板の原画等を作画するためのラスタ用
画素列データを効率よく、高速で生成することが
できる。
リント配線板の原画等を作画するためのラスタ用
画素列データを効率よく、高速で生成することが
できる。
尚本実施例では、ラスタデータ展開部が２段の
場合について説明したが、本発明でラスタデータ
展開部が２段に限定されるものではない。
場合について説明したが、本発明でラスタデータ
展開部が２段に限定されるものではない。
図は本発明の１実施例を示す構成図である。図
において３は第１交点データ生成部、４は第１登
録形状データ記憶部、５は記憶制御部、７は第１
継続判定部、８は記憶選択部、９は第１画素列デ
ータ記憶部、１１は継続形状記述データパイプラ
イン記憶部、１２は第２交点データ生成部、１３
は第２登録形状データ記憶部、１４は第２継続判
定部、１５は記憶選択部、１６は第２画素列デー
タ記憶部である。
において３は第１交点データ生成部、４は第１登
録形状データ記憶部、５は記憶制御部、７は第１
継続判定部、８は記憶選択部、９は第１画素列デ
ータ記憶部、１１は継続形状記述データパイプラ
イン記憶部、１２は第２交点データ生成部、１３
は第２登録形状データ記憶部、１４は第２継続判
定部、１５は記憶選択部、１６は第２画素列デー
タ記憶部である。
Claims (1)
- １ 副走査方向の生起順に整列された形状記述デ
ータ群を記憶する第１の形状記述データ記憶部
と、継続的な処理過程にある前記形状記述データ
群を記憶する第２の形状記述データ記憶部と、該
２つの記憶部を制御する記憶制御部と、登録形状
とラスタとの交点の相対位置を示す登録形状デー
タ群を記憶する登録形状データ記憶部と、前記形
状記述データとラスタとの絶対位置を示す交点デ
ータを生成する交点データ生成部と、該形状が次
に続くラスタと交差するか否かの判定を行う継続
判定部と、ラスタ１本分の画素列データを記憶す
る画素列データ記憶部と、前記交点データから画
素列データを発生し前記画素列データ記憶部に記
憶せしめる記憶選択部とを備えた画素列データ生
成装置において、高速パイプライン処理のための
継続形状記述データパイプライン記憶部と、前記
登録形状データ記憶部と交点データ生成部と記憶
選択部と画素列データ記憶部と継続判定部を含む
ラスタデータ展開部を複数個備えたことを特徴と
する高速画素列データ生成装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56032062A JPS57146291A (en) | 1981-03-06 | 1981-03-06 | Quick pixel train data producer |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56032062A JPS57146291A (en) | 1981-03-06 | 1981-03-06 | Quick pixel train data producer |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS57146291A JPS57146291A (en) | 1982-09-09 |
| JPH0325829B2 true JPH0325829B2 (ja) | 1991-04-09 |
Family
ID=12348386
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56032062A Granted JPS57146291A (en) | 1981-03-06 | 1981-03-06 | Quick pixel train data producer |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS57146291A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US9109326B2 (en) | 2007-11-30 | 2015-08-18 | Kaneka Corporation | Antibacterial artificial hair and antibacterial coating agent for artificial hair |
-
1981
- 1981-03-06 JP JP56032062A patent/JPS57146291A/ja active Granted
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US9109326B2 (en) | 2007-11-30 | 2015-08-18 | Kaneka Corporation | Antibacterial artificial hair and antibacterial coating agent for artificial hair |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS57146291A (en) | 1982-09-09 |
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