JPH03280741A - クロック抽出回路 - Google Patents
クロック抽出回路Info
- Publication number
- JPH03280741A JPH03280741A JP2082638A JP8263890A JPH03280741A JP H03280741 A JPH03280741 A JP H03280741A JP 2082638 A JP2082638 A JP 2082638A JP 8263890 A JP8263890 A JP 8263890A JP H03280741 A JPH03280741 A JP H03280741A
- Authority
- JP
- Japan
- Prior art keywords
- frequency
- circuit
- signal
- comparator
- clock
- Prior art date
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- Pending
Links
- 238000000605 extraction Methods 0.000 title claims description 11
- 239000000284 extract Substances 0.000 claims description 3
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 230000001629 suppression Effects 0.000 description 1
- 230000001360 synchronised effect Effects 0.000 description 1
Landscapes
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はクロック抽出回路に関し、特に周波数信号源に
同期化する装置において受信信号からクロック成分を抽
出するクロック抽出回路に関する。
同期化する装置において受信信号からクロック成分を抽
出するクロック抽出回路に関する。
従来この種のクロック抽出回路は、ある特定の周波数信
号源からクロック成分を抽出するための専用回路として
作成されている。
号源からクロック成分を抽出するための専用回路として
作成されている。
上述した従来のクロック抽出回路は、周波数信号源ごと
に専用のクロック抽出回路であるため、信号源の周波数
が異なければ同一の回路は使用できず、新たに別の専用
回路を作成しなければならないので、汎用性がないとい
う欠点がある。
に専用のクロック抽出回路であるため、信号源の周波数
が異なければ同一の回路は使用できず、新たに別の専用
回路を作成しなければならないので、汎用性がないとい
う欠点がある。
本発明のクロック抽出回路は、任意の周波数信号源から
の信号を一方の入力とする比較器と前記比較器の出力信
号の周波数に対応して分周比を変更できる可変分周器と
からなり前記可変分周器の出力信号を前記比較器の他方
の入力とするディジタルPLL回路と、前記比較器の出
力信号を分周する固定分周器と、この固定分周器の出力
信号からクロックを抽出して出力する同調器とを備える
ことを特徴どする。
の信号を一方の入力とする比較器と前記比較器の出力信
号の周波数に対応して分周比を変更できる可変分周器と
からなり前記可変分周器の出力信号を前記比較器の他方
の入力とするディジタルPLL回路と、前記比較器の出
力信号を分周する固定分周器と、この固定分周器の出力
信号からクロックを抽出して出力する同調器とを備える
ことを特徴どする。
次に本発明について図面を参照して説明する。
第1図は本発明のクロック抽出回路の一実施例を示すブ
ロック図である。
ロック図である。
第1図において、まず受信l−た周波数信号源〕、から
の入力信号をディジタルP L I−回路2内の比較器
2]の一方の入力どし、位相同期をかける。
の入力信号をディジタルP L I−回路2内の比較器
2]の一方の入力どし、位相同期をかける。
ここで、ディジタルP1、L回路2内の可変分周器22
は入力信号周波数に対応j−て分周比を変更できるもの
どL 、、その出力を比較器21の他方の入力とする。
は入力信号周波数に対応j−て分周比を変更できるもの
どL 、、その出力を比較器21の他方の入力とする。
このP 1.、、 I−回路2では、特定の周波数に限
定する3:となく任意の周波数に位相同期をかけること
ができる。
定する3:となく任意の周波数に位相同期をかけること
ができる。
位相同期化された比較器21の出力信号はディジタルP
L L回路2を制御するマスタクロック5の周波数f
Oに依存するジッタ(位相変動〉が発生ずるので、通常
ごの信号を基準として装置を同期化するのは色々と支障
が出る。そこで本実施例では、比較器21の出力信号(
周波数f。/2)を固定分周器うに入力1−て勿周1−
1さらにこの分周された信号を同調器・1によ−)てジ
・ンタの抑圧を行ってクロックとして抽出する。なお、
固定分周器3の分周比は、通常、同調器4の実現性を容
易とするような値を選ぶ8 〔発明の効果〕 以上説明したよつに本発明のタロツク抽出回路によれば
、任意の周波数信号源からの信号を位相同期化し、かつ
同調器により安定Lノ、=クロックを抽出できるので、
回路の汎用性が高くなる効果がある。
L L回路2を制御するマスタクロック5の周波数f
Oに依存するジッタ(位相変動〉が発生ずるので、通常
ごの信号を基準として装置を同期化するのは色々と支障
が出る。そこで本実施例では、比較器21の出力信号(
周波数f。/2)を固定分周器うに入力1−て勿周1−
1さらにこの分周された信号を同調器・1によ−)てジ
・ンタの抑圧を行ってクロックとして抽出する。なお、
固定分周器3の分周比は、通常、同調器4の実現性を容
易とするような値を選ぶ8 〔発明の効果〕 以上説明したよつに本発明のタロツク抽出回路によれば
、任意の周波数信号源からの信号を位相同期化し、かつ
同調器により安定Lノ、=クロックを抽出できるので、
回路の汎用性が高くなる効果がある。
第1図は本発明のクロック抽出回路の一実施例を示すブ
ロック図である。 ]・・・周波数信号源、2・・・ディジタルPLL回路
43・・・固定分周器、4・・・同調器、5・・・マス
タクロ・ツク、2]・・・比較器、22・・・可変分周
器。
ロック図である。 ]・・・周波数信号源、2・・・ディジタルPLL回路
43・・・固定分周器、4・・・同調器、5・・・マス
タクロ・ツク、2]・・・比較器、22・・・可変分周
器。
Claims (1)
- 任意の周波数信号源からの信号を一方の入力とする比較
器と前記比較器の出力信号の周波数に対応して分周比を
変更できる可変分周器とからなり前記可変分周器の出力
信号を前記比較器の他方の入力とするディジタルPLL
回路と、前記比較器の出力信号を分周する固定分周器と
、この固定分周器の出力信号からクロックを抽出して出
力する同調器とを備えることを特徴とするクロック抽出
回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2082638A JPH03280741A (ja) | 1990-03-29 | 1990-03-29 | クロック抽出回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2082638A JPH03280741A (ja) | 1990-03-29 | 1990-03-29 | クロック抽出回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03280741A true JPH03280741A (ja) | 1991-12-11 |
Family
ID=13779974
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2082638A Pending JPH03280741A (ja) | 1990-03-29 | 1990-03-29 | クロック抽出回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03280741A (ja) |
-
1990
- 1990-03-29 JP JP2082638A patent/JPH03280741A/ja active Pending
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