JPH0342507B2 - - Google Patents

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JPH0342507B2
JPH0342507B2 JP58175794A JP17579483A JPH0342507B2 JP H0342507 B2 JPH0342507 B2 JP H0342507B2 JP 58175794 A JP58175794 A JP 58175794A JP 17579483 A JP17579483 A JP 17579483A JP H0342507 B2 JPH0342507 B2 JP H0342507B2
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JP
Japan
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insulating film
semiconductor wafer
semiconductor
metal layer
forming
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JP58175794A
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JPS6066830A (ja
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Classifications

    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10PGENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P54/00Cutting or separating of wafers, substrates or parts of devices

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  • Dicing (AREA)

Description

【発明の詳細な説明】技術分野 この発明は半導体装置の製造方法に関し、より
詳しくは半導体ウエーハから多数の半導体ペレツ
トを製造する方法に関する。背景技術 トランジスタ、ダイオード等の半導体装置を製
造する場合、第1図に示すように、一枚の半導体
ウエーハ1に多数の半導体素子2を形成し、表裏
面に金属層3,4を形成したのち、各半導体素子
2,2間を切断分離して、多数の半導体ペレツト
を製造する工程を経て製造する。こゝで、表面の
金属層3は各半導体素子2毎に独立しているが、
裏面の金属層4は一様に形成されており連続して
いることが多い。また、各半導体素子2,2間を
切断する場合、一般にダイシング法によることが
多い。ところが、裏面の金属層4が銀等の軟質の
ものである場合、ダイシングソウで完全カツトし
ようとすると、軟質の銀がダイシングブレードに
目詰りして、ダイシングが不可能になる。このた
め、第2図に示すように、半導体ウエーハ1の裏
面に接着テープ5を貼り付け、半導体ウエーハ1
の表面から所定の残り代tを設けてダイシング溝
6を形成した後、半導体ウエーハ1に撓屈力を作
用させて、第3図に示すように、前記ダイシング
溝6部分から破断7するブレーキング工程を経
て、多数の半導体ペレツトを製造している。しか
しながら、半導体素子2の寸法が1mm□以下の小
型のものでは、半導体ウエーハ1に大きな撓屈力
を作用させることができないこと、および裏面の
金属層4が軟質であるために、確実にブレーキン
グが行なえず、複数個の半導体ペレツトが金属層
4で連結状態になつた、いわゆるアベツク不良が
発生しやすかつた。
そこで、半導体ウエーハのスクライブラインに
沿つて絶縁膜を形成し、その上から全面に半田層
を形成した後、半田層を加熱溶融して溶融半田の
凝集力でもつて絶縁膜上の半田層を不連続状態と
し、次いで絶縁膜を溶解除去する薬品に浸漬し
て、絶縁膜をその上の半田層とともに除去する方
法が提案されている(特開昭51−58862号公報)。
しかしながら、この方法によると、絶縁膜の薬
品による溶解除去が必要であるのみならず、薬品
の洗浄除去および乾燥工程が必要で工程が煩雑に
なるという問題点があつた。発明の開示 〔目的〕 この発明は、半導体素子の寸法が小さくかつ裏
面の金属層が銀等の軟質材料よりなる場合であつ
ても前述のように絶縁膜を除去することなく、ア
ベツク不良を生じない半導体装置の製造方法を提
供することを目的とする。
〔構成〕
この発明は、半導体ウエーハに多数の半導体素
子を形成する工程と、半導体ウエーハの裏面の各
半導体素子間に対応する位置に絶縁膜を形成する
工程と、半導体ウエーハの裏面全面に軟質金属層
を形成する工程と、半導体ウエーハの裏面に接着
テープを貼り付けたのち剥離することにより、金
属層の半導体材料と絶縁膜への接着力の差を利用
して絶縁膜上の金属層を除去し、絶縁膜形成部分
以外に軟質金属層を形成する工程と、半導体ウエ
ーハを前記絶縁膜に対応する位置からダイシング
する工程とを含むことを特徴とするものである。
〔効果〕
この発明は、半導体ウエーハの裏面のダイシン
グ対応位置に硬質の絶縁膜を有するから、半導体
ウエーハをハーフカツトしてブレーキングする場
合に、前記絶縁膜が確実に破断するし、半導体ウ
エーハをダイシング法で完全カツトしても、ダイ
シングブレードの目詰りを生じることなく確実に
ダイシングできる。しかも、絶縁膜を薬品によつ
て溶解除去しないので、その後の洗浄や乾燥を省
略することも可能で製造する容易になるのみなら
ず、資材費や用力費等が節減できて、原価低減が
図れる。さらに、絶縁膜を残存されることによつ
て、この絶縁膜を積極的に利用して、半導体ペレ
ツトとリードフレームやステム等の放熱板との間
に、容易にヒートサイクルに強い最適な半田圧を
確保することができる。発明を実施するための最良の形態 以下に、この発明の実施例を図面を参照して説
明する。
第4図ないし第9図はこの発明による方法の各
段階における半導体ウエーハの断面図を示す。
まず、N+N-半導体ウエーハ1を用意し、表裏
両面に酸化膜等の絶縁膜8,9を形成し、表面側
の絶縁膜8のみに窓孔を形成し、N-型領域内に
P型不純物を選択拡散してP型領域を形成するこ
とにより、多数の半導体素子2を形成する(第4
図)。
次に、周知のフオトエツチング法によつて、表
面側の絶縁膜8にオーミツク接触用の窓孔10を
形成するとともに、裏面の絶縁膜9を前記各半導
体素子2,2間に対応する位置のみに残す(第5
図)。
続いて、表面の絶縁膜8上および窓孔10を含
む全面に金を蒸着して金属層3を形成するととも
に、裏面の絶縁膜9上を含む全面に、金を蒸着し
て金層4aを形成し、さらにこの金層4a上に銀
を蒸着して銀層4bを積層することによつて金属
層4を形成する(第6図)。
次に半導体ウエーハ1の表裏両面に接着テープ
を貼り付けたのち剥離することにより、金属層3
および金属4aのシリコンと絶縁膜8,9上の接
着力の差を利用して、絶縁膜8,9上の金属層3
および金層4aを剥離除去し、絶縁膜8の窓孔1
0および絶縁膜9,9間部分に、金属層3および
4を形成する(第7図)。
さらに、半導体ウエーハ1の裏面に接着テープ
5を貼り付けて、表面側から各半導体素子2,2
間部分をダイシングして、残り代が60〜80μ程度
のダイシング溝6を形成する(第8図)。
この半導体ウエーハ1を下側にしてゴム板等の
上に載せ、接着テープ5の上から鋼製ローラ(図
示せず)を転動させて、半導体ウエーハ1に撓屈
力を作用せしめ、ダイシング溝6の底部から裏面
の絶縁膜9にかけて破断11を生じさせて、各半
導体素子2毎に分離する(第9図)。
上記の製造方法にしたがえば、ダイシング溝6
に対応する裏面に、硬質の絶縁膜9が形成されて
いるので、ブレーキング時に絶縁膜9が容易かつ
確実に破断し、アベツク不良は発生しない。
なお、上記実施例は半導体ウエーハ1を所定の
残り代を設けてハーフカツトしたのちブレーキン
グする場合について説明したが、絶縁膜9部分を
含んで完全カツトするようにしてもよい。この場
合、絶縁膜9が硬質なので、ダイシングソウが目
詰りするとなく、容易かつ確実に完全カツトでき
る。
【図面の簡単な説明】
第1図ないし第3図は従来方法について説明す
るための各段階の半導体ウエーハの断面図であ
る。第4図ないし第9図はこの発明による方法に
ついて説明するための各段階の半導体ウエーハの
断面図である。 1……半導体ウエーハ、2……半導体素子、
3,4……金属層、5……接着テープ、6……ダ
イシング溝、8,9……絶縁膜、11……破断
部。

Claims (1)

  1. 【特許請求の範囲】 1 半導体ウエーハに多数の半導体素子を形成す
    る工程と、 半導体ウエーハの裏面の各半導体素子間に対応
    する位置に絶縁膜を形成する工程と、 半導体ウエーハの裏面全面に軟質金属層を形成
    する工程と、 半導体ウエーハの裏面に接着テープを貼り付け
    たのち剥離することにより、前記軟質金属層の半
    導体材料に対する接着力と前記絶縁膜に対する接
    着力との差を利用して、絶縁膜上の軟質金属層を
    除去し、絶縁膜形成部分以外に軟質金属層を形成
    する工程と、 前記絶縁膜に対応する位置から半導体ウエーハ
    をダイシングする工程とを含む半導体装置の製造
    方法。
JP58175794A 1983-09-22 1983-09-22 半導体装置の製造方法 Granted JPS6066830A (ja)

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Application Number Priority Date Filing Date Title
JP58175794A JPS6066830A (ja) 1983-09-22 1983-09-22 半導体装置の製造方法

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JP58175794A JPS6066830A (ja) 1983-09-22 1983-09-22 半導体装置の製造方法

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JPS6066830A JPS6066830A (ja) 1985-04-17
JPH0342507B2 true JPH0342507B2 (ja) 1991-06-27

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ID=16002360

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JP58175794A Granted JPS6066830A (ja) 1983-09-22 1983-09-22 半導体装置の製造方法

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Families Citing this family (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2932278B2 (ja) * 1989-02-23 1999-08-09 日本インター株式会社 半導体装置の製造方法
DE102011112659B4 (de) * 2011-09-06 2022-01-27 Vishay Semiconductor Gmbh Oberflächenmontierbares elektronisches Bauelement

Family Cites Families (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5158862A (en) * 1974-11-19 1976-05-22 Matsushita Electronics Corp Handotaisoshino bunkatsuho
JPS5386570A (en) * 1977-01-10 1978-07-31 Mitsubishi Electric Corp Production of semiconductor device

Also Published As

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JPS6066830A (ja) 1985-04-17

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