JPH0413076B2 - - Google Patents
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- JPH0413076B2 JPH0413076B2 JP9608985A JP9608985A JPH0413076B2 JP H0413076 B2 JPH0413076 B2 JP H0413076B2 JP 9608985 A JP9608985 A JP 9608985A JP 9608985 A JP9608985 A JP 9608985A JP H0413076 B2 JPH0413076 B2 JP H0413076B2
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- welding
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- 238000003466 welding Methods 0.000 claims description 110
- 238000010586 diagram Methods 0.000 description 7
- 238000003079 width control Methods 0.000 description 7
- 238000001514 detection method Methods 0.000 description 3
- 239000004020 conductor Substances 0.000 description 1
- 230000007547 defect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000006870 function Effects 0.000 description 1
- 239000000463 material Substances 0.000 description 1
- 230000004044 response Effects 0.000 description 1
- 238000004904 shortening Methods 0.000 description 1
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- Arc Welding Control (AREA)
- Generation Of Surge Voltage And Current (AREA)
Description
（産業上の利用分野）
本発明は、溶接電流を種々の設定値に制御する
抵抗溶接機の電流制御装置に関する。 （従来の技術） 従来、交流電源を整流回路及び波回路を介し
てトランジスタから成るインバータに接続すると
共に該インバータを溶接変圧器及び整流回路を介
して溶接電極に接続し、インバータの入力回路に
流れる溶接電流の実効値が電流設定器で設定した
実効値に達した時インバータのトランジスタのベ
ースに加わる電流をオフにし、インバータを不作
動にして溶接電流の実効値を設定値に制御する装
置が提案されている。 このものにおいて、大容量の溶接変圧器Ｆを用
いた時の電流設定器の設定値と実際に流れる溶接
電流値は、予め測定した第１図の特性Ｆを用いる
ことにより対応させることができるが、溶接ガン
の２次導体を短くしたり、溶接すべきワークの枚
数を少なくしたりあるいは厚さを薄くしてそれに
応じて容量の小さな溶接変圧器Ａを用いた場合に
は対応させることができず、第１図の特性Ａのよ
うになる。 そこで、溶接変圧器として、容量の異なるもの
を用いた時には、その都度インバータのトランジ
スタのベース回路に介入した可変抵抗器を調整
し、電流設定器の設定値と実際に流れる溶接電流
値が対応するようにしていた。 したがつて、容量の異なる溶接変圧器にしばし
ば取り替える場合、調整に時間がかかつて直ちに
使用できず、また調整ミスにより溶接不良が生じ
る等の不都合が存した。 （発明が解決しようとする問題点） 本発明は、従来のかかる不都合の無い抵抗溶接
機の電流制御装置を得ることをその目的としたも
のである。 （問題点を解決するための手段） 本発明は、溶接変圧器と、該溶接変圧器の１次
コイルに接続され且つ溶接電流設定器による設定
値に対応する制御信号により溶接電流を所定値に
制御するインバータを備える抵抗溶接機の電流制
御装置において、該制御信号の補正装置を備え、
該補正装置は、使用する溶接変圧器の容量に対応
する設定信号を出力する溶接変圧器容量設定器
と、溶接変圧器の複数の容量に各対応する補正定
数を記憶するメモリと、該溶接電流設定器におい
て設定された溶接電流値と該メモリから読み出さ
れた前記溶接変圧器容量設定器において設定され
た溶接変圧器の容量に対応する補正定数とから溶
接回路に流れる前記設定値の溶接電流に対応する
制御信号値を算出する演算器とから成り、該演算
器から出力する制御信号をインバータに供給する
ようにしたことを特徴とする。 （作用） 本発明の構成によれば、溶接電流設定器におい
て溶接電流の設定値に設定すると共に使用した溶
接変圧器の容量設定器においてその変圧器の容量
を設定すると、メモリから使用した変圧器の容量
に対応する補正定数が読み出され、演算器におい
て溶接電流設定値と補正定数とから補正された制
御信号値が算出され、この演算器から出力する補
正された制御信号がインバータに加わることによ
り溶接電流設定器において設定した設定値の溶接
電流が溶接回路に流れる。 （実施例） 本発明の実施例を図面につき説明する。 第２図において、１は溶接変圧器で、該溶接変
圧器１の１次コイルはトランジスタ２1，２2，２
３，２4から成るインバータ２と波回路３と整流
回路４を介して交流電源端子５に接続し、２次コ
イルは整流回路６を介して溶接電極７に接続し
た。該トランジスタ２1，２2，２3，２4のベース
はベースドライブ回路８を介して発振器９のクロ
ツクパルスにより付勢されるパルス幅制御回路１
０に接続し、ホールセンサ等の電流検出器１１か
ら得られた溶接電流の実効値を検出する電流検出
回路１２の出力が電流設定器１３により設定され
た溶接電流値に達するまでトランジスタ２1，２
２，２3，２4のベースに電流を加え、超過した時
はトランジスタ２1，２2，２3，２4をオフにし、
設定値の溶接電流が流れるようにした。 以上は先に提案したものと特に異ならない。 本発明によれば、溶接電流設定器１３と、使用
する溶接変圧器の容量を設定すると該容量に対応
する設定信号を出力する溶接変圧器容量設定器１
４と、溶接変圧器の複数の容量に各対応する補正
定数を記憶するメモリ１５と、溶接電流設定器１
３において設定された溶接電流値とメモリ１５か
ら読み出された設定器１４において設定された使
用した溶接変圧器１の容量に対応する補正定数と
から溶接電流設定値に対応する制御信号値を算出
する演算器としてのCPU１６とから成る制御信
号の補正装置を備え、CPU１６から出力する制
御信号をＤ／Ａ変換器１７を介してパルス幅制御
回路１０に加え、かくて溶接電流設定器１３及び
容量設定器１４の設定によれば容量の異なる溶接
変圧器１に取り替えた時も溶接電流設定値に対応
した溶接電流が溶接回路に流れるようにした。 前記メモリ１５の記憶内容について更に説明す
ると、各種容量の溶接変圧器を使用した場合、そ
れぞれの容量の溶接変圧器１における溶接電流設
定器１３で設定された溶接設定値Ｉとこの設定値
の溶接電流が実際に溶接回路に流れるときのＤ／
Ａ変換器１７の出力値Ｓ（制御信号値）との間に
は、例えば第３図示のような関係にあり、次式で
表わされる。 Ｓ＝KI＋Ｖ 但し、Ｋ、Ｖは補正定数 次式は各種容量の溶接変圧器の補正定数の１例
を示す。
抵抗溶接機の電流制御装置に関する。 （従来の技術） 従来、交流電源を整流回路及び波回路を介し
てトランジスタから成るインバータに接続すると
共に該インバータを溶接変圧器及び整流回路を介
して溶接電極に接続し、インバータの入力回路に
流れる溶接電流の実効値が電流設定器で設定した
実効値に達した時インバータのトランジスタのベ
ースに加わる電流をオフにし、インバータを不作
動にして溶接電流の実効値を設定値に制御する装
置が提案されている。 このものにおいて、大容量の溶接変圧器Ｆを用
いた時の電流設定器の設定値と実際に流れる溶接
電流値は、予め測定した第１図の特性Ｆを用いる
ことにより対応させることができるが、溶接ガン
の２次導体を短くしたり、溶接すべきワークの枚
数を少なくしたりあるいは厚さを薄くしてそれに
応じて容量の小さな溶接変圧器Ａを用いた場合に
は対応させることができず、第１図の特性Ａのよ
うになる。 そこで、溶接変圧器として、容量の異なるもの
を用いた時には、その都度インバータのトランジ
スタのベース回路に介入した可変抵抗器を調整
し、電流設定器の設定値と実際に流れる溶接電流
値が対応するようにしていた。 したがつて、容量の異なる溶接変圧器にしばし
ば取り替える場合、調整に時間がかかつて直ちに
使用できず、また調整ミスにより溶接不良が生じ
る等の不都合が存した。 （発明が解決しようとする問題点） 本発明は、従来のかかる不都合の無い抵抗溶接
機の電流制御装置を得ることをその目的としたも
のである。 （問題点を解決するための手段） 本発明は、溶接変圧器と、該溶接変圧器の１次
コイルに接続され且つ溶接電流設定器による設定
値に対応する制御信号により溶接電流を所定値に
制御するインバータを備える抵抗溶接機の電流制
御装置において、該制御信号の補正装置を備え、
該補正装置は、使用する溶接変圧器の容量に対応
する設定信号を出力する溶接変圧器容量設定器
と、溶接変圧器の複数の容量に各対応する補正定
数を記憶するメモリと、該溶接電流設定器におい
て設定された溶接電流値と該メモリから読み出さ
れた前記溶接変圧器容量設定器において設定され
た溶接変圧器の容量に対応する補正定数とから溶
接回路に流れる前記設定値の溶接電流に対応する
制御信号値を算出する演算器とから成り、該演算
器から出力する制御信号をインバータに供給する
ようにしたことを特徴とする。 （作用） 本発明の構成によれば、溶接電流設定器におい
て溶接電流の設定値に設定すると共に使用した溶
接変圧器の容量設定器においてその変圧器の容量
を設定すると、メモリから使用した変圧器の容量
に対応する補正定数が読み出され、演算器におい
て溶接電流設定値と補正定数とから補正された制
御信号値が算出され、この演算器から出力する補
正された制御信号がインバータに加わることによ
り溶接電流設定器において設定した設定値の溶接
電流が溶接回路に流れる。 （実施例） 本発明の実施例を図面につき説明する。 第２図において、１は溶接変圧器で、該溶接変
圧器１の１次コイルはトランジスタ２1，２2，２
３，２4から成るインバータ２と波回路３と整流
回路４を介して交流電源端子５に接続し、２次コ
イルは整流回路６を介して溶接電極７に接続し
た。該トランジスタ２1，２2，２3，２4のベース
はベースドライブ回路８を介して発振器９のクロ
ツクパルスにより付勢されるパルス幅制御回路１
０に接続し、ホールセンサ等の電流検出器１１か
ら得られた溶接電流の実効値を検出する電流検出
回路１２の出力が電流設定器１３により設定され
た溶接電流値に達するまでトランジスタ２1，２
２，２3，２4のベースに電流を加え、超過した時
はトランジスタ２1，２2，２3，２4をオフにし、
設定値の溶接電流が流れるようにした。 以上は先に提案したものと特に異ならない。 本発明によれば、溶接電流設定器１３と、使用
する溶接変圧器の容量を設定すると該容量に対応
する設定信号を出力する溶接変圧器容量設定器１
４と、溶接変圧器の複数の容量に各対応する補正
定数を記憶するメモリ１５と、溶接電流設定器１
３において設定された溶接電流値とメモリ１５か
ら読み出された設定器１４において設定された使
用した溶接変圧器１の容量に対応する補正定数と
から溶接電流設定値に対応する制御信号値を算出
する演算器としてのCPU１６とから成る制御信
号の補正装置を備え、CPU１６から出力する制
御信号をＤ／Ａ変換器１７を介してパルス幅制御
回路１０に加え、かくて溶接電流設定器１３及び
容量設定器１４の設定によれば容量の異なる溶接
変圧器１に取り替えた時も溶接電流設定値に対応
した溶接電流が溶接回路に流れるようにした。 前記メモリ１５の記憶内容について更に説明す
ると、各種容量の溶接変圧器を使用した場合、そ
れぞれの容量の溶接変圧器１における溶接電流設
定器１３で設定された溶接設定値Ｉとこの設定値
の溶接電流が実際に溶接回路に流れるときのＤ／
Ａ変換器１７の出力値Ｓ（制御信号値）との間に
は、例えば第３図示のような関係にあり、次式で
表わされる。 Ｓ＝KI＋Ｖ 但し、Ｋ、Ｖは補正定数 次式は各種容量の溶接変圧器の補正定数の１例
を示す。
【表】
第２図において、１８はインターフエースであ
る。 第４図は前記パルス幅制御回路１０の１例のブ
ロツク図を示す。 同図において、１９，２０はフリツプフロツ
プ、２１，２２，２３，２４はANDゲート、２
５は発振器９のクロツクパルスで端子の出力が
短時間低レベルになる単安定マルチバイブレー
タ、２６はORゲート、２７はインバータ、２８
は溶接回路に流れる溶接電流の実効値を検出する
電流検出回路１２の出力とＤ／Ａ変換器１７の出
力とを比較し、両者が一致したとき低レベルの信
号を出力する比較器である。 該パルス幅制御回路１０は、電流検出路１２の
出力する実効値がＤ／Ａ変換器１７から出力する
溶接電流設定値に対応する制御信号値に達しない
時、発振器９のクロツクパルスによつてフリツプ
フロツプ１９のＱ端子の出力は高いレベルを持続
し、フリツプフロツプ２０のＱ端子及び端子の
出力は交互に高レベルとなり、単安定マルチバイ
ブレータ２５の端子の出力はクロツクパルスの
入力毎に短時間低レベルになるので、ANDゲー
ト２７，２８から交互に高レベルの信号が相互の
間に短い低レベルの期間を存して出力し、該実効
値が設定値に達した時、ANDゲート２７，２８
の出力す低レベルとなる。 次に、第２図示の回路の作用について説明す
る。 今、溶接電極７に挟まれるワークを２枚とし、
それに対応して溶接変圧器１として例えば
20KVAの容量のものを使用する。そして溶接電
流設定器１３で溶接電流を例えば7000Aに設定す
ると共に、容量設定器１４を前記した20KVAに
設定する。 メモリ１５には、前記したように複数種の容量
の溶接変圧器１につき補正定数Ｋ、Ｖが記憶され
ているので、前記設定器１３，１４よりの設定信
号がインターフエース１８を介してCPU１６に
入力するとメモリ１５により設定信号に対応する
補正定数Ｋ＝１、Ｖ＝0.3125が読み出され、CPU
１６において前式に従つて演算が行われ、溶接電
流7000Aに対応する制御信号がＤ／Ａが変換器１
７から出力する。 かくてこの制御信号はパルス幅制御回路１０に
加わり、この回路１０の出力はベースドライブ回
路８を経てインバータ２のトランジスタ２1〜２4
のベースに印加されるから、インバータ２は溶接
変圧器１の１次コイルに例えば800Hzの交流電圧
を出力し、溶接回路には7000Aの溶接電流が流れ
る。 溶接変圧器１を取り替えないまま溶接電流を変
えうるときは、溶接電流設定器１３を設定し直せ
ばよく、ワークの枚数を増加するかあるいはワー
クの板材を厚くし、それに対応して大容量の溶接
変圧器１と置き替えたときは溶接変圧器容量設定
器１４を設定し直せば、溶接電流設定器１４が設
定した溶接電流が溶接回路に流れる。 （発明の効果） 本発明によれば、ワークの溶接条件の変化に対
応させて容量の異なる溶接変圧器に取り替えた場
合において、インバータを手動で調整する必要が
ないため作業工数が少なくなり、また、容量設定
器で設定するだけのため調整ミスにより溶接不良
を防止できる等の効果がある。
る。 第４図は前記パルス幅制御回路１０の１例のブ
ロツク図を示す。 同図において、１９，２０はフリツプフロツ
プ、２１，２２，２３，２４はANDゲート、２
５は発振器９のクロツクパルスで端子の出力が
短時間低レベルになる単安定マルチバイブレー
タ、２６はORゲート、２７はインバータ、２８
は溶接回路に流れる溶接電流の実効値を検出する
電流検出回路１２の出力とＤ／Ａ変換器１７の出
力とを比較し、両者が一致したとき低レベルの信
号を出力する比較器である。 該パルス幅制御回路１０は、電流検出路１２の
出力する実効値がＤ／Ａ変換器１７から出力する
溶接電流設定値に対応する制御信号値に達しない
時、発振器９のクロツクパルスによつてフリツプ
フロツプ１９のＱ端子の出力は高いレベルを持続
し、フリツプフロツプ２０のＱ端子及び端子の
出力は交互に高レベルとなり、単安定マルチバイ
ブレータ２５の端子の出力はクロツクパルスの
入力毎に短時間低レベルになるので、ANDゲー
ト２７，２８から交互に高レベルの信号が相互の
間に短い低レベルの期間を存して出力し、該実効
値が設定値に達した時、ANDゲート２７，２８
の出力す低レベルとなる。 次に、第２図示の回路の作用について説明す
る。 今、溶接電極７に挟まれるワークを２枚とし、
それに対応して溶接変圧器１として例えば
20KVAの容量のものを使用する。そして溶接電
流設定器１３で溶接電流を例えば7000Aに設定す
ると共に、容量設定器１４を前記した20KVAに
設定する。 メモリ１５には、前記したように複数種の容量
の溶接変圧器１につき補正定数Ｋ、Ｖが記憶され
ているので、前記設定器１３，１４よりの設定信
号がインターフエース１８を介してCPU１６に
入力するとメモリ１５により設定信号に対応する
補正定数Ｋ＝１、Ｖ＝0.3125が読み出され、CPU
１６において前式に従つて演算が行われ、溶接電
流7000Aに対応する制御信号がＤ／Ａが変換器１
７から出力する。 かくてこの制御信号はパルス幅制御回路１０に
加わり、この回路１０の出力はベースドライブ回
路８を経てインバータ２のトランジスタ２1〜２4
のベースに印加されるから、インバータ２は溶接
変圧器１の１次コイルに例えば800Hzの交流電圧
を出力し、溶接回路には7000Aの溶接電流が流れ
る。 溶接変圧器１を取り替えないまま溶接電流を変
えうるときは、溶接電流設定器１３を設定し直せ
ばよく、ワークの枚数を増加するかあるいはワー
クの板材を厚くし、それに対応して大容量の溶接
変圧器１と置き替えたときは溶接変圧器容量設定
器１４を設定し直せば、溶接電流設定器１４が設
定した溶接電流が溶接回路に流れる。 （発明の効果） 本発明によれば、ワークの溶接条件の変化に対
応させて容量の異なる溶接変圧器に取り替えた場
合において、インバータを手動で調整する必要が
ないため作業工数が少なくなり、また、容量設定
器で設定するだけのため調整ミスにより溶接不良
を防止できる等の効果がある。
第１図は、溶接変圧器の容量をパラメータとす
る溶接電流設定値と溶接電流との関係を示す図、
第２図は本発明の１実施例のブロツク図、第３図
は溶接変圧器の容量をパラメータとする溶接電流
設定値とＤ／Ａ変換器の出力値との関係を示す
図、第４図はパルス幅制御回路の１例のブロツク
図である。 １……溶接変圧器、２……インバータ、７……
溶接電極、１０……パルス幅制御回路、１３……
溶接電流設定器、１４……溶接変圧器容量設定
器、１５……メモリ、１６……CPU、１７……
Ｄ／Ａ変換器。
る溶接電流設定値と溶接電流との関係を示す図、
第２図は本発明の１実施例のブロツク図、第３図
は溶接変圧器の容量をパラメータとする溶接電流
設定値とＤ／Ａ変換器の出力値との関係を示す
図、第４図はパルス幅制御回路の１例のブロツク
図である。 １……溶接変圧器、２……インバータ、７……
溶接電極、１０……パルス幅制御回路、１３……
溶接電流設定器、１４……溶接変圧器容量設定
器、１５……メモリ、１６……CPU、１７……
Ｄ／Ａ変換器。
Claims (1)
- １ 溶接変圧器と、該溶接変圧器の１次コイルに
接続され且つ溶接電流設定器による設定値に対応
する制御信号により溶接電流を所定値に制御する
インバータを備える抵抗溶接機の電流制御装置に
おいて、該制御信号の補正装置を備え、該補正装
置は、使用する溶接変圧器の容量に対応する設定
信号を出力する溶接変圧器容量設定器と、溶接変
圧器の複数の容量に各対応する補正定数を記憶す
るメモリと、該溶接電流設定器において設定され
た溶接電流値と該メモリから読み出された前記溶
接変圧器容量設定器において設定された溶接変圧
器の容量に対応する補正定数とから溶接回路に流
れる前記設定値の溶接電流に対応する制御信号値
を算出する演算器とから成り、該演算器から出力
する制御信号をインバータに供給するようにした
ことを特徴とする抵抗溶接機の電流制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9608985A JPS61255772A (ja) | 1985-05-08 | 1985-05-08 | 抵抗溶接機の電流制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9608985A JPS61255772A (ja) | 1985-05-08 | 1985-05-08 | 抵抗溶接機の電流制御装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61255772A JPS61255772A (ja) | 1986-11-13 |
| JPH0413076B2 true JPH0413076B2 (ja) | 1992-03-06 |
Family
ID=14155670
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9608985A Granted JPS61255772A (ja) | 1985-05-08 | 1985-05-08 | 抵抗溶接機の電流制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61255772A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0832364B2 (ja) * | 1987-06-08 | 1996-03-29 | ニチコン株式会社 | 溶接機用電源装置 |
-
1985
- 1985-05-08 JP JP9608985A patent/JPS61255772A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61255772A (ja) | 1986-11-13 |
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