JPH04276640A - Icパッケージ - Google Patents

Icパッケージ

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Publication number
JPH04276640A
JPH04276640A JP3825691A JP3825691A JPH04276640A JP H04276640 A JPH04276640 A JP H04276640A JP 3825691 A JP3825691 A JP 3825691A JP 3825691 A JP3825691 A JP 3825691A JP H04276640 A JPH04276640 A JP H04276640A
Authority
JP
Japan
Prior art keywords
package
test
mounting board
pads
mounting
Prior art date
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Pending
Application number
JP3825691A
Other languages
English (en)
Inventor
Shingo Wada
和田 真悟
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明はICパッケージに関し、
特に表面実装用ICパッケージに関する。
【0002】
【従来の技術】従来の表面実装用ICパッケージの一例
を図2に示す。ICパッケージ2内の半導体の端子は、
実装基板3へ実装する面のみ入出力端子21が出ている
。入出力端子21は、実装基板3に作られた実装基板接
続用パッド31にハンダ付けされ、配線32を通し他の
ICと接続され、電子回路が構成されている。
【0003】この電子回路を試験する場合、表面実装用
ICの入出力端子21へは直接接触することができない
ため、実装基板3の配線32に試験用パッド33又は試
験用スルーホール34を設けている。
【0004】
【発明が解決しようとする課題】この従来の表面実装用
ICパッケージでは、実装基板の配線上に試験用パッド
又は試験用スルーホールを設けて試験を行なうため、試
験用パッド又は試験用スルーホールが実装基板上大きな
面積を有し、表面実装ICを使用する小型化のメリット
がない。
【0005】又、電子回路の試験は、実装基板の配線上
のパッド又はスルーホールにて行なわれるため、表面実
装ICの入出力端子と実装基板接続用パッドとの導通試
験ができないという欠点がある。
【0006】
【課題を解決するための手段】本発明のICパッケージ
は、表面実装用ICパッケージにおいて、ICパッケー
ジ内半導体基板の端子よりパッケージ封止外側上面に引
き出された導体と、この導体の先端に設けられた試験用
パッドとを備えている。
【0007】
【実施例】次に本発明について図面を参照して説明する
【0008】図1は本発明の一実施例の斜視図である。 ICパッケージ1の上面に、試験用パッド13を設け、
導体12でICパッケージ内半導体の端子(図示せず)
と試験用パッド13とを接続している。
【0009】本発明のICパッケージ1を実装基板へ実
装し他のICとで構成された電子回路を試験する場合、
ICパッケージ1の上面に設けた試験用パッド13に試
験治具を接触させることにより、導体12及びICパッ
ケージ1の入出力端子11の2つの経路のそれぞれを通
して試験を行なうことができる。
【0010】
【発明の効果】以上説明したように本発明は、ICパッ
ケージの上面に試験用パッドを設けることにより、実装
基板側に試験用パッド又は試験用スルーホールを作る必
要がなく、表面実装ICの小型化のメリットが生かせる
【0011】又、実装基板へのIC搭載後、接続パッド
とICの入出力端子との接続性試験を行なうことができ
るという効果を有する。
【図面の簡単な説明】
【図1】本発明の一実施例の斜視図である。
【図2】従来のICパッケージの一例を示す斜視図であ
る。
【符号の説明】
1,2    ICパッケージ 3,2−2    実装基板 11,21    入出力端子 12    導体 13,33    試験用パッド 31    実装基板接続用パッド 32    配線 34    試験用スルーホール

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】  表面実装用ICパッケージにおいて、
    ICパッケージ内半導体基板の端子よりパッケージ封止
    外側上面に引き出された導体と、この導体の先端に設け
    られた試験用パッドとを備えることを特徴とするICパ
    ッケージ。
JP3825691A 1991-03-05 1991-03-05 Icパッケージ Pending JPH04276640A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP3825691A JPH04276640A (ja) 1991-03-05 1991-03-05 Icパッケージ

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JP3825691A JPH04276640A (ja) 1991-03-05 1991-03-05 Icパッケージ

Publications (1)

Publication Number Publication Date
JPH04276640A true JPH04276640A (ja) 1992-10-01

Family

ID=12520239

Family Applications (1)

Application Number Title Priority Date Filing Date
JP3825691A Pending JPH04276640A (ja) 1991-03-05 1991-03-05 Icパッケージ

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JP (1) JPH04276640A (ja)

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62152428A (ja) * 1985-12-27 1987-07-07 安田 信美 グラス自動洗浄器

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62152428A (ja) * 1985-12-27 1987-07-07 安田 信美 グラス自動洗浄器

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