JPH04284554A - 計算機システム - Google Patents

計算機システム

Info

Publication number
JPH04284554A
JPH04284554A JP3073799A JP7379991A JPH04284554A JP H04284554 A JPH04284554 A JP H04284554A JP 3073799 A JP3073799 A JP 3073799A JP 7379991 A JP7379991 A JP 7379991A JP H04284554 A JPH04284554 A JP H04284554A
Authority
JP
Japan
Prior art keywords
common memory
memory interface
data
switch
memory device
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP3073799A
Other languages
English (en)
Inventor
Nobuhiko Itaya
伸彦 板屋
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP3073799A priority Critical patent/JPH04284554A/ja
Publication of JPH04284554A publication Critical patent/JPH04284554A/ja
Pending legal-status Critical Current

Links

Landscapes

  • Storage Device Security (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】この発明は、他システムからコモ
ンメモリインターフェースを介して送られて来るデータ
をコモンメモリ装置に書き込むことができるようにした
計算機システムに関するものである。
【0002】
【従来の技術】図3は例えば三菱電機MELCOM35
0−60シリーズBA236/BA238コモンメモリ
説明書(昭和61年1月20日発行)に記載された従来
のコモンメモリインターフェースを用いた計算機システ
ムを示すブロック図であり、図1において、1は自シス
テム、2は自システムと通信を行う他システムである。
【0003】自システム1において、3は中央処理装置
としての基本処理装置、4は処理演算に用いられる生記
憶装置、5は自システム1及び他システム2のデータを
格納するコモンメモリ装置、6は他システム2との通信
を行うコモンメモリインターフェース、7は上記各部を
接続するメモリバスである。
【0004】他システム2において、8,9,10,1
1,12は自システム1の3,4,5,6,7と対応す
る。13は自システム1及び他システム2のコモンメモ
リインターフェース6,11間を接続するコモンメモリ
インターフェースバスである。
【0005】図4はコモンメモリインターフェース6,
11の状態を切替えるスイッチを示し、■メモリバス・
コモンメモリインターフェースバス可、■コモンメモリ
インターフェースバス可、■コモンメモリインターフェ
ースバス不可の3つの状態を切替えるトグルスイッチに
構成されている。
【0006】次に動作について説明する。
【0007】自システム1において、基本処理装置3か
らはメモリバス7を介して生記憶装置4およびコモンメ
モリ装置5にデータの読み書きができる。また、基本処
理装置3からコモンメモリ装置5にデータを書き込む場
合には、コモンメモリインターフェース6、コモンメモ
リインターフェースバス13、コモンメモリインターフ
ェース11およびメモリバス12を介して同じデータを
他システム2のコモンメモリ装置10にも書き込むこと
ができる。また他システム2の基本処理装置8からデー
タの読み書きをする場合も同様である。
【0008】以上のように、コモンメモリ装置5,10
に同じデータが書き込まれるため、基本処理装置3,8
はデータの共有ができる。
【0009】また、他システム2から自システム1のコ
モンメモリ装置5にデータを書き込みたくない場合には
スイッチ14をコモンメモリインターフェースバス不可
の状態とする。
【0010】
【発明が解決しようとする課題】従来のコモンメモリイ
ンターフェースを用いた計算機システムは以上のように
構成されているので、基本処理装置3が自分のコモンメ
モリ装置5だけにデータを書き込みたい時には、コモン
メモリインターフェース6のスイッチ14を人が操作す
ることにより、電気的に切ることが必要であり、この操
作を忘れた場合は他のシステム2のコモンメモリ装置1
0に書き込みたくないデータを書き込んでしまうなどの
問題があった。
【0011】この発明は上記のような課題を解消するた
めになされたもので基本処理からのコモンメモリ装置へ
の書き込みをスイッチを操作することなく禁止すること
ができる計算機システムを得ることを目的としている。
【0012】
【課題を解決するための手段】この発明に係る計算機シ
ステムは、他システムから自システムのコモンメモリ装
置へのデータの書き込み可否の切り替えを、自システム
の基本処理装置のソフトウェアにより行えるようにした
ものである。
【0013】
【作用】この発明における計算機システムは、自システ
ムの基本処理装置の命令により他システムの基本処理装
置から自システムのコモンメモリ装置へのデータの書き
込みが禁止される。
【0014】
【実施例】実施例1.以下、この発明の一実施例を図に
ついて説明する。図1においては図3と対応する部分に
は同一符号を付して説明を省略する。
【0015】図1において、15,16はコモンメモリ
インターフェース6,11内のコモンメモリ書き込み可
否切替え用のスイッチである。
【0016】図2において、17は押す毎にコモンメモ
リインターフェースバス13の接続を切替える押し釦ス
イッチ、上記スイッチ12,13は押し釦スイッチ17
又は基本処理装置3,8からのソフトウェア命令により
コモンメモリインターフェースバス13の接続を前記■
,■,■の状態に切替えるスイッチである。
【0017】基本処理装置3,8は、それぞれ相手シス
テムによって自分のコモンメモリ装置5,10のデータ
が書き替えられることを禁止したいときに、自分のスイ
ッチ15,16を■のコモンメモリインターフェースバ
ス不可の状態に切替えるソフトウェアを有している。
【0018】次に動作について説明する。
【0019】基本処理装置3からコモンメモリ装置5に
データを書きこむとき、同時にコモンメモリインターフ
ェース6,コモンメモリインターフェースバス13,コ
モンメモリインターフェース11を介してコモンメモリ
装置10にも同じデータを書き込むことができる。この
時、基本処理装置8からソフトウェア上の命令でコモン
メモリインターフェース11のコモンメモリ書き込み可
否切替え用のスイッチ16が切られていれば、基本処理
装置3からコモンメモリ装置10への書き込みは禁止さ
れる。基本処理装置8からコモンメモリ装置5への書き
込みも同様に、コモンメモリインターフェース6のコモ
ンメモリ書き込み可否切替え用のスイッチ15を切るこ
とにより禁止される。
【0020】なおスイッチ15,16の上記切り状態は
図2におけるスイッチ15,16を自分の基本処理装置
3,8からのソフトウェア命令により、■のコモンメモ
リインターフェースバス不可状態にすることに相当する
【0021】なお上記実施例ではコモンメモリインター
フェース6のスイッチ15により、他システム2の基本
処理装置8からの書き込みを禁止したが、他システム2
のコモンメモリインターフェース11のスイッチ16に
より基本処理装置8から自システム1のコモンメモリ装
置5への書き込みを禁止してもよい。
【0022】
【発明の効果】以上のようにこの発明によれば、基本処
理装置のソフトウェア上の命令により、コモンメモリイ
ンターフェース内のスイッチを切替え、他システムから
自システムのコモンメモリへの書き込みを禁止できるよ
うに構成したので、他システムからコモンメモリ装置の
データを書き替えられては困る場合、上記スイッチを切
るようにソフトウェアを作ることにより、自動的に書き
込みが禁止されるため、従来の人の操作により書き込み
を禁止する場合に生じる書き込み禁止忘れや、操作の手
間が省ける効果がある。
【図面の簡単な説明】
【図1】この発明の一実施例による計算機システムのブ
ロック図である。
【図2】同システムに用いられるスイッチの構成図であ
る。
【図3】従来の計算機システムのブロック図である。
【図4】同システムに用いられるスイッチの構成図であ
る。
【符号の説明】
1    自システム 2    他システム 3    基本処理装置 5    コモンメモリ装置 6    コモンメモリインターフェース13  コモ
ンメモリインターフェースバス15  コモンメモリ書
き込み可否切替え用のスイッチなお、図中、同一符号は
同一、又は相当部分を示す。

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】  他システムとコモンメモリインターフ
    ェースバスを通じてデータの通信を行うコモンメモリイ
    ンターフェースと、上記コモンメモリインターフェース
    の通信状態を切替えるスイッチと、上記他システムから
    受信したデータの書き込みを行うコモンメモリ装置と、
    上記他システムから受信したデータの上記コモンメモリ
    装置への書き込みを必要に応じて禁止するように上記ス
    イッチの状態を切替えるソフトウェアを有する基本処理
    装置とを備えた計算機システム。
JP3073799A 1991-03-14 1991-03-14 計算機システム Pending JPH04284554A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP3073799A JPH04284554A (ja) 1991-03-14 1991-03-14 計算機システム

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP3073799A JPH04284554A (ja) 1991-03-14 1991-03-14 計算機システム

Publications (1)

Publication Number Publication Date
JPH04284554A true JPH04284554A (ja) 1992-10-09

Family

ID=13528586

Family Applications (1)

Application Number Title Priority Date Filing Date
JP3073799A Pending JPH04284554A (ja) 1991-03-14 1991-03-14 計算機システム

Country Status (1)

Country Link
JP (1) JPH04284554A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2009140609A (ja) * 2007-12-04 2009-06-25 Korea Electronics Telecommun 偽変造防止のためのデジタル録音装置

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2009140609A (ja) * 2007-12-04 2009-06-25 Korea Electronics Telecommun 偽変造防止のためのデジタル録音装置
US8095988B2 (en) 2007-12-04 2012-01-10 Electronics And Telecommunications Research Institute Forgery-proof digital sound recording device

Similar Documents

Publication Publication Date Title
JPH0113573B2 (ja)
US5125081A (en) Inter-configuration changing controller based upon the connection and configuration information among plurality of clusters and the global storage
JPS6362010B2 (ja)
JPS6142306B2 (ja)
US4627035A (en) Switching circuit for memory devices
JPH0554480B2 (ja)
JPH0554009A (ja) プログラムロード方式
JPH03278138A (ja) 2重化制御方式
JPH05165731A (ja) 二重化記憶装置
JPH0644209B2 (ja) バス変換装置
JPS62216063A (ja) 共通バスライン切替方法
JPH0261749A (ja) データ転送装置
JPH04105110A (ja) 電源制御装置
JPH04263333A (ja) メモリ二重化方式
JPS6222516B2 (ja)
JPH0460821A (ja) 記憶保持装置
JPH04340119A (ja) 情報処理装置
JPS60254479A (ja) バブルメモリ制御装置
JPS62262169A (ja) デ−タ転送方式
JPH02230440A (ja) プログラムメモリ制御回路
JPH02121049A (ja) 入出力装置
JPS607803B2 (ja) プログラム作成装置
JPS6210751A (ja) マイクロコンピユ−タ回路
JP2000250759A (ja) フラッシュメモリのブートブロック書き込み方法
JPH01191202A (ja) シーケンスコントローラ