JPH04290254A - 半導体装置用リードフレーム - Google Patents

半導体装置用リードフレーム

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Publication number
JPH04290254A
JPH04290254A JP3053044A JP5304491A JPH04290254A JP H04290254 A JPH04290254 A JP H04290254A JP 3053044 A JP3053044 A JP 3053044A JP 5304491 A JP5304491 A JP 5304491A JP H04290254 A JPH04290254 A JP H04290254A
Authority
JP
Japan
Prior art keywords
semiconductor
lead frame
element mounting
semiconductor device
mounting stand
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP3053044A
Other languages
English (en)
Inventor
Sadayuki Moroi
定幸 諸井
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP3053044A priority Critical patent/JPH04290254A/ja
Publication of JPH04290254A publication Critical patent/JPH04290254A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10DINORGANIC ELECTRIC SEMICONDUCTOR DEVICES
    • H10D62/00Semiconductor bodies, or regions thereof, of devices having potential barriers
    • H10D62/10Shapes, relative sizes or dispositions of the regions of the semiconductor bodies; Shapes of the semiconductor bodies
    • H10D62/117Shapes of semiconductor bodies
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
    • H10W72/50Bond wires
    • H10W72/541Dispositions of bond wires
    • H10W72/5449Dispositions of bond wires not being orthogonal to a side surface of the chip, e.g. fan-out arrangements

Landscapes

  • Wire Bonding (AREA)
  • Lead Frames For Integrated Circuits (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、半導体装置に用いるリ
ードフレームに関し、特にその半導体素子搭載台部の形
状に関する。
【0002】
【従来の技術】従来、この種の半導体装置に用いるリー
ドフレームは、図3,図4に示すように、半導体素子搭
載台部1の形状が単に長方形であったり、リードフレー
ムと封止樹脂との密着性を高めるために内部リード2や
半導体素子搭載台部1裏面に複数の凹部(ハーフエッチ
)5をエッチング加工によって形成している。この凹部
5の位置は、半導体装置を全体加熱方式によってプリン
ト基板へ実装する際のリードフレームと封止樹脂との熱
膨張差によるボンディングワイヤの破断等の不具合を防
止するためには、内部リードのボンディング点付近にあ
ることが必要であった。
【0003】
【発明が解決しようとする課題】この従来の半導体装置
用リードフレームでは、内部リード2や半導体素子搭載
台部裏面に凹部5を形成するためには、エッチング加工
する必要があり、プレス加工ができず生産数量が多い場
合でもコストを低減することが困難であった。また、内
部リード2に凹部5を形成した場合、内部リードの強度
が低下し、リードフレーム製造工程中及び半導体装置組
立工程中にリードが変形し易いという問題点があった。 さらに、近年半導体装置の多ピン化が進み、内部リード
が細くなると凹部の加工が困難になるという問題点があ
った。
【0004】本発明の目的は、これらの問題を解決し、
コスト低減しながらリードフレームと封止樹脂との密着
性を高めると共に、エッチング加工を不要とした半導体
装置用リードフレームを提供することにある。
【0005】
【課題を解決するための手段】本発明の構成は、半導体
素子を半導体素子搭載台部に載置してこれらを樹脂封止
して組立てる半導体装置用リードフレームにおいて、前
記半導体素子搭載部の縁端部近傍で内部リードと対向す
る箇所に複数の貫通穴を形成したことを特徴とする。
【0006】
【実施例】図1は本発明の一実施例の半導体装置用リー
ドフレームの部分平面図である。図2は本発明の第2の
実施例の半導体装置用リードフレームの平面図である。 本実施例の半導体素子搭載台部1は、内部リード2の先
端に沿って形成され、かつその端部に貫通穴3を複数個
形成している。その際半導体素子搭載台部1と内部リー
ド2の先端とのすき間はできる限り狭い方が望ましい。
【0007】このような形状のリードフレームを用いて
半導体装置を組立てた場合、半導体素子上の電極と内部
リード2との間をワイヤボンディングした金線等のワイ
ヤが半導体素子搭載台部1と接触してしまうことが懸念
される。そのため、図2に示す、本発明の第2の実施例
では、半導体素子搭載台部1の端部に電気絶縁性のテー
プ4を貼付するか、同様に絶縁性の液状樹脂等をできる
限り薄く塗布し硬化させている。
【0008】この第2の実施例によって、もしも半導体
装置組立工程中において、ボンディングワイヤが垂れ半
導体素子搭載第部1と接触するような場合があっても、
電気的には絶縁を保つことができる。
【0009】
【発明の効果】以上説明したように本発明は、半導体素
子搭載台部の縁端部近傍に複数の貫通穴を備えることに
より、封止樹脂とリードフレームとの密着性を高め、従
来のエッチング加工によって形成した凹部を有するリー
ドフレームと同等の効果がある。また、本発明のリード
フレームは、プレス加工によって製造することが可能で
あり、生産コストを従来の1/5程度まで低減させるこ
とができる。さらに、内部リード上に凹部を形成する必
要がないため、内部リードの強度を低下させることがな
く、リードフレーム製造工程及び半導体装置組立工程中
の歩留を向上させるという効果も有する。
【図面の簡単な説明】
【図1】本発明の一実施例の部分平面図。
【図2】本発明の第2の実施例の部分平面図。
【図3】従来の半導体装置用リードフレームの部分平面
図。
【図4】従来のリードフレームの他の例の部分平面図。
【符号の説明】
1    半導体素子搭載台部 2    内部リード 3    貫通穴 4    電気絶縁性テープ 5    凹部(ハーフエッチ)

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】  半導体素子を半導体素子搭載台部に載
    置してこれらを樹脂封止して組立てる半導体装置用リー
    ドフレームにおいて、前記半導体素子搭載部の縁端部近
    傍で内部リードと対向する箇所に複数の貫通穴を形成し
    たことを特徴とする半導体装置用リードフレーム。
JP3053044A 1991-03-19 1991-03-19 半導体装置用リードフレーム Pending JPH04290254A (ja)

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Application Number Priority Date Filing Date Title
JP3053044A JPH04290254A (ja) 1991-03-19 1991-03-19 半導体装置用リードフレーム

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JP3053044A JPH04290254A (ja) 1991-03-19 1991-03-19 半導体装置用リードフレーム

Publications (1)

Publication Number Publication Date
JPH04290254A true JPH04290254A (ja) 1992-10-14

Family

ID=12931885

Family Applications (1)

Application Number Title Priority Date Filing Date
JP3053044A Pending JPH04290254A (ja) 1991-03-19 1991-03-19 半導体装置用リードフレーム

Country Status (1)

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JP (1) JPH04290254A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5844306A (en) * 1995-09-28 1998-12-01 Mitsubishi Denki Kabushiki Kaisha Die pad structure for solder bonding

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5844306A (en) * 1995-09-28 1998-12-01 Mitsubishi Denki Kabushiki Kaisha Die pad structure for solder bonding

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Legal Events

Date Code Title Description
A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 19990119