JPH04367075A - ハードウェア設計システム及び方法 - Google Patents
ハードウェア設計システム及び方法Info
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- JPH04367075A JPH04367075A JP3142070A JP14207091A JPH04367075A JP H04367075 A JPH04367075 A JP H04367075A JP 3142070 A JP3142070 A JP 3142070A JP 14207091 A JP14207091 A JP 14207091A JP H04367075 A JPH04367075 A JP H04367075A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明は、ハードウェアの仕様を
入力することにより機能もしくは論理回路の接続情報が
得られるハードウェア設計方式に関する。
入力することにより機能もしくは論理回路の接続情報が
得られるハードウェア設計方式に関する。
【０００２】
【従来の技術】近年、ハードウェアの設計において、ハ
ードウェアの動作や構造を機能ブロック図や機能もしく
は論理記述言語で入力するツールが開発されている。
ードウェアの動作や構造を機能ブロック図や機能もしく
は論理記述言語で入力するツールが開発されている。
【０００３】一例として、機能設計は、パーソナルコン
ピュータ、エンジニアリングワークステーション等の機
能設計システムを使用、グラフィックエディタ等で機能
ブロック図を描き、その図形情報から機能記述言語に変
換していた。論理設計も同様に、パーソナルコンピュー
タ、エンジニアリングワークステーション等の機能設計
システムを使用し、グラフィックエディタによりロジッ
クセルを描いて論理図面を作成し、図形情報から論理接
続記述言語に変換していたものである。
ピュータ、エンジニアリングワークステーション等の機
能設計システムを使用、グラフィックエディタ等で機能
ブロック図を描き、その図形情報から機能記述言語に変
換していた。論理設計も同様に、パーソナルコンピュー
タ、エンジニアリングワークステーション等の機能設計
システムを使用し、グラフィックエディタによりロジッ
クセルを描いて論理図面を作成し、図形情報から論理接
続記述言語に変換していたものである。
【０００４】
【発明が解決しようとする課題】ところが上述した従来
例によれば、論理図でビット幅を持つ、例えばデータパ
スでは、ロジックセルを１ビットあるいは、４ビット単
位に構成することが多く、従って図面が見ずらく、また
図面枚数も多くなり管理が大変であった。また、図面情
報からハードウェア接続記述言語への変換処理のために
多大な時間を要していた。更に、仕様作成、機能設計、
論理設計が別々のアプリケーションのため、各々のシス
テムのオペレーションを修得しなければならない、また
、アプリケーションを煩繁に切り替えなければならない
といった問題があった。
例によれば、論理図でビット幅を持つ、例えばデータパ
スでは、ロジックセルを１ビットあるいは、４ビット単
位に構成することが多く、従って図面が見ずらく、また
図面枚数も多くなり管理が大変であった。また、図面情
報からハードウェア接続記述言語への変換処理のために
多大な時間を要していた。更に、仕様作成、機能設計、
論理設計が別々のアプリケーションのため、各々のシス
テムのオペレーションを修得しなければならない、また
、アプリケーションを煩繁に切り替えなければならない
といった問題があった。
【０００５】本発明は上述した事情に鑑みてなされたも
のであり、仕様作成、機能設計、論理設計を自分が使用
しているワードプロセッサもしくはエディタ等一つの環
境で実現でき、かつ、この中で機能図、論理図表現を行
なうことで設計を簡素化し、ハードウェア接続記述言語
への変換を高速化したハードウェア設計方式を提供する
ことを目的とする。
のであり、仕様作成、機能設計、論理設計を自分が使用
しているワードプロセッサもしくはエディタ等一つの環
境で実現でき、かつ、この中で機能図、論理図表現を行
なうことで設計を簡素化し、ハードウェア接続記述言語
への変換を高速化したハードウェア設計方式を提供する
ことを目的とする。
【０００６】
【課題を解決するための手段】本発明は、論理あるいは
機能を表または式の形式にて表現したロジック情報を含
む文書ファイルをテキストエディタを使用することによ
り作成し、ここで作成された文書ファイルの中から上記
のロジック情報を抽出し、表または式からハードウェア
接続記述言語に変換することを特徴とする。
機能を表または式の形式にて表現したロジック情報を含
む文書ファイルをテキストエディタを使用することによ
り作成し、ここで作成された文書ファイルの中から上記
のロジック情報を抽出し、表または式からハードウェア
接続記述言語に変換することを特徴とする。
【０００７】また、表から有効データを抽出してこれを
ビット単位に展開してビット配列データを生成し、セル
毎に用意されるライブラリの配列情報に従って上記のビ
ット配列データを再配置しハードウェア接続記述言語に
変換するものである。
ビット単位に展開してビット配列データを生成し、セル
毎に用意されるライブラリの配列情報に従って上記のビ
ット配列データを再配置しハードウェア接続記述言語に
変換するものである。
【０００８】
【作用】上述した構成にて、まずワードプロセッサある
いは編集プログラムを使用して、ハードウェアの設計仕
様書等の文章中に上述したロジック情報を入れ文書ファ
イルを作成する。この文書ファイル中からロジック情報
を抽出し、表及び式をハードウェア接続記述言語（論理
回路接続記述言語あるいは機能記述言語）に変換するも
のである。
いは編集プログラムを使用して、ハードウェアの設計仕
様書等の文章中に上述したロジック情報を入れ文書ファ
イルを作成する。この文書ファイル中からロジック情報
を抽出し、表及び式をハードウェア接続記述言語（論理
回路接続記述言語あるいは機能記述言語）に変換するも
のである。
【０００９】このことにより、ハードウェア仕様書、機
能図、論理展開図等１つのファイルに集積でき、また、
多岐のアプリケーションに渡ることなく１つの環境で実
現でき、高速処理に寄与する。
能図、論理展開図等１つのファイルに集積でき、また、
多岐のアプリケーションに渡ることなく１つの環境で実
現でき、高速処理に寄与する。
【００１０】
【実施例】以下、図面を使用して本発明実施例について
説明する。
説明する。
【００１１】図１は本発明の実施例を示すブロック図で
ある。図において、１はシステムの制御中枢となるＣＰ
Ｕである。２は主記憶であり、文書ファイルを作成する
エディタプログラム並びに言語変換プログラムが格納さ
れる他、ワーキング領域として使用される。ＣＰＵ１は
このプログラムを読み出して所期の目的を実行する。
ある。図において、１はシステムの制御中枢となるＣＰ
Ｕである。２は主記憶であり、文書ファイルを作成する
エディタプログラム並びに言語変換プログラムが格納さ
れる他、ワーキング領域として使用される。ＣＰＵ１は
このプログラムを読み出して所期の目的を実行する。
【００１２】３はキーボード（ＫＢ）であり、仕様情報
を入力するものである。仕様情報として、通常の文書情
報の他にロジック情報が含まれる。このロジック情報は
、論理あるいは機能が、表または式の形式にて表現され
るものである。
を入力するものである。仕様情報として、通常の文書情
報の他にロジック情報が含まれる。このロジック情報は
、論理あるいは機能が、表または式の形式にて表現され
るものである。
【００１３】上記した表の記述の形式を図２及び図３に
示す。ここで、図２は標準的な記述を、図３（ａ）はレ
ジスタ、ラッチ記述を、図３（ｂ）はマルチプレクサ記
述を、図３（ｃ）はデコーダ記述を、それぞれ示す。ま
た、上記した式の記述の形式を図４に示す。
示す。ここで、図２は標準的な記述を、図３（ａ）はレ
ジスタ、ラッチ記述を、図３（ｂ）はマルチプレクサ記
述を、図３（ｃ）はデコーダ記述を、それぞれ示す。ま
た、上記した式の記述の形式を図４に示す。
【００１４】図中、１カラム目は制御コマンド指定領域
を示し、コマンドとして、Ｍ，Ｉ，Ｏ，Ｃ，Ｓ，Ｅ，Ｆ
，Ｑ，ＱＮ，Ｅ等が用意される。各コマンドの機能は後
述する。
を示し、コマンドとして、Ｍ，Ｉ，Ｏ，Ｃ，Ｓ，Ｅ，Ｆ
，Ｑ，ＱＮ，Ｅ等が用意される。各コマンドの機能は後
述する。
【００１５】また、図中の符号ａはモジュール名指定（
階層名を記述）のコマンド（Ｍコマンド）の、ｂはモジ
ュール入力する信号名指定のコマンド（Ｉコマンド）の
、ｃはモジュールから出力する信号名指定のコマンド（
Ｏコマンド）の領域である。ｄはコメント行指定のコマ
ンド（Ｃコマンド）の、ｅは表開始マーク（ハードウェ
ア接続記述言語変換する領域の開始マーク）の領域（Ｓ
コマンドの領域）である。
階層名を記述）のコマンド（Ｍコマンド）の、ｂはモジ
ュール入力する信号名指定のコマンド（Ｉコマンド）の
、ｃはモジュールから出力する信号名指定のコマンド（
Ｏコマンド）の領域である。ｄはコメント行指定のコマ
ンド（Ｃコマンド）の、ｅは表開始マーク（ハードウェ
ア接続記述言語変換する領域の開始マーク）の領域（Ｓ
コマンドの領域）である。
【００１６】ｆはユニット名の記述領域であり、１つの
機能をもったユニットの名称を記述する。機能の場合は
機能のブロック名、論理の場合はセル名を記述する。ｇ
は表の出力信号のビット幅の記述領域である。ｈは出力
信号名の、ｉは入力信号名１の、ｊは入力信号名２の、
それぞれ記述領域である。
機能をもったユニットの名称を記述する。機能の場合は
機能のブロック名、論理の場合はセル名を記述する。ｇ
は表の出力信号のビット幅の記述領域である。ｈは出力
信号名の、ｉは入力信号名１の、ｊは入力信号名２の、
それぞれ記述領域である。
【００１７】ｋは表終了マーク（ハードウェア接続記述
言語に変換する領域の終了マーク）の領域（Ｅコマンド
の領域）である。ｌはモジュールの終了指定（一つの階
層の終了指定）のコマンド（Ｆコマンド）の領域、ｍは
レジスタ、ラッチの省略記述での表開始マークの領域で
ある。
言語に変換する領域の終了マーク）の領域（Ｅコマンド
の領域）である。ｌはモジュールの終了指定（一つの階
層の終了指定）のコマンド（Ｆコマンド）の領域、ｍは
レジスタ、ラッチの省略記述での表開始マークの領域で
ある。
【００１８】ｎはレジスタ、ラッチの省略記述で、Ｑ（
Ｑ出力）側のみを言語に変換することを指定（何も指定
しないとＱ，Ｑバーに変換）するためのコマンド（Ｑコ
マンド）の領域である。ｏはレジスタ、ラッチの省略記
述で、Ｑバー（Ｑバー出力）側のみを言語に変換するこ
とを指定するためのコマンド（ＱＮコマンド）の領域で
ある。ｐはマルチプレクサ省略記述での表開始マークの
領域、ｑはマルチプレクサ省略記述でのマルチプレクサ
選択信号名の指定領域である。ｒは論理回路接続記述言
語で直接記述するコマンド（Ｄコマンド）の領域、ｓは
機能記述言語で直接記述するコマンド（Ｈコマンド）の
領域である。
Ｑ出力）側のみを言語に変換することを指定（何も指定
しないとＱ，Ｑバーに変換）するためのコマンド（Ｑコ
マンド）の領域である。ｏはレジスタ、ラッチの省略記
述で、Ｑバー（Ｑバー出力）側のみを言語に変換するこ
とを指定するためのコマンド（ＱＮコマンド）の領域で
ある。ｐはマルチプレクサ省略記述での表開始マークの
領域、ｑはマルチプレクサ省略記述でのマルチプレクサ
選択信号名の指定領域である。ｒは論理回路接続記述言
語で直接記述するコマンド（Ｄコマンド）の領域、ｓは
機能記述言語で直接記述するコマンド（Ｈコマンド）の
領域である。
【００１９】説明を図１に戻すと、４はディスプレイ装
置（ＤＩＳＰ）であり、キーボード３によって入力され
、エディタにて編集された文書情報並びに言語変換プロ
グラムにて言語変換された結果が表示される。５はフロ
ッピーディスク装置、ハードディスク装置等の外部ファ
イル装置であり、中間ファイルの他、セル毎に用意され
る各種ライブラリが格納される。６はシステムバスであ
り、上述したＣＰＵ１、主記憶２、キーボード３、ディ
スプレイ装置４、及び外部ファイル装置５が共通に接続
される。
置（ＤＩＳＰ）であり、キーボード３によって入力され
、エディタにて編集された文書情報並びに言語変換プロ
グラムにて言語変換された結果が表示される。５はフロ
ッピーディスク装置、ハードディスク装置等の外部ファ
イル装置であり、中間ファイルの他、セル毎に用意され
る各種ライブラリが格納される。６はシステムバスであ
り、上述したＣＰＵ１、主記憶２、キーボード３、ディ
スプレイ装置４、及び外部ファイル装置５が共通に接続
される。
【００２０】図５乃至図７は、図２並びに図３に示す表
形式にて表現した記述、及び図４に示す式形式にて表現
した記述をハードウェア接続記述言語に変換するための
プログラムの処理概要を示すフローチャートの部分図、
図８乃至図１１は、図７における表をＴＤＬ（ハードウ
ェア接続記述言語）に変換する処理の手順を示すフロー
チャートの部分図である。
形式にて表現した記述、及び図４に示す式形式にて表現
した記述をハードウェア接続記述言語に変換するための
プログラムの処理概要を示すフローチャートの部分図、
図８乃至図１１は、図７における表をＴＤＬ（ハードウ
ェア接続記述言語）に変換する処理の手順を示すフロー
チャートの部分図である。
【００２１】図１２及び図１３は、表形式のロジック情
報を含むファイルから有効データを抽出してハードウェ
ア接続記述言語に変換する場合の動作を４ビットラッチ
を例に説明するための図である。
報を含むファイルから有効データを抽出してハードウェ
ア接続記述言語に変換する場合の動作を４ビットラッチ
を例に説明するための図である。
【００２２】図中、１２１は表形式にて表現されたロジ
ック情報を含む文書ファイル（入力ファイル）、１２２
は同ロジック情報で表現される論理図、１２３はファイ
ル１２１から抽出された有効データが書き込まれた中間
ファイル（ＤＡＴＡＳファイル）である。また、１３１
は抽出された有効データがビット単位に展開されたビッ
ト配列バッファ、１３２はセル毎に用意されるライブラ
リ、１３３はビット配列バッファ１３１から変換された
ハードウェア接続記述言語（ＴＤＬ）である。
ック情報を含む文書ファイル（入力ファイル）、１２２
は同ロジック情報で表現される論理図、１２３はファイ
ル１２１から抽出された有効データが書き込まれた中間
ファイル（ＤＡＴＡＳファイル）である。また、１３１
は抽出された有効データがビット単位に展開されたビッ
ト配列バッファ、１３２はセル毎に用意されるライブラ
リ、１３３はビット配列バッファ１３１から変換された
ハードウェア接続記述言語（ＴＤＬ）である。
【００２３】以下、図１乃至図１３を参照しながら本発
明実施例の動作について説明する。まずＣＰＵ１は、主
記憶２に格納されたエディタプログラムを使用して、キ
ーボード３にて入力され、作成された、例えば図１２に
示す文書ファイル（入力ファイル）１２１をオープンす
る（図５ステップ５１）。そしてＣＰＵ１は、以下に述
べるように入力ファイル１２１を１レコードずつ順に読
んで、表あるいは式形式にて表現されたロジック情報を
抽出する。
明実施例の動作について説明する。まずＣＰＵ１は、主
記憶２に格納されたエディタプログラムを使用して、キ
ーボード３にて入力され、作成された、例えば図１２に
示す文書ファイル（入力ファイル）１２１をオープンす
る（図５ステップ５１）。そしてＣＰＵ１は、以下に述
べるように入力ファイル１２１を１レコードずつ順に読
んで、表あるいは式形式にて表現されたロジック情報を
抽出する。
【００２４】即ちＣＰＵ１は、入力ファイル１２１を１
レコードずつ読み（図５ステップ５２）、まずＭコマン
ドをサーチしてモジュール名を抽出する（図５ステップ
５３，５４）。そしてＣＰＵ１は、変換ファイルを作成
するために出力ファイルをオープンし、モジュール名を
書き込む。（図５ステップ５５，５６）。
レコードずつ読み（図５ステップ５２）、まずＭコマン
ドをサーチしてモジュール名を抽出する（図５ステップ
５３，５４）。そしてＣＰＵ１は、変換ファイルを作成
するために出力ファイルをオープンし、モジュール名を
書き込む。（図５ステップ５５，５６）。
【００２５】次にＣＰＵ１は入力ファイル１２１からの
レコード読み込みを続け（図６ステップ６１）、今度は
Ｉコマンドをサーチすることにより入力信号を抽出して
出力ファイルに書き込む。（図６ステップ６２，６３）
。
レコード読み込みを続け（図６ステップ６１）、今度は
Ｉコマンドをサーチすることにより入力信号を抽出して
出力ファイルに書き込む。（図６ステップ６２，６３）
。
【００２６】次にＣＰＵ１は入力ファイル１２１からの
レコード読み込みを続け（図６ステップ６４）、今度は
Ｏコマンドをサーチすることにより出力信号を抽出して
出力ファイルに書き込む。（図６ステップ６５，６６）
。
レコード読み込みを続け（図６ステップ６４）、今度は
Ｏコマンドをサーチすることにより出力信号を抽出して
出力ファイルに書き込む。（図６ステップ６５，６６）
。
【００２７】そしてＣＰＵ１は入力ファイル１２１から
のレコード読み込みを続け（図７ステップ７１）、Ｂコ
マンドを検出して双方向信号を抽出したならば、それを
出力ファイルに書き込む（図７ステップ７２，７３）。 またＳコマンドを検出したならば（図７ステップ７４）
、ＣＰＵ１は入力ファイル１２１内の表（表形式で記述
されたロジック情報）をハードウェア接続記述言語（Ｔ
ＤＬ）に変換する処理（図７ステップ７５）を実行する
。この変換（ＴＤＬ変換）処理の手順は図８乃至図１１
に示すようにサブルーチン化されており、詳細は後述す
る。
のレコード読み込みを続け（図７ステップ７１）、Ｂコ
マンドを検出して双方向信号を抽出したならば、それを
出力ファイルに書き込む（図７ステップ７２，７３）。 またＳコマンドを検出したならば（図７ステップ７４）
、ＣＰＵ１は入力ファイル１２１内の表（表形式で記述
されたロジック情報）をハードウェア接続記述言語（Ｔ
ＤＬ）に変換する処理（図７ステップ７５）を実行する
。この変換（ＴＤＬ変換）処理の手順は図８乃至図１１
に示すようにサブルーチン化されており、詳細は後述す
る。
【００２８】更にＣＰＵ１は、入力ファイル１２１から
のレコード読み込みでＤコマンドを検出したならば、式
による直接記述処理を行なう（図７ステップ７６，７７
）。同様にＣコマンドを検出したならば、ＣＰＵ１はコ
メント処理を行なう（図７ステップ７８，７９）。最後
にＣＰＵ１は、Ｆコマンドのサーチを行ない、出力ファ
イルへの書き込み処理を行なう。
のレコード読み込みでＤコマンドを検出したならば、式
による直接記述処理を行なう（図７ステップ７６，７７
）。同様にＣコマンドを検出したならば、ＣＰＵ１はコ
メント処理を行なう（図７ステップ７８，７９）。最後
にＣＰＵ１は、Ｆコマンドのサーチを行ない、出力ファ
イルへの書き込み処理を行なう。
【００２９】ここで、サブルーチンによるハードウェア
接続記述言語への変換処理（ＴＤＬ変換処理）について
、図８乃至図１１を参照しながら説明する。まずＣＰＵ
１は、表内の有効データを終了マーク（Ｅコマンド）が
検出されるまで中間ファイル（ＤＡＴＡＳファイル）１
２３に書き込み、これをあるバッファ（＃１）に取り込
む（図８ステップ８１，８２）。
接続記述言語への変換処理（ＴＤＬ変換処理）について
、図８乃至図１１を参照しながら説明する。まずＣＰＵ
１は、表内の有効データを終了マーク（Ｅコマンド）が
検出されるまで中間ファイル（ＤＡＴＡＳファイル）１
２３に書き込み、これをあるバッファ（＃１）に取り込
む（図８ステップ８１，８２）。
【００３０】そしてＣＰＵ１は、バッファ（＃１）の出
力信号をビット配列バッファ１３１に格納し（図８ステ
ップ８３）、ビット幅のある信号はビット展開してビッ
ト配列バッファ１３１に書き込む（図８ステップ８４）
。ＣＰＵ１はこの処理を、セル毎に用意されるライブラ
リ１３２の出力信号数分だけループする。
力信号をビット配列バッファ１３１に格納し（図８ステ
ップ８３）、ビット幅のある信号はビット展開してビッ
ト配列バッファ１３１に書き込む（図８ステップ８４）
。ＣＰＵ１はこの処理を、セル毎に用意されるライブラ
リ１３２の出力信号数分だけループする。
【００３１】同様にＣＰＵ１は、バッファ（＃１）の入
力信号をビット配列バッファ１３１に格納し（図９ステ
ップ９１）、ビット幅のある信号はビット展開してビッ
ト配列バッファ１３１に書き込む（図９ステップ９２）
。ＣＰＵ１はこの処理を、セル毎に用意されるライブラ
リ１３２の入力信号数分だけループする。
力信号をビット配列バッファ１３１に格納し（図９ステ
ップ９１）、ビット幅のある信号はビット展開してビッ
ト配列バッファ１３１に書き込む（図９ステップ９２）
。ＣＰＵ１はこの処理を、セル毎に用意されるライブラ
リ１３２の入力信号数分だけループする。
【００３２】最後にＣＰＵ１は、ライブラリ１３２の配
列情報に従ってビット配列バッファ１３１のデータを配
置してハードウェア接続記述言語（ＴＤＬ）１３３を作
成し、出力ファイルに書き込む（図９ステップ９３）。 そして表の終了マーク（Ｅコマンド）を検出すると（図
９ステップＳ９４）、一連のＴＤＬ変換処理は終了とな
る。
列情報に従ってビット配列バッファ１３１のデータを配
置してハードウェア接続記述言語（ＴＤＬ）１３３を作
成し、出力ファイルに書き込む（図９ステップ９３）。 そして表の終了マーク（Ｅコマンド）を検出すると（図
９ステップＳ９４）、一連のＴＤＬ変換処理は終了とな
る。
【００３３】
【発明の効果】以上説明のように本発明によれば、見や
すい機能図、論理図表現が可能となり、ハードウェア接
続記述言語への変換が高速化される。また、ハードウェ
ア内部仕様書、機能図（ブロック図）、論理展開情報等
を１個の文書ファイルに集積することができ、かつ、仕
様作成、機能設計、論理設計を自分が使用しているワー
ドプロセッサあるいはエディタ等一つの環境で実現でき
る。
すい機能図、論理図表現が可能となり、ハードウェア接
続記述言語への変換が高速化される。また、ハードウェ
ア内部仕様書、機能図（ブロック図）、論理展開情報等
を１個の文書ファイルに集積することができ、かつ、仕
様作成、機能設計、論理設計を自分が使用しているワー
ドプロセッサあるいはエディタ等一つの環境で実現でき
る。
【図１】本発明を適用するシステムの実施例を示すブロ
ック構成図。
ック構成図。
【図２】同実施例にて用いられる「表」表現されるロジ
ック情報の一例を示す図。
ック情報の一例を示す図。
【図３】同実施例にて用いられる「表」表現されるロジ
ック情報の一例を示す図。
ック情報の一例を示す図。
【図４】同実施例にて用いられる「式」表現されるロジ
ック情報の一例を示す図。
ック情報の一例を示す図。
【図５】上記ロジック情報をハードウェア接続記述言語
に変換するためのプログラムの処理概要を示すフローチ
ャートの部分図。
に変換するためのプログラムの処理概要を示すフローチ
ャートの部分図。
【図６】同フローチャートの他の部分図。
【図７】同フローチャートの残りの部分図。
【図８】図７に示すハードウェア接続記述言語への変換
処理（ステップ７５）を実現するためのサブルーチンの
具体的処理手順を示す部分図。
処理（ステップ７５）を実現するためのサブルーチンの
具体的処理手順を示す部分図。
【図９】同サブルーチンの具体的処理手順を示す他の部
分図。
分図。
【図１０】同サブルーチンの具体的処理手順を示す更に
他の部分図。
他の部分図。
【図１１】同サブルーチンの具体的処理手順を示す残り
の部分図。
の部分図。
【図１２】表形式のロジック情報を含むファイルから有
効データを抽出してハードウェア接続記述言語に変換す
る場合の動作を４ビットラッチを例に説明するための動
作説明図の一部を示す図。
効データを抽出してハードウェア接続記述言語に変換す
る場合の動作を４ビットラッチを例に説明するための動
作説明図の一部を示す図。
【図１３】同動作説明図の残りを示す図。
１…ＣＰＵ、２…主記憶、３…キーボード（ＫＢ）、４
…ディスプレイ（ＤＩＳＰ）、５…外部ファイル装置、
６…システムバス、１２１…入力ファイル（文書ファイ
ル）、１２３…中間ファイル、１３１…ビット配列バッ
ファ、１３３…ＴＤＬ（ハードウェア接続記述言語）。
…ディスプレイ（ＤＩＳＰ）、５…外部ファイル装置、
６…システムバス、１２１…入力ファイル（文書ファイ
ル）、１２３…中間ファイル、１３１…ビット配列バッ
ファ、１３３…ＴＤＬ（ハードウェア接続記述言語）。
Claims (2)
- 【請求項１】 論理あるいは機能を表または式の形式
にて表現したロジック情報を含む文書ファイルをテキス
トエディタを使用することにより作成し、ここで作成さ
れた文書ファイルの中から上記のロジック情報を抽出し
、表または式からハードウェア接続記述言語に変換する
ことを特徴とするハードウェア設計方式。 - 【請求項２】 表から有効データを抽出してこれをビ
ット単位に展開してビット配列データを生成し、セル毎
に用意されるライブラリの配列情報に従って上記のビッ
ト配列データを再配置しハードウェア接続記述言語に変
換することを特徴とする請求項１記載のハードウェア設
計方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3142070A JPH0786886B2 (ja) | 1991-06-13 | 1991-06-13 | ハードウェア設計システム及び方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3142070A JPH0786886B2 (ja) | 1991-06-13 | 1991-06-13 | ハードウェア設計システム及び方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04367075A true JPH04367075A (ja) | 1992-12-18 |
| JPH0786886B2 JPH0786886B2 (ja) | 1995-09-20 |
Family
ID=15306733
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3142070A Expired - Lifetime JPH0786886B2 (ja) | 1991-06-13 | 1991-06-13 | ハードウェア設計システム及び方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0786886B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07306879A (ja) * | 1994-05-11 | 1995-11-21 | Nec Corp | ネットリスト・ハードウェア記述変換装置 |
| JP2009223697A (ja) * | 2008-03-17 | 2009-10-01 | Ricoh Co Ltd | 検証装置及び検証方法 |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63211467A (ja) * | 1987-02-27 | 1988-09-02 | Fujitsu Ltd | 回路構成復元方式 |
| JPH01239671A (ja) * | 1988-03-18 | 1989-09-25 | Nec Corp | 会話型レイアウト構造記述生成方式 |
| JPH02247780A (ja) * | 1989-03-22 | 1990-10-03 | Toshiba Corp | Ｌｓｉ設計支援システム |
-
1991
- 1991-06-13 JP JP3142070A patent/JPH0786886B2/ja not_active Expired - Lifetime
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63211467A (ja) * | 1987-02-27 | 1988-09-02 | Fujitsu Ltd | 回路構成復元方式 |
| JPH01239671A (ja) * | 1988-03-18 | 1989-09-25 | Nec Corp | 会話型レイアウト構造記述生成方式 |
| JPH02247780A (ja) * | 1989-03-22 | 1990-10-03 | Toshiba Corp | Ｌｓｉ設計支援システム |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07306879A (ja) * | 1994-05-11 | 1995-11-21 | Nec Corp | ネットリスト・ハードウェア記述変換装置 |
| JP2009223697A (ja) * | 2008-03-17 | 2009-10-01 | Ricoh Co Ltd | 検証装置及び検証方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0786886B2 (ja) | 1995-09-20 |
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