JPH0441672U - - Google Patents

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JPH0441672U
JPH0441672U JP8300890U JP8300890U JPH0441672U JP H0441672 U JPH0441672 U JP H0441672U JP 8300890 U JP8300890 U JP 8300890U JP 8300890 U JP8300890 U JP 8300890U JP H0441672 U JPH0441672 U JP H0441672U
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semiconductor integrated
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block
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Description

【図面の簡単な説明】
第1図はこの考案の一実施例による半導体集積
回路装置を示す回路図、第2図はこの考案の一実
施例による試験判定回路内の回路図、第3図およ
び第4図はこの考案の他の実施例を示す試験判定
回路内の回路図、第5図は従来の半導体集積回路
装置の回路図である。 1は外部入力ピン、2は外部出力ピン、3はス
キヤン入力ピン、4はスキヤン出力ピン、5はフ
リツプフロツプ、6は組合せ回路、7はスキヤン
回路、8は診断結果出力ピン、9は選択回路、1
0は回路ブロツク、11はバス制御回路、12は
試験判定回路、13は第1の回路ブロツクの出力
、14は回路ブロツク(第1を除く)の出力、1
5は一致回路、16はNAND回路、17はテス
ト周期カウントクロツク、18はテスト周期カウ
ンタ、18はイネーブル付フリツプフロツプ、2
0はエンコーダ、21はRAMアドレスカウンタ
、22はフリツプフロツプ、23はOR回路、2
4はNOR回路、25はRAM、26はパラレル
ーシリアル変換回路、27は診断モード入力、2
8は診断結果読み出しクロツク。なお、図中、同
一符号は同一、又は相当部分を示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. 基本回路ブロツクが複数個並んだ構成を持つ半
    導体集積回路装置において、第1の回路ブロツク
    に印加する信号が他の全ての回路ブロツクにも印
    加されるような選択回路と、第1の回路ブロツク
    の出力信号と他の回路ブロツクの出力信号が全て
    同じであるかどうかを判定しもし異なつていれば
    エラー信号を生成する試験判定回路とを備えたこ
    とを特徴とする半導体集積回路装置。
JP8300890U 1990-08-04 1990-08-04 Pending JPH0441672U (ja)

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JP8300890U JPH0441672U (ja) 1990-08-04 1990-08-04

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JPH0441672U true JPH0441672U (ja) 1992-04-08

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ID=31630318

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