JPH044340U - - Google Patents

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JPH044340U
JPH044340U JP4212490U JP4212490U JPH044340U JP H044340 U JPH044340 U JP H044340U JP 4212490 U JP4212490 U JP 4212490U JP 4212490 U JP4212490 U JP 4212490U JP H044340 U JPH044340 U JP H044340U
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information processing
processing device
processing devices
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  • Multi Processors (AREA)

Description

【図面の簡単な説明】
第１図はこの考案の一実施例によるデジタル情
報処理装置の構成図、第２図は従来のデジタル情
報処理装置の構成図である。 １は双方向データバス、２は主系情報処理装置
、３は冗長系情報処理装置、４ａ及び４ｂはデー
タ交信回路、５ａは情報処理回路、５ｂは冗長系
情報処理回路、６は故障検出回路、７は入出力停
止回路、８は冗長系起動用デイスクリート信号線
、９は冗長系起動回路、１０はセンサー情報処理
回路、１１ａ及び１１ｂは同期回路、１２ａ及び
１２ｂは自系正常動作確認回路、１３ａ及び１３
ｂは冗長系入出力抑止回路、１４ａ及び１４ｂは
全入出力停止回路、１５ａ及び１５ｂは主系交換
回路である。なお、図中、同一符号は同一または
相当部分を示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. 双方向の通信手段を用いて、３台以上の情報処
    理装置間並びに単数あるいは複数台のセンサとの
    間で、データの交信を行う回路と、上記データ交
    信回路を用いたデータ交信により、複数台の情報
    処理装置の同期をとる回路と、上記データ交信回
    路を用いて各情報処理装置からの出力を比較し、
    主系情報処理装置と自系情報処理装置の正常動作
    を確認する回路と、上記動作確認回路により正常
    と確認された情報処理装置の内、一系のみを主系
    とし、それ以外の冗長系の情報処理装置からの上
    記の同期及び動作確認の為のデータ交信以外の入
    出力を抑止する回路と、上記動作確認回路により
    自系を異常と判断した場合、自系の入出力をせべ
    て抑止する回路と、予め定められた間隔で主系を
    交換する回路とを有することを特徴としたデジタ
    ル情報処理装置。
JP4212490U 1990-04-20 1990-04-20 Pending JPH044340U (ja)

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JP4212490U JPH044340U (ja) 1990-04-20 1990-04-20

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JPH044340U true JPH044340U (ja) 1992-01-16

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ID=31553390

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JP4212490U Pending JPH044340U (ja) 1990-04-20 1990-04-20

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0447622U (ja) * 1990-08-24 1992-04-22

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0447622U (ja) * 1990-08-24 1992-04-22

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