JPH05206457A - Mos形電界効果トランジスタ半導体装置 - Google Patents
Mos形電界効果トランジスタ半導体装置Info
- Publication number
- JPH05206457A JPH05206457A JP3725292A JP3725292A JPH05206457A JP H05206457 A JPH05206457 A JP H05206457A JP 3725292 A JP3725292 A JP 3725292A JP 3725292 A JP3725292 A JP 3725292A JP H05206457 A JPH05206457 A JP H05206457A
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- JP
- Japan
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- effect transistor
- semiconductor device
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- transistor semiconductor
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- Pending
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Abstract
(57)【要約】
【目的】 微細化が可能で、サージ耐圧の高いMOS形
電界効果トランジスタ半導体装置を提供する。 【構成】 MOS形電界効果トランジスタ半導体装置の
N+ 活性化領域2を素子分離するフィールド酸化膜3の
上に層間絶縁膜4aを介してポリサイド層7を設け、こ
のポリサイド層7と金属配線5cをオーミックコンタク
トで接続し、金属配線5cに接地電位を印加する。
電界効果トランジスタ半導体装置を提供する。 【構成】 MOS形電界効果トランジスタ半導体装置の
N+ 活性化領域2を素子分離するフィールド酸化膜3の
上に層間絶縁膜4aを介してポリサイド層7を設け、こ
のポリサイド層7と金属配線5cをオーミックコンタク
トで接続し、金属配線5cに接地電位を印加する。
Description
【0001】
【産業上の利用分野】この発明はMOS形電界効果トラ
ンジスタ半導体装置に関し、特にMOS形電界効果トラ
ンジスタのデバイス構造に関するものである。
ンジスタ半導体装置に関し、特にMOS形電界効果トラ
ンジスタのデバイス構造に関するものである。
【0002】
【従来の技術】図2は従来のMOSFETトランジスタ
のデバイス構造を示す断面図であり、図において、1は
P- 型Si基板、2はN型のイオン注入により形成され
たN+ 活性化領域、3はフィールド酸化膜、4はN+ 活
性化領域2と金属配線の間の層間絶縁膜、5a,5bは
金属配線で、オーミックコンタクト部6を介してN+ 活
性化領域2と接続されている。
のデバイス構造を示す断面図であり、図において、1は
P- 型Si基板、2はN型のイオン注入により形成され
たN+ 活性化領域、3はフィールド酸化膜、4はN+ 活
性化領域2と金属配線の間の層間絶縁膜、5a,5bは
金属配線で、オーミックコンタクト部6を介してN+ 活
性化領域2と接続されている。
【0003】次に動作について説明する。今、金属配線
5aが高電位(VCC)に接続され、金属配線5bが低電
位(VSS又は1/2VCC)に接続されているとする。そ
して、チップ外部からVCCの端子に極めて急峻な正のサ
ージが与えられると、これまでは両電位はフィールド酸
化膜3によって電気的に分離されていたが、該急峻な正
のサージによって、金属配線5aにオーミック接続され
たN+ 活性化領域2から、基板1を通して、金属配線5
bにオーミック接続されたN+ 活性化領域2に電流が流
れることとなる。この現象が比較的長い時間起こると、
オーミックコンタクト部6が電荷の集中によって破壊さ
れることとなる。
5aが高電位(VCC)に接続され、金属配線5bが低電
位(VSS又は1/2VCC)に接続されているとする。そ
して、チップ外部からVCCの端子に極めて急峻な正のサ
ージが与えられると、これまでは両電位はフィールド酸
化膜3によって電気的に分離されていたが、該急峻な正
のサージによって、金属配線5aにオーミック接続され
たN+ 活性化領域2から、基板1を通して、金属配線5
bにオーミック接続されたN+ 活性化領域2に電流が流
れることとなる。この現象が比較的長い時間起こると、
オーミックコンタクト部6が電荷の集中によって破壊さ
れることとなる。
【0004】
【発明が解決しようとする課題】従来のMOSFETト
ランジスタは以上のように構成されているので、サージ
耐圧が低く、上記オーミックコンタクト部の破壊の問題
を解決するためには、フィールド酸化膜3の厚さを厚く
したり、フィールド酸化膜3部の幅を広くしたり、また
金属配線5aを高融点材料であるポリサイドに変えたり
しなければならず、装置の微細化には適さないなどの問
題があった。
ランジスタは以上のように構成されているので、サージ
耐圧が低く、上記オーミックコンタクト部の破壊の問題
を解決するためには、フィールド酸化膜3の厚さを厚く
したり、フィールド酸化膜3部の幅を広くしたり、また
金属配線5aを高融点材料であるポリサイドに変えたり
しなければならず、装置の微細化には適さないなどの問
題があった。
【0005】この発明は上記のような問題点を解消する
ためになされたもので、微細化できるとともに、さらに
サージ耐圧の高いMOS形電界効果トランジスタ半導体
装置を得ることを目的としている。
ためになされたもので、微細化できるとともに、さらに
サージ耐圧の高いMOS形電界効果トランジスタ半導体
装置を得ることを目的としている。
【0006】
【課題を解決するための手段】この発明に係るMOS形
電界効果トランジスタ半導体装置は、素子分離用のフィ
ールド酸化膜の上に層間絶縁膜を介して高融点材料のポ
リサイド層を置き、このポリサイド層と金属配線をオー
ミックコンタクトで接続し、前記金属配線に接地電位を
印加するようにしたものである。
電界効果トランジスタ半導体装置は、素子分離用のフィ
ールド酸化膜の上に層間絶縁膜を介して高融点材料のポ
リサイド層を置き、このポリサイド層と金属配線をオー
ミックコンタクトで接続し、前記金属配線に接地電位を
印加するようにしたものである。
【0007】
【作用】この発明におけるMOS形電界効果トランジス
タ半導体装置は、素子分離用のフィールド酸化膜の上に
層間絶縁膜を介して高融点材料のポリサイド層を置き、
このポリサイド層と金属配線をオーミックコンタクトで
接続し、前記金属配線に接地電位を印加するようにした
ので、サージが外部から与えられてもフィールド酸化膜
の下を通って電流が流れるということが起こりにくくな
る。
タ半導体装置は、素子分離用のフィールド酸化膜の上に
層間絶縁膜を介して高融点材料のポリサイド層を置き、
このポリサイド層と金属配線をオーミックコンタクトで
接続し、前記金属配線に接地電位を印加するようにした
ので、サージが外部から与えられてもフィールド酸化膜
の下を通って電流が流れるということが起こりにくくな
る。
【0008】
【実施例】以下、この発明の一実施例を図について説明
する。図1は本発明の一実施例によるMOS形電界効果
トランジスタ半導体装置を示し、図において、1はP-
Si基板、2はN型のイオン注入により形成されたN+
活性化領域、3は素子分離用フィールド酸化膜、5a,
5b,5cは金属配線、4a,4bはそれぞれN+ 活性
化領域2とポリサイド層7間の層間絶縁膜,ポリサイド
層7と金属配線5a,5b,5c間の層間絶縁膜であ
り、5a,5b,5cは金属配線であり、これらはオー
ミックコンタクト部6,8を介してN+ 活性化領域2と
ポリサイド層7に接続されている。
する。図1は本発明の一実施例によるMOS形電界効果
トランジスタ半導体装置を示し、図において、1はP-
Si基板、2はN型のイオン注入により形成されたN+
活性化領域、3は素子分離用フィールド酸化膜、5a,
5b,5cは金属配線、4a,4bはそれぞれN+ 活性
化領域2とポリサイド層7間の層間絶縁膜,ポリサイド
層7と金属配線5a,5b,5c間の層間絶縁膜であ
り、5a,5b,5cは金属配線であり、これらはオー
ミックコンタクト部6,8を介してN+ 活性化領域2と
ポリサイド層7に接続されている。
【0009】次に動作について説明する。金属配線5a
が高電位(VCC)に接続され、金属配線5bが低電位
(VSS,あるいは1/2VCC)に接続され、金属配線5
cが接地電位(VSS)に接続されている。金属配線5c
は接地電位(VSS)が印加され、オーミックコンタクト
部8を介してポリサイド層7に接続されているので、ポ
リサイド層7の下地であるフィールド酸化膜3を通し
て、基板1には接地電位が与えられる。これにより、チ
ップ外部からVCC端子に急峻な正のサージが与えられて
も、素子分離用のフィールド酸化膜3の下地である基板
1には、逆電位が与えられているので、高電位(VCC)
が印加されているN+ 活性化領域2から、P- 基板1を
通して、低電位(VSS,1/2VCC)が印加されている
N+ 活性化領域2にパンチスルー電流が流れるのを防ぐ
ことができる。このように本実施例によれば、サージ耐
圧が高く、微細化の可能なMOS形電界効果トランジス
タ半導体装置を得ることができる。
が高電位(VCC)に接続され、金属配線5bが低電位
(VSS,あるいは1/2VCC)に接続され、金属配線5
cが接地電位(VSS)に接続されている。金属配線5c
は接地電位(VSS)が印加され、オーミックコンタクト
部8を介してポリサイド層7に接続されているので、ポ
リサイド層7の下地であるフィールド酸化膜3を通し
て、基板1には接地電位が与えられる。これにより、チ
ップ外部からVCC端子に急峻な正のサージが与えられて
も、素子分離用のフィールド酸化膜3の下地である基板
1には、逆電位が与えられているので、高電位(VCC)
が印加されているN+ 活性化領域2から、P- 基板1を
通して、低電位(VSS,1/2VCC)が印加されている
N+ 活性化領域2にパンチスルー電流が流れるのを防ぐ
ことができる。このように本実施例によれば、サージ耐
圧が高く、微細化の可能なMOS形電界効果トランジス
タ半導体装置を得ることができる。
【0010】
【発明の効果】以上のように、この発明に係るMOS形
電界効果トランジスタによれば、素子分離用のフィール
ド酸化膜の上に層間絶縁膜を介して高融点材料のポリサ
イド層を置き、このポリサイド層と金属配線をオーミッ
クコンタクトで接続し、前記金属配線に接地電位を印加
するようにしたので、小面積でサージ耐圧の高いMOS
形電界効果トランジスタ半導体装置が得られる効果があ
る。
電界効果トランジスタによれば、素子分離用のフィール
ド酸化膜の上に層間絶縁膜を介して高融点材料のポリサ
イド層を置き、このポリサイド層と金属配線をオーミッ
クコンタクトで接続し、前記金属配線に接地電位を印加
するようにしたので、小面積でサージ耐圧の高いMOS
形電界効果トランジスタ半導体装置が得られる効果があ
る。
【図1】この発明の一実施例によるMOS形電界効果ト
ランジスタ半導体装置の断面図である。
ランジスタ半導体装置の断面図である。
【図2】従来のMOS形電界効果トランジスタ半導体装
置の断面図である。
置の断面図である。
1 P- 基板 2 N+ 活性化領域 3 素子分離用フィールド酸化膜 4 層間絶縁膜 5 金属配線 6 オーミックコンタクト部(N+ −金属配線) 7 ポリサイド 8 オーミックコンタクト部(ポリサイド−金属配線)
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.5 識別記号 庁内整理番号 FI 技術表示箇所 // H01L 29/46 D 7738−4M
Claims (1)
- 【請求項1】 素子領域及び該素子領域を分離するフィ
ールド酸化膜を有するMOS形電界効果トランジスタ半
導体装置において、 上記フィールド酸化膜上に層間絶縁膜を介して設けられ
た高融点材料であるポリサイド層と、 上記ポリサイド層とオーミックコンタクトで接続され、
接地電位を印加した金属配線とを備えたことを特徴とす
るMOS形電界効果トランジスタ半導体装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3725292A JPH05206457A (ja) | 1992-01-27 | 1992-01-27 | Mos形電界効果トランジスタ半導体装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3725292A JPH05206457A (ja) | 1992-01-27 | 1992-01-27 | Mos形電界効果トランジスタ半導体装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05206457A true JPH05206457A (ja) | 1993-08-13 |
Family
ID=12492455
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3725292A Pending JPH05206457A (ja) | 1992-01-27 | 1992-01-27 | Mos形電界効果トランジスタ半導体装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05206457A (ja) |
-
1992
- 1992-01-27 JP JP3725292A patent/JPH05206457A/ja active Pending
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