JPH05334187A - メモリオーバレイ管理方式 - Google Patents
メモリオーバレイ管理方式Info
- Publication number
- JPH05334187A JPH05334187A JP4141170A JP14117092A JPH05334187A JP H05334187 A JPH05334187 A JP H05334187A JP 4141170 A JP4141170 A JP 4141170A JP 14117092 A JP14117092 A JP 14117092A JP H05334187 A JPH05334187 A JP H05334187A
- Authority
- JP
- Japan
- Prior art keywords
- memory
- module
- overlay
- logical page
- modules
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Withdrawn
Links
- 230000006870 function Effects 0.000 claims abstract description 12
- 238000013507 mapping Methods 0.000 claims abstract description 6
- 238000007726 management method Methods 0.000 claims 6
- 238000010586 diagram Methods 0.000 description 2
- 238000000034 method Methods 0.000 description 2
- 230000004044 response Effects 0.000 description 1
Landscapes
- Memory System Of A Hierarchy Structure (AREA)
Abstract
(57)【要約】
【目的】巨大化しつつあるプログラムによるメモリ不足
の問題に対し、既存のプログラム構造を変更する事なし
に、モジュール単位に仮想メモリをプログラムに割り当
てる方式を提供しメモリ不足対策のための工数増大と納
期遅延及び、品質の低下を回避する。 【構成】メモリ管理モジュール2によってプログラム1
の各モジュールA〜Dに仮想メモリ4の割り当てを行
う。メモリ管理テーブル5とスタックテーブル6によっ
て要求したモジュールと仮想メモリ4の関連付けを行
う。
の問題に対し、既存のプログラム構造を変更する事なし
に、モジュール単位に仮想メモリをプログラムに割り当
てる方式を提供しメモリ不足対策のための工数増大と納
期遅延及び、品質の低下を回避する。 【構成】メモリ管理モジュール2によってプログラム1
の各モジュールA〜Dに仮想メモリ4の割り当てを行
う。メモリ管理テーブル5とスタックテーブル6によっ
て要求したモジュールと仮想メモリ4の関連付けを行
う。
Description
【0001】
【産業上の利用分野】本発明は、メモリオーバレイ管理
方式、特に、巨大化しつつあるプログラムによるメモリ
不足を解消するためのメモリオーバレイ管理方式に関す
る。
方式、特に、巨大化しつつあるプログラムによるメモリ
不足を解消するためのメモリオーバレイ管理方式に関す
る。
【0002】
【従来の技術】従来のメモリオーバレイ管理方式は手続
き部のみのオーバレイを行っていた。
き部のみのオーバレイを行っていた。
【0003】このためメモリ不足の場合にはプログラム
の構造や構成を変更することによって対処していた。
の構造や構成を変更することによって対処していた。
【0004】
【発明が解決しようとする課題】しかしながら、このよ
うな上述した従来のメモリオーバレイ管理方式は、メモ
リ不足の対処法として既存のプログラム構造を大幅に変
更する必要がある。また、プログラム構造を変更しても
メモリ不足を回避できない場合、プログラムの構成を変
更する必要がある。そのため上位工程のの再検討が必要
となり多大な後戻り作業が発生する場合があるという欠
点があった。
うな上述した従来のメモリオーバレイ管理方式は、メモ
リ不足の対処法として既存のプログラム構造を大幅に変
更する必要がある。また、プログラム構造を変更しても
メモリ不足を回避できない場合、プログラムの構成を変
更する必要がある。そのため上位工程のの再検討が必要
となり多大な後戻り作業が発生する場合があるという欠
点があった。
【0005】
【課題を解決するための手段】本発明のメモリオーバレ
イ管理方式は、仮想メモリの論理ページを要求モジュー
ルに対し関連付ける機能と、ウィンドメモリと論理ペー
ジをマッピングする機能と、モジュール構成に従って要
求モジュールに論理ページを関連付ける機能と、これら
の機能を既存のプログラムに組み込むことによりプログ
ラム構造を変更することなしにデータ部のオーバレイを
実現することができる機能を有して構成される。
イ管理方式は、仮想メモリの論理ページを要求モジュー
ルに対し関連付ける機能と、ウィンドメモリと論理ペー
ジをマッピングする機能と、モジュール構成に従って要
求モジュールに論理ページを関連付ける機能と、これら
の機能を既存のプログラムに組み込むことによりプログ
ラム構造を変更することなしにデータ部のオーバレイを
実現することができる機能を有して構成される。
【0006】
【実施例】次に、本発明の実施例について図面を参照し
て説明する。
て説明する。
【0007】図1は本発明の一実施例を示すシステム構
成図である。
成図である。
【0008】図1に示すメモリオーバレイ管理方式は、
プログラム1と、メモリ管理テーブル5およびスタック
テーブル6を含むメモリ管理モジュール2と、ウィンド
メモリ3と、仮想メモリ4とを含んで構成される。
プログラム1と、メモリ管理テーブル5およびスタック
テーブル6を含むメモリ管理モジュール2と、ウィンド
メモリ3と、仮想メモリ4とを含んで構成される。
【0009】プログラム1は、データ部のオーバレイを
行っており複数のモジュールA〜Dで構成されている。
行っており複数のモジュールA〜Dで構成されている。
【0010】メモリ管理モジュール2は、モジュールA
〜Dより要求されたメモリを仮想メモリ4へ割り当てる
機能をコントロールするものである。
〜Dより要求されたメモリを仮想メモリ4へ割り当てる
機能をコントロールするものである。
【0011】ウィンドメモリ3は、モジュールA〜Dに
渡される実アドレスを持つ領域である。
渡される実アドレスを持つ領域である。
【0012】仮想メモリ4はモジュールA〜Dの実デー
タが格納されている仮想メモリ領域(外部記憶装置)で
ある。
タが格納されている仮想メモリ領域(外部記憶装置)で
ある。
【0013】メモリ管理テーブル5は、モジュールA〜
Dより要求された仮想メモリ4の論理ページP1,P2
・・・と要求したモジュールA,B・・・とを関連付け
るためのモジュール名Mと論理ページ番号Pとが対にな
ったテーブルである。
Dより要求された仮想メモリ4の論理ページP1,P2
・・・と要求したモジュールA,B・・・とを関連付け
るためのモジュール名Mと論理ページ番号Pとが対にな
ったテーブルである。
【0014】スタックテーブル6は、下位モジュールB
〜Dから上位モジュールA〜Cに制御が戻った時、上位
モジュールA〜Cのデータを仮想メモリ4からウィンド
メモリ3にロードするための、モジュール名Mをスタッ
クしておくテーブルである。
〜Dから上位モジュールA〜Cに制御が戻った時、上位
モジュールA〜Cのデータを仮想メモリ4からウィンド
メモリ3にロードするための、モジュール名Mをスタッ
クしておくテーブルである。
【0015】次に、図1に示すメモリオーバレイ管理方
式の動作を図1を参照して説明する。
式の動作を図1を参照して説明する。
【0016】まず、データオーバレイを使用したプログ
ラム1が実行される。
ラム1が実行される。
【0017】これに応じて先頭のモジュールAのデータ
部の先頭のアドレスをウィンドメモリ3にマッピングす
る。
部の先頭のアドレスをウィンドメモリ3にマッピングす
る。
【0018】この結果、メモリ管理モジュール2に制御
が移る。
が移る。
【0019】これにより、メモリ管理テーブル5に要求
したモジュール名MとしてのモジュールA〜Dと論理ペ
ージ番号Pとしての論理ページP1〜P4が登録され
る。(既に登録されている場合は時処理へ行く。)次
に、メモリ管理テーブル5に登録された論理ページP1
〜P4にウィンドメモリ3をマッピングする。
したモジュール名MとしてのモジュールA〜Dと論理ペ
ージ番号Pとしての論理ページP1〜P4が登録され
る。(既に登録されている場合は時処理へ行く。)次
に、メモリ管理テーブル5に登録された論理ページP1
〜P4にウィンドメモリ3をマッピングする。
【0020】スタックテーブルにモジュール名Mとして
モジュールAをスタックし、モジュールC〜Dについて
も同様に実行される。
モジュールAをスタックし、モジュールC〜Dについて
も同様に実行される。
【0021】最下位のモジュールDが終了した時、スタ
ックテーブル6より上位モジュールCを検索する。
ックテーブル6より上位モジュールCを検索する。
【0022】検索したモジュールCにリンクされている
論理ページP3をメモリ管理テーブル2より捜しウィン
ドメモリ3へのマッピングを実行する。
論理ページP3をメモリ管理テーブル2より捜しウィン
ドメモリ3へのマッピングを実行する。
【0023】スタックカウンタを減ずる。
【0024】これらの動作を先頭のモジュールAが終了
するまで繰り返す。
するまで繰り返す。
【0025】
【発明の効果】本発明のメモリオーバレイ管理方式は、
データ部のオーバレイ機能を追加することにより、プロ
グラム開発において既存のプログラム構造を変更するこ
となしに、短期間、低コスト、高品質にてメモリ不足を
解消することを実現できるという効果がある。
データ部のオーバレイ機能を追加することにより、プロ
グラム開発において既存のプログラム構造を変更するこ
となしに、短期間、低コスト、高品質にてメモリ不足を
解消することを実現できるという効果がある。
【図1】本発明の一実施例を示すシステム構成図であ
る。
る。
1 プログラム 2 メモリ管理モジュール 3 ウィンドメモリ 4 仮想メモリ 5 メモリ管理テーブル 6 スタックテーブル A〜D モジュール P1〜P4 論理ページ M モジュール名 P 論理ページ番号
Claims (3)
- 【請求項1】 仮想メモリの論理ページを要求モジュー
ルに対し関連付ける機能と、ウィンドメモリと論理ペー
ジをマッピングする機能と、モジュール構成に従って要
求モジュールに論理ページを関連付ける機能と、これら
の機能を既存のプログラムに組み込む事によりプログラ
ム構造を変更することなしにデータ部のオーバレイを実
現することができるメモリオーバレイ管理方式。 - 【請求項2】 論理ページとモジュールとを関連付け、
要求されたモジュールに対応した論理ページをデータ部
を含めてウィンドメモリにマッピングすることを特徴と
するメモリオーバレイ管理方式。 - 【請求項3】 複数のモジュールからなるプログラム
と、複数の論理ページからなる仮想メモリと、前記モジ
ュールと前記論理ページとを関連づけるメモリ管理テー
ブルおよび前記モジュールの実行順にモジュール名をス
タックするスタックテーブルを含むメモリ管理モジュー
ルと、要求モジュールに応じてメモリ管理モジュールを
参照しながら仮想メモリの論理ページがマッピングされ
るウィンドメモリとを含むことを特徴とするメモリオー
バレイ管理方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4141170A JPH05334187A (ja) | 1992-06-02 | 1992-06-02 | メモリオーバレイ管理方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4141170A JPH05334187A (ja) | 1992-06-02 | 1992-06-02 | メモリオーバレイ管理方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05334187A true JPH05334187A (ja) | 1993-12-17 |
Family
ID=15285769
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4141170A Withdrawn JPH05334187A (ja) | 1992-06-02 | 1992-06-02 | メモリオーバレイ管理方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05334187A (ja) |
-
1992
- 1992-06-02 JP JP4141170A patent/JPH05334187A/ja not_active Withdrawn
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19990803 |