JPH0537348A - 出力回路 - Google Patents
出力回路Info
- Publication number
- JPH0537348A JPH0537348A JP3193981A JP19398191A JPH0537348A JP H0537348 A JPH0537348 A JP H0537348A JP 3193981 A JP3193981 A JP 3193981A JP 19398191 A JP19398191 A JP 19398191A JP H0537348 A JPH0537348 A JP H0537348A
- Authority
- JP
- Japan
- Prior art keywords
- transistor
- output
- base
- emitter
- collector
- Prior art date
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- Pending
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Abstract
(57)【要約】
【目的】 バイポーラトランジスタ出力回路の応答特性
を改善することである。 【構成】 コレクタを出力とする出力トランジスタＱ４
のベース，エミッタ間に、出力トランジスタと逆極性の
トランジスタＱ５を、コレクタまたはエミッタを開放に
して順方向に接続する。
を改善することである。 【構成】 コレクタを出力とする出力トランジスタＱ４
のベース，エミッタ間に、出力トランジスタと逆極性の
トランジスタＱ５を、コレクタまたはエミッタを開放に
して順方向に接続する。
Description
【０００１】
【産業上の利用分野】本発明は、バイポーラトランジス
タから成る出力回路に関するものである。
タから成る出力回路に関するものである。
【０００２】
【従来の技術】バイポーラトランジスタを用いたオープ
ンコレクタ出力回路の従来例を図３に示す。図３に於い
て、Ｑ４はオープンコレクタの出力ＮＰＮトランジス
タ、Ｒ３は負荷抵抗であり、ＮＰＮトランジスタＱ１，
Ｑ２，Ｑ３と抵抗Ｒ１，Ｒ２とで、出力トランジスタＱ
４のベースをドライブする回路を構成している。Ｑ１ベ
ース電位（入力）が“Ｈ”（高電位）になると、Ｑ４が
オンして、出力は“Ｌ”（低電位）となり、Ｑ１ベース
電位が“Ｌ”になると、Ｑ４はオフとなり、出力は
“Ｈ”となるように動作する。すなわち、全体でインバ
ータ回路を構成している。
ンコレクタ出力回路の従来例を図３に示す。図３に於い
て、Ｑ４はオープンコレクタの出力ＮＰＮトランジス
タ、Ｒ３は負荷抵抗であり、ＮＰＮトランジスタＱ１，
Ｑ２，Ｑ３と抵抗Ｒ１，Ｒ２とで、出力トランジスタＱ
４のベースをドライブする回路を構成している。Ｑ１ベ
ース電位（入力）が“Ｈ”（高電位）になると、Ｑ４が
オンして、出力は“Ｌ”（低電位）となり、Ｑ１ベース
電位が“Ｌ”になると、Ｑ４はオフとなり、出力は
“Ｈ”となるように動作する。すなわち、全体でインバ
ータ回路を構成している。
【０００３】
【発明が解決しようとする課題】ところで、Ｑ４は通常
オン状態で飽和しており、オンからオフに変化する場
合、ドライブ電流が無くなっても、Ｑ４のベースに残留
する蓄積電荷のために、入力の変化から出力の変化まで
多少の時間遅れが生じる。この時間遅れは、Ｑ４のオー
バードライブが大きい程顕著になる。
オン状態で飽和しており、オンからオフに変化する場
合、ドライブ電流が無くなっても、Ｑ４のベースに残留
する蓄積電荷のために、入力の変化から出力の変化まで
多少の時間遅れが生じる。この時間遅れは、Ｑ４のオー
バードライブが大きい程顕著になる。
【０００４】本発明は、上記時間遅れを小さくするため
の一手段を提供するものである。
の一手段を提供するものである。
【０００５】
【課題を解決するための手段】上記課題を解決するた
め、出力トランジスタのベースに、コレクタ端子または
エミッタ端子を開放状態にした、出力トランジスタとは
逆極性のトランジスタのエミッタまたはコレクタを接続
し、前記出力トランジスタのエミッタと同電位に、前記
逆極性トランジスタのベースを直接または抵抗を介して
接続する。
め、出力トランジスタのベースに、コレクタ端子または
エミッタ端子を開放状態にした、出力トランジスタとは
逆極性のトランジスタのエミッタまたはコレクタを接続
し、前記出力トランジスタのエミッタと同電位に、前記
逆極性トランジスタのベースを直接または抵抗を介して
接続する。
【０００６】また、出力トランジスタのベースに、コレ
クタ端子またはエミッタ端子を開放状態にした、出力ト
ランジスタと同一極性（同タイプ）のトランジスタのベ
ースを接続し、前記出力トランジスタのエミッタと同電
位に、前記同一極性トランジスタのエミッタまたはコレ
クタを直接または抵抗を介して接続する。
クタ端子またはエミッタ端子を開放状態にした、出力ト
ランジスタと同一極性（同タイプ）のトランジスタのベ
ースを接続し、前記出力トランジスタのエミッタと同電
位に、前記同一極性トランジスタのエミッタまたはコレ
クタを直接または抵抗を介して接続する。
【０００７】
【作用】上記逆極性トランジスタまたは同一極性トラン
ジスタを設けることにより、出力トランジスタベース蓄
積電荷の放電が促進される。したがって、応答性が改善
される。
ジスタを設けることにより、出力トランジスタベース蓄
積電荷の放電が促進される。したがって、応答性が改善
される。
【０００８】
【実施例】以下，実施例に基づいて本発明を詳細に説明
する。
する。
【０００９】図１は請求項１記載の本発明の一実施例の
回路構成図である。
回路構成図である。
【００１０】図１（ａ）に於いて、Ｑ４はオープンコレ
クタの出力ＮＰＮトランジスタ、Ｒ３は負荷抵抗であ
り、ＮＰＮトランジスタＱ１，Ｑ２，Ｑ３と抵抗Ｒ１，
Ｒ２とで、出力トランジスタＱ４のベースをドライブす
る回路を構成している。Ｑ５は出力トランジスタＱ４の
ベースの蓄積電荷を放電するためのＰＮＰトランジスタ
であって、コレクタ端子が開放になっている。Ｒ４は放
電効果調整用の抵抗であって、０Ω（直接接続）のとき
が、最も効果が大きくなる。
クタの出力ＮＰＮトランジスタ、Ｒ３は負荷抵抗であ
り、ＮＰＮトランジスタＱ１，Ｑ２，Ｑ３と抵抗Ｒ１，
Ｒ２とで、出力トランジスタＱ４のベースをドライブす
る回路を構成している。Ｑ５は出力トランジスタＱ４の
ベースの蓄積電荷を放電するためのＰＮＰトランジスタ
であって、コレクタ端子が開放になっている。Ｒ４は放
電効果調整用の抵抗であって、０Ω（直接接続）のとき
が、最も効果が大きくなる。
【００１１】図１（ｂ）は、放電用トランジスタをエミ
ッタ開放にして接続したものであり、図１（ａ）と同様
の効果がある。
ッタ開放にして接続したものであり、図１（ａ）と同様
の効果がある。
【００１２】図２は請求項２記載の本発明の一実施例の
回路構成図である。
回路構成図である。
【００１３】図２（ａ）において、Ｑ４はオープンコレ
クタの出力ＮＰＮトランジスタ、Ｒ３は負荷抵抗であ
り、ＮＰＮトランジスタＱ１，Ｑ２，Ｑ３と抵抗Ｒ１，
Ｒ２とで、出力トランジスタＱ４のベースをドライブす
る回路を構成している。Ｑ５は出力トランジスタＱ４の
ベースの蓄積電荷を放電するためのＮＰＮトランジスタ
であって、コレクタ端子が開放になっている。Ｒ４は放
電効果調整用の抵抗であって、０Ω（直接接続）のとき
が、最も効果が大きくなる。
クタの出力ＮＰＮトランジスタ、Ｒ３は負荷抵抗であ
り、ＮＰＮトランジスタＱ１，Ｑ２，Ｑ３と抵抗Ｒ１，
Ｒ２とで、出力トランジスタＱ４のベースをドライブす
る回路を構成している。Ｑ５は出力トランジスタＱ４の
ベースの蓄積電荷を放電するためのＮＰＮトランジスタ
であって、コレクタ端子が開放になっている。Ｒ４は放
電効果調整用の抵抗であって、０Ω（直接接続）のとき
が、最も効果が大きくなる。
【００１４】図２（ｂ）は、放電用トランジスタをエミ
ッタ開放にして接続したものであり、図２（ａ）と同様
の効果がある。
ッタ開放にして接続したものであり、図２（ａ）と同様
の効果がある。
【００１５】
【発明の効果】以上詳細に説明したように、本発明によ
れば、簡単な構成で、出力応答特性を改善することがで
きるものである。
れば、簡単な構成で、出力応答特性を改善することがで
きるものである。
【図１】本発明の実施例の回路構成図である。
【図２】本発明の実施例の回路構成図である。
【図３】従来例の回路構成図である。
Ｑ１，Ｑ２，Ｑ３ ＮＰＮトランジスタ
Ｑ４ 出力ＮＰＮトランジスタ
Ｑ５ 放電用トランジスタ
Ｒ１，Ｒ２ 抵抗
Ｒ３ 負荷抵抗
Ｒ４ 放電効果調整用抵抗
Claims (2)
- 【請求項１】 コレクタを出力とする出力トランジスタ
と、該出力トランジスタのベースをドライブする回路
と、コレクタ端子またはエミッタ端子を開放状態にし
た、前記出力トランジスタとは逆極性の、前記出力トラ
ンジスタのベース蓄積電荷放電用トランジスタとを有す
る出力回路であって、前記放電用トランジスタのエミッ
タまたはコレクタが前記出力トランジスタのベースに接
続され、ベースが直接または抵抗を介して前記出力トラ
ンジスタのエミッタと同電位に接続されて成ることを特
徴とする出力回路。 - 【請求項２】 コレクタを出力とする出力トランジスタ
と、該出力トランジスタのベースをドライブする回路
と、コレクタ端子またはエミッタ端子を開放状態にし
た、前記出力トランジスタと同一極性の、前記出力トラ
ンジスタのベース蓄積電荷放電用トランジスタとを有す
る出力回路であって、前記放電用トランジスタのベース
が前記出力トランジスタのベースに接続され、エミッタ
またはコレクタが直接または抵抗を介して前記出力トラ
ンジスタのエミッタと同電位に接続されて成ることを特
徴とする出力回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3193981A JPH0537348A (ja) | 1991-08-02 | 1991-08-02 | 出力回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3193981A JPH0537348A (ja) | 1991-08-02 | 1991-08-02 | 出力回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0537348A true JPH0537348A (ja) | 1993-02-12 |
Family
ID=16316995
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3193981A Pending JPH0537348A (ja) | 1991-08-02 | 1991-08-02 | 出力回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0537348A (ja) |
Citations (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60118A (ja) * | 1983-03-16 | 1985-01-05 | フエアチアイルド・カメラ・アンド・インストルメント・コ−ポレ−シヨン | Ｔｔｌ出力段 |
| JPS61224728A (ja) * | 1985-03-29 | 1986-10-06 | Nec Corp | Ｅｃｌ−ｔｔｌインタ−フエ−ス回路 |
| JPS62128A (ja) * | 1985-06-26 | 1987-01-06 | Toshiba Corp | ２値信号出力回路 |
| JPH0199317A (ja) * | 1987-10-12 | 1989-04-18 | Ricoh Co Ltd | 温度補償付レベルシフト回路 |
| JPH0230216A (ja) * | 1988-07-20 | 1990-01-31 | Fujitsu Ltd | Ｔｔｌ回路 |
-
1991
- 1991-08-02 JP JP3193981A patent/JPH0537348A/ja active Pending
Patent Citations (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60118A (ja) * | 1983-03-16 | 1985-01-05 | フエアチアイルド・カメラ・アンド・インストルメント・コ−ポレ−シヨン | Ｔｔｌ出力段 |
| JPS61224728A (ja) * | 1985-03-29 | 1986-10-06 | Nec Corp | Ｅｃｌ−ｔｔｌインタ−フエ−ス回路 |
| JPS62128A (ja) * | 1985-06-26 | 1987-01-06 | Toshiba Corp | ２値信号出力回路 |
| JPH0199317A (ja) * | 1987-10-12 | 1989-04-18 | Ricoh Co Ltd | 温度補償付レベルシフト回路 |
| JPH0230216A (ja) * | 1988-07-20 | 1990-01-31 | Fujitsu Ltd | Ｔｔｌ回路 |
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