JPH0564483B2 - - Google Patents
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- Publication number
- JPH0564483B2 JPH0564483B2 JP20752584A JP20752584A JPH0564483B2 JP H0564483 B2 JPH0564483 B2 JP H0564483B2 JP 20752584 A JP20752584 A JP 20752584A JP 20752584 A JP20752584 A JP 20752584A JP H0564483 B2 JPH0564483 B2 JP H0564483B2
- Authority
- JP
- Japan
- Prior art keywords
- section
- oscillation
- sections
- resonant circuit
- oscillation frequency
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
- 230000010355 oscillation Effects 0.000 claims description 52
- 239000003990 capacitor Substances 0.000 description 5
- 238000010586 diagram Methods 0.000 description 4
- 230000000694 effects Effects 0.000 description 1
- 230000002093 peripheral effect Effects 0.000 description 1
- 230000005855 radiation Effects 0.000 description 1
Landscapes
- Inductance-Capacitance Distribution Constants And Capacitance-Resistance Oscillators (AREA)
Description
【発明の詳細な説明】
＜産業上の利用分野＞
本発明は、発振回路に関し、さらに詳しくは、
オペレーシヨンアンプを用いて発振周波数の切換
えが可能なようにした発振回路に関する。
オペレーシヨンアンプを用いて発振周波数の切換
えが可能なようにした発振回路に関する。
＜従来の技術＞
第２図は従来例の発振回路の構成図である。第
２図において、１は正転入力部１ａ，１ｂを２つ
有するオペレーシヨナルアンプである。１ｃ，１
ｄはそれぞれこのオペレーシヨナルアンプ１の逆
転入力部と出力部である。このオペレーシヨナル
アンプ１の出力部１ｄには、コンデンサＣ１と抵
抗Ｒ１との直列回路からなる第１共振回路部２ａ
と、同じくコンデンサＣ２と抵抗Ｒ２との直列回
路からなる第２共振回路部２ｂとの各一端が共通
に接続され、オペレーシヨナルアンプ１の各正転
入力部１ａ，１ｂには、前記第１、第２共振回路
部２ａ，２ｂの他方端が個別に接続される。第１
共振回路部２ａと接地部３との間および第２共振
回路部２ｂと接地部３との間にそれぞれ第３、第
４共振回路部２ｃ，２ｄが接続される。
２図において、１は正転入力部１ａ，１ｂを２つ
有するオペレーシヨナルアンプである。１ｃ，１
ｄはそれぞれこのオペレーシヨナルアンプ１の逆
転入力部と出力部である。このオペレーシヨナル
アンプ１の出力部１ｄには、コンデンサＣ１と抵
抗Ｒ１との直列回路からなる第１共振回路部２ａ
と、同じくコンデンサＣ２と抵抗Ｒ２との直列回
路からなる第２共振回路部２ｂとの各一端が共通
に接続され、オペレーシヨナルアンプ１の各正転
入力部１ａ，１ｂには、前記第１、第２共振回路
部２ａ，２ｂの他方端が個別に接続される。第１
共振回路部２ａと接地部３との間および第２共振
回路部２ｂと接地部３との間にそれぞれ第３、第
４共振回路部２ｃ，２ｄが接続される。
このような構成の従来例の発振回路において
は、前記第１、第３共振回路部２ａ，２ｃとによ
り第１発振周波数ｆ１が決定され、第２、第４共
振回路部２ｂ，２ｄとにより第２発振周波数ｆ２
が決定されるようになつており、これらの発振周
波数の切換えは、発振周波数切換信号によつて行
なわれるように構成されている。
は、前記第１、第３共振回路部２ａ，２ｃとによ
り第１発振周波数ｆ１が決定され、第２、第４共
振回路部２ｂ，２ｄとにより第２発振周波数ｆ２
が決定されるようになつており、これらの発振周
波数の切換えは、発振周波数切換信号によつて行
なわれるように構成されている。
このような発振回路において、例えば、今、第
１、第３共振回路部２ａ，２ｃによつて周波数ｆ
１の発振が行なわれているとすると、発振周波数
の選択されない非選択側の第２、第４共振回路部
２ｂ，２ｄによる発振レベルは０レベルでなけれ
ばならない。ところが、オペレーシヨナルアンプ
１の出力部１ｄと第１、第２共振回路部２ａ，２
ｂとは共通に接続されているために、非選択側で
ある第２、第４共振回路部２ｂ，２ｄが選択側の
影響を受け、このため、オペレーシヨナルアンプ
１の出力レベルの（z1″R）／（z2＋z1″R）倍の出
力がこの非選択側に現われることになる。
１、第３共振回路部２ａ，２ｃによつて周波数ｆ
１の発振が行なわれているとすると、発振周波数
の選択されない非選択側の第２、第４共振回路部
２ｂ，２ｄによる発振レベルは０レベルでなけれ
ばならない。ところが、オペレーシヨナルアンプ
１の出力部１ｄと第１、第２共振回路部２ａ，２
ｂとは共通に接続されているために、非選択側で
ある第２、第４共振回路部２ｂ，２ｄが選択側の
影響を受け、このため、オペレーシヨナルアンプ
１の出力レベルの（z1″R）／（z2＋z1″R）倍の出
力がこの非選択側に現われることになる。
ここで、z1は第４共振回路部２ｄのインピーダ
ンス、z2は第２共振回路部２ｄのインピーダン
ス、Ｒはオペレーシヨナルアンプ１の入力インピ
ーダンス、z1″Rはz1とＲとの並列インピーダンス
である。
ンス、z2は第２共振回路部２ｄのインピーダン
ス、Ｒはオペレーシヨナルアンプ１の入力インピ
ーダンス、z1″Rはz1とＲとの並列インピーダンス
である。
このような非選択側に現われる出力は、他の周
辺機器に対して輻射され、それに好ましくない影
響を与えるので、このような出力の発生はなくす
ようにすることが望ましい。
辺機器に対して輻射され、それに好ましくない影
響を与えるので、このような出力の発生はなくす
ようにすることが望ましい。
＜発明が解決しようとする問題点＞
本発明は、上述の点に鑑みて成されたものであ
つて、発振周波数の選択されない非選択側の共振
回路部からの不要な輻射を可及的に低減すること
を目的とする。
つて、発振周波数の選択されない非選択側の共振
回路部からの不要な輻射を可及的に低減すること
を目的とする。
＜問題点を解決するための手段＞
正転または逆転の入力部を少なくとも２つ有す
るオペレーシヨナルアンプを備え、このオペレー
シヨナルアンプの出力部には、第１、第２共振回
路部の各一方端が共通に接続され、また、前記各
入力部には、第１、第２共振回路部の各他方端が
個別に接続され、さらに、前記第１、第２共振回
路部と接地部との間に、それぞれ第３、第４共振
回路部が個別に接続され、前記第１、第３共振回
路部とにより第１発振周波数が、第２、第４共振
回路部とにより第２発振周波数がそれぞれ決定さ
れるとともに、外部から与えられる発振周波数切
換信号により前記各発振周波数の選択切換えが行
われる発振回路において、 前記発振周波数切換信号に同期して動作するス
イツチ手段を設け、前記各入力部の内、前記スイ
ツチ手段により発振周波数が選択されない非選択
側の第３共振回路部あるいは第４共振回路部に接
続された入力部と接地部とを電気的に短絡するよ
うにしている。
るオペレーシヨナルアンプを備え、このオペレー
シヨナルアンプの出力部には、第１、第２共振回
路部の各一方端が共通に接続され、また、前記各
入力部には、第１、第２共振回路部の各他方端が
個別に接続され、さらに、前記第１、第２共振回
路部と接地部との間に、それぞれ第３、第４共振
回路部が個別に接続され、前記第１、第３共振回
路部とにより第１発振周波数が、第２、第４共振
回路部とにより第２発振周波数がそれぞれ決定さ
れるとともに、外部から与えられる発振周波数切
換信号により前記各発振周波数の選択切換えが行
われる発振回路において、 前記発振周波数切換信号に同期して動作するス
イツチ手段を設け、前記各入力部の内、前記スイ
ツチ手段により発振周波数が選択されない非選択
側の第３共振回路部あるいは第４共振回路部に接
続された入力部と接地部とを電気的に短絡するよ
うにしている。
＜実施例＞
以下、図面によつて本発明の実施例について詳
細に説明する。第１図は本発明の一実施例の発振
回路の構成図であり、第２図に対応する部分には
同一の参照符を付す。
細に説明する。第１図は本発明の一実施例の発振
回路の構成図であり、第２図に対応する部分には
同一の参照符を付す。
この実施例の発振回路は、正転入力部１ａ，１
ｂを２つ有するオペレーシヨナルアンプ１′を備
える。このオペレーシヨナルアンプ１′の出力部
１ｄには、コンデンサＣ１と抵抗Ｒ１との直列回
路からなる第１共振回路部２ａと、同じくコンデ
ンサＣ２と抵抗Ｒ２との直列回路からなる第２共
振回路部２ｂとの各一端が共通に接続され、オペ
レーシヨナルアンプ１′の各正転入力部１ａ，１
ｂには、前記第１、第２共振回路部２ａ，２ｂの
他方端が個別に接続される。第１共振回路部２ａ
と接地部３との間および第２共振回路部２ｂと接
地部３との間には、それぞれ第３、第４共振回路
部２ｃ，２ｄが接続される。この第３、第４共振
回路部２ｃ，２ｄは、例えば、コイルとコンデン
サとより成る。オペレーシヨナルアンプ１′の逆
転入力部１ｃと出力部１ｄとの間および逆転入力
部１ｃと接地部３との間には、抵抗Ｒ３，Ｒ４が
それぞれ接続される。
ｂを２つ有するオペレーシヨナルアンプ１′を備
える。このオペレーシヨナルアンプ１′の出力部
１ｄには、コンデンサＣ１と抵抗Ｒ１との直列回
路からなる第１共振回路部２ａと、同じくコンデ
ンサＣ２と抵抗Ｒ２との直列回路からなる第２共
振回路部２ｂとの各一端が共通に接続され、オペ
レーシヨナルアンプ１′の各正転入力部１ａ，１
ｂには、前記第１、第２共振回路部２ａ，２ｂの
他方端が個別に接続される。第１共振回路部２ａ
と接地部３との間および第２共振回路部２ｂと接
地部３との間には、それぞれ第３、第４共振回路
部２ｃ，２ｄが接続される。この第３、第４共振
回路部２ｃ，２ｄは、例えば、コイルとコンデン
サとより成る。オペレーシヨナルアンプ１′の逆
転入力部１ｃと出力部１ｄとの間および逆転入力
部１ｃと接地部３との間には、抵抗Ｒ３，Ｒ４が
それぞれ接続される。
このような構成の発振回路では、第１、第３共
振回路部２ａ，２ｃによつて第１発振周波数ｆ１
が決定され、第２、第４共振回路部２ｂ，２ｄに
よつて第２発振周波数ｆ２が決定される。これら
の発振周波数ｆ１，ｆ２の選択は、発振周波数切
換信号によつて行なわれる。
振回路部２ａ，２ｃによつて第１発振周波数ｆ１
が決定され、第２、第４共振回路部２ｂ，２ｄに
よつて第２発振周波数ｆ２が決定される。これら
の発振周波数ｆ１，ｆ２の選択は、発振周波数切
換信号によつて行なわれる。
この実施例の発振回路では、発振周波数が選択
されない非選択側の共振回路部の影響を可及的に
低減するために、発振周波数切換信号に同期して
動作するスイツチ手段としての第１、第２スイツ
チングトランジスタTr１，Tr２をそれぞれ設け
ている。第１、第２スイツチングトランジスタ
Tr１，Tr２の各コレクタは、正転入力部１ａ，
１ｂにそれぞれ接続され、各エミツタはそれぞれ
接地される。第１スイツチングトランジスタTr
１のベースはインバータ４を介して、また、第２
スイツチングトランジスタTr２は直接に、それ
ぞれ発振周波数切換信号の入力端子５に接続され
る。したがつて、第１、第３共振回路部２ａ，２
ｂによつて発振が行なれる場合には、入力端子５
からハイレベルの発振周波数切換信号が与えら
れ、これによつて第２スイツチングトランジスタ
Tr２が導通し、非選択側の第２、第４共振回路
部２ｂ，２ｄに接続された入力部１ｂと第２スイ
ツチングトランジスタTr２の接地部とが電気的
に短絡され、オペレーシヨナルアンプ１′の入力
インピーダンスが小さくなる。これによつて、発
振周波数の選択されない非選択側の第２、第４共
振回路部２ｂ，２ｄが、選択側によるオペレーシ
ヨナルアンプ１′の出力の影響を大幅に低減させ
ることが可能となる。
されない非選択側の共振回路部の影響を可及的に
低減するために、発振周波数切換信号に同期して
動作するスイツチ手段としての第１、第２スイツ
チングトランジスタTr１，Tr２をそれぞれ設け
ている。第１、第２スイツチングトランジスタ
Tr１，Tr２の各コレクタは、正転入力部１ａ，
１ｂにそれぞれ接続され、各エミツタはそれぞれ
接地される。第１スイツチングトランジスタTr
１のベースはインバータ４を介して、また、第２
スイツチングトランジスタTr２は直接に、それ
ぞれ発振周波数切換信号の入力端子５に接続され
る。したがつて、第１、第３共振回路部２ａ，２
ｂによつて発振が行なれる場合には、入力端子５
からハイレベルの発振周波数切換信号が与えら
れ、これによつて第２スイツチングトランジスタ
Tr２が導通し、非選択側の第２、第４共振回路
部２ｂ，２ｄに接続された入力部１ｂと第２スイ
ツチングトランジスタTr２の接地部とが電気的
に短絡され、オペレーシヨナルアンプ１′の入力
インピーダンスが小さくなる。これによつて、発
振周波数の選択されない非選択側の第２、第４共
振回路部２ｂ，２ｄが、選択側によるオペレーシ
ヨナルアンプ１′の出力の影響を大幅に低減させ
ることが可能となる。
第２、第４共振回路部２ｂ，２ｄによつて発振
が行なわれる場合には、入力端子５にローレベル
の発振周波数切換信号が与えられ、これがインバ
ータ４でレベル反転されて第１スイツチングトラ
ンジスタTr１に加わるために、第１スイツチン
グトランジスタTr１が導通して非選択側の第１、
第３共振回路部２ａ，２ｃに接続されて入力部１
ａと第１スイツチングトランジスタTr１の接地
部とが電気的に短絡される。なお、前記第１、第
２発振周波数ｆ１，ｆ２は共に同じ場合や、互い
に異なる場合を含むものである。
が行なわれる場合には、入力端子５にローレベル
の発振周波数切換信号が与えられ、これがインバ
ータ４でレベル反転されて第１スイツチングトラ
ンジスタTr１に加わるために、第１スイツチン
グトランジスタTr１が導通して非選択側の第１、
第３共振回路部２ａ，２ｃに接続されて入力部１
ａと第１スイツチングトランジスタTr１の接地
部とが電気的に短絡される。なお、前記第１、第
２発振周波数ｆ１，ｆ２は共に同じ場合や、互い
に異なる場合を含むものである。
＜発明の効果＞
以上のように本発明によれば、発振周波数切換
信号に同期して動作するスイツチ手段を設け、オ
ペレーシヨナルアンプの各入力部の内、前記スイ
ツチ手段により発振周波数が選択されない非選択
側の共振回路部に接続された入力と接地部とを電
気的に短絡するようにしたので、発振周波数の選
択されない非選択側の共振回路部からの不要な輻
射を可及部に低減することが可能となる。
信号に同期して動作するスイツチ手段を設け、オ
ペレーシヨナルアンプの各入力部の内、前記スイ
ツチ手段により発振周波数が選択されない非選択
側の共振回路部に接続された入力と接地部とを電
気的に短絡するようにしたので、発振周波数の選
択されない非選択側の共振回路部からの不要な輻
射を可及部に低減することが可能となる。
第１図は本発明の一実施例の発振回路の構成
図、第２図は従来例の発振回路の構成図である。 １，１′……オペレーシヨナルアンプ、２ａ，
２ｂ，２ｃ，２ｄ……共振回路部、３……接地
部、１ａ，１ｂ，１ｃ……入力部、１ｄ……出力
部、Tr１，Tr２……第１、第２スイツチングト
ランジスタ。
図、第２図は従来例の発振回路の構成図である。 １，１′……オペレーシヨナルアンプ、２ａ，
２ｂ，２ｃ，２ｄ……共振回路部、３……接地
部、１ａ，１ｂ，１ｃ……入力部、１ｄ……出力
部、Tr１，Tr２……第１、第２スイツチングト
ランジスタ。
Claims (1)
- 【特許請求の範囲】 １ 正転（または逆転）の入力部を少なくとも２
つ有するオペレーシヨナルアンプを備え、このオ
ペレーシヨナルアンプの出力部には、第１、第２
共振回路部の各一方端が共通に接続され、また、
前記各入力部には、第１、第２共振回路部の各他
方端が個別に接続され、さらに、前記第１、第２
共振回路部と接地部との間に、それぞれ第３、第
４共振回路部が個別に接続され、前記第１、第３
共振回路部とにより第１発振周波数が、第２、第
４共振回路部とにより第２発振周波数がそれぞれ
決定されるとともに、外部から与えられる発振周
波数切換信号により前記各発振周波数の選択切換
えが行われる発振回路において、 前記発振周波数切換信号に同期して動作するス
イツチ手段を設け、前記各入力部の内、前記スイ
ツチ手段により発振周波数が選択されない非選択
側の第３共振回路部あるいは第４共振回路部に接
続された入力部と接地部とを電気的に短絡するこ
とを特徴とする発振回路。 ２ 前記特許請求の範囲第１項に記載の発振回路
において、前記スイツチ手段がスイツチングトラ
ンジスタである発振回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20752584A JPS6184906A (ja) | 1984-10-03 | 1984-10-03 | 発振回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20752584A JPS6184906A (ja) | 1984-10-03 | 1984-10-03 | 発振回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6184906A JPS6184906A (ja) | 1986-04-30 |
| JPH0564483B2 true JPH0564483B2 (ja) | 1993-09-14 |
Family
ID=16541157
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP20752584A Granted JPS6184906A (ja) | 1984-10-03 | 1984-10-03 | 発振回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6184906A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04160924A (ja) * | 1990-10-25 | 1992-06-04 | Nec Ic Microcomput Syst Ltd | 半導体集積回路 |
-
1984
- 1984-10-03 JP JP20752584A patent/JPS6184906A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6184906A (ja) | 1986-04-30 |
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