JPS6184906A - 発振回路 - Google Patents
発振回路Info
- Publication number
- JPS6184906A JPS6184906A JP20752584A JP20752584A JPS6184906A JP S6184906 A JPS6184906 A JP S6184906A JP 20752584 A JP20752584 A JP 20752584A JP 20752584 A JP20752584 A JP 20752584A JP S6184906 A JPS6184906 A JP S6184906A
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- JP
- Japan
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- section
- circuit
- oscillation frequency
- oscillation
- resonant circuit
- Prior art date
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- Granted
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- 230000010355 oscillation Effects 0.000 claims abstract description 63
- 230000005855 radiation Effects 0.000 abstract description 3
- 230000000694 effects Effects 0.000 abstract description 2
- 230000003247 decreasing effect Effects 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 4
- 239000003990 capacitor Substances 0.000 description 2
- 230000002093 peripheral effect Effects 0.000 description 1
- 230000001360 synchronised effect Effects 0.000 description 1
Landscapes
- Inductance-Capacitance Distribution Constants And Capacitance-Resistance Oscillators (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〈産業」−の利用分野〉
本発明は、発振回路に関し、さらに詳しくは、−オベレ
ーノぢナルアンプを用いて発振周波数の切換えが１１１
能なようにした発振回路に関する。
ーノぢナルアンプを用いて発振周波数の切換えが１１１
能なようにした発振回路に関する。
く従来の技術〉
第２図は従来例の発振回路の構成図である。第２図にお
いて、ｌは正転入力圧１ ａ、 ｌ ｂを２つ有４”ろ
オベレーノヨ→・ルアンプである。ｌｃ、Ｉｄはそれぞ
れこのオペレーショナルアンプ１の逆転入力部と出力部
である。このオペレーンヨナルアンプｌの各正転入力部
１ ａ、 Ｉ ｂと出力部１ｄとの間にそれぞれ１氏抗
１ｔ１．ｎ２とコンデンサＣ１，Ｃ２とて＋１■成され
ｌ−第１．第２共振回路部２ ａ、 ２ ｂが個別に接
続さＩＩ、ろ。第１共振回路部２ａと接地部３との間お
よび第２４１； 振回路部２ｂと接地部３との問にそれ
ぞれ第３．第４共振回路部２ｃ、２ｄが接続される。
いて、ｌは正転入力圧１ ａ、 ｌ ｂを２つ有４”ろ
オベレーノヨ→・ルアンプである。ｌｃ、Ｉｄはそれぞ
れこのオペレーショナルアンプ１の逆転入力部と出力部
である。このオペレーンヨナルアンプｌの各正転入力部
１ ａ、 Ｉ ｂと出力部１ｄとの間にそれぞれ１氏抗
１ｔ１．ｎ２とコンデンサＣ１，Ｃ２とて＋１■成され
ｌ−第１．第２共振回路部２ ａ、 ２ ｂが個別に接
続さＩＩ、ろ。第１共振回路部２ａと接地部３との間お
よび第２４１； 振回路部２ｂと接地部３との問にそれ
ぞれ第３．第４共振回路部２ｃ、２ｄが接続される。
このような構成の従来例の発振回路においては、＋ｉｉ
ｉ記第１．第３Ｊｌｉ振回路部２ ａ、 ２ ｃとによ
り第１発振周波敗ｒ１が決定され、第２．第４共振回路
部２ｂ、２ｄとにより第２発振周波敗ｒ２が決定される
ようになっており、これらの発振周波数の切換えは、発
振周波数切換信号によって行なわれるように構成されて
いる。
ｉ記第１．第３Ｊｌｉ振回路部２ ａ、 ２ ｃとによ
り第１発振周波敗ｒ１が決定され、第２．第４共振回路
部２ｂ、２ｄとにより第２発振周波敗ｒ２が決定される
ようになっており、これらの発振周波数の切換えは、発
振周波数切換信号によって行なわれるように構成されて
いる。
このような発振回路において、例えば、今、第１、第３
ノ（振回路部２ ａ、 ２ ｃによって周波数ｒ１の発
振が行なわれているとすると、発振周波数の選択されな
い非選択側の第２．第４共振回路部２ｂ。
ノ（振回路部２ ａ、 ２ ｃによって周波数ｒ１の発
振が行なわれているとすると、発振周波数の選択されな
い非選択側の第２．第４共振回路部２ｂ。
２ｄによる発振レベルはＯレベルでなければならない。
ところが、オペレーノヨナルアンブｌの出力部１ｄと第
１．第２共振回路部２ ａ、 ２ ｂとは共通に接続さ
れているために、非選択側である第２゜第４共振回路部
２ ｂ、 ２ ｄか選択側の影響を受け、二のため、オ
ペレーショナルアンプ１の出力レベルの（ｚ＋”Ｒ）／
（Ｚｔ＋ｚＩ／ｌＲ）倍の出力がこの非選択側に現われ
ることになる。
１．第２共振回路部２ ａ、 ２ ｂとは共通に接続さ
れているために、非選択側である第２゜第４共振回路部
２ ｂ、 ２ ｄか選択側の影響を受け、二のため、オ
ペレーショナルアンプ１の出力レベルの（ｚ＋”Ｒ）／
（Ｚｔ＋ｚＩ／ｌＲ）倍の出力がこの非選択側に現われ
ることになる。
ここで、１１は第４ノ１振回路部２ｄのインピーダンス
、ｌ、は第２１１ｊ娠回路詔２ｂのインピーダンス、Ｒ
はオペレーノーＩ−Ｉルアンプ１の人力インピーダンス
、Ｚ、／／ＲはＺｌとＲとの並列インピーダンスである
っこのような非選択側に現われる出力は、他の周辺機器
に対して輻射され、それに好ましくない影響を与えるの
で、二のような出力の発生はなくすよっに４゛ることか
望ましい。
、ｌ、は第２１１ｊ娠回路詔２ｂのインピーダンス、Ｒ
はオペレーノーＩ−Ｉルアンプ１の人力インピーダンス
、Ｚ、／／ＲはＺｌとＲとの並列インピーダンスである
っこのような非選択側に現われる出力は、他の周辺機器
に対して輻射され、それに好ましくない影響を与えるの
で、二のような出力の発生はなくすよっに４゛ることか
望ましい。
〈発明が解決しようとする問題点〉
本発明は、１述の点に鑑みて成されたしのであって、発
振層Ｉｌ数の選択されない非選択側の共振回路部からの
不・次な輻射を可及的に低減することを目的とずろ、。
振層Ｉｌ数の選択されない非選択側の共振回路部からの
不・次な輻射を可及的に低減することを目的とずろ、。
く問題点を解決セろための手段〉
本発明は、１．述の目的を達成するために、正転または
逆転の入力部を少なくと６２つ有するオペレーノジナル
アンプを備え、該オペレーショナルアンプの前記６入力
部と出力部との間に第１．第２ｊｔ−振回路ｉ！を個別
に接続し、前記第１共振回路部と接地部との間および第
２共振回路部と接地部との１ｍにそれぞれ第３．第４共
振口路部を接続し、前記第１．第３共振回路部とにより
第４発振周波敗を決定し、第２．第４共振回路部とによ
り第２発振周波数を決定し、発振周波数切換信号により
＠紀各発振周波敗の選択切換えが行なわれる発振回路に
おいて、前記発振周波数切換信号に同期して動作す゛る
スイッチ手段を設け、前記各入力部の内、前記スイッチ
手段により発振周波数が選択さイ１ない非選択側の第３
または第４兵振回路部に接続された入力部と接地部とを
電気的に短絡するようにしている。
逆転の入力部を少なくと６２つ有するオペレーノジナル
アンプを備え、該オペレーショナルアンプの前記６入力
部と出力部との間に第１．第２ｊｔ−振回路ｉ！を個別
に接続し、前記第１共振回路部と接地部との間および第
２共振回路部と接地部との１ｍにそれぞれ第３．第４共
振口路部を接続し、前記第１．第３共振回路部とにより
第４発振周波敗を決定し、第２．第４共振回路部とによ
り第２発振周波数を決定し、発振周波数切換信号により
＠紀各発振周波敗の選択切換えが行なわれる発振回路に
おいて、前記発振周波数切換信号に同期して動作す゛る
スイッチ手段を設け、前記各入力部の内、前記スイッチ
手段により発振周波数が選択さイ１ない非選択側の第３
または第４兵振回路部に接続された入力部と接地部とを
電気的に短絡するようにしている。
〈実施例〉
以下、図面によって本発明の実施例について詳細に説明
する。第１図は本発明の一実施例の発振回路の構成図で
あり、第２図に対応する部分には同一の参照符を付す。
する。第１図は本発明の一実施例の発振回路の構成図で
あり、第２図に対応する部分には同一の参照符を付す。
こめ実施例の発振回路は、正転入力部１ ａ、 Ｉ ｂ
を２つ有オろオペレーンヨナルアンプビを備える。この
オペレーショナルアンプビの各入力部ｌ ａ、 ｌ ｂ
と出力部１ ｄとの間には、第１．第２ＪＩＨ７ｌｊ回
路！’１ｓ２ａ、２ｂが個別的に接続され、第１ Ｊ％
振回路部２＋１と接地部３との間および第２共振回路部
２ｂと接地部“３との間には、それぞれ第３．第４共振
回路１１１２ｃ、２ｄが接続される。この第３．第４共
振回路部２ ｃ、 ２ ｄは、例えば、コイルとコンデ
ンサとより成る。オペレーノヨナルアノプビの逆転入力
ｒｌ＋ ｌ ｃと出力部１ｄとの間および逆転入力部Ｉ
ｃと接地部３との間には、抵抗Ｒ３，Ｒ４がそれぞれ接
続さイ１ろ、。
を２つ有オろオペレーンヨナルアンプビを備える。この
オペレーショナルアンプビの各入力部ｌ ａ、 ｌ ｂ
と出力部１ ｄとの間には、第１．第２ＪＩＨ７ｌｊ回
路！’１ｓ２ａ、２ｂが個別的に接続され、第１ Ｊ％
振回路部２＋１と接地部３との間および第２共振回路部
２ｂと接地部“３との間には、それぞれ第３．第４共振
回路１１１２ｃ、２ｄが接続される。この第３．第４共
振回路部２ ｃ、 ２ ｄは、例えば、コイルとコンデ
ンサとより成る。オペレーノヨナルアノプビの逆転入力
ｒｌ＋ ｌ ｃと出力部１ｄとの間および逆転入力部Ｉ
ｃと接地部３との間には、抵抗Ｒ３，Ｒ４がそれぞれ接
続さイ１ろ、。
このような構成の発振回路では、第１．第３共振回路部
２ ａ’、 ２ ｃによって第１発振周波敗ｒ１が決定
され、第２．第４ｊｌ［回路部２ｂ、２ｄによって第２
発振周波改「２か決定される。これらの発振周波数ｒ１
．ｒ２の選択は、発振周波数切換信号によって行なわれ
る。
２ ａ’、 ２ ｃによって第１発振周波敗ｒ１が決定
され、第２．第４ｊｌ［回路部２ｂ、２ｄによって第２
発振周波改「２か決定される。これらの発振周波数ｒ１
．ｒ２の選択は、発振周波数切換信号によって行なわれ
る。
この実施例の発振回路では、発振周波数が選択されない
非選択側の共振回路部の影響を可及的に低重４−るため
に、発振周波数切換１３号に同期して動ｒ１・１゛ろス
ｒ・、＝ｆ丁段としての第１．第２スイノチングトラノ
ノスタＴｒｌ 、Ｔｒ２をそれぞれ設けている。第１
第２スイソチングトラノノスタＴｒ１、Ｔｒ２の各コレ
クタは、正転入力部ｌ ａ、 ｌ ｂにそれぞれ接続さ
れ、各エミッタはそれぞれ接地さイ１ろ。第１．第２ス
イツチングトランノスタＴｒｌ 。
非選択側の共振回路部の影響を可及的に低重４−るため
に、発振周波数切換１３号に同期して動ｒ１・１゛ろス
ｒ・、＝ｆ丁段としての第１．第２スイノチングトラノ
ノスタＴｒｌ 、Ｔｒ２をそれぞれ設けている。第１
第２スイソチングトラノノスタＴｒ１、Ｔｒ２の各コレ
クタは、正転入力部ｌ ａ、 ｌ ｂにそれぞれ接続さ
れ、各エミッタはそれぞれ接地さイ１ろ。第１．第２ス
イツチングトランノスタＴｒｌ 。
’ｌ” ｒ ２の各ベースには、発振周波数か選択され
なし・４１選択側のノ（振回路部に接続された入力部と
ス１′−ｒ−ｒ：／グトラ／ノスタの接１ｔ！！＋１＜
とを電気的に短イ；シ４ろための信号か発振周波数切換
信号に同期しで１）んられろ。
なし・４１選択側のノ（振回路部に接続された入力部と
ス１′−ｒ−ｒ：／グトラ／ノスタの接１ｔ！！＋１＜
とを電気的に短イ；シ４ろための信号か発振周波数切換
信号に同期しで１）んられろ。
例えば、第１．第３兵振回路１ＩＩＫ２ａ、２ｃによっ
て発振がイ１なｔ）れる場合には、第２スイツヂ／グト
ラノノスタ′ｒ「２のベースに発振周波数切換信号に同
期した信号か与えられ、これによって第２スイ！チノグ
トランノスクＴｒ２が導通し、非選択側の第２．第４共
振回路部２ｂ、２ｄに接続された入力部１ ｂと第２ス
イツチングトランノスタＴｒ２の接地部とが電気的に短
絡され、オペレーショナルアンプｌ°の入力インピーダ
ンスが小さくなる。
て発振がイ１なｔ）れる場合には、第２スイツヂ／グト
ラノノスタ′ｒ「２のベースに発振周波数切換信号に同
期した信号か与えられ、これによって第２スイ！チノグ
トランノスクＴｒ２が導通し、非選択側の第２．第４共
振回路部２ｂ、２ｄに接続された入力部１ ｂと第２ス
イツチングトランノスタＴｒ２の接地部とが電気的に短
絡され、オペレーショナルアンプｌ°の入力インピーダ
ンスが小さくなる。
これによって、発振周波数の選択されない非選択側の第
２．第４ノ（振回路部２ ｂ、２ ｄが、選択側による
オペレーノヨナルアノプビの出力の影響を大幅に低減さ
Ｕろごとか＝１能となる。
２．第４ノ（振回路部２ ｂ、２ ｄが、選択側による
オペレーノヨナルアノプビの出力の影響を大幅に低減さ
Ｕろごとか＝１能となる。
第２．第４共振回路部２ｂ、２ｄによって発振が行なわ
Ａｔ ”、＋ ｕ’Ｈ合には、同様に第１スイツチ／グ
トラノノスタ’ｌ’ ｒ ｌ ／Ｊ”１７通して非選択
側の第１．第３ Ｊｌｊｌ口振回路ａ、２ｃに接続され
て入力部１ａと第１スイーｌチノｑ’ ｌ、ラノノスタ
Ｔｒｌの接地部とが電気的に短絡されろ。なお、ギｉ記
第１．第２発振周波数ｒ１．ｒ２は」（に同し場合や、
互いに異なる場合を含むしのである。
Ａｔ ”、＋ ｕ’Ｈ合には、同様に第１スイツチ／グ
トラノノスタ’ｌ’ ｒ ｌ ／Ｊ”１７通して非選択
側の第１．第３ Ｊｌｊｌ口振回路ａ、２ｃに接続され
て入力部１ａと第１スイーｌチノｑ’ ｌ、ラノノスタ
Ｔｒｌの接地部とが電気的に短絡されろ。なお、ギｉ記
第１．第２発振周波数ｒ１．ｒ２は」（に同し場合や、
互いに異なる場合を含むしのである。
〈発明の効果〉
以１．のように本発明によれば、発振周波数切換信号に
同期して動作するスイッチ手段を設け、オベレーノ？１
→・ルアンブの各入力部の内、前記スイブヂト１々＋、
：、Ｌり発振周波数が選択されない非選択側の共振回路
部に接続された入力部と接地部とを電気的に１９絡・１
°ろようにしたので、発振周波数の選択されない４１選
択側の共振回路部からの不要な輻射を１１１及的に低減
することが可能となる。
同期して動作するスイッチ手段を設け、オベレーノ？１
→・ルアンブの各入力部の内、前記スイブヂト１々＋、
：、Ｌり発振周波数が選択されない非選択側の共振回路
部に接続された入力部と接地部とを電気的に１９絡・１
°ろようにしたので、発振周波数の選択されない４１選
択側の共振回路部からの不要な輻射を１１１及的に低減
することが可能となる。
第１図は本発明の一実施例の発振回路の構成図、第２図
は従来例の発振回路の構成図である。 １．１’−オペレーンｇナルアンプ、２ ａ、 ２ ｂ
、 ２ｃ、 ２ ｄ−共振回路部、３・・接地部、ｌ
ａ、 ｌ ｂ、 ｌ ｃ・入力部、１ｄ・出力部、Ｔｒ
ｌ、Ｔｒ２−第１．第２スイ！チノグトラノノスタ。
は従来例の発振回路の構成図である。 １．１’−オペレーンｇナルアンプ、２ ａ、 ２ ｂ
、 ２ｃ、 ２ ｄ−共振回路部、３・・接地部、ｌ
ａ、 ｌ ｂ、 ｌ ｃ・入力部、１ｄ・出力部、Ｔｒ
ｌ、Ｔｒ２−第１．第２スイ！チノグトラノノスタ。
Claims (2)
- （１）正転または逆転の入力部を少なくとも２つ有する
オペレーショナルアンプを備え、該オペレーショナルア
ンプの前記各入力部と出力部との間に第１、第２共振回
路部を個別に接続し、前記第１共振回路部と接地部との
間および第２共振回路部と接地部との間にそれぞれ第３
、第４共振回路部を接続し、前記第１、第３共振回路部
とにより第１発振周波数を決定し、第２、第４共振回路
部とにより第２発振周波数を決定し、発振周波数切換信
号により前記各発振周波数の選択切換えが行なわれる発
振回路において、 前記発振周波数切換信号に同期して動作するスイッチ手
段を設け、前記各入力部の内、前記スイッチ手段により
発振周波数か選択されない非選択側の第３または第４共
振回路部に接続された入力部と接地部とを電気的に短絡
することを特徴とする発振回路。 - （２）前記特許請求の範囲第１項に記載の発振回路にお
いて、前記スイッチ手段がスイッチングトランジスタで
ある発振回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20752584A JPS6184906A (ja) | 1984-10-03 | 1984-10-03 | 発振回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20752584A JPS6184906A (ja) | 1984-10-03 | 1984-10-03 | 発振回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6184906A true JPS6184906A (ja) | 1986-04-30 |
| JPH0564483B2 JPH0564483B2 (ja) | 1993-09-14 |
Family
ID=16541157
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP20752584A Granted JPS6184906A (ja) | 1984-10-03 | 1984-10-03 | 発振回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6184906A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04160924A (ja) * | 1990-10-25 | 1992-06-04 | Nec Ic Microcomput Syst Ltd | 半導体集積回路 |
-
1984
- 1984-10-03 JP JP20752584A patent/JPS6184906A/ja active Granted
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04160924A (ja) * | 1990-10-25 | 1992-06-04 | Nec Ic Microcomput Syst Ltd | 半導体集積回路 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0564483B2 (ja) | 1993-09-14 |
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