JPH0618364B2 - デ−タ伝送システムの時刻同期方法 - Google Patents
デ−タ伝送システムの時刻同期方法Info
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- JPH0618364B2 JPH0618364B2 JP61142780A JP14278086A JPH0618364B2 JP H0618364 B2 JPH0618364 B2 JP H0618364B2 JP 61142780 A JP61142780 A JP 61142780A JP 14278086 A JP14278086 A JP 14278086A JP H0618364 B2 JPH0618364 B2 JP H0618364B2
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Links
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Landscapes
- Arrangements For Transmission Of Measured Signals (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
Description
【発明の詳細な説明】 〔産業上の利用分野〕 この発明は、遠隔地点間で双方向にデータ伝送を行なう
データ伝送システムにおいて両端局に設置された時計の
時刻をデータ伝送回線を介して同期させるデータ伝送シ
ステムの時刻同期方法に関するものである。
データ伝送システムにおいて両端局に設置された時計の
時刻をデータ伝送回線を介して同期させるデータ伝送シ
ステムの時刻同期方法に関するものである。
電力系統運用の高度化に伴ない広域に亘る各電気所にお
ける保護装置や各機器の動作時刻、動作順序を正確に記
録、解析する必要性が生じたり、また計測データの収集
に際しても異なる地点のデータの収集時点が一致してい
なければならないという問題が生じてきた。
ける保護装置や各機器の動作時刻、動作順序を正確に記
録、解析する必要性が生じたり、また計測データの収集
に際しても異なる地点のデータの収集時点が一致してい
なければならないという問題が生じてきた。
これらの問題を解決する方法としては、データ伝送シス
テムの親局および各子局に時計回路を設け、保護装置や
機器の動作はこの時刻の符号と共に伝送し、また予め定
めた時刻に全子局一斉に計測を行なって一旦計測データ
をメモリに収納した後、親局に伝送する方法が考えられ
る。
テムの親局および各子局に時計回路を設け、保護装置や
機器の動作はこの時刻の符号と共に伝送し、また予め定
めた時刻に全子局一斉に計測を行なって一旦計測データ
をメモリに収納した後、親局に伝送する方法が考えられ
る。
この場合に重要なことは、親局と子局の時計回路が実用
上差支えない誤差の範囲で同期がとれていることである
が、データ伝送に要する時間が上記誤差の範囲の時間を
遥かに越えるため同期の方法に特別な工夫を要する。
上差支えない誤差の範囲で同期がとれていることである
が、データ伝送に要する時間が上記誤差の範囲の時間を
遥かに越えるため同期の方法に特別な工夫を要する。
従来のこの種のデータ伝送システムの時刻同期方法は、
親局の時計回路が所定時刻に達すると親局から時刻設定
信号を送信し、子局ではこれを受けて伝送遅れ時間を加
味して子局時計回路を設定するものである。
親局の時計回路が所定時刻に達すると親局から時刻設定
信号を送信し、子局ではこれを受けて伝送遅れ時間を加
味して子局時計回路を設定するものである。
従来のデータ伝送システムの時刻同期方法は以上のよう
に行なわれていたので、時刻同期を実時間で行なうため
動作に猶予はなく、親局、子局の演算処理回路は他の動
作を保留して専ら時刻同期の動作を行なはなければなら
ない問題点があった。また、常時サイクリックにデータ
伝送を行なうシステムでは、実時間で時刻同期信号を伝
送しようとすれば、データの流れを一旦止めなければな
らないという問題点があった。
に行なわれていたので、時刻同期を実時間で行なうため
動作に猶予はなく、親局、子局の演算処理回路は他の動
作を保留して専ら時刻同期の動作を行なはなければなら
ない問題点があった。また、常時サイクリックにデータ
伝送を行なうシステムでは、実時間で時刻同期信号を伝
送しようとすれば、データの流れを一旦止めなければな
らないという問題点があった。
この発明は上記のような問題点を解消するためになされ
たもので、データ伝送システムの演算処理装置に動作の
中断や大きな負担をかけず、また常時サイクリック伝送
の場合もその流れを保ったま、親時計、子時計間の時刻
同期が行なえるデータ伝送システムの時刻同期方法を提
供することを目的とする。
たもので、データ伝送システムの演算処理装置に動作の
中断や大きな負担をかけず、また常時サイクリック伝送
の場合もその流れを保ったま、親時計、子時計間の時刻
同期が行なえるデータ伝送システムの時刻同期方法を提
供することを目的とする。
この出願の第１の発明に係るデータ伝送システムの時刻
同期方法は、親局からの時刻調査指令に応じ、子局は前
記親局に向って送信している符号のフレームの区切り目
より予め定めた一定時刻ta前の子時計の時刻ＴS1のその
区切り目に続く前記フレームの中にデータとして送信
し、前記親局では該フレームの受信完了時点の親時計の
時刻ＴR0から符号１フレームの長さtc＋前記一定時刻ta
＋伝送遅れ時間tdの合計を差引いた子時計推定時刻Ｔ
S10を算出し、これと前記子局よりデータとして到来し
た前記子時計の時刻ＴS1との差ＴS10−ＴS1を時刻修正
データとして前記子局に送信し、前記子局はこれを受け
ると前記子時計の時刻に前記差ＴS10−ＴS1を加えて修
正することにより前記子時計を前記親時計に同期させる
ものである。
同期方法は、親局からの時刻調査指令に応じ、子局は前
記親局に向って送信している符号のフレームの区切り目
より予め定めた一定時刻ta前の子時計の時刻ＴS1のその
区切り目に続く前記フレームの中にデータとして送信
し、前記親局では該フレームの受信完了時点の親時計の
時刻ＴR0から符号１フレームの長さtc＋前記一定時刻ta
＋伝送遅れ時間tdの合計を差引いた子時計推定時刻Ｔ
S10を算出し、これと前記子局よりデータとして到来し
た前記子時計の時刻ＴS1との差ＴS10−ＴS1を時刻修正
データとして前記子局に送信し、前記子局はこれを受け
ると前記子時計の時刻に前記差ＴS10−ＴS1を加えて修
正することにより前記子時計を前記親時計に同期させる
ものである。
この出願の第２の発明に係るデータ伝送システムの時刻
同期方法は、親局からの時刻調査指令に応じ、子局は前
記親局に向って送信している符号のフレームの区切り目
より予め定めた一定時刻ta前の前記子時計の時刻ＴS1を
その区切り目に続く前記フレームの中にデータとして送
信し、前記親局では前記子局からデータとして到来した
前記子時計の時刻ＴS1に伝送遅れ時間td＋前記子時計の
時刻読取りから符号送出迄の時間ta＋符号１フレームの
長さtcの合計を加えた子時計推定時刻ＴR10を算出し、
これと該フレームの受信完了時点の前記親時計の時刻Ｔ
R0との差ＴR0−ＴR10を時刻修正データとして前記子局
に送信し、前記子局はこれを受けると前記子時計の時刻
に前記差ＴR0−ＴR10を加えて修正することにより前記
子時計を前記親時計に同期させるものである。
同期方法は、親局からの時刻調査指令に応じ、子局は前
記親局に向って送信している符号のフレームの区切り目
より予め定めた一定時刻ta前の前記子時計の時刻ＴS1を
その区切り目に続く前記フレームの中にデータとして送
信し、前記親局では前記子局からデータとして到来した
前記子時計の時刻ＴS1に伝送遅れ時間td＋前記子時計の
時刻読取りから符号送出迄の時間ta＋符号１フレームの
長さtcの合計を加えた子時計推定時刻ＴR10を算出し、
これと該フレームの受信完了時点の前記親時計の時刻Ｔ
R0との差ＴR0−ＴR10を時刻修正データとして前記子局
に送信し、前記子局はこれを受けると前記子時計の時刻
に前記差ＴR0−ＴR10を加えて修正することにより前記
子時計を前記親時計に同期させるものである。
この出願の第１，第２の発明におけるデータ伝送システ
ムの時刻同期方法は、上記のように親時計と子時計の時
刻差のデータにより子時計の修正を行なうため、修正動
作は直ちに行なう必要はなく他の動作の合間に行なうこ
とができる。
ムの時刻同期方法は、上記のように親時計と子時計の時
刻差のデータにより子時計の修正を行なうため、修正動
作は直ちに行なう必要はなく他の動作の合間に行なうこ
とができる。
また時刻差のデータを得るための親時計と子時計の時刻
の読み取り等は、常時行なている符号送受信に合せて行
なってレジスタに蓄わえるようにしているので、親局、
子局共演算処理装置の負担は軽く、サイクリックにデー
タ伝送を行なうシステムの場合にもデータ伝送の流れを
止める必要がない。
の読み取り等は、常時行なている符号送受信に合せて行
なってレジスタに蓄わえるようにしているので、親局、
子局共演算処理装置の負担は軽く、サイクリックにデー
タ伝送を行なうシステムの場合にもデータ伝送の流れを
止める必要がない。
第１図はこの発明によるデータ伝送システムの時刻同期
方法をスーパーバイザアリィ・コントロール・アンド・
データ・アクウィジィション（Supervisory Controd An
d Data Acquisition、以下、ＳＣＡＤＡという）システ
ムの親局に設置された親時計と各子局に設置された子時
計との間の時刻同期に実施した一例を示す図である。図
において、０はＳＣＡＤＡシステムの親局、１，２，…
…は子局である。親局０において、ＧＰは各子局１，
２，……の状態を表示する表示盤、ＣＤは各子局１，
２，……に制御指令を発するための制御卓、ＴＷは動作
やデータの記録を行なうタイプライタ、ＣＰＵ０は演算
処理回路、ＤＯ０は出力回路、ＤＩ０は入力回路、ＴＣ
はタイプライタ制御回路、ＭＣは親時計、ＲＧ01，ＲＧ
02，……はレジスタ、Ｓ01，Ｓ02，……は符号送信回
路、Ｒ01，Ｒ02，……は符号受信回路、Ｍ01，Ｍ02，…
…は変調回路、Ｄ01，Ｄ02，……は復調回路である。
方法をスーパーバイザアリィ・コントロール・アンド・
データ・アクウィジィション（Supervisory Controd An
d Data Acquisition、以下、ＳＣＡＤＡという）システ
ムの親局に設置された親時計と各子局に設置された子時
計との間の時刻同期に実施した一例を示す図である。図
において、０はＳＣＡＤＡシステムの親局、１，２，…
…は子局である。親局０において、ＧＰは各子局１，
２，……の状態を表示する表示盤、ＣＤは各子局１，
２，……に制御指令を発するための制御卓、ＴＷは動作
やデータの記録を行なうタイプライタ、ＣＰＵ０は演算
処理回路、ＤＯ０は出力回路、ＤＩ０は入力回路、ＴＣ
はタイプライタ制御回路、ＭＣは親時計、ＲＧ01，ＲＧ
02，……はレジスタ、Ｓ01，Ｓ02，……は符号送信回
路、Ｒ01，Ｒ02，……は符号受信回路、Ｍ01，Ｍ02，…
…は変調回路、Ｄ01，Ｄ02，……は復調回路である。
また、子局１，２において、ＣＰＵ１，ＣＰＵ２は演算
処理回路、Ｄ１，Ｄ２は復調回路、Ｍ１，Ｍ２は変調回
路、Ｒ１，Ｒ２は符号受信回路、Ｓ１，Ｓ２は符号送信
回路、ＤＯ１，ＤＯ２は出力回路、ＤＩ１，ＤＩ２は入
力回路、ＬＣ１，ＬＣ２は子時計、ＲＧ１，ＲＧ２はレ
ジスタである。
処理回路、Ｄ１，Ｄ２は復調回路、Ｍ１，Ｍ２は変調回
路、Ｒ１，Ｒ２は符号受信回路、Ｓ１，Ｓ２は符号送信
回路、ＤＯ１，ＤＯ２は出力回路、ＤＩ１，ＤＩ２は入
力回路、ＬＣ１，ＬＣ２は子時計、ＲＧ１，ＲＧ２はレ
ジスタである。
Ｌ1D，Ｌ1U，Ｌ2D，Ｌ2U……は親局０と各子局１，２…
…を結ぶデータ伝送路である。
…を結ぶデータ伝送路である。
次に第１図の動作について、親局０〜子局１間で送受信
される符号のタイムチャート図を示す第２図を用いて説
明する。
される符号のタイムチャート図を示す第２図を用いて説
明する。
まず、通常の遠方監視制御及び動作記録を行なう場合に
ついて説明する。
ついて説明する。
第１図において、子局１の演算処理回路CPU1は入力回路
ＤＩ１に入力された被監視接点（保護継電器やしゃ断器
の補助接点等）の状態を走査し、その状態を記憶してい
る。そして入力接点に状態変化があれば、その接点のア
ドレス番号と新しい状態を符号送信回路Ｓ１に渡す。符
号送信回路Ｓ１は常時親局０に向って符号の送信を行な
っており、演算処理回路ＣＰＵ１から上記状態変化接点
のアドレス及び新状態のデータを受けると、これをその
時送信している符号の次の符号フレームに乗せて親局０
に送るべく変調回路Ｍ１に渡す。符号送信回路Ｓ１が送
信する符号の一例を第２図のＳ１に示す。第２図におい
て、Ｄは符号の各フレーム、ＦはフレームＤ間の区切り
を示すフラグである。フラグＦのパターンは固定である
が、フレームＤは送る内容により長さも含めて変化す
る。また、その内容は送信すべきデータの他に送受信を
確実にするためのコントロール部分や符号チェックの部
分が追加されるのが普通である。なお、符号フォーマッ
トの例としてはハイレベル・データ・リンク・コントロ
ール（High-Level Data Link Co-ntrol、以下ＨＤＬＣ
という）プロスィ−ジュアのそれがある。
ＤＩ１に入力された被監視接点（保護継電器やしゃ断器
の補助接点等）の状態を走査し、その状態を記憶してい
る。そして入力接点に状態変化があれば、その接点のア
ドレス番号と新しい状態を符号送信回路Ｓ１に渡す。符
号送信回路Ｓ１は常時親局０に向って符号の送信を行な
っており、演算処理回路ＣＰＵ１から上記状態変化接点
のアドレス及び新状態のデータを受けると、これをその
時送信している符号の次の符号フレームに乗せて親局０
に送るべく変調回路Ｍ１に渡す。符号送信回路Ｓ１が送
信する符号の一例を第２図のＳ１に示す。第２図におい
て、Ｄは符号の各フレーム、ＦはフレームＤ間の区切り
を示すフラグである。フラグＦのパターンは固定である
が、フレームＤは送る内容により長さも含めて変化す
る。また、その内容は送信すべきデータの他に送受信を
確実にするためのコントロール部分や符号チェックの部
分が追加されるのが普通である。なお、符号フォーマッ
トの例としてはハイレベル・データ・リンク・コントロ
ール（High-Level Data Link Co-ntrol、以下ＨＤＬＣ
という）プロスィ−ジュアのそれがある。
第１図に戻ると、変調回路Ｍ１は符号送信回路Ｓ１から
受けた符号を信号伝送路に適合し、雑音の影響も受けに
くい形、例えば周波数偏移（Frequency Shift Keying、
以下ＦＳＫという）信号に変調して信号伝送路Ｌ1Uを介
して親局０に伝送する。親局０では復調回路Ｄ01がこれ
を受けて直流パルスに復調し、符号受信回路Ｒ01に渡
す。
受けた符号を信号伝送路に適合し、雑音の影響も受けに
くい形、例えば周波数偏移（Frequency Shift Keying、
以下ＦＳＫという）信号に変調して信号伝送路Ｌ1Uを介
して親局０に伝送する。親局０では復調回路Ｄ01がこれ
を受けて直流パルスに復調し、符号受信回路Ｒ01に渡
す。
符号受信回路Ｒ01に到達する符号は、第２図のＲ01の如
く送信符号Ｓ１と同様であるが伝送遅れ時間tdだけ遅れ
ている。
く送信符号Ｓ１と同様であるが伝送遅れ時間tdだけ遅れ
ている。
親局０の演算処理回路ＣＰＵ０は周期的走査あるいは符
号受信回路Ｒ01からの割込信号によりその受信内容を読
み取り、状態変化のデータが到来すれば、自己の記憶装
置の内容を更新するとともに出力回路ＤＯ０を介して表
示盤ＧＰの表示を変化させる。また、タイプライタ制御
回路ＴＣを介してタイプライタＴＷにより状態変化を記
録する。
号受信回路Ｒ01からの割込信号によりその受信内容を読
み取り、状態変化のデータが到来すれば、自己の記憶装
置の内容を更新するとともに出力回路ＤＯ０を介して表
示盤ＧＰの表示を変化させる。また、タイプライタ制御
回路ＴＣを介してタイプライタＴＷにより状態変化を記
録する。
親局０の演算処理回路ＣＰＵ０は入力回路ＤＩ０を介し
て制御卓ＣＤからの入力も走査しており、子局１の機器
に対する選択、制御の指令があると該当機器アドレス、
制御すべき状態（入切等）を符号化して符号送信回路Ｓ
01に与える。符号送信回路Ｓ01は第２図のＳ01に示す符
号を送信しており、その１フレームにこれを乗せて変調
回路Ｍ01、伝送路Ｌ1D、復調回路Ｄ１を介して子局１の
符号受信回路Ｒ１に伝送する。演算処理回路ＣＰＵ１は
周期的走査または符号受信回路Ｒ１からの割込信号によ
りその受信内容を読取り、符号チェック及び復号化を行
ない出力回路ＤＯ１を介して割当機器に制御指令を与え
る。
て制御卓ＣＤからの入力も走査しており、子局１の機器
に対する選択、制御の指令があると該当機器アドレス、
制御すべき状態（入切等）を符号化して符号送信回路Ｓ
01に与える。符号送信回路Ｓ01は第２図のＳ01に示す符
号を送信しており、その１フレームにこれを乗せて変調
回路Ｍ01、伝送路Ｌ1D、復調回路Ｄ１を介して子局１の
符号受信回路Ｒ１に伝送する。演算処理回路ＣＰＵ１は
周期的走査または符号受信回路Ｒ１からの割込信号によ
りその受信内容を読取り、符号チェック及び復号化を行
ない出力回路ＤＯ１を介して割当機器に制御指令を与え
る。
以上の動作は、子局２についても全く同様なので説明は
省略する。また、図示していない子局３以下についても
同様の追加構成を行ない、全く同様の動作を行なわせる
ことができる。
省略する。また、図示していない子局３以下についても
同様の追加構成を行ない、全く同様の動作を行なわせる
ことができる。
以上は通常の遠方監視制御及び動作記録の動作である
が、親局０で動作記録を行なう場合、上記通常動作では
各子局１，２，……から状態変化が発生した時刻のデー
タが来ないため親局０の演算処理回路ＣＰＵ０が確認し
た順序に親時計ＭＣの時刻をつけて記録する以外に方法
はないが、電力系統のように保護装置や機器の動作がデ
ータ伝送装置の符号伝送所要時間に比べて遥かに速い場
合にはデータが親局０に到達した時点では動作順序の正
確な判別はつかなくなっている。
が、親局０で動作記録を行なう場合、上記通常動作では
各子局１，２，……から状態変化が発生した時刻のデー
タが来ないため親局０の演算処理回路ＣＰＵ０が確認し
た順序に親時計ＭＣの時刻をつけて記録する以外に方法
はないが、電力系統のように保護装置や機器の動作がデ
ータ伝送装置の符号伝送所要時間に比べて遥かに速い場
合にはデータが親局０に到達した時点では動作順序の正
確な判別はつかなくなっている。
これを解決するために、各子局１，２，……に子時計Ｌ
Ｃ１，ＬＣ２，……を設け、これを親時計ＭＣと同期さ
せておき、状態変化が発生した場合には子時計ＬＣ１，
ＬＣ２，……の時刻も合せて親局０へ伝送する。即ち、
先に説明した子局１の入力回路ＤＩ１に入力されている
接点に状態変化があった場合、演算処理回路ＣＰＵ１は
該当接点のアドレス番号、親状態と共に子時計ＬＣ１の
時刻も合せて親局０へ伝送すれば、親局０の演算処理回
路ＣＰＵ０は自己の記憶装置に一旦これを蓄え、一定時
間他子局からのデータも集めた上で付加された時刻順に
整理しタイプライタ制御回路ＴＣを介してタイプライタ
ＴＷで打出せば、操作員は正しい動作時刻とその順序を
知ることが出来る。
Ｃ１，ＬＣ２，……を設け、これを親時計ＭＣと同期さ
せておき、状態変化が発生した場合には子時計ＬＣ１，
ＬＣ２，……の時刻も合せて親局０へ伝送する。即ち、
先に説明した子局１の入力回路ＤＩ１に入力されている
接点に状態変化があった場合、演算処理回路ＣＰＵ１は
該当接点のアドレス番号、親状態と共に子時計ＬＣ１の
時刻も合せて親局０へ伝送すれば、親局０の演算処理回
路ＣＰＵ０は自己の記憶装置に一旦これを蓄え、一定時
間他子局からのデータも集めた上で付加された時刻順に
整理しタイプライタ制御回路ＴＣを介してタイプライタ
ＴＷで打出せば、操作員は正しい動作時刻とその順序を
知ることが出来る。
この場合、親局０の親時計ＭＣと各子局１，２，……の
子時計ＬＣ１，ＬＣ２，……がかなりな精度（例えば数
ミリ秒以内）で同期している必要があるがこの同期をと
る動作について以下に説明する。
子時計ＬＣ１，ＬＣ２，……がかなりな精度（例えば数
ミリ秒以内）で同期している必要があるがこの同期をと
る動作について以下に説明する。
親局０の演算処理回路ＣＰＵ０は一定時間（子時計の精
度により１時間〜１日）に１回、各子時計ＬＣ１，ＬＣ
２，……の時刻をチェックするための時刻調査指令を各
符号送信回路Ｓ01，Ｓ02，……を介して各子局１，２，
……に発する。
度により１時間〜１日）に１回、各子時計ＬＣ１，ＬＣ
２，……の時刻をチェックするための時刻調査指令を各
符号送信回路Ｓ01，Ｓ02，……を介して各子局１，２，
……に発する。
子局１について説明すると、まず通常の動作として符号
送信回路Ｓ１は符号フレーム送信開始より予め定めた一
定時間ta前にレジスタＲＧ１に信号を与え、レジスタＲ
Ｇ１はこの信号が到来した時点の子時計ＬＣ１の時刻を
読込んでこれを蓄える動作を繰返し行なっている。親局
０の演算処理回路ＣＰＵ０が時刻調査指令を出すと符号
送信回路Ｓ01は変調回路Ｍ01、伝送路Ｌ1D、復調回路Ｄ
１を介して子局１の符号受信回路Ｒ１に伝送する。この
動作は第２図のタイムチャート図でＤ（ＴＩＱ）として
示されている。
送信回路Ｓ１は符号フレーム送信開始より予め定めた一
定時間ta前にレジスタＲＧ１に信号を与え、レジスタＲ
Ｇ１はこの信号が到来した時点の子時計ＬＣ１の時刻を
読込んでこれを蓄える動作を繰返し行なっている。親局
０の演算処理回路ＣＰＵ０が時刻調査指令を出すと符号
送信回路Ｓ01は変調回路Ｍ01、伝送路Ｌ1D、復調回路Ｄ
１を介して子局１の符号受信回路Ｒ１に伝送する。この
動作は第２図のタイムチャート図でＤ（ＴＩＱ）として
示されている。
子局１の演算処理回路ＣＰＵ１は符号受信回路Ｒ１が時
刻調査指令Ｄ（ＴＩＱ）を受けると、次の符号フレーム
にレジスタＲＧ１に蓄わえられたデータを乗せるが、レ
ジスタＲＧ１のデータは第２図のＳ１の上部に示した如
く次のフレームよりtaだけ前（この例では前のフレーム
の送信完了時点）の子時計ＬＣ１の時刻が入っており、
これをＴS1とすれば次のフレームＤ（ＴＡＳ）にはこの
ＴS1が子時計ＬＣ１の時刻データとして符号送信回路Ｓ
１、変調回路Ｍ１、伝送路Ｌ1U、復調回路Ｄ01を介して
親局０の符号受信回路Ｒ01に伝送する。
刻調査指令Ｄ（ＴＩＱ）を受けると、次の符号フレーム
にレジスタＲＧ１に蓄わえられたデータを乗せるが、レ
ジスタＲＧ１のデータは第２図のＳ１の上部に示した如
く次のフレームよりtaだけ前（この例では前のフレーム
の送信完了時点）の子時計ＬＣ１の時刻が入っており、
これをＴS1とすれば次のフレームＤ（ＴＡＳ）にはこの
ＴS1が子時計ＬＣ１の時刻データとして符号送信回路Ｓ
１、変調回路Ｍ１、伝送路Ｌ1U、復調回路Ｄ01を介して
親局０の符号受信回路Ｒ01に伝送する。
符号受信回路Ｒ01に到来する符号は、第２図のＲ01の如
く送信符号Ｓ１と同じで伝送遅れ時間tdだけ遅れたもの
である。符号受信回路Ｒ01は子時計ＬＣ１の時刻データ
が乗ったフレームの受信を完了すると、その時点の親時
計ＭＣの時刻ＴR0をレジスタＲＧ01に読込んで蓄える。
く送信符号Ｓ１と同じで伝送遅れ時間tdだけ遅れたもの
である。符号受信回路Ｒ01は子時計ＬＣ１の時刻データ
が乗ったフレームの受信を完了すると、その時点の親時
計ＭＣの時刻ＴR0をレジスタＲＧ01に読込んで蓄える。
演算処理回路ＣＰＵ０は上記レジスタＲＧ01に入った時
刻データＴR0を読出し、これより、予め分っている符号
１フレームの長さtc＋前述の子時計時刻読取りから符号
送出迄の時間ta＋伝送遅れ時間tdの合計を差引いて子時
計推定時刻ＴS10を出し、それと子局１よりＤ（ＴＡ
Ｓ）のフレームにより到来した子時計時刻ＴS1との差Ｔ
S10−ＴS1を取ると、これが親時計０と子時計１との時
刻差となるとでこれを自己の記憶装置に蓄える。
刻データＴR0を読出し、これより、予め分っている符号
１フレームの長さtc＋前述の子時計時刻読取りから符号
送出迄の時間ta＋伝送遅れ時間tdの合計を差引いて子時
計推定時刻ＴS10を出し、それと子局１よりＤ（ＴＡ
Ｓ）のフレームにより到来した子時計時刻ＴS1との差Ｔ
S10−ＴS1を取ると、これが親時計０と子時計１との時
刻差となるとでこれを自己の記憶装置に蓄える。
次に、演算処理回路ＣＰＵ０は上記時刻差を子時計修正
データとして符号送信回路Ｓ01、変調回路Ｍ01、伝送路
Ｌ1D、復調回路Ｄ１を介して子局１の符号受信回路Ｒ１
に伝送する。この動作のタイムチャートは第２図のＤ
（ＴＡＪ）で示されている。
データとして符号送信回路Ｓ01、変調回路Ｍ01、伝送路
Ｌ1D、復調回路Ｄ１を介して子局１の符号受信回路Ｒ１
に伝送する。この動作のタイムチャートは第２図のＤ
（ＴＡＪ）で示されている。
子局１の演算処理回路ＣＰＵ１は符号受信回路Ｒ１が時
刻修正データＤ（ＴＡＪ）を受けると、子時計ＬＣ１の
時刻を読出し、これに時刻修正データを加算（符号も含
めて）し、その時刻に子時刻ＬＣ１の時刻を設定する。
刻修正データＤ（ＴＡＪ）を受けると、子時計ＬＣ１の
時刻を読出し、これに時刻修正データを加算（符号も含
めて）し、その時刻に子時刻ＬＣ１の時刻を設定する。
これにより子時計ＬＣ１の時刻は親時計ＭＣの時刻に同
期される。
期される。
子局２以下の子時計ＬＣ２……についても全く同様の動
作により時刻同期を行なうことが出来る。時刻修正デー
タは、親局０の演算処理回路CPU0が上記とは逆に子局１
より到来した子時計ＬＣ１の時刻ＴS1に伝送遅れ時間td
＋子時計の時刻読取りから符号送出迄の時間ta＋符号１
フレームの長さtcの合計を加えた子時計推定時刻ＴR10
と子時計時刻ＴS1を乗せて到来した符号フレームの受信
完了時点の親時計０の時刻ＴR0との差ＴR10−ＴR0とし
て得ることも出来る。
作により時刻同期を行なうことが出来る。時刻修正デー
タは、親局０の演算処理回路CPU0が上記とは逆に子局１
より到来した子時計ＬＣ１の時刻ＴS1に伝送遅れ時間td
＋子時計の時刻読取りから符号送出迄の時間ta＋符号１
フレームの長さtcの合計を加えた子時計推定時刻ＴR10
と子時計時刻ＴS1を乗せて到来した符号フレームの受信
完了時点の親時計０の時刻ＴR0との差ＴR10−ＴR0とし
て得ることも出来る。
この発明による時刻同期方法は、常時符号を送出してい
るデータ伝送システムに適用することが出来るので実施
例にもその方式を挙げているが、他の符号方式、例えば
常時符号の送出は行なわず親局からのポーリング(Polli
ng)に応じて各子局が符号送出を行なう方式等にも適用
できることは勿論である。
るデータ伝送システムに適用することが出来るので実施
例にもその方式を挙げているが、他の符号方式、例えば
常時符号の送出は行なわず親局からのポーリング(Polli
ng)に応じて各子局が符号送出を行なう方式等にも適用
できることは勿論である。
実施例の構成においても、例えば親局０のレジスタＲＧ
01，ＲＧ02，……は実施例のように個別に設ければ各子
局の子時計の時刻修正動作を並行して行なえるが、１局
ずつ順次行なうことにすれば１個の共用レジスタを順次
使用して行なえる等色々な構成が出来ることもまた勿論
である。
01，ＲＧ02，……は実施例のように個別に設ければ各子
局の子時計の時刻修正動作を並行して行なえるが、１局
ずつ順次行なうことにすれば１個の共用レジスタを順次
使用して行なえる等色々な構成が出来ることもまた勿論
である。
なお、親局と各子局との間の伝送遅れ時間tdはデータ伝
送システムを設置した時に変復調回路の折返し試験、例
えば、第１図において親局０の変調回路Ｍ01、復調回路
Ｄ01及び子局１の変調回路Ｍ１、復調回路Ｄ１を内部回
路から切離し、子局１において復調回路Ｄ１の出力を変
調回路Ｍ１に接続し、親局０の変調回路Ｍ01の入力符号
の変化が復調回路Ｄ01の出力に現われる迄の時間遅れを
測定しこれを２で割る等により測定し、親局０の演算処
理回路ＣＰＵ０の記憶装置にデータとして蓄わえておけ
ばよい。
送システムを設置した時に変復調回路の折返し試験、例
えば、第１図において親局０の変調回路Ｍ01、復調回路
Ｄ01及び子局１の変調回路Ｍ１、復調回路Ｄ１を内部回
路から切離し、子局１において復調回路Ｄ１の出力を変
調回路Ｍ１に接続し、親局０の変調回路Ｍ01の入力符号
の変化が復調回路Ｄ01の出力に現われる迄の時間遅れを
測定しこれを２で割る等により測定し、親局０の演算処
理回路ＣＰＵ０の記憶装置にデータとして蓄わえておけ
ばよい。
また時刻修正動作は毎回時刻の全ての桁（時、分、秒、
ミリセカンド）について行なう必要は必らずしもなく、
装置起動時あるいは長時間周期で秒迄の修正（あるいは
絶対時刻を伝送して子時計の時刻設定）を行ない、１時
間に１度ミリセカンドの修正をすることにして子時計時
刻やその修正データのビット長を減ずることを可能であ
る。
ミリセカンド）について行なう必要は必らずしもなく、
装置起動時あるいは長時間周期で秒迄の修正（あるいは
絶対時刻を伝送して子時計の時刻設定）を行ない、１時
間に１度ミリセカンドの修正をすることにして子時計時
刻やその修正データのビット長を減ずることを可能であ
る。
以上のようにこの出願の第１，第２の発明によれば、デ
ータ伝送システムの符号送受信動作に合せる子時計の時
刻データを収集し、また修正動作も絶対時刻によらず親
時計との時刻差のデータにより修正を行なうようにした
ので、データ伝送システムの演算処理回路に動作の中断
や大きな負担をかけず、また常時サイクリック伝送の場
合もその流れを保ったまま時刻修正が行えるとともに、
上下伝送路に遅延時間の差がある場合であっても確実に
時刻同期を確立できる効果がある。
ータ伝送システムの符号送受信動作に合せる子時計の時
刻データを収集し、また修正動作も絶対時刻によらず親
時計との時刻差のデータにより修正を行なうようにした
ので、データ伝送システムの演算処理回路に動作の中断
や大きな負担をかけず、また常時サイクリック伝送の場
合もその流れを保ったまま時刻修正が行えるとともに、
上下伝送路に遅延時間の差がある場合であっても確実に
時刻同期を確立できる効果がある。
第１図は本発明によるデータ伝送システムの時刻同期方
法をＳＣＡＤＡシステムにおいて実例した一例を示すブ
ロック図、第２図は第１図の親局０と子局１との間で送
受信される符号の一例を示す説明図である。 ０は親局、１，２，……は子局、ＣＰＵ０は演算処理回
路、ＭＣは親時計、ＲＧ01，ＲＧ02，……はレジスタ、
Ｓ01，Ｓ02，……は符号送信回路、Ｒ01，Ｒ02，……は
符号受信回路、ＣＰＵ１，ＣＰＵ２，……は演算処理回
路、ＬＣ１，ＬＣ２，……は子時計、ＲＧ１，ＲＧ２，
……はレジスタ、Ｒ１，Ｒ２，……は符号受信回路、Ｓ
１，Ｓ２，……は符号送信回路、Ｌ1D，Ｌ1U，Ｌ2D，Ｌ
2U，……は親局０と子局１，２，……を結ぶ伝送路。
法をＳＣＡＤＡシステムにおいて実例した一例を示すブ
ロック図、第２図は第１図の親局０と子局１との間で送
受信される符号の一例を示す説明図である。 ０は親局、１，２，……は子局、ＣＰＵ０は演算処理回
路、ＭＣは親時計、ＲＧ01，ＲＧ02，……はレジスタ、
Ｓ01，Ｓ02，……は符号送信回路、Ｒ01，Ｒ02，……は
符号受信回路、ＣＰＵ１，ＣＰＵ２，……は演算処理回
路、ＬＣ１，ＬＣ２，……は子時計、ＲＧ１，ＲＧ２，
……はレジスタ、Ｒ１，Ｒ２，……は符号受信回路、Ｓ
１，Ｓ２，……は符号送信回路、Ｌ1D，Ｌ1U，Ｌ2D，Ｌ
2U，……は親局０と子局１，２，……を結ぶ伝送路。
フロントページの続き (56)参考文献 特開 昭60−109347（ＪＰ，Ａ) 特開 昭60−2220915（ＪＰ，Ａ) 特開 昭60−214291（ＪＰ，Ａ)
Claims (2)
- 【請求項１】親局と子局の間で双方向にデータ伝送を行
なうデータ伝送システムにおける方法であって、前記子
局に設置された子時計を前記親局に設置された親時計と
時刻的に同期させるデータ伝送システムの時刻同期方法
において、 前記子局は、前記親局からの子時計時刻調査指令に応じ
て、前記親局へ向って送信している符号のフレームの区
切り目より予め定めた一定時刻(ta)前の子時計の時刻
（ＴS1）をその区切り目に続くフレームの中にデータと
して送信し、 前記親局は、そのフレームの受信完了時点の時刻
（ＴR0）から、１フレームの長さ(tc)＋前記一定時刻(t
a)＋伝送遅れ時間(td)の合計を差引いた子時計推定時刻
（ＴS10 ）を算出し、その子時計推定時刻（ＴS10 ）と
前記子局から受信した子時計の時刻（ＴS1）との差時間
（ＴS10 −ＴS1）を時刻修正データとして前記子局に送
信し、 前記子局は、前記時刻修正データを受けると、そのとき
の時刻に前記差時間（ＴS10 −ＴS1）を加えて修正する
ことにより前記子時計を前記親時計に同期させることを
特徴とするデータ伝送システムの時刻同期方法。 - 【請求項２】親局と子局の間で双方向にデータ伝送を行
なうデータ伝送システムにおける方法であって、前記子
局に設置された子時計を前記親局に設置された親時計と
時刻的に同期させるデータ伝送システムの時刻同期方法
において、 前記子局は、前記親局からの子時計時刻調査指令に応じ
て、前記親局へ向って送信している符号のフレームの区
切り目より予め定めた一定時刻(ta)前の子時計の時刻
（ＴS1）をその区切り目に続くフレームの中にデータと
して送信し、 前記親局は、前記子局から受信した子時計の時刻
（ＴS1）に、伝送遅れ時間(td)＋前記一定時刻(ta)＋１
フレームの長さ(tc)の合計を加えた子時計推定時刻（Ｔ
R10 ）を算出し、その子時計推定時刻（ＴR10 ）と前記
子局から子時計の時刻（ＴS1）を受信完了した時刻（Ｔ
R0）との差時間（ＴR0−ＴR10 ）を時刻修正データとし
て前記子局に送信し、 前記子局は、前記時刻修正データを受けると、そのとき
の時刻に前記差時間（ＴR0−ＴR10 ）を加えて修正する
ことにより前記子時計を前記親時計に同期させることを
特徴とするデータ伝送システムの時刻同期方法。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61142780A JPH0618364B2 (ja) | 1986-06-20 | 1986-06-20 | デ−タ伝送システムの時刻同期方法 |
| DE3751571T DE3751571T2 (de) | 1986-05-20 | 1987-05-16 | Verfahren zur Synchronisation der Echtzeituhren in einem Datenübertragungssystem. |
| EP87107110A EP0253096B1 (en) | 1986-05-20 | 1987-05-16 | Time synchronization method in a data transmission system |
| US07/050,576 US4807259A (en) | 1986-05-20 | 1987-05-18 | Time synchronization method in data transmission system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61142780A JPH0618364B2 (ja) | 1986-06-20 | 1986-06-20 | デ−タ伝送システムの時刻同期方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS631126A JPS631126A (ja) | 1988-01-06 |
| JPH0618364B2 true JPH0618364B2 (ja) | 1994-03-09 |
Family
ID=15323419
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61142780A Expired - Lifetime JPH0618364B2 (ja) | 1986-05-20 | 1986-06-20 | デ−タ伝送システムの時刻同期方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0618364B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH08104470A (ja) * | 1994-10-05 | 1996-04-23 | Abansu Techno Kk | ボビン |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE10333932A1 (de) * | 2003-07-25 | 2005-02-24 | Robert Bosch Gmbh | Synchronisation von datenverarbeitenden Einheiten |
| AT13701U1 (de) * | 2012-03-21 | 2014-06-15 | Bachmann Gmbh | Verfahren zur Synchronisation von Zeitbasis und Ereignissen in einem verzweigten Verbundnetz, z.B. in Windpark-Netzen |
| CN108710064B (zh) * | 2018-07-27 | 2024-09-24 | 四川瑞霆智汇科技有限公司 | 一种零序有功分量型线路故障指示器 |
| CN116880339B (zh) * | 2023-09-07 | 2023-11-28 | 北京控达科技有限公司 | 基于双mcu的数据周期同步方法及系统 |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60214291A (ja) * | 1984-04-11 | 1985-10-26 | Nec Corp | 時計管理方式 |
| JPS60222915A (ja) * | 1984-04-20 | 1985-11-07 | Fujitsu Ltd | 遠隔ステ−シヨンにおける時刻情報補正方式 |
-
1986
- 1986-06-20 JP JP61142780A patent/JPH0618364B2/ja not_active Expired - Lifetime
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH08104470A (ja) * | 1994-10-05 | 1996-04-23 | Abansu Techno Kk | ボビン |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS631126A (ja) | 1988-01-06 |
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