JPH0731490B2 - コンピユータビデオグラフイツクシステム - Google Patents

コンピユータビデオグラフイツクシステム

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JPH0731490B2
JPH0731490B2 JP4143397A JP14339792A JPH0731490B2 JP H0731490 B2 JPH0731490 B2 JP H0731490B2 JP 4143397 A JP4143397 A JP 4143397A JP 14339792 A JP14339792 A JP 14339792A JP H0731490 B2 JPH0731490 B2 JP H0731490B2
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video
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video memory
filling level
memory
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Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明はコンピユータビデオグラ
フイツクシステムに関し、ビデオメモリへの処理装置ア
クセスが先入れ先出し（ＦＩＦＯ）リフレツシユバツフ
アの現在の充填レベル及び現在の動作モードに依存する
ビデオグラフイツクシステムに適用して好適なものであ
る。
【０００２】
【従来の技術】一般的なビデオシステムは、画面全体の
ビデオデータを記憶する専用ビデオメモリを含み、陰極
線管（ＣＲＴ）デイスプレイのようなラスタ走査型表示
装置上にビデオデータを表示する。表示されるべきビデ
オデータはコンピユータの中央処理装置からビデオメモ
リに転送される。ＣＲＴコントローラ（ＣＲＴＣ）は適
切な水平同期パルス及び垂直同期パルス並びに関連する
タイミング信号を発生し、適切な時期にビツト、バイト
又はブロツクのビデオデータがビデオメモリから読み取
られて処理され、画面上に表示される。デユアルポーテ
イツドビデオメモリ（ＶＲＡＭ）が使用されない場合、
中央処理装置は、ビツト、バイト又はブロツクのデータ
がビデオメモリから読み取られて画面をリフレツシユす
るのと同時にビデオメモリにアクセスすることはできな
い。従つて、通常画面リフレツシユを目的とするビデオ
メモリ読取り動作は、ビデオメモリへの中央処理装置の
書込み動作に対して優先権を有する。ビデオメモリ読取
り動作がビデオメモリへの中央処理装置の書込み動作に
対して優先権を有しない場合、処理装置ビデオメモリア
クセスの期間中に表示データは画面から瞬時に消える。
従つて通常ビデオメモリへの処理装置アクセスは、水平
及び垂直のブランキング期間に制限される。
【０００３】
【発明が解決しようとする課題】画面当たりの画素数及
び画素当たりの色の数の双方に関して、ビデオシステム
の解像度が向上すると画面当たりのビツト又はバイトの
総数が極端に増加すると共に、１画面のデータをビデオ
メモリに再書込みするのに処理装置が要する時間も増加
する。従つて、ビデオメモリへの処理装置アクセスが水
平及び垂直ブランキング期間のみに制限される場合、当
該処理装置は、常に変化している像に遅れないように十
分速くビデオメモリに再書込みすることができなくなつ
てしまう。この問題点を克服できる１つの方法は、例え
ば先入れ先出しバツフア（ＦＩＦＯ）によりビデオメモ
リのリフレツシユ出力をバツフアすることである。ビデ
オメモリのリフレツシユ出力においてバツフアすれば、
１ブロツクのビデオデータをビデオメモリからバツフア
に迅速にコピーすることができる。次にバツフアに記憶
されているデータは画面をリフレツシユするために使用
されるが、予め定められたレベルにバツフアが空にされ
るまで、ブランキング期間でない期間においてでさえ処
理装置はビデオメモリに新しいビデオデータを書き込む
ことができる。
【０００４】今日、ビデオ又は「グラフイツクス」に関
する多数の規格を利用することができる。例えば低解像
度の規格又は「モード」は 320× 200の画素を表示する
にすぎず、その際各画素は４色のうちの１色を表示す
る。高解像度モードにおいては1024× 768の画素を表示
することができ、その際、各画素は 256色のうちの１色
である。しかしながら、ビデオメモリへの中央処理装置
アクセスが禁止される前に、バツフアが空にされなけれ
ばならない予め定められたレベルは、動作モードに依存
する。高速高解像度モードにおいてはバツフアが迅速に
空にされるので、中央処理装置がビデオメモリにアクセ
スすることができるようにこのバツフアの充填レベルは
比較的高くなければならない。他方、低速低解像度モー
ドにおいてはバツフアが一段と緩やかに空にされるの
で、ビデオメモリへの処理装置アクセスが拒絶される充
填レベルは一段と低い。
【０００５】かくして複数のプログラマブル動作モード
及びリフレツシユバツフアを有するビデオシステムにお
いては、動作モード次第で数多くの異なるバツフア充填
レベルにおいて処理装置はビデオメモリにアクセスする
ことができるのが望ましい。あらゆる動作モードについ
て、処理装置アクセスが拒絶される充填レベルを固定す
ることもできるが、充填レベルを可変にすることは一段
と優れた性能を提供する。
【０００６】従つて、以下に述べる本発明は、処理装置
のビデオメモリアクセスについての最小充填レベルをビ
デオシステムの現在の動作モードの関数として調整す
る。
【０００７】
【課題を解決するための手段】かかる課題を解決するた
め本発明においては、ビデオメモリポートに結合された
入力端を有する先入れ先出しバツフア（２０１）と、先
入れ先出しバツフア（２０１）に結合され、先入れ先出
しバツフア（２０１）の充填レベルを検出する充填レベ
ル検出手段（２０２）と、解像度が高い第１の表示モー
ド又は解像度が低い第２の表示モードにプログラムされ
るプログラマブルモードレジスタ（２０３）と、充填レ
ベル検出手段（２０２）及びプログラマブルモードレジ
スタ（２０３）間に結合され、プログラマブルモードレ
ジスタ（２０３）が第１の表示モードにプログラムされ
るとき高いレベルの第１の最小充填レベルを選択し、か
つプログラマブルモードレジスタ（２０３）が第２の表
示モードにプログラムされるとき低いレベルの第２の最
小充填レベルを選択する充填レベル選択手段（２０５）
と、処理装置アクセスポート及びビデオメモリポート間
に結合され、処理装置アクセスポートにおけるアドレス
及びビデオデータをビデオメモリポートに結合する処理
装置アクセス手段（２０７）と、先入れ先出しバツフア
（２０１）の現在の充填レベルが充填レベル選択手段
（２０２）により選択された第１又は第２の最小充填レ
ベル以下であるとき処理装置アクセス手段（２０７）を
デイスイネーブルするデイスイネーブル手段（２０６）
とを設けるようにする。
【０００８】
【作用】ビデオメモリポートに接続された入力端を有す
る先入れ先出しバツフア（ＦＩＦＯ）（２０１）を含む
ビデオメモリインタフエースにおいて、充填レベル検出
手段（２０２）はこのＦＩＦＯ（２０１）に接続され
る。充填レベル検出手段（２０２）はＦＩＦＯ（２０
１）の現在の充填レベルを検出する。またビデオメモリ
インタフエースはプログラマブルモードレジスタ（２０
３）を含む。充填レベル選択手段（２０５）は充填レベ
ル検出手段（２０２）及びプログラマブルモードレジス
タ（２０３）間に接続される。この充填レベル選択手段
（２０５）は、プログラマブルモードレジスタ（２０
３）が第１のモードにプログラムされるときには第１の
最小充填レベルを選択し、プログラマブルモードレジス
タ（２０３）が第２のモードにプログラムされるときに
は第２の最小充填レベルを選択する。処理装置アクセス
手段（２０７）は処理装置アクセスポート及びビデオメ
モリポート間に接続される。処理装置アクセス手段（２
０７）は処理装置ポートにおけるアドレス及びビデオデ
ータをビデオメモリポートに接続する。またＦＩＦＯ
（２０１）の現在の充填レベルが充填レベル選択手段
（２０５）によつて選択された最小充填レベル以下であ
るときにはデイスエーブル（２０６）によつて処理装置
アクセス手段（２０７）をデイスエーブルする。
【０００９】
【実施例】以下図面について、本発明の一実施例を詳述
する。
【００１０】図１は本発明のビデオシステム１０１を含
むコンピユータ１００のブロツク図である。図示のよう
に中央処理装置ユニツト（ＣＰＵ）１０２はメモリバス
１０３及び入出力バス（Ｉ／Ｏバス）１０４に結合され
ている。メモリバス１０３及びＩ／Ｏバス１０４は別個
のバスとして示されているが、これらのメモリバス１０
３及びＩ／Ｏバス１０４を単一のバスとして結合でき
る。半導体メモリ１０５はメモリバス１０３に接続さ
れ、複数のＩ／Ｏ装置１０６〜１０９はＩ／Ｏバス１０
４に接続され、Ｉ／Ｏ装置１０６〜１０９は特定的には
キーボード１０６、マウス又はトラツクボールなどの位
置決め装置１０７、ハードデイスクドライブ１０８及び
フロツピーデイスクドライブ１０９である。電源１１０
はコンピユータに電力を供給する。
【００１１】ビデオシステム１０１はＩ／Ｏバス１０４
に結合され、従来の設計の陰極線管コントローラ（ＣＲ
ＴＣ）１１１を含む。ＣＲＴＣ１１１は陰極線管（ＣＲ
Ｔ）のようなラスタ走査型表示画面上にビデオ情報を表
示するのに必要な水平及び垂直同期パルス並びに他のタ
イミング信号を発生する。メモリインタフエース１１２
については図２を参照して後述する。ビデオメモリ１１
３はメモリインタフエースユニツト１１２に接続され
る。ビデオメモリ１１３は従来の設計の複数のダイナミ
ツクランダムアクセスメモリ（ＤＲＡＭ）を含む。メモ
リインタフエースユニツト１１２の出力はいずれも従来
の設計の並直列変換回路１１４及びデイジタルアナログ
変換回路（ＤＡＣ）１１５に接続される。並直列変換回
路１１４はメモリインタフエースユニツト１１２の並列
出力を直列形式に変換し、ＤＡＣ１１５は直列に変換さ
れたデイジタルビデオ情報を赤、緑及び青を表すアナロ
グ電圧に変換する。ＣＲＴ表示装置のような従来のラス
タ走査型表示装置１１６はビデオ情報を表示するために
使用される。
【００１２】図２はメモリインタフエースユニツト１１
２の詳細図である。図示のように、従来の６×３２ビツ
ト先入れ先出しバツフア（ＦＩＦＯ）２０１は６「ダブ
ルワード」までのビデオデータを一時的に記憶し、この
データは一度に１ダブルワードづつ並直列変換回路に転
送される。この明細書においては、１バイト＝８ビツ
ト、１ワード＝２バイト及び１ダブルワード（１Ｄワー
ド）＝２ワードと定義する。従つて１ダブルワードは４
バイトすなわち３２ビツトである。ビデオデータはビデ
オメモリ１１３からＦＩＦＯ２０１に一度に１ダブルワ
ードづつコピーされる。従来の充填レベル検出回路２０
２はＦＩＦＯ２０１に結合される。充填レベル検出回路
２０２のＦＩＦＯ充填状態出力は、ＦＩＦＯ２０１の最
小充填レベルが３Ｄワード、５Ｄワード及び６Ｄワード
であることを示す３つの個別の出力を有する。
【００１３】ビデオシステム１０１の動作モードは、コ
ンピユータのデータバスからモードレジスタ２０３内に
ロードされる。モードレジスタ２０３はアドレスデコー
ド回路２０４によりデコードされてバス上の独自のアド
レスにおいてアクセスされる。ビデオシステムは、画素
当たり 256色で1024× 768画素の高解像度モードから画
素当たりたつた４色で 320× 200画素の低解像度モード
までの複数の画面解像度モードにより動作することがで
きる。モードレジスタ２０３は５つのプログラマブルビ
ツトを含む。第１ビツトは英数字モードを示し、第２ビ
ツトは画素当たり８ビツトあることを示す。第３、第４
及び第５ビツトはクロツク周波数を設定するのに使用さ
れ、これをクロツク選択ビツト０、１及び２（ＣＳＯ、
ＣＳ１及びＣＳ２）と呼ぶ。特にクロツク周波数は次表
に従つて設定される。
【表１】
【００１４】充填レベル選択回路２０５は最小のＦＩＦ
Ｏ充填レベルを選択する。この最小のＦＩＦＯ充填レベ
ルはビデオメモリ１１３にアクセスすることをＣＰＵ１
０２に許可するために必要とされる。最小充填レベルの
この選択はモードレジスタ２０３にプログラムされてい
るビデオシステムの現在の動作モードに基づく。一般に
高解像度モードには高い最小充填レベル（例えば、６Ｄ
ワード）が必要であり、低解像度モードには低い最小充
填レベル（例えば、３Ｄワード）が必要とされるに過ぎ
ない。ＦＩＦＯの実際の充填レベルが充填レベル選択回
路２０５によつて選択された最小充填レベルに達してい
るか又は上回つているとき、この充填レベル選択回路２
０５の充填レベルＯＫ出力は活性状態となる。充填レベ
ル選択回路２０５に関しては図３との関連で詳述する。
最小充填レベルを動作モードの関数として次表に列挙す
る。
【表２】
【００１５】メモリサイクルアービタ２０６はビデオメ
モリの制御をＣＲＴＣ１１１及びＣＰＵ１０２間におい
て適切な時間にシフトすることによつて、ビデオメモリ
１１３へのアクセスを制御する。メモリサイクルアービ
タ２０６は図４の状態機械を実現するが、これは従来の
アービタの設計である。ビデオメモリ１１３へのアドレ
スラインの制御は従来のマルチプレクサＭＵＸ２０７に
より提供され、マルチプレクサＭＵＸ２０７はメモリサ
イクルアービタ２０６からのＣＲＴＣ／ＣＰＵ−ＮＯＴ
出力によつて制御される。このラインが活性状態にある
とき、ＣＲＴＣ１１１はＣＲＴＣポート「Ｃ」及びビデ
オメモリボード「Ｖ」を経由してビデオメモリ１１３を
アドレス指定する。ＣＲＴＣ／ＣＰＵ−ＮＯＴ出力が活
性状態でないとき、ＣＰＵ１０２は中央処理装置ポート
「Ｐ」を介してビデオメモリをアドレス指定する。かく
してメモリサイクルアービタ２０６は充填レベル選択回
路２０５により選択された最小充填レベルに対するＦＩ
ＦＯの実際のレベル次第でビデオメモリ１１３へのＣＰ
Ｕアクセスをイネーブル及びデイスイネーブルする手段
を提供する。さらにメモリサイクルアービタ２０６は、
ＣＲＴＣ／ＣＰＵ−ＮＯＴラインが非活性状態であると
き、バツフア２０８にＣＰＵデータを書き込み、かつラ
ツチ回路２０９からデータを読み取るのに必要なＣＰＵ
書込みイネーブル信号及びＣＰＵ読取りストローブ信号
を従来の様式で発生させる。かくしてマルチプレクサＭ
ＵＸ２０７、バツフア２０８及びラツチ回路２０９は、
処理装置ポート「Ｐ」におけるアドレス及びビデオデー
タをビデオメモリポート「Ｖ」に結合する処理装置アク
セス手段を提供する。
【００１６】またメモリサイクルアービタ２０６は、メ
モリサイクル実行コマンドＥＸｅｃｕｔｅ Ｍｅｍｏｒ
ｙ Ｃｙｏｌｅ（ＥＭＣ）Ｃｏｍｍａｎｄを従来様式で
発生させる。このメモリサイクル実行コマンドＥＭＣ
は、ビデオメモリ１１３にアクセスするのに必要なロウ
アドレス選択信号、カラムアドレス選択信号及び書込み
イネーブル信号のような他のサイクルのビデオメモリ制
御信号を発生させるようにメモリサイクルジエネレータ
２１０に指令する。メモリサイクルジエネレータ２１０
は従来の設計のものであり、メモリサイクルジエネレー
タ２１０が要求されたメモリサイクルを完了したとき、
メモリサイクルアービタ２０６に確認応答（ＡＣＫ）信
号を返す。
【００１７】図３は充填レベル選択回路２０５の概略を
示す。図示のように充填レベル選択回路２０５は、ＡＮ
Ｄゲート３０１〜３０４、ＯＲゲート３０５〜３０６、
ＮＡＮＤゲート３０７及びＮＯＲゲート３０８を含む。
充填レベル選択回路２０５は、モードレジスタ２０３の
５つのビツトの現在の状態に基づいて処理装置ビデオメ
モリアクセスのための最小充填レベルを選択する。ＯＲ
ゲート３０５の出力は、充填レベル検出回路２０２によ
つて感知された現在のＦＩＦＯ充填レベルが充填レベル
選択回路２０５により選択された最小レベルに達してい
るか又は上回つていることを示す充填レベルＯＫ信号で
ある。
【００１８】図４はメモリサイクルアービタ２０６の状
態図である。図４及び図２を組み合わせて参照すれば判
るようにこのメモリサイクルアービタは３つの状態を有
し、ＦＩＦＯの変化及びＣＰＵがビデオメモリにアクセ
スする現在の必要性に応答して、状態間を移動する。第
１の状態は遊休状態であり、この遊休状態においてアー
ビタは、ＦＩＦＯが完全に一杯でなくなるか又はＣＰＵ
がビデオメモリへのアクセスを必要とするまで待機す
る。第２の状態においてＣＲＴＣはビデオメモリ１１３
へのアクセスを有し、ＦＩＦＯが一杯になるか又はＣＰ
Ｕがビデオメモリへのアクセスを必要とし、かつ充填レ
ベルがＯＫ状態となるまでＦＩＦＯにビデオデータを転
送する。第３の状態において、ＣＰＵはビデオメモリへ
のアクセスを有する。
【００１９】
【発明の効果】上述の通り本発明によれば、先入れ先出
しバツフア（ＦＩＦＯ）及びプログラマブル動作モード
を設けることにより、中央処理装置は動作モード次第で
多数の異なるバツフア充填レベルにおいてビデオメモリ
に容易にアクセスすることができる。
【図面の簡単な説明】
【図１】図１は本発明のビデオグラフイツクシステムを
含むコンピユータのブロツク図である。
【図２】図２はビデオメモリインタフエースユニツトの
ブロツク図である。
【図３】図３は充填レベル選択回路のブロツク図であ
る。
【図４】図４はメモリサイクルアービタの動作及び構成
を示す略線図である。
【符号の説明】
１００……コンピユータ、１０１……ビデオシステム、
１０２……中央処理装置ユニツト（ＣＰＵ）、１０３…
…メモリバス、１０４……入出力バス（Ｉ／Ｏバス）、
１０５……半導体メモリ、１０６……キーボード、１０
７……位置決め装置、１０８……ハードデイスクドライ
ブ、１０９……フロツピーデイスクドライブ、１１０…
…電源、１１１……陰極線管コントローラ（ＣＲＴ
Ｃ）、１１２……メモリインタフエース、１１３……ビ
デオメモリ、１１４……並直列変換回路、１１５……デ
イジタルアナログ変換回路（ＤＡＣ）、１１６……ラス
タ走査型表示装置、２０１……ＦＩＦＯ、２０２……充
填レベル検出回路、２０３……モードレジスタ、２０４
……アドレスデコード回路、２０５……充填レベル選択
回路、２０６……メモリサイクルアービタ、２０７……
マルチプレクサＭＵＸ、２０８……バツフア、２０９…
…ラツチ回路、２１０……メモリサイクルジエネレー
タ、３０１〜３０４……ＡＮＤゲート、３０５〜３０６
……ＯＲゲート、３０７……ＮＡＮＤゲート、３０８…
…ＮＯＲゲート。

Claims (6)

    【特許請求の範囲】
  1. 【請求項１】ビデオメモリポートに結合された入力端を
    有する先入れ先出しバツフアと、 上記先入れ先出しバツ
    フアに結合され、上記先入れ先出しバツフアの充填レベ
    ルを検出する充填レベル検出手段と、 解像度が高い第１
    の表示モード又は解像度が低い第２の表示モードにプロ
    グラムされるプログラマブルモードレジスタと、 上記充
    填レベル検出手段及び上記プログラマブルモードレジス
    タ間に結合され、上記プログラマブルモードレジスタが
    第１の表示モードにプログラムされるとき高いレベルの
    第１の最小充填レベルを選択し、かつ上記プログラマブ
    ルモードレジスタが第２の表示モードにプログラムされ
    るとき低いレベルの第２の最小充填レベルを選択する充
    填レベル選択手段と、 上記処理装置アクセスポート及び
    上記ビデオメモリポート間に結合され、処理装置アクセ
    スポートにおけるアドレス及びビデオデータを上記ビデ
    オメモリポートに結合する処理装置アクセス手段と、 上
    記先入れ先出しバツフアの現在の充填レベルが上記充填
    レベル選択手段により選択された上記第１又は第２の最
    小充填レベル以下であるとき上記処理装置アクセス手段
    をデイスイネーブルするデイスイネーブル手段とを具え
    ることを特徴とするビデオメモリインタフエース。
  2. 【請求項２】さらに、第１の状態、第２の状態及び第３
    の状態を有するアービタ手段を具え、 上記アービタ手
    段によつて、上記第１の状態において上記ビデオメモリ
    ポートへのアクセスを与えず、上記第２の状態において
    上記ビデオメモリポートから上記先入れ先出しバツフア
    にビデオ情報をロードし、上記第３の状態において上記
    処理装置アクセスポートから上記ビデオメモリポートに
    ビデオ情報を転送することを特徴とする請求項１に記載
    のビデオメモリインタフエース。
  3. 【請求項３】ビデオメモリと、 上記ビデオメモリに結合
    された入力端を有する先入れ先出しバツフアと、 上記先
    入れ先出しバツフアに結合され、上記先入れ先出しバツ
    フアの充填レベルを検出する充填レベル検出手段と、 解
    像度が高い第１の表示モード又は解像度が低い第２の表
    示モードにプログラムされるプログラマブルモードレジ
    スタと、 上記充填レベル検出手段及び上記プログラマブ
    ルモードレジスタ間に結合され、上記プログラマブルモ
    ードレジスタが第１の表示モードにプログラムされると
    き高いレベルの第１の最小充填レベルを選択し、かつ上
    記プログラマブルモードレジスタが第２の表示モードに
    プログラムされるとき第２の最小充填レベルを選択する
    充填レベル選択手段と、 上記処理装置アクセスポート及
    び上記ビデオメモリ間に結合され、処理装置アクセスポ
    ートにおけるアドレス及びビデオデータを上記ビデオメ
    モリに結合する処理装置アクセス手段と、 上記先入れ先
    出しバツフアの現在の充填レベルが上記充填レベル選択
    手段により選択された上記第１又は第２の最小充填レベ
    ル以下であるとき上記処理装置アクセス手段をデイスイ
    ネーブルするデイスイネーブル手段とを具えることを特
    徴とするビデオアダプタ。
  4. 【請求項４】さらに、第１の状態、第２の状態及び第３
    の状態を有するアービタ手段を具え、 上記アービタ手段
    によつて、上記第１の状態において上記ビデオメモリへ
    のアクセスを与えず、上記第２の状態において上記ビデ
    オメモリから上記先入れ先出しバツフアにビデオ情報を
    ロードし、上記第３の状態において上記処理装置アクセ
    スポートから上記ビデオメモリにビデオ情報を転送する
    ことを特徴とする請求項３に記載のビデオアダプタ。
  5. 【請求項５】少なくとも１つの処理装置ユニツトと、 メ
    モリバスを介して上記処理装置ユニツトに結合されたメ
    モリと、 入出力バスを介して上記処理装置ユニツトに結
    合された複数の入出力装置と、 上記処理装置ユニツトに
    結合されたビデオシステムと を具え、上記ビデオシステ
    ムは、 ビデオメモリと、 上記ビデオメモリに結合された
    入力端を有する先入れ先出しバツフアと、 上記先入れ先
    出しバツフアに結合され、上記先入れ先出しバツフアの
    充填レベルを検出する充填レベル検出手段と、 解像度が
    高い第１の表示モード又は解像度が低い第２の表示モー
    ドにプログラムされるプログラマブルモードレジスタ
    と、 上記充填レベル検出手段及び上記プログラマブルモ
    ードレジスタ間に結合され、上記プログラマブルモード
    レジスタが第１の表示モードにプログラムされるとき高
    いレベルの第１の最小充填レベルを選択し、かつ上記プ
    ログラマブルモードレジスタが第２の表示モードにプロ
    グラムされるとき低いレベルの第２の最小充填レベルを
    選択する充填レベル選択手段と、 上記処理装置ユニツト
    及び上記ビデオメモリ間に結合され、上記処理装置ユニ
    ツトをイネーブルすることにより、ビデオデータを上記
    ビデオメモリに書き込む処理装置アクセス手段と、 上記
    先入れ先出しバツフアの現在の充填レベルが上記充填レ
    ベル選択手段により選択された上記第１又は第２の最小
    充填レベル以下であるとき上記処理装置アクセス手段を
    デイスイネーブルするデイスエイネーブル手段とを含む
    ことを特徴とするコンピユータ。
  6. 【請求項６】さらに、第１の状態、第２の状態及び第３
    の状態を有するアービタ手段を具え、 上記アービタ手段
    によつて、上記第１の状態において上記ビデオメモリへ
    のアクセスを与えず、上記第２の状態において上記ビデ
    オメモリから上記先入れ先出しバツフアにビデオ情報を
    ロードし、上記第３の状態において上記処理装置ユニツ
    トから上記ビデオメモリにビデオ情報を転送することを
    特徴とする請求項５に記載のコンピユータ。
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