JPH08153843A - 半導体チップ実装用リードフレーム - Google Patents

半導体チップ実装用リードフレーム

Info

Publication number
JPH08153843A
JPH08153843A JP6294564A JP29456494A JPH08153843A JP H08153843 A JPH08153843 A JP H08153843A JP 6294564 A JP6294564 A JP 6294564A JP 29456494 A JP29456494 A JP 29456494A JP H08153843 A JPH08153843 A JP H08153843A
Authority
JP
Japan
Prior art keywords
lead frame
alloy
layer
underlayer
thickness
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP6294564A
Other languages
English (en)
Inventor
Takafumi Morikawa
貴文 森川
Akira Matsuda
晃 松田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Furukawa Electric Co Ltd
Original Assignee
Furukawa Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Furukawa Electric Co Ltd filed Critical Furukawa Electric Co Ltd
Priority to JP6294564A priority Critical patent/JPH08153843A/ja
Publication of JPH08153843A publication Critical patent/JPH08153843A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
    • H10W72/50Bond wires
    • H10W72/551Materials of bond wires
    • H10W72/552Materials of bond wires comprising metals or metalloids, e.g. silver
    • H10W72/5522Materials of bond wires comprising metals or metalloids, e.g. silver comprising gold [Au]
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W90/00Package configurations
    • H10W90/701Package configurations characterised by the relative positions of pads or connectors relative to package parts
    • H10W90/751Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires
    • H10W90/756Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires between a chip and a stacked lead frame, conducting package substrate or heat sink

Landscapes

  • Wire Bonding (AREA)
  • Lead Frames For Integrated Circuits (AREA)
  • Electroplating And Plating Baths Therefor (AREA)

Abstract

(57)【要約】 【目的】 組立工程での半田付けが良好に行え、又耐食
性等の実用特性に優れたリードフレームを提供する。 【構成】 リードフレーム本体全面に、厚さ 0.2〜1.5
μmのNi下地層が形成され、前記Ni下地層の上に厚
さ0.01〜0.2 μmの、Pd−0.01〜5wt%Ag合金層又
はPd−0.01〜5wt%Au合金層を形成した半導体チッ
プ実装用リードフレーム。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、半導体チップ実装用リ
ードフレームに関する。
【0002】
【従来の技術】トランジスタやIC等の電子部品を実装
する為のリードフレームは、図1にその平面図を示すよ
うに、半導体チップを搭載するダイパッド1の周囲に複
数本のインナーリード2が互いに離隔して配置され、こ
のインナーリード2はダムバー部3を介してアウターリ
ード4と連結して構成されたものである。このリードフ
レームには、通常Cu合金や42アロイ(Fe-42wt%Ni合
金)からなる条材や板材が用いられ、これらをプレス又
はエッチングにより、図1に示した形状のリードフレー
ム本体に加工する。前記リードフレームのダイパッド1
及びインナーリード2には、ワイヤーボンディング性を
高める為、Ag等の貴金属を3〜5μmの厚さにスポッ
トめっきする。
【0003】このリードフレームへの半導体チップの実
装は、次のようにして行われる。即ち、図2に示すよう
に、まず、ダイパッド1の上に、Agペースト5を用い
て半導体チップ6をダイボンディングする。次に、この
半導体チップ6上にある電極パッド7とインナーリード
2とを金、アルミ等からなるワイヤー8によってワイヤ
ーボンディングして電気的に接続する。次に、前記ボン
ディングした箇所の全体をエポキシ樹脂9で封止する。
次いでアウターリード4に、半田付け性を良くする為
に、半田(Sn-10wt%Pb)をめっきし、次いでダムバー3を
切断し、切断部分のバリを除去したのち、アウターリー
ド4を直角に曲げ、曲げた先をプリント配線基板の配線
に各々半田付けして半導体素子を組立てる。
【0004】ところで、前記のアウターリード4への半
田(Sn−10wt%Pb)めっきは、溶融めっき又は電気めっき
により行われる為、電子部品が熱やめっき液に晒されて
劣化しその信頼性が低下する。このようなことから、リ
ードフレーム全面に純Pd層を 0.1μm以下の厚さにめ
っきしたリードフレームが提案された。本来、Pdは大
気中で安定で酸化し難い為、ワイヤーボンディング性、
半田付け性、封止樹脂の密着性等が良好に保持され、従
ってパッド部とインナーリードへのAgのスポットめっ
きやアウターリードへの半田めっきが不要になる等の効
果が期待された。
【0005】
【発明が解決しようとする課題】しかし、純Pd層は緻
密性に欠け又ピンホールが散在する為、組立て時の熱等
によりNi下地層の酸化、純Pd層自身の酸化等が起
き、或いは表面が活性な為、樹脂封止の際の有機物の吸
着等により半田付け性が低下するという問題があった。
又純Pd層が薄い為、輸送時や保管時にピンホールを通
じてガルバニック腐食が起きて耐食性にも劣るものであ
った。これらの問題を解決する為に、純Pd層の上に厚
さがオングストロームオーダーのAuをフラッシュめっ
きする方法が提案された。この方法は、有機物の吸着防
止や純Pd層の酸化防止には効果が認められた。しか
し、Auフラッシュめっきをしてもピンホールを減少さ
せる効果は期待できず、ピンホールの影響をなくす為に
Auを厚くめっきするのはコスト的に引き合わない。又
Auは柔らかい為、リードフレーム同士の擦れやめっき
設備のロールやワイパーとの接触により下地が局部的に
露出して半田付け性が低下する等の問題があった。本発
明は、組立工程での半田付けが良好に行え、耐食性等の
実用特性に優れた半導体チップ実装用リードフレームの
提供を目的とする。
【0006】
【課題を解決するための手段】請求項1記載の発明は、
リードフレーム本体の少なくともボンディングエリアと
半田付け部にNi、Co、或いはこれらの合金からなる
下地層が 0.1〜2.0 μmの厚さに形成され、前記下地層
の上にPd−0.01〜5wt%Ag合金層又はPd−0.01〜
5wt%Au合金層が0.01μm以上の厚さに形成されてい
ることを特徴とする半導体チップ実装用リードフレーム
である。
【0007】この発明において、リードフレーム本体の
表面に形成されるNi下地層は、リードフレーム本体の
腐食や拡散を防止する作用を果たす。この為、Ni下地
層上に形成する高価なAg−Pd合金層、又はAu−P
d合金層の厚さを薄くでき、0.2μm以下で十分な効果
が得られる。リードフレーム本体におけるNi下地層の
形成部位は、少なくとも金線等をボンディングするボン
ディングエリアとアウターリード部の半田付け部であ
る。Ni下地層、及びPd−Ag合金層又はPd−Au
合金層をリードフレーム本体全面に形成しても差し支え
ない。Ni下地層の厚さを 0.2〜2.0 μmに限定する理
由は、Ni下地層の厚さが 0.2μm未満では、その効果
が十分に得られず、 2.0μmを超えるとリード曲げ部に
クラックが発生する為である。0.3 〜1.5 μmの厚さが
好ましく、特に好ましい範囲は0.3〜1.0 μmである。
【0008】Ni下地層の上に形成するPd−Ag合金
層又はPd−Au合金層は、従来の純Pd層より緻密で
ピンホールが少ないものである。この為、Ni下地層の
酸化及び前記Pd合金層自身の酸化が抑制され、又表面
の活性度が、従来の純Pd層より低いので、封止樹脂の
吸着量が減少し、耐食性や組立工程後の半田付け性が従
来より良好になる。Pd−Ag合金層中のAg含有量を
0.01〜5wt%に限定する理由は、Ag含有量が0.01wt%
未満では、その効果が十分に得られず、5wt%を超える
と、硫化が起き易くなって耐食性が低下し、又Ni下地
層との密着性も悪くなり、更にマイグレーションも懸念
されるようになる為である。又Pd−Au合金層中のA
u含有量を0.01〜5wt%に限定する理由は、Au含有量
が0.01wt%未満では、有機物の吸着やPdの酸化による
半田付け性劣化を抑制できず、5wt%を超えると、Pd
−Au合金層とNi下地層の密着性が悪化し、又外観ム
ラが出易くなる為である。
【0009】Pd−Ag合金層又はPd−Au合金層の
厚さを0.01μm以上に限定した理由は、厚さが0.01μm
未満では、緻密性に欠けてピンホールが多くなり、その
効果が十分に得られない為である。又その厚さを 0.2μ
mを超えて厚くしてもその効果が飽和し、コスト高を招
くだけであるので、厚さは 0.2μm以下にするのが望ま
しい。特に好ましい厚さは0.02〜0.1 μmである。
【0010】請求項2記載の発明は、Ni、Co、或い
はこれらの合金からなる下地層とPd−Ag合金層の
間、又は前記下地層とPd−Au合金層の間に、Pdス
トライクめっき層が0.01〜0.1 μmの厚さに形成されて
いることを特徴する請求項1記載の半導体チップ実装用
リードフレームである。
【0011】この発明において、Pdストライクめっき
層は、Ni下地層とPd−Ag合金層、又はNi下地層
とPd−Au合金層の間の密着性を一層向上させる。P
dストライクめっき層の厚さを0.01〜0.1 μmに限定す
る理由は、0.01μm未満では、その効果が十分に得られ
ず、 0.1μmを超えて厚くしてもその効果が飽和して、
コスト高になるだけの為である。Pdストライクめっき
層と前記合金層の合計の厚さは、経済上の理由から 0.2
μm以下にすることが望ましい。
【0012】請求項3記載の発明は、Ni、Co、或い
はこれらの合金からなる下地層に含有される硫黄の量が
0.01wt%以下であることを特徴とする請求項1又は請求
項2記載の半導体チップ実装用リードフレームである。
この発明で、Ni下地層に含有される硫黄の量を0.01wt
%以下に限定したのは、前記硫黄の含有量が0.01wt%を
超えると、Ni下地層の展延性が低下し、アウターリー
ド部を曲げ加工する際に曲げ部にクラックが発生し易く
なる為である。Ni下地層に硫黄が含有される原因は、
Niめっき液に添加される光沢剤によるもので、光沢剤
を使用しないか、使用しても硫黄を殆ど含まない光沢剤
を使用するのが好ましい。
【0013】本発明において、リードフレーム本体の材
料には、42アロイ、りん青銅、Cu−0.3 wt%Cr−
0.25wt%Sn−0.2 wt%Zn合金等の任意のリードフレ
ーム材が適用できる。尚、リードフレーム本体の表面
に、厚さ0.02〜0.2 μm程度のCu又はNiのストライ
クめっきを施しておくと、リードフレーム本体とNi下
地層との密着性が向上し、又Ni下地層のピンホールが
減少する。
【0014】
【実施例】以下に本発明を実施例により詳細に説明す
る。 (実施例1)Cu-0.3wt%Cr- 0.25wt%Sn-0.2wt%
Zn合金条をプレス加工して、図1に示すリードフレー
ム本体を得た。次にこのリードフレーム本体に電解脱脂
と酸洗処理を施した後、リードフレーム本体全面に厚さ
0.2μmのCuストライクめっきを施し、その上にNi
を下地めっき(Ni下地層)し、その上にAg−Pd合
金層又はAu−Pd合金層をめっきした。Ag−Pd合
金層とAu−Pd合金層の合金組成、及び各めっき層の
厚さは、本発明限定値内で種々に変化させた。
【0015】(実施例2)実施例1において、リードフ
レーム本体にCuストライクめっきを施さなかった他
は、実施例1と同じ方法によりリードフレーム本体にA
g−Pd合金又はAu−Pd合金のめっき層を形成し
た。
【0016】(実施例3)実施例1において、Ni下地
層上に、Pdをストライクめっきし、その上にAg−P
d合金層又はAu−Pd合金層をそれぞれめっきした他
は、実施例2と同じ方法によりリードフレーム本体にめ
っき層を形成した。
【0017】(比較例1)実施例1において、Ag−P
d合金めっき層とAu−Pd合金めっき層の合金組成、
及び各めっき層の厚さを、請求項1記載の発明の限定値
外で変化させた他は、実施例1と同じ方法により、リー
ドフレーム本体にめっき層を形成した。
【0018】(比較例2)実施例3において、Ag−P
d合金めっき層とAu−Pd合金めっき層の合金組成、
及び各めっき層の厚さを、請求項2記載の発明の限定値
外で変化させた他は、実施例3と同じ方法により、リー
ドフレーム本体にめっき層を形成した。
【0019】(従来例1)実施例1において、Ni下地
層上に純Pd層をめっきしたか、或いは前記純Pd層の
上に更にAuをフラッシュめっきした他は、実施例1と
同じ方法によりリードフレーム本体にめっき層を形成し
た。
【0020】このようにして得られた、めっき層を形成
したリードフレームについて、半田付け性、ボンディン
グ性、曲げ加工性、耐食性、及びめっき層の密着性を試
験した。めっき層の構成と試験結果を表1と表2に示
す。又めっき液組成とめっき条件を表3に示す。
【0021】以下に、試験方法について説明する。半田
付け性は、めっきしたリードフレームをホットプレート
上で 350℃、1分間加熱後、 230℃の共晶半田融液に3
秒間浸漬してそのときの半田濡れ面積を測定して評価し
た。フラックスは非活性ロジン系のものを使用した。試
験結果は半田濡れ面積の全面積に対する百分率で表示し
た。ボンディング性は、ダイパッドに半導体チップを実
装し、 280℃、荷重50gの条件で線径25μmのAu線を
ボンディングし、ボンディング後のAu線にフックを掛
けてプル試験を行って評価した。Au線部分で破断した
ものを良品、接合部で破断したものを不良品として、ボ
ンディング性は良品率で示した。曲げ加工性は、アウタ
ーリードを半径 0.3mmで90゜曲げ加工し、その曲げ部の
クラック発生の有無を顕微鏡観察して調べた。判定はク
ラックが全く無かったものを◎、実用上問題ない程度の
微小クラックが少数発生したものを○、クラックが発生
し母材が露出したものを×とした。耐食性は、 H2S濃度
3ppm 、温度40℃、湿度90%R.H.の雰囲気中で96時間保
持する硫化水素試験を行って調べた。錆が全く発生しな
かったものを◎、錆が若干認められたが実用上問題ない
程度のものを○、実用上問題ある程度に錆が発生したも
のを△、全面腐食したものを×とした。めっき層の密着
性は、アウターリードを 180゜密着曲げ後曲げ戻し、曲
げ部分のめっき層の剥離状況を顕微鏡観察して調べた。
めっき層の剥離が全くなかったものを◎、若干認められ
たが実用上問題ない程度のものを○、実用上問題ある程
度に剥離したものを△、めっき剥離が多数認められたも
のを×とした。上記種々の試験において、試験個数は各
々20個とし、結果は平均値で示した。
【0022】
【表1】
【0023】
【表2】
【0024】
【表3】
【0025】表1と表2より明らかなように、本発明例
品(実施例1〜3、No.1〜24)は、いずれも、半田付け
性、ボンディング性、曲げ加工性、耐食性、及びめっき
層の密着性が良好なものであった。特に、Ni下地層と
Pd合金層の間にPdをストライクめっきしたものは、
耐食性と密着性が一段と向上した。No.9はNi下地層に
硫黄が0.01wt%を超えて含有されていた為に、No.2,8等
に較べて曲げ加工でクラックが若干多めに観察された。
これに対し、比較例品(比較例1,2)のNo.25,30は、Pd
−Ag合金又はPd−Au合金の合金濃度が低かった
為、いずれも、半田付け性が劣った。No.26 はPd−A
g合金のAg濃度が高すぎた為耐食性と密着性が低下
し、No.31 はPd−Au合金のAu濃度が高すぎた為密
着性が低下し、又外観も悪化した。これらの傾向は、P
dをストライクめっきしたもの(No.32,36,33,37) にも
認められた。No.28,34は、Ni下地層が薄かった為、耐
食性に劣り、No.29,35は、Ni下地層が厚すぎて曲げ加
工でクラックが入った。No.27 はPd−Ag合金めっき
層の厚さが薄く、めっき層の密着性が低下した。従来例
品のNo.38 は、半田付け性と耐食性が劣り、No.39 は、
半田付け性は改善されたが、耐食性に劣るものであっ
た。
【0026】
【発明の効果】以上述べたように、本発明のリードフレ
ームは、リードフレーム全面に所定厚さのNi下地層を
めっきし、この上に緻密でピンホールの少ないPd−A
g合金層、又はPd−Au合金層を形成したものであ
る。従って、組立工程での半田付けが良好に行え、又耐
食性等の実用特性に優れ、工業上顕著な効果を奏する。
【図面の簡単な説明】
【図1】リードフレーム本体の平面図である。
【図2】リードフレーム本体に半導体チップを実装した
状態を示す側断面図である。
【符号の説明】
1──パッド部 2──インナーリード 3──ダイバー 4──アウターリード 5──Agペースト 6──半導体チップ 7──電極パッド 8──ボンディングワイヤー 9──封止樹脂
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.6 識別記号 庁内整理番号 FI 技術表示箇所 C25D 3/48 3/50 102 3/56 F

Claims (3)

    【特許請求の範囲】
  1. 【請求項1】 リードフレーム本体の少なくともボンデ
    ィングエリアと半田付け部にNi、Co、或いはこれら
    の合金からなる下地層が 0.1〜2.0 μmの厚さに形成さ
    れ、前記下地層の上にPd−0.01〜5wt%Ag合金層又
    はPd−0.01〜5wt%Au合金層が0.01μm以上の厚さ
    に形成されていることを特徴とする半導体チップ実装用
    リードフレーム。
  2. 【請求項2】 Ni、Co、或いはこれらの合金からな
    る下地層とPd−Ag合金層の間、又は前記下地層とP
    d−Au合金層の間に、Pdストライクめっき層が0.01
    〜0.1 μmの厚さに形成されていることを特徴する請求
    項1記載の半導体チップ実装用リードフレーム。
  3. 【請求項3】 Ni、Co、或いはこれらの合金からな
    る下地層に含有される硫黄の量が0.01wt%以下であるこ
    とを特徴とする請求項1又は請求項2記載の半導体チッ
    プ実装用リードフレーム。
JP6294564A 1994-11-29 1994-11-29 半導体チップ実装用リードフレーム Pending JPH08153843A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP6294564A JPH08153843A (ja) 1994-11-29 1994-11-29 半導体チップ実装用リードフレーム

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP6294564A JPH08153843A (ja) 1994-11-29 1994-11-29 半導体チップ実装用リードフレーム

Publications (1)

Publication Number Publication Date
JPH08153843A true JPH08153843A (ja) 1996-06-11

Family

ID=17809426

Family Applications (1)

Application Number Title Priority Date Filing Date
JP6294564A Pending JPH08153843A (ja) 1994-11-29 1994-11-29 半導体チップ実装用リードフレーム

Country Status (1)

Country Link
JP (1) JPH08153843A (ja)

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH09232493A (ja) * 1995-12-20 1997-09-05 Seiichi Serizawa リードフレーム
JP2010232283A (ja) * 2009-03-26 2010-10-14 Sumitomo Metal Mining Co Ltd 銅被覆ポリイミド基板とその製造方法
US8016624B2 (en) * 2005-09-22 2011-09-13 Enplas Corporation Electric contact and socket for electrical part

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH09232493A (ja) * 1995-12-20 1997-09-05 Seiichi Serizawa リードフレーム
US8016624B2 (en) * 2005-09-22 2011-09-13 Enplas Corporation Electric contact and socket for electrical part
JP5334416B2 (ja) * 2005-09-22 2013-11-06 株式会社エンプラス 電気接触子及び電気部品用ソケット
USRE45924E1 (en) * 2005-09-22 2016-03-15 Enplas Corporation Electric contact and socket for electrical part
JP2010232283A (ja) * 2009-03-26 2010-10-14 Sumitomo Metal Mining Co Ltd 銅被覆ポリイミド基板とその製造方法

Similar Documents

Publication Publication Date Title
KR100381302B1 (ko) 반도체 장치 및 그 제조방법
JP3760075B2 (ja) 半導体パッケージ用リードフレーム
JP3537417B2 (ja) 半導体装置およびその製造方法
JPH10237691A (ja) 多層メッキリードフレーム
EP0250146A1 (en) Palladium plated lead frame for integrated circuit
JP2003197827A (ja) 半導体装置およびその製造方法
JP2925815B2 (ja) 半導体チップ実装用リードフレームとその製造方法
JPS6349382B2 (ja)
JPH07326701A (ja) 電気電子部品用導電材、リードフレ−ム及びそれを使用した半導体集積回路
JP3402228B2 (ja) 鉛を含まない錫ベース半田皮膜を有する半導体装置
JPH08153843A (ja) 半導体チップ実装用リードフレーム
TWI381505B (zh) 導線架與利用此導線架製造半導體封裝的方法
JPH11111909A (ja) 半導体装置用リードフレーム
KR100702956B1 (ko) 반도체 팩키지용 리드프레임 및 그 제조 방법
JPH10313087A (ja) 電子部品用リード材
JPH09223771A (ja) 電子部品用リード部材及びその製造方法
JPH08204081A (ja) 半導体装置用リードフレーム及び半導体装置とその製造法
JP3481448B2 (ja) リードフレーム
JPS63304654A (ja) リ−ドフレ−ム
JPH10284666A (ja) 電子部品機器
JP3077963B2 (ja) 半導体装置用リードフレーム
JP2944128B2 (ja) セラミックパッケージ
JP2899549B2 (ja) 2層メッキのリード線とリードフレーム
JP2673642B2 (ja) リードフレーム
JPH04174546A (ja) 銅合金製半導体リードフレームの製造方法