JPH1064822A - 半導体素子のための緩衝化基板 - Google Patents
半導体素子のための緩衝化基板Info
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Abstract
晶シリコン粒径の微小化と均一化を行なうための技術を
提供する。 【解決手段】 基板100上に形成したシリコン層10
4をレーザビーム106の照射によって結晶化して多結
晶シリコン層108を得る半導体装置などに用いられ、
基板100とシリコン層104との間にバッファ層10
2が形成されている。バッファ層102を有するこのよ
うなバッファ化基板において、該バッファ層102は、
基板100の限界温度よりも高い融点を有し、さらに、
シリコン層104の結晶化に際し、バッファ層102上
に均一なシリコン結晶粒子を形成するためシリコン層1
04の核生成密度を規定し、かつシリコン層104の結
晶化過程における等方粒成長の基礎として機能する。
Description
用いられる基板構成、特に、均一で微小な多結晶粒径を
もつ多結晶層を形成するための構成と方法に関する。
化に伴い薄膜トランジスタ(TFT)等の素子も小型化
していく。これに応じて多結晶シリコンの粒径および粒
径バラツキが多結晶シリコン素子の特性上より重要な因
子になる。特にTFTの外形寸法が小さくなるにしたが
いより微小な結晶粒が必要になり、これにより統計的に
有意な数の粒子がTFTのチャンネル領域に得られ、多
結晶シリコン層に形成されたTFTの均一な素子特性が
確保される。例えばTFTの外形寸法に比べて相対的に
粒径が大きくかつ粒径バラツキも大であると、チャンネ
ル領域に含まれる粒界の数に基づいたTFT特性にバラ
ツキが生じる。
成のために、従来からレーザ結晶化法などの技術が用い
られている。しかしながら、このようなレーザ結晶化技
術により作製された多結晶層は、巨大な粒径並びに粒径
バラツキに加えて望ましくない粗な多結晶シリコン膜表
面を有するという問題があった。レーザ結晶化法におい
ては、レーザビームによってアモルファスシリコン層が
融解され、次いで融解したシリコンが冷却することによ
り多結晶シリコン層が形成される。一般にレーザ結晶化
法では10%の出力バラツキをもつパルスレーザが使用
される。しかし、このバラツキは多結晶シリコン層中に
1000%の粒径バラツキの発生をもたらす。このため
従来のパルスレーザ結晶化法で作製されたTFT構成中
の粒子数は著しく変動する。
るいはシリカ緩衝化基板(bufferedsubstrate)を用いて
行われていた。この方式においては多結晶シリコンの粒
径はレーザ出力(laser fluence)依存性がきわめて高
い。この現象についていくつかの理論付けがなされてい
る。すなわち臨界レーザ出力論「The critical laser f
luence」(ジョンソン他著、Materials Research Socie
ty Symposium Proceedings:マテリアルズリサーチソサ
エティシンポジウムプロシーディングス297巻、53
3頁、1993年)、側方成長論「lateral growth」
(クリヤマ他著、Japanese Journal of Applied Physic
s Letters:ジャパニーズジャーナルオブアプライドフ
ィジックスレターズ33巻、5657頁、1994年)
および超側方成長論「super lateral growth」(イム
「Im」他著、Applied Physics Letters:アプライドフ
ィジックスレターズ64巻、2303頁、1994年)
である。これらの理論によると、狭いレーザ出力域でシ
リコン結晶粒は側方に大きく(シリコン膜の厚さの約1
0倍の寸法に)成長する。この大きな側方粒成長はしば
しば表面の凹凸が激しい場合に発生する。
にTFTが形成されると、粒子が大きすぎるため小型T
FT用の粒子を統計的に有意な数で得ることができなく
なる。さらに、100nm厚さの結晶化多結晶シリコン
層における巨大結晶粒の二乗平均(rms)表面粗度は
約60nmである。rms表面粗度がこのように大きい
と絶縁破壊が発生するため高い素子バイアス電圧を維持
できない。
に、基板加熱等の技術による多結晶シリコン層の粒径の
均一性の改善が行われてきた。しかし基板加熱は製造工
程における追加作業を必要とし、このために素子製造に
要する工程時間が増加して結果的に製造価格の高額化を
招く。
れたものであり、製造時間および製造価格を増加するこ
となく多結晶シリコン粒径の微小化と均一化を行なうた
めの技術を提案することを目的とする。
成するために、結晶化するシリコン層と基板との間に緩
衝層(buffer layer、以下バッファ層という)を設けた
緩衝化基板(bufferedsubstrate、以下バッファ化基板
という)を用いることを特徴とする。このバッファ化基
板は、基板、基板上に形成されたバッファ層およびバッ
ファ層上に形成されたシリコン層を含む。このシリコン
層はバッファ層上に形成された後、レーザビームを用い
て結晶化される。ここで、バッファ層は基板の限界温度
(threshlod temperature)、即ち基板の耐熱限界温度
以上の融点を有し、さらに、前記シリコン層の結晶化に
際し、該バッファ層上に均一なシリコン結晶粒子を形成
するために、前記シリコン層の核生成密度を規定し、か
つ前記シリコン層の結晶化過程における等方粒成長の基
礎として機能する。
O2、ガラス、石英および金属などが適用可能である。
また、バッファ層の構成材料としては、例えば、Mg
O、MgAl2O4、Al2O3およびZrO2が適用可能
である。更に、バッファ層上に最初に形成されるシリコ
ン層としては、アモルファスシリコン層が、またこのア
モルファスシリコン層の厚みは、約100nmが適用可
能である。
は、基板上へのバッファ層の形成工程を含む。また、結
晶化シリコン層は、基板上のバッファ層の上にシリコン
層を形成した後、レーザビームを用いて結晶化すること
によって得られる。
バラツキは、基本的に基板と溶融シリコンとの界面近傍
での不均質な核生成(heterogeneous nucleation)が欠
乏することに起因する。この不均質核生成の欠乏は、多
結晶シリコン結晶粒子の巨大な側方成長をもたらす。同
側方成長は狭いレーザ出力範囲で発生し、寸法はシリコ
ン層の厚さの約10倍である。この巨大な側方粒成長は
しばしば表面の凹凸が激しい場合に発生する。
コン溶融用のレーザ出力にきわめて敏感に影響を受け
る。このレーザ出力に対する敏感さは粒径バラツキ発生
の主因であり、シリコンが未溶融シリコンに接触した状
態で結晶化する場合と、下地基板に接触した状態で結晶
化する場合における核生成密度の相違に起因するもので
ある。レーザ出力の強度がシリコン層を部分的に貫通溶
融(メルトスルー:melt-through)し得る程度である場
合、基板に接した状態の溶融シリコンは、接していない
状態のものとは異なる核生成密度をもつ。レーザ出力を
シリコン層全体を貫通溶融するためのしきい値以上に設
定して均一な核生成密度を得ようとすると、多くの場合
基板が損傷を受けると共に多結晶シリコン層のアブレー
ション(ablation:融除)などの悪影響が生じる。
コン結晶を用いた半導体素子などの構成において、基板
とシリコン層の間にバッファ層を設けることで、結晶化
によって得られる多結晶シリコン結晶の粒径と粒径バラ
ツキを減少させる。バッファ層は、基板の限界温度(基
板の耐熱限界温度)以上の耐熱性をもつ材料から形成さ
れる。基板がその限界温度以上に加熱されると、基板の
アブレーションや基板上に形成された膜のアブレーショ
ンが起こるといった悪影響が生じる。そこでバッファ層
によって上記悪影響から基板を保護する。例えばSiO
2は、約1610℃〜1723℃の間に融点をもつ。し
たがって1723℃以上の融点をもつ材料がSiO2基
板のバッファ層として使用されうる。
に加えて、バッファ層は高密度のシリコン核生成の基礎
にもなる。基板と溶融シリコン界面に大量の核が存在す
ると、結晶化は多結晶シリコン薄膜の厚さにほぼ等しい
大きさの結晶粒を形成するように進行する。この現象は
等方粒成長(isotropic grain growth)と呼ばれる。バ
ッファ層はシリコンの等方粒成長を促進するものであ
る。等方粒成長の増加により巨大な側方成長が抑制さ
れ、横方向、つまり面方向の粒子サイズが多結晶シリコ
ン膜の厚さと同程度まで低減される。
冷却される時に、前記増加した核生成密度の作用により
シリコン粒子の微小化と粒径の均一化がなされる。多数
の微小なシリコン粒子が、形成される素子寸法に対して
統計的に有意な数の粒子となる。素子当りの粒子数の増
加は素子特性の均一性を高め、結果的に素子の適用製品
の信頼性を高める。
料を下表に示す。なおこの一覧表は、適用可能な材料全
てを網羅するものではない。
同材料を用いて形成したバッファ層により、レーザ照射
で生じる基板の損傷に対する耐性が付与される。
TFTなどの素子にとっては特に重要である。同TFT
は活性層下の基板上にゲート電極が形成されるため、基
板の損傷によって漏洩電流が発生する。ゲート電極が基
板とバッファ層の間にあれば、このバッファ層は基板を
熱的に保護しつつボトムゲートTFTのゲート絶縁層と
して機能する。このようにバッファ層により素子特性が
改善される。
層の高融点材料層を使用すればよい。つまりバッファ層
は、要求される熱的境界条件に応じて単層あるいは多層
のいずれでも形成することができる。また別の効果とし
て、融解処理時間の延長、又は類似の他の処置による熱
的損傷から基板を保護する事がある。
長とを共に生じさせて結晶化した場合、同シリコン層は
低アスペクト比(ほとんど1に近い)の粒子領域と高ア
スペクト比の粒子領域とをもつ。粒子のアスペクト比と
は粒子の幅と高さとの比率の事である。図1は該多結晶
シリコン層のTEM写真を示す図の一例である。等方粒
成長と側方粒成長とによって得られた多結晶シリコン膜
の粒径バラツキは、側方結晶粒子と等方結晶粒子との粒
径の違いにほぼ等しい。例えば、厚さ100nmのシリ
コン膜での側方成長においては、約100nm径の等方
結晶粒子の基質中にしばしば1μm径の粒子が生成す
る。すなわち約10倍の粒径バラツキが発生する。
キが概ね2倍以下で平均粒径が概ね多結晶シリコン層の
厚み以下の多結晶シリコン層を提供する。
径をもつ多結晶シリコン層の形成方法を示す。図2
(a)は石英あるいはガラス等の材料で形成された基板
100を示すものである。この基板100の材料として
は、例えばSiO2、コーニング7059または173
1などがある(コーニング7059または1731は一
般的な基板材料であり、コーニンググラスワークス社
(ニューヨーク コーニング、14830)から容易に
入手できる)。基板100は他の構成、例えばボトムゲ
ート素子のゲート誘電体やゲート電極などを含んでいて
もよい。
ッファ層102を示す。基板100上へのバッファ層1
02の形成は物理気相成長、化学気相成長(CVD)あ
るいはゾルゲル法などの技術により行われる。物理気相
成長法として、電子ビーム蒸着、スパッタ、加熱蒸着、
パルスレーザ蒸着等がある。薄膜バッファ層102は単
層でよく、場合によっては基板100表面を必ずしも完
全に覆う必要はない。バッファ層102が基板100表
面を部分的に覆ってアイランド状になる場合は、アイラ
ンドの密度が当該多結晶シリコン層に必要な粒子の密度
にほぼ一致することが必要である。
リコン層104が約100nm以下の厚さのバッファ層
102上に形成される。他の厚さのバッファ層も適用可
能である。課題に即した素子としては約100nm以下
の厚さのアモルファスシリコン層がパルスレーザ結晶化
処理用として適する。またシリコン層は非晶質でなくて
もよい。この理由はレーザビームがシリコン層を融解
し、融解前の結晶構造をすべて解消するためである。
06によって融解され、次いで冷却されることにより結
晶化し、多結晶層108が形成される。各々の工程を図
2(d)、図2(e)に示す。レーザビーム106はY
AGレーザあるいはエキシマレーザ等のレーザ装置から
発振される。多くの場合エキシマレーザが好適である。
この理由は同レーザは照射範囲が広いため処理速度が早
いことによる。
0nm厚さの多結晶シリコン層についての実験結果か
ら、約540±20mJ/cm2あるいは全レーザ出力
域の約10%の狭いレーザ出力域で側方粒成長が生じる
ことが判明している。この狭いレーザ出力域はレーザ結
晶化の施工に必要なレーザ出力分布のほぼ中央に位置す
るものである。したがって巨大粒径を防止するために
は、狭いレーザ出力域内でのレーザ出力の変動を抑制す
る必要がある。しかし素子作製に用いる工業用レーザの
出力制御は困難であるため、工業用レーザでのレーザ出
力においては側方成長が生じる出力域を避ける必要があ
る。このため結晶化処理に適用可能な工業用レーザの出
力域は著しく制限される。
ーザの出力制御に必要な条件が緩和される。バッファ層
によって生起されるシリコン粒子の核生成の作用により
側方粒成長が抑制される。基本的には、バッファ層が存
在する時には100nm厚さのシリコン膜を貫通溶融
(約300mJ/cm2)から融除(約600mJ/c
m2)するまでの全レーザ出力範囲が適用可能である。
すなわちバッファ層を用いる事で著しく広範囲のレーザ
出力が適用可能になる。
結晶シリコン層108における平均粒径バラツキは概ね
2以下である。これに対し従来技術による粒径バラツキ
は約10である。つまりバッファ層102により粒径バ
ラツキが5分の1以下に減少する。
しく改善され、結果的にこの多結晶層108に形成され
る素子の特性の均一性が著しく向上する。TFT、キャ
パシタおよび抵抗などの素子の信頼性が高まり、その結
果優れた性能の製品が得られる。
ン層における同シリコン層108のrms表面粗度は概
ね6nm以下である。この値は側方成長を伴う従来のレ
ーザ結晶化技術でのrms表面粗度が60nmであるの
に対して1桁向上している。
ったが、上記説明に限らず、本発明の範囲内で様々な別
の実施形態や、修正および変形が可能である。例えば、
同様の原理を用いて微結晶Si、GeあるいはSiGe
合金のパルスレーザ結晶化を行なうことができる。した
がって、上述の実施形態は好適な一例であり制約するも
のではない。特許請求の範囲で規定された本発明の範囲
内で種々の変更を行なうことが可能である。
シリコン層の透過電子顕微鏡(TEM)写真を示す図で
ある。
例を示す概略断面図である。
ァスシリコン層、106 レーザビーム、108 多結
晶シリコン層。
Claims (1)
- 【請求項1】 基板と、 前記基板上に形成された緩衝層と、 前記緩衝層上に形成された後にレーザによって結晶化さ
れたシリコン層と、を含む緩衝化基板であって、 前記緩衝層は、前記基板の限界温度以上の融点を有し、
さらに、前記シリコン層の結晶化に際し、該緩衝層上に
均一なシリコン結晶粒子を形成するために、前記シリコ
ン層の核生成密度を規定し、かつ前記シリコン層の結晶
化過程における等方粒成長の基礎として機能することを
特徴とする緩衝化基板。
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