JPS58111477A - 主走査縮小方式 - Google Patents
主走査縮小方式Info
- Publication number
- JPS58111477A JPS58111477A JP56209120A JP20912081A JPS58111477A JP S58111477 A JPS58111477 A JP S58111477A JP 56209120 A JP56209120 A JP 56209120A JP 20912081 A JP20912081 A JP 20912081A JP S58111477 A JPS58111477 A JP S58111477A
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- Japan
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- pixel
- data
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
- H04N1/04—Scanning arrangements, i.e. arrangements for the displacement of active reading or reproducing elements relative to the original or reproducing medium, or vice versa
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、ＣＣＩＴＴ（国際電信電話諮問委員会）規格
によるＧＩ［機、 Ｇｌ［機等の中高速のファクシミリ
装置において、主走査読取り後の画素データ抜取りを行
って送信原稿のサイズを縮小して送信するための主走査
縮小方式に関するものである。
によるＧＩ［機、 Ｇｌ［機等の中高速のファクシミリ
装置において、主走査読取り後の画素データ抜取りを行
って送信原稿のサイズを縮小して送信するための主走査
縮小方式に関するものである。
ファクシミリ装置においては、相手機種に応じて、例え
ば、送信原稿をＡ３版サイズから８４版サイズに、また
は８４版サイズからＡ４版サイズ等に縮小して送信する
必要がある。
ば、送信原稿をＡ３版サイズから８４版サイズに、また
は８４版サイズからＡ４版サイズ等に縮小して送信する
必要がある。
この場合、送信ファク、シｉ リ信号の主走査方向の縮
小を行わなければならないが、従来の主走査縮小方式は
、−例として、読取部で読み取られて読取シ用のライン
メモリに蓄積さ氷ている１ライン分の２値化読取シデー
タを順次に取り出し、分周回路を通して一定ビット間隔
で画素データの抜き取シを行い、順次、送信用のライン
メモリに縮小した主走査ラインデータを蓄積した後、所
望の相手に対して当該ファクシミリ信号を送出せしめる
ようにしていた。
小を行わなければならないが、従来の主走査縮小方式は
、−例として、読取部で読み取られて読取シ用のライン
メモリに蓄積さ氷ている１ライン分の２値化読取シデー
タを順次に取り出し、分周回路を通して一定ビット間隔
で画素データの抜き取シを行い、順次、送信用のライン
メモリに縮小した主走査ラインデータを蓄積した後、所
望の相手に対して当該ファクシミリ信号を送出せしめる
ようにしていた。
例えば、主走査２値化データを８４版サイズ（２０４８
ビツト／ライン）からＡ４版サイズ（１７２８ビツト／
ライン）に縮小するには、分局回路で縮小前の原２値化
データの６ビツト目ごとの画素データ抜取りを行つｆｃ
１７０７ビツトのデータに白データ２１ビツトを付加し
て１７２８ビツトとする。
ビツト／ライン）からＡ４版サイズ（１７２８ビツト／
ライン）に縮小するには、分局回路で縮小前の原２値化
データの６ビツト目ごとの画素データ抜取りを行つｆｃ
１７０７ビツトのデータに白データ２１ビツトを付加し
て１７２８ビツトとする。
この従来方式は、常に、一定間隔の画素データ抜取り方
式であるので、抜き取るべき画素データが１ビツトのラ
ンレングスの画素（当該画素データが黒であるとき、そ
の前後両ビットの画素データが白であるもの、またはそ
の逆の関係にあるものであって、以下、孤立画素という
。）に係るものであると、その部分に細部情報欠落が生
じ、受信画像の画品質が低下することになる。
式であるので、抜き取るべき画素データが１ビツトのラ
ンレングスの画素（当該画素データが黒であるとき、そ
の前後両ビットの画素データが白であるもの、またはそ
の逆の関係にあるものであって、以下、孤立画素という
。）に係るものであると、その部分に細部情報欠落が生
じ、受信画像の画品質が低下することになる。
本発明の目的は、上記した従来技術の欠点をなくシ、主
走査読取り後の画素データ抜取りを行って送信原稿のサ
イズを縮小・送信しても受信画品質の低下を防止するこ
とができる主走査縮小方式を提供することにある。
走査読取り後の画素データ抜取りを行って送信原稿のサ
イズを縮小・送信しても受信画品質の低下を防止するこ
とができる主走査縮小方式を提供することにある。
本発明の特徴は、所定のビット間隔の画素データ抜取り
を行いつつも、その抜取シを行うべき画素データが孤立
画素に係るものである場合は、当該画素データ抜取りを
停止し、その直前もしくは直後の部分が２ビツト以上の
ランレングスの画素データ群であるときは、その最後も
しくは最初の１ビツトの画素データ抜取りを行い、また
は当該抜取るべきビットの直前もしくは直後の部分が１
ビツト以上の孤立画素に係る画素データ群であるときは
、その直前の１ビツトの画素データ抜取りを行うように
した主走査縮小方式にある。
を行いつつも、その抜取シを行うべき画素データが孤立
画素に係るものである場合は、当該画素データ抜取りを
停止し、その直前もしくは直後の部分が２ビツト以上の
ランレングスの画素データ群であるときは、その最後も
しくは最初の１ビツトの画素データ抜取りを行い、また
は当該抜取るべきビットの直前もしくは直後の部分が１
ビツト以上の孤立画素に係る画素データ群であるときは
、その直前の１ビツトの画素データ抜取りを行うように
した主走査縮小方式にある。
以下、本発明の実施例を図に基づいて説明する。
゛第１図は、本発明に係る主走査縮小方式によるファ
クシミリ装置の送信系の一実施例のブロック図、第２図
は、そのタイムチャートであって、５／６縮小の場合に
対するものである。
゛第１図は、本発明に係る主走査縮小方式によるファ
クシミリ装置の送信系の一実施例のブロック図、第２図
は、そのタイムチャートであって、５／６縮小の場合に
対するものである。
ここで、１は、送信原稿の光学的読取りを行い、その２
値化読取りデータを順次に送出する読取り部、２Ａは、
２値化読取９データを１ライン分ととに蓄積する読取り
データ用のラインメモリ、２Ｂは、画素データ抜取り後
の２値化読取りデータを蓄積する送信用のラインメモリ
、３Ａ、３Ｂは、それぞれ、ラインメモリ２Ａ、２Ｂに
ついてデータの書込み、読取りを行うためのアドレスカ
ウンタ、４は、画素データ抜取９部、４ａは、その孤立
画素検出回路、４ｂは、同孤立画素計数回路、４Ｃは、
同一定間隔抜取り指示回路、４ｄは、同遅延回路、４ｅ
は、同画素抜取り回路、４ｆは、同インバータ、５は、
２値化画データを所望の帯域圧縮符号に変換する符号化
部、６は、上記符号の変調を行い、回線ＬＩＮＥとのイ
ンタフェースを行う伝送制御部、７は、上記各部に対し
て必要な制御を行う制御部である。
値化読取りデータを順次に送出する読取り部、２Ａは、
２値化読取９データを１ライン分ととに蓄積する読取り
データ用のラインメモリ、２Ｂは、画素データ抜取り後
の２値化読取りデータを蓄積する送信用のラインメモリ
、３Ａ、３Ｂは、それぞれ、ラインメモリ２Ａ、２Ｂに
ついてデータの書込み、読取りを行うためのアドレスカ
ウンタ、４は、画素データ抜取９部、４ａは、その孤立
画素検出回路、４ｂは、同孤立画素計数回路、４Ｃは、
同一定間隔抜取り指示回路、４ｄは、同遅延回路、４ｅ
は、同画素抜取り回路、４ｆは、同インバータ、５は、
２値化画データを所望の帯域圧縮符号に変換する符号化
部、６は、上記符号の変調を行い、回線ＬＩＮＥとのイ
ンタフェースを行う伝送制御部、７は、上記各部に対し
て必要な制御を行う制御部である。
まず、読取り部１からの２値化された画データは、公知
のように、制御部７の制御により、アドレス力＋７ｙ夕
３Ａからの番地指示に従い、ラインメモリ２人に蓄積さ
れる。
のように、制御部７の制御により、アドレス力＋７ｙ夕
３Ａからの番地指示に従い、ラインメモリ２人に蓄積さ
れる。
次に、画素データ抜取り部４において、孤立画素検出回
路４ａは、制御部７からの制御により、その制御クロッ
クＣＫに従い、ラインメモリ３Ａに蓄積された画データ
ＰＤ（例えば、各画素デー−タＡｌｌ〜Ａ１６．Ａ２１
〜Ａ２６．Ａ３１〜Ａ３６．Ａ４１〜Ａ４６．・・・・
・・からなるもの）を１ビツトずつ順次に取り出し、そ
のランレングスを計算する。
路４ａは、制御部７からの制御により、その制御クロッ
クＣＫに従い、ラインメモリ３Ａに蓄積された画データ
ＰＤ（例えば、各画素デー−タＡｌｌ〜Ａ１６．Ａ２１
〜Ａ２６．Ａ３１〜Ａ３６．Ａ４１〜Ａ４６．・・・・
・・からなるもの）を１ビツトずつ順次に取り出し、そ
のランレングスを計算する。
その結果、孤立画素が検出されない限り、上記制御クロ
ックＣＫに基づいて、一定間隔抜取り指示回路４Ｃから
送出される一定間隔抜取シ信号ＴＫＯｉ例えば、制御ク
ロックＣＫの６クロツクごとの高レベル信号によシ、画
素抜取り回路４ｅは、遅延回路４ｄによって所定の遅延
、例えば、制御クロックＣＫの１．５クロツク分の遅延
をされた遅延画データＤＬＰＤ（画素データＢｌｌ〜Ｂ
１６，８２１〜Ｂ２６．・・・・・・等からなるもの）
について、サイクリックに所定ビット目（本実施例では
６ビツト目）ごとの画素データ抜き取りを行い、制御部
７の制御により、アドレスカウンタ３Ｂの番地指示に従
い、順次にラインメモリ２Ｂに蓄積せしめる。これは、
要するに前述の従来例における分周回路の動作と同様な
ものである。
ックＣＫに基づいて、一定間隔抜取り指示回路４Ｃから
送出される一定間隔抜取シ信号ＴＫＯｉ例えば、制御ク
ロックＣＫの６クロツクごとの高レベル信号によシ、画
素抜取り回路４ｅは、遅延回路４ｄによって所定の遅延
、例えば、制御クロックＣＫの１．５クロツク分の遅延
をされた遅延画データＤＬＰＤ（画素データＢｌｌ〜Ｂ
１６，８２１〜Ｂ２６．・・・・・・等からなるもの）
について、サイクリックに所定ビット目（本実施例では
６ビツト目）ごとの画素データ抜き取りを行い、制御部
７の制御により、アドレスカウンタ３Ｂの番地指示に従
い、順次にラインメモリ２Ｂに蓄積せしめる。これは、
要するに前述の従来例における分周回路の動作と同様な
ものである。
ここで、孤立画素（例えば、第２図において、画データ
ＰＤの各画素データＡ１５．Ａ１６゜Ａ２６．Ａ３１〜
Ａ３６．Ａ４１〜Ａ４４）が検出されると、孤立画素検
出回路４ａは、各孤立画素の終了ごとに制御クロックＣ
Ｋの１クロツク長の孤立画素信号ＩＢを孤立画素計数回
路４ｂへ送出する。
ＰＤの各画素データＡ１５．Ａ１６゜Ａ２６．Ａ３１〜
Ａ３６．Ａ４１〜Ａ４４）が検出されると、孤立画素検
出回路４ａは、各孤立画素の終了ごとに制御クロックＣ
Ｋの１クロツク長の孤立画素信号ＩＢを孤立画素計数回
路４ｂへ送出する。
これは、例えば、上記孤立画素データＡ１５゜Ａ１６に
対して２クロツク長、Ａ２６〜Ａ４４に対して１１クロ
ツク長のａｔ Ｈｎ （高レベル信号）である。
対して２クロツク長、Ａ２６〜Ａ４４に対して１１クロ
ツク長のａｔ Ｈｎ （高レベル信号）である。
孤立画素計数回路４ｂは、制御クロックＣＫに基づき、
上記孤立画素信号ＩＢを受けている間、そのクロック数
を計数し、画素抜取り回路４ｅに対する連続孤立画素信
号ＣＩＢを当該クロック数分だけ”Ｈ′′とするが、そ
れが画素抜取りのための一定間隔クロック（ビット）数
（本実施例では６）の１個前まで続くと（すなわち、制
御クロックＣＫ５個分続くと）、次の１クロック分を“
Ｌ′″（低レベル）とする。
上記孤立画素信号ＩＢを受けている間、そのクロック数
を計数し、画素抜取り回路４ｅに対する連続孤立画素信
号ＣＩＢを当該クロック数分だけ”Ｈ′′とするが、そ
れが画素抜取りのための一定間隔クロック（ビット）数
（本実施例では６）の１個前まで続くと（すなわち、制
御クロックＣＫ５個分続くと）、次の１クロック分を“
Ｌ′″（低レベル）とする。
また、一定間隔抜取り信号ＴＫＯＩが、連続孤立画素信
号ＣＩＢが”Ｈ”となっている間に到来すると、当該信
号ＣＩＨの”Ｈ”後の“Ｌ”の初頭の１クロック分（制
御クロックＣＫについて）だけ期外抜取シ信号ＴＫＯ２
を送出する。
号ＣＩＢが”Ｈ”となっている間に到来すると、当該信
号ＣＩＨの”Ｈ”後の“Ｌ”の初頭の１クロック分（制
御クロックＣＫについて）だけ期外抜取シ信号ＴＫＯ２
を送出する。
画素抜取シ回路４ｅは、期外抜取り信号ＴＫＯ２、また
は、上記連続孤立画素信号ＣＩＢが”Ｌ″中に上記一定
間隔抜取り信号’Ｉ’ＫＯ１（“Ｈ″）を受けたときに
、当該制御クロックＣＫ（”Ｈ’″）に同期した画素デ
ータのラインメモリ２Ｂへの書込みを禁止する。
は、上記連続孤立画素信号ＣＩＢが”Ｌ″中に上記一定
間隔抜取り信号’Ｉ’ＫＯ１（“Ｈ″）を受けたときに
、当該制御クロックＣＫ（”Ｈ’″）に同期した画素デ
ータのラインメモリ２Ｂへの書込みを禁止する。
すなわち、制御クロックＣＫをインバータ４ｆで反転し
た反転制御クロックＣ【から、上記期外抜取り信号ＴＫ
Ｏ２または連続孤立画素信号ＣＩＢのｕ Ｌ″′時の一
定間隔抜取り信号ＴＫＯ１に同期したクロックパルスを
除き、これを書込みクロックＷＣＫとしてラインメモリ
２Ｂ、アドレスカウンタ３Ｂに供給し、所望の画素デー
タ抜取シを行って主走査方向を縮小した画データをライ
ンメモリ２Ｂに蓄積するようにする。
た反転制御クロックＣ【から、上記期外抜取り信号ＴＫ
Ｏ２または連続孤立画素信号ＣＩＢのｕ Ｌ″′時の一
定間隔抜取り信号ＴＫＯ１に同期したクロックパルスを
除き、これを書込みクロックＷＣＫとしてラインメモリ
２Ｂ、アドレスカウンタ３Ｂに供給し、所望の画素デー
タ抜取シを行って主走査方向を縮小した画データをライ
ンメモリ２Ｂに蓄積するようにする。
例えば、画素データＡ１６は、本来、抜き取られるべき
であるが、その前の画素データＡ１５とともに孤立画素
であるので、次の連続画素データ部分のうち画素データ
Ａ２１が抜き取られることになる。
であるが、その前の画素データＡ１５とともに孤立画素
であるので、次の連続画素データ部分のうち画素データ
Ａ２１が抜き取られることになる。
また、画素データＡ２６．Ａ３６．Ａ４６については、
その直前が連続画素データ部分（群）または孤立画素デ
ータの連続部分（群）であって、その後が孤立画素デー
タの連続部分（群）または連続画素データ部分（群）で
あるので、一定間隔抜取り信号ＴＫＯＩに従い、画素デ
ータＡ２５゜Ａ３５．Ａ４５が抜き取られることになる
。なお、孤立画素データＡ３５の抜取シについては、連
続部分の１個のみであるので、実用上、画品質の低下と
なることはない。
その直前が連続画素データ部分（群）または孤立画素デ
ータの連続部分（群）であって、その後が孤立画素デー
タの連続部分（群）または連続画素データ部分（群）で
あるので、一定間隔抜取り信号ＴＫＯＩに従い、画素デ
ータＡ２５゜Ａ３５．Ａ４５が抜き取られることになる
。なお、孤立画素データＡ３５の抜取シについては、連
続部分の１個のみであるので、実用上、画品質の低下と
なることはない。
すなわち、ラインメモリ２Ｂには、遅延画データＤＬＰ
Ｄのうち、画素データＢｌｌ〜Ｂ１６、Ｂ２２〜Ｂ２４
．Ｂ２６、Ｂ３１〜Ｂ ３４ 、 Ｂ３６およびＢ４１
〜Ｂ４４．Ｂ４６等が書き込まれる。
Ｄのうち、画素データＢｌｌ〜Ｂ１６、Ｂ２２〜Ｂ２４
．Ｂ２６、Ｂ３１〜Ｂ ３４ 、 Ｂ３６およびＢ４１
〜Ｂ４４．Ｂ４６等が書き込まれる。
このようにして、完全な孤立画素データの抜取りを防止
するとともに、細部情報欠落が生じない範囲で孤立画素
データの連続部分について抜取りを行い、所望の主走査
縮小（例えば、上記実施例では５／６縮小）を行うこと
ができる。
するとともに、細部情報欠落が生じない範囲で孤立画素
データの連続部分について抜取りを行い、所望の主走査
縮小（例えば、上記実施例では５／６縮小）を行うこと
ができる。
以上、詳細に説明したように、本発明によれば、所望の
縮小率となるように画素データの抜取りを行っても、受
信画品質の低下を防止することができるので、ファクシ
ミリ通信の信頼性９画品質を向上し、ひいては、同通信
網の拡大に顕著な効果が得られる。
縮小率となるように画素データの抜取りを行っても、受
信画品質の低下を防止することができるので、ファクシ
ミリ通信の信頼性９画品質を向上し、ひいては、同通信
網の拡大に顕著な効果が得られる。
第１図は、本発明に係る主走査縮小方式によるファクシ
ミリ装置の送信系の一実施例のブロック図、第２図は、
そのタイムチャートである。 １・・・読取り部、２Ａ、２Ｂ・・・ラインメモリ、３
Ａ。 ３Ｂ・・・アドレスカウンタ、４・・・画素データ抜取
り部、４ａ・・・孤立画素検出回路、４ｂ・・・孤立画
素計数回路、４Ｃ・・・一定間隔抜取り指示回路、４ｄ
・・・遅延回路、４ｅ・・・画素抜取り回路、４ｆ・・
・インバータ、５・・・符号化部、６・・・伝送制御部
、７・・・制御部。 代理人 弁理士 福田幸作 （ほか１名）
ミリ装置の送信系の一実施例のブロック図、第２図は、
そのタイムチャートである。 １・・・読取り部、２Ａ、２Ｂ・・・ラインメモリ、３
Ａ。 ３Ｂ・・・アドレスカウンタ、４・・・画素データ抜取
り部、４ａ・・・孤立画素検出回路、４ｂ・・・孤立画
素計数回路、４Ｃ・・・一定間隔抜取り指示回路、４ｄ
・・・遅延回路、４ｅ・・・画素抜取り回路、４ｆ・・
・インバータ、５・・・符号化部、６・・・伝送制御部
、７・・・制御部。 代理人 弁理士 福田幸作 （ほか１名）
Claims (1)
- １、ファクシミリ装置の読取り画データについて画素デ
ータ抜取シを行い、送信原稿のサイズを縮小して送信す
るようにした主走査縮小方式において、所定のビット間
隔の画素データ抜取りを行いつつも、その抜取りを行う
べき画素データが孤立画素に係るものである場合は、当
該画素データ抜取りを停止し、その直前もしくは直後の
部分が２ビツト以上のランレングスの画素データ群であ
るときは、その最後もしくは最初の１ビツトの画素デー
タ抜取９を行い、または当該抜取るべきビットの直前も
しくは直後の部分が１ビツト以上の孤立画素に係る画素
データ群であるときは、その直前の１ビツトの画素デー
タ抜取りを行うようにすることを特徴とする主走査縮小
方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56209120A JPS58111477A (ja) | 1981-12-25 | 1981-12-25 | 主走査縮小方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56209120A JPS58111477A (ja) | 1981-12-25 | 1981-12-25 | 主走査縮小方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58111477A true JPS58111477A (ja) | 1983-07-02 |
Family
ID=16567613
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56209120A Pending JPS58111477A (ja) | 1981-12-25 | 1981-12-25 | 主走査縮小方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58111477A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01292582A (ja) * | 1988-05-20 | 1989-11-24 | Pfu Ltd | ドット・イメージ・データ密度変換処理装置 |
| US9217539B2 (en) | 2005-06-01 | 2015-12-22 | Toyota Jidosha Kabushiki Kaisha | High-pressure tank |
-
1981
- 1981-12-25 JP JP56209120A patent/JPS58111477A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01292582A (ja) * | 1988-05-20 | 1989-11-24 | Pfu Ltd | ドット・イメージ・データ密度変換処理装置 |
| US9217539B2 (en) | 2005-06-01 | 2015-12-22 | Toyota Jidosha Kabushiki Kaisha | High-pressure tank |
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