JPS5831424A - スイツチングレギユレ−タ - Google Patents
スイツチングレギユレ−タInfo
- Publication number
- JPS5831424A JPS5831424A JP12915681A JP12915681A JPS5831424A JP S5831424 A JPS5831424 A JP S5831424A JP 12915681 A JP12915681 A JP 12915681A JP 12915681 A JP12915681 A JP 12915681A JP S5831424 A JPS5831424 A JP S5831424A
- Authority
- JP
- Japan
- Prior art keywords
- voltage
- transistor
- circuit
- inverter
- emitter
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M3/00—Conversion of DC power input into DC power output
- H02M3/22—Conversion of DC power input into DC power output with intermediate conversion into AC
- H02M3/24—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters
- H02M3/28—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate AC
- H02M3/325—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate AC using devices of a triode or a transistor type requiring continuous application of a control signal
- H02M3/335—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate AC using devices of a triode or a transistor type requiring continuous application of a control signal using semiconductor devices only
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Continuous-Control Power Sources That Use Transistors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はスイッチングレギュレータに係り、特に補助イ
ンバータ回路に使用しているインバータ用トランジスタ
の耐電圧負担を軽減したスイッチジグレギュレータに関
する。
ンバータ回路に使用しているインバータ用トランジスタ
の耐電圧負担を軽減したスイッチジグレギュレータに関
する。
一般に比較的電力容量の大きい電源装置においては、１
次電源投入時に発生する突入電流を極力抑制する観点か
ら種々な手段が提案されている。
次電源投入時に発生する突入電流を極力抑制する観点か
ら種々な手段が提案されている。
例えば１つの手段として、１次電源投入当初においては
、出力の大きい主出力回路側のインバータは駆動せしめ
ず、代りに補助のインバータでもって上記主出力回路を
駆動し、その駆動後、主出力回路の出力でもって主出力
回路のインバータを駆動する方法である。
、出力の大きい主出力回路側のインバータは駆動せしめ
ず、代りに補助のインバータでもって上記主出力回路を
駆動し、その駆動後、主出力回路の出力でもって主出力
回路のインバータを駆動する方法である。
しかして補助インバータ回路の発振に使用されるインバ
ータ用トランジスタに印加される電圧は・一般に１次側
交流電源を直接全波整流して得られた直流高電圧であり
、したがってインバータ用トランジスタには高耐圧性を
有することが要請されている。
ータ用トランジスタに印加される電圧は・一般に１次側
交流電源を直接全波整流して得られた直流高電圧であり
、したがってインバータ用トランジスタには高耐圧性を
有することが要請されている。
さらに１次交流電源が例えば日本・米国の如く１００Ｖ
系の場合には比較的耐圧の低いトランジスタを用いるこ
ともできるが、欧州の如き２００■系電源に於ては、上
記トランジスタの耐圧要請上、高耐圧のトランジスタが
必要となり当該レギュレータの原価上大変高価につくと
いう欠点があった。
系の場合には比較的耐圧の低いトランジスタを用いるこ
ともできるが、欧州の如き２００■系電源に於ては、上
記トランジスタの耐圧要請上、高耐圧のトランジスタが
必要となり当該レギュレータの原価上大変高価につくと
いう欠点があった。
本発明はか＼る事情に鑑みてなされたもので、１次交流
電源電圧が１００ｖ系又は２００ｖ系何れの場合であっ
ても、上記した高耐圧トランジスタを必要とせずしかも
同一で極めて簡単な回路構成からなる補助インバータ回
路を有するスイッチングレギュレータを提供することを
目的としたもので、以下図面に従って本発明の実施例に
つき説明する。
電源電圧が１００ｖ系又は２００ｖ系何れの場合であっ
ても、上記した高耐圧トランジスタを必要とせずしかも
同一で極めて簡単な回路構成からなる補助インバータ回
路を有するスイッチングレギュレータを提供することを
目的としたもので、以下図面に従って本発明の実施例に
つき説明する。
第１図は本発明に係るスイッチングレギュレータの概略
構成をしめずブロックダイヤグラムである。すなわちこ
のスイッチングレギュレータは１次交流入力を直接整流
して回路を動作せしめるいわゆるラインオペレーション
方式を採用しているため、電気用品取締法および各国安
全規格に基づく空間ならびに沿面距離を確保するため同
図に示す如く絶縁トランスＴ１．’Ｔｈ、’Ｔｓによっ
て１次回路ｒ６と２次回路２０が絶縁分離されている。
構成をしめずブロックダイヤグラムである。すなわちこ
のスイッチングレギュレータは１次交流入力を直接整流
して回路を動作せしめるいわゆるラインオペレーション
方式を採用しているため、電気用品取締法および各国安
全規格に基づく空間ならびに沿面距離を確保するため同
図に示す如く絶縁トランスＴ１．’Ｔｈ、’Ｔｓによっ
て１次回路ｒ６と２次回路２０が絶縁分離されている。
１法文流入力ＡＣはコンデンサ、整流素子、ノイズフィ
ルタから構成されている全波整流回路ＤＳにより全波整
流されたあと、ＤＳに直列接続された２個のコンデンサ
ＣＩ、 Ｃ２を充電する。そして１は公知のインバータ
回路である。インバータ回路１からは約２５ＫＨ２の高
周波電流が出力しトランスＴｌを介して主出力回路２に
入力し、主出力回路２でもって直流出力電圧に変換され
る。またこの直流出力はダイオードＤ１を介して制御回
路３に導かれ、制御回路３から出た制御パルスがトラン
スＴ２に入り、トランスＴ２を介してインバータ回路１
を駆動することになる。なお上記制御回路３は内部に設
けた基準電圧と上記直流出力を比較し、その比較結果に
基づいてパルス幅を定めるパルス発振回路等を含む公知
のＩＣ素子とドライバ回路が内蔵されている。
ルタから構成されている全波整流回路ＤＳにより全波整
流されたあと、ＤＳに直列接続された２個のコンデンサ
ＣＩ、 Ｃ２を充電する。そして１は公知のインバータ
回路である。インバータ回路１からは約２５ＫＨ２の高
周波電流が出力しトランスＴｌを介して主出力回路２に
入力し、主出力回路２でもって直流出力電圧に変換され
る。またこの直流出力はダイオードＤ１を介して制御回
路３に導かれ、制御回路３から出た制御パルスがトラン
スＴ２に入り、トランスＴ２を介してインバータ回路１
を駆動することになる。なお上記制御回路３は内部に設
けた基準電圧と上記直流出力を比較し、その比較結果に
基づいてパルス幅を定めるパルス発振回路等を含む公知
のＩＣ素子とドライバ回路が内蔵されている。
次に補助インバータ回路３０の構成とその動作について
説明する。
説明する。
まずトランスＴ３は上述の如く１次回路１ｏと２次回路
加を絶縁分離しているっしかして１次巻線はコイルＬ１
、Ｌｌ、２次巻線はコイルＬ３から構成され。
加を絶縁分離しているっしかして１次巻線はコイルＬ１
、Ｌｌ、２次巻線はコイルＬ３から構成され。
Ｌｌの１端はインバータ用トランジスタＱｌのエミッタ
、シリーズレギュレータ用トランジスタＱ２のエミッタ
にそれぞれ接続され、他端はダイオードＤ２のカソード
に接続されている。一方Ｌ２の１端はトランジスタＱＩ
のコレクタに、その他端は余波整流出力側に接続され、
上記トランジスタＱｌにコレクタ電圧を供給している。
、シリーズレギュレータ用トランジスタＱ２のエミッタ
にそれぞれ接続され、他端はダイオードＤ２のカソード
に接続されている。一方Ｌ２の１端はトランジスタＱＩ
のコレクタに、その他端は余波整流出力側に接続され、
上記トランジスタＱｌにコレクタ電圧を供給している。
そしてＬｌとＬｌは図示する如（インバータ用トランジ
スタＱＩが発振しうるよう互に逆位相に接続されている
。なおＬｌの両端に１は抵抗Ｒ７とコンデンサＣ３の直
列回路が並列に、またダイオードＤ４とコンデンサＣ７
の直列回路が並列にそれぞれ接続されており、コンデン
サＣ７の両端には抵抗Ｒ８が接続されている。またＬｌ
の他端とＱｌのベース間にはコンデンサＣ４と抵抗Ｒ１
が直列に、上記ダイオードＤ２のアノードとＱ＋ベース
間にはツェナーダイオードＺＤ＋ 、 Ｑ＋のベース・
エミッタ間には抵抗Ｒ２、ダイオードＤ２のアノードと
Ｑ１エミッタ間にはコンデンサＣ５がそれぞれ接続され
ている。
スタＱＩが発振しうるよう互に逆位相に接続されている
。なおＬｌの両端に１は抵抗Ｒ７とコンデンサＣ３の直
列回路が並列に、またダイオードＤ４とコンデンサＣ７
の直列回路が並列にそれぞれ接続されており、コンデン
サＣ７の両端には抵抗Ｒ８が接続されている。またＬｌ
の他端とＱｌのベース間にはコンデンサＣ４と抵抗Ｒ１
が直列に、上記ダイオードＤ２のアノードとＱ＋ベース
間にはツェナーダイオードＺＤ＋ 、 Ｑ＋のベース・
エミッタ間には抵抗Ｒ２、ダイオードＤ２のアノードと
Ｑ１エミッタ間にはコンデンサＣ５がそれぞれ接続され
ている。
またトランジスタＱ１ベースとコイルＬ２の他端には抵
抗Ｒ３が接続されている。一方シリーズレギュレータ用
トランジスタＱ２のベースには占記全波整流出力回路に
並列接続された２個の抵抗Ｒ４，Ｒ５の接続点に接続さ
れ、Ｑ２のコレクタは全波整流回路ＤＳの低電位側が接
続されている。
抗Ｒ３が接続されている。一方シリーズレギュレータ用
トランジスタＱ２のベースには占記全波整流出力回路に
並列接続された２個の抵抗Ｒ４，Ｒ５の接続点に接続さ
れ、Ｑ２のコレクタは全波整流回路ＤＳの低電位側が接
続されている。
またトランジスタＱ３のベース・コレクタ間には抵抗Ｒ
６及びコンデンサＣ６とツェナーダイオード２Ｄ２の直
列回路が並列接続され、Ｑ３のコレクタにはダイオード
Ｄ３のカソードが接続され、ＤＳのアノードはコイルＬ
３の１端に接続されている。またＱ３のエミッタは上記
トランスＴ２の１次コイル側に接続されている。
６及びコンデンサＣ６とツェナーダイオード２Ｄ２の直
列回路が並列接続され、Ｑ３のコレクタにはダイオード
Ｄ３のカソードが接続され、ＤＳのアノードはコイルＬ
３の１端に接続されている。またＱ３のエミッタは上記
トランスＴ２の１次コイル側に接続されている。
しかしてこの補助インバータ回路は電源投入直後におい
て、制御回路３の代りに発振トランジスタＱが発振し、
その発振出力でもってインバータ回路を他励発振せしめ
ることと、他方、厳密には制御されることを必要としな
い比較的ｔＪＪ容量の直流電源を当該スイッチングレギ
ュレータに併有せしめることを目的とした回路である。
て、制御回路３の代りに発振トランジスタＱが発振し、
その発振出力でもってインバータ回路を他励発振せしめ
ることと、他方、厳密には制御されることを必要としな
い比較的ｔＪＪ容量の直流電源を当該スイッチングレギ
ュレータに併有せしめることを目的とした回路である。
すなわち電源投入直後ＣＩ、 Ｃ２によって平滑化され
た電圧が約８０９６の値に到達したあと補助インバータ
回路のトランジスタＱ１が発振を開始する。なおこの場
合の発振周波数は２５ＫＨ２〜３ＱＫＨ２であって、こ
れは主としてトランスＴ３のＬとＣ４、Ｒｓ等で決定さ
れる。
た電圧が約８０９６の値に到達したあと補助インバータ
回路のトランジスタＱ１が発振を開始する。なおこの場
合の発振周波数は２５ＫＨ２〜３ＱＫＨ２であって、こ
れは主としてトランスＴ３のＬとＣ４、Ｒｓ等で決定さ
れる。
Ｑｌが発振を始めることにより、トランスＴ３のコイル
Ｌ２には上記周波数の高周波電圧が発生し、この高周波
電圧はトランスフを介してコイルＬ３に伝達される。な
おコイルＬ２に接続されたダイオードＤ４、コンデンサ
Ｃ７、抵抗Ｒ８及びＲ７、Ｃ３はいわゆるスナバ−回路
であ二で、Ｒ２の両端に生じたスパイク状電圧を吸収す
る役目をもっている。またツェナーダイオードＺＤ＋は
Ｑｌのオンオフをコントロールして出力を安定化させる
ためのものである。コイルＩ、８１こ伝達された高周波
電圧はＤ３、Ｃ６によって直流に平滑されトランジスタ
Ｑ３によって安定化されている。しかして本発明のスイ
ッチングレギュレータ回路においては、上記のようにト
ランジスタＱ２のコレクタは直流低電位側に接続され、
エミッタはトランジスタＱｌのエミッタに接続され、さ
らにそのコレクタはトランスＴ３のコイルＬ！を介して
直流高電位側に接続されている。またＣ２のベースｉこ
は上記直流高電位側と直流低電位側に接続されている２
個の抵抗Ｒ４、Ｒｓによって分圧された電圧が印加され
ている。したがってトランジスタＱ２の出力側、すなわ
ちエミッタ上には路上配分圧電圧に等しい電圧が加わる
ことになるので、インバータトランジスタＱ、の主ミッ
タ、コレクタ間に加わる電圧はＱｌのエミッタ電圧分だ
け小さくなる。
Ｌ２には上記周波数の高周波電圧が発生し、この高周波
電圧はトランスフを介してコイルＬ３に伝達される。な
おコイルＬ２に接続されたダイオードＤ４、コンデンサ
Ｃ７、抵抗Ｒ８及びＲ７、Ｃ３はいわゆるスナバ−回路
であ二で、Ｒ２の両端に生じたスパイク状電圧を吸収す
る役目をもっている。またツェナーダイオードＺＤ＋は
Ｑｌのオンオフをコントロールして出力を安定化させる
ためのものである。コイルＩ、８１こ伝達された高周波
電圧はＤ３、Ｃ６によって直流に平滑されトランジスタ
Ｑ３によって安定化されている。しかして本発明のスイ
ッチングレギュレータ回路においては、上記のようにト
ランジスタＱ２のコレクタは直流低電位側に接続され、
エミッタはトランジスタＱｌのエミッタに接続され、さ
らにそのコレクタはトランスＴ３のコイルＬ！を介して
直流高電位側に接続されている。またＣ２のベースｉこ
は上記直流高電位側と直流低電位側に接続されている２
個の抵抗Ｒ４、Ｒｓによって分圧された電圧が印加され
ている。したがってトランジスタＱ２の出力側、すなわ
ちエミッタ上には路上配分圧電圧に等しい電圧が加わる
ことになるので、インバータトランジスタＱ、の主ミッ
タ、コレクタ間に加わる電圧はＱｌのエミッタ電圧分だ
け小さくなる。
ナなわちＱ、はエミッタ、コレクタ耐圧Ｖｃｅｏの小さ
いものでよく、またそのためトランス−の絶縁耐圧上大
変有利ともなる。さらに１次電源電圧が１００Ｖ系また
は２００ Ｖ糸回れの場合においても抵抗Ｒ４、Ｒ６及
びＣ２を用いるか否かで全く同一の回路構成が共用でき
るという別異の利点がある。
いものでよく、またそのためトランス−の絶縁耐圧上大
変有利ともなる。さらに１次電源電圧が１００Ｖ系また
は２００ Ｖ糸回れの場合においても抵抗Ｒ４、Ｒ６及
びＣ２を用いるか否かで全く同一の回路構成が共用でき
るという別異の利点がある。
他の実施例として、上記抵抗Ｒ４の代りにツェナーダイ
オードを用いるこ゛とにより上記と同様の効果を得るこ
とができると同時にインバータ一部にかかる電圧を安定
化し、ダイオードＤ３のカソード電圧を一定化できるの
で、このカソード電圧を定電圧電源として利用すること
が可能である。
オードを用いるこ゛とにより上記と同様の効果を得るこ
とができると同時にインバータ一部にかかる電圧を安定
化し、ダイオードＤ３のカソード電圧を一定化できるの
で、このカソード電圧を定電圧電源として利用すること
が可能である。
以上、本発明は要約すれば、直流高電位、直流低電位間
にインバータ用トランジ、スタＱ１とシリーズレギュレ
ータ用トランジスタＱ−ｆ−直列接続しが・つ１次側直
流電圧を２個の直列抵抗（または１個の抵抗と１個のツ
ェナーダイオード）で分圧し、その分圧電圧を前記シリ
ーズレギュレータ用トランジスタのベースに印加した補
助インバータ回路を具備せるスイッチングレギュレータ
であるから、前記インバータ用トランジスタに印加する
電圧を浅くし得、しかも交流電源が１００ｖ系もしくは
２００ｖ系いずれの場合においてもバイアス回路の有無
のみで、同一の回路構成を有する補助インバータ回路を
具備したスイッチングレギュレータを得ることができる
。
にインバータ用トランジ、スタＱ１とシリーズレギュレ
ータ用トランジスタＱ−ｆ−直列接続しが・つ１次側直
流電圧を２個の直列抵抗（または１個の抵抗と１個のツ
ェナーダイオード）で分圧し、その分圧電圧を前記シリ
ーズレギュレータ用トランジスタのベースに印加した補
助インバータ回路を具備せるスイッチングレギュレータ
であるから、前記インバータ用トランジスタに印加する
電圧を浅くし得、しかも交流電源が１００ｖ系もしくは
２００ｖ系いずれの場合においてもバイアス回路の有無
のみで、同一の回路構成を有する補助インバータ回路を
具備したスイッチングレギュレータを得ることができる
。
第１図は本発明の実施例をしめずブロックダイヤグラム
である。 特許出願人 田淵電機株式会社 代理人弁理士大西孝治
である。 特許出願人 田淵電機株式会社 代理人弁理士大西孝治
Claims (2)
- （１）直流高電位と直流低電位間に於てインバータ用ト
ランジスタとシリーズレギュレータ用トランジスタを直
列接続し、かつ１次側直流電圧を２個の直列抵抗で分圧
し、その分圧電圧を前記シリーズレギュレータ用トラン
ジスタのベースに印加することにより、前記インバータ
用トランジスタに印加される電圧を浅くした補助インバ
ータ回路を具備したことを特徴とするスイッチングレギ
ュレータ。 - （２）直流高電位と直流低電位間に於てインバータ用ト
ランジスタとシリーズレギュレータ用トランジスタを直
列接続し、かつ１次側直流電圧を抵抗とツェナーダイオ
ードで分圧し、その分圧電圧を前記シリーズレギュレー
タ用トランジスタのベースに印加することにより、前記
インバータ用トランジスタに印加される電圧を浅（した
補助インバータ回路を具備したことを特徴とするスイッ
チングレギュレータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12915681A JPS5831424A (ja) | 1981-08-18 | 1981-08-18 | スイツチングレギユレ−タ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12915681A JPS5831424A (ja) | 1981-08-18 | 1981-08-18 | スイツチングレギユレ−タ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5831424A true JPS5831424A (ja) | 1983-02-24 |
Family
ID=15002520
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12915681A Pending JPS5831424A (ja) | 1981-08-18 | 1981-08-18 | スイツチングレギユレ−タ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5831424A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8840116B2 (en) | 2008-12-10 | 2014-09-23 | Ulvac, Inc. | Seal mechanism and treatment apparatus |
-
1981
- 1981-08-18 JP JP12915681A patent/JPS5831424A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8840116B2 (en) | 2008-12-10 | 2014-09-23 | Ulvac, Inc. | Seal mechanism and treatment apparatus |
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