JPS5839376B2 - イオン注入法 - Google Patents
イオン注入法Info
- Publication number
- JPS5839376B2 JPS5839376B2 JP53133623A JP13362378A JPS5839376B2 JP S5839376 B2 JPS5839376 B2 JP S5839376B2 JP 53133623 A JP53133623 A JP 53133623A JP 13362378 A JP13362378 A JP 13362378A JP S5839376 B2 JPS5839376 B2 JP S5839376B2
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- Japan
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- insulating film
- beam current
- ion implantation
- implantation
- surface potential
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- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
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-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
- H10P30/00—Ion implantation into wafers, substrates or parts of devices
- H10P30/20—Ion implantation into wafers, substrates or parts of devices into semiconductor materials, e.g. for doping
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
- H10P30/00—Ion implantation into wafers, substrates or parts of devices
- H10P30/20—Ion implantation into wafers, substrates or parts of devices into semiconductor materials, e.g. for doping
- H10P30/22—Ion implantation into wafers, substrates or parts of devices into semiconductor materials, e.g. for doping using masks
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10S—TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10S438/00—Semiconductor device manufacturing: process
- Y10S438/91—Controlling charging state at semiconductor-insulator interface
Landscapes
- Insulated Gate Type Field-Effect Transistor (AREA)
- Physical Vapour Deposition (AREA)
Description
【発明の詳細な説明】
本発明は、表面に絶縁膜を有する半導体基板に高ドーズ
量のイオン注入を迅速に行なうイオン注入法に関する。
量のイオン注入を迅速に行なうイオン注入法に関する。
表面に絶縁膜を有する半導体基板にイオン注入すると、
注入イオンの電荷の為に絶縁膜表面がプラスに帯電し、
半導体基板との間に電位差を生じて電荷が放電する時に
絶縁膜を破壊する事がある。
注入イオンの電荷の為に絶縁膜表面がプラスに帯電し、
半導体基板との間に電位差を生じて電荷が放電する時に
絶縁膜を破壊する事がある。
この現象は例えば絶縁膜上に基板とは電気的に隔離され
た電極例えびMOSトランジスタにかけるゲート電極が
ある場合や、絶縁膜の一部が薄くなっているような場合
に顕著である。
た電極例えびMOSトランジスタにかけるゲート電極が
ある場合や、絶縁膜の一部が薄くなっているような場合
に顕著である。
一般に高ドーズ量のイオン注入はソース、ドレイン拡散
などがそうであるように、IC製造工程の後期で行なわ
れ、ゲート電極などが既に取付けられている。
などがそうであるように、IC製造工程の後期で行なわ
れ、ゲート電極などが既に取付けられている。
第1図にその→lを示す。
同図はMOSトランジスタの製造工程の一部を示すもの
で、P型シリコン基板1の表面は厚いフィールド酸化膜
(SiO2)2a、!=−よび薄いゲート酸化膜2b並
びにソース、ドレイン電極窓を覆いそしてゲート酸化膜
2bと膜厚の等しい酸化膜2cにより覆われている。
で、P型シリコン基板1の表面は厚いフィールド酸化膜
(SiO2)2a、!=−よび薄いゲート酸化膜2b並
びにソース、ドレイン電極窓を覆いそしてゲート酸化膜
2bと膜厚の等しい酸化膜2cにより覆われている。
ゲート酸化膜2b上にはポリシリコンなどで作られるゲ
ート電極3が形成されている。
ート電極3が形成されている。
酸化膜2cの直下はソース拡散層4およびドレイン拡散
層5が形成される部分で、この酸化膜2cはイオン注入
の前に除去されることもあるが、本例のようにゲート酸
化膜と共に残存させることもある。
層5が形成される部分で、この酸化膜2cはイオン注入
の前に除去されることもあるが、本例のようにゲート酸
化膜と共に残存させることもある。
拡散層4.5はフィールド酸化膜2aおよびゲート電極
3をマスクとして、リン、ヒ素等のイオンP+A8千等
が注入されることにより形成される。
3をマスクとして、リン、ヒ素等のイオンP+A8千等
が注入されることにより形成される。
このイオン注入では不純物イオンは酸化膜2cを−通っ
て基板1内に入るだけでなくゲート電極3やフィールド
酸化膜2aにも打込筐れ、これらをプラスにチャージア
ップする。
て基板1内に入るだけでなくゲート電極3やフィールド
酸化膜2aにも打込筐れ、これらをプラスにチャージア
ップする。
特にゲート電極部分は、ゲート電極3と基板1を電極と
しゲート酸化膜2bを誘電体とするコンデンサを形成す
るから、ゲート電極3に打込瞥れた不純物イオンの電荷
がゲート酸化膜2bの表面に蓄積し、このため基板1測
にe電荷が誘起され、ゲート酸化膜表裏面間電位差が数
10〜100V程度に達することがある。
しゲート酸化膜2bを誘電体とするコンデンサを形成す
るから、ゲート電極3に打込瞥れた不純物イオンの電荷
がゲート酸化膜2bの表面に蓄積し、このため基板1測
にe電荷が誘起され、ゲート酸化膜表裏面間電位差が数
10〜100V程度に達することがある。
このため、酸化膜2bの一部に弱い部分があると、そこ
から放電が開始する。
から放電が開始する。
一旦放電が始するとなだれ現象が生じ、全電荷がこの弱
い部分に集中して放電するので、この放電電流による発
熱でゲート酸化膜2bの一部が熱破壊され、ゲート電極
3と基板1との間を短絡してしまう。
い部分に集中して放電するので、この放電電流による発
熱でゲート酸化膜2bの一部が熱破壊され、ゲート電極
3と基板1との間を短絡してしまう。
イオン注入領域内に、一部分でも半導体基板の露出部分
(例えばスクライブライン)があれば、イオン電流はそ
こから吸収されて、絶縁膜表面の電位は低く釦さえられ
る。
(例えばスクライブライン)があれば、イオン電流はそ
こから吸収されて、絶縁膜表面の電位は低く釦さえられ
る。
しかし、露出部分での電流吸収が十分でない場合には絶
縁膜表面電位は注入イオンビーム電流をパラメータとし
て注入量に対し第2図のように変化することが見い出さ
れた。
縁膜表面電位は注入イオンビーム電流をパラメータとし
て注入量に対し第2図のように変化することが見い出さ
れた。
つ1す、注入イオンビーム電流IBをII z l2t
I3・・・・・・(■1〈■2〈■3 )と増加させる
と、注入量に対する絶縁膜表面電位(絶縁膜表面と半導
体基板との間の電圧(が図示の如く変り、最初は増加す
るが、やがてピークをもち、以後漸減しかつビーム電流
の増加に伴ないこの表面電位は全体として上昇する。
I3・・・・・・(■1〈■2〈■3 )と増加させる
と、注入量に対する絶縁膜表面電位(絶縁膜表面と半導
体基板との間の電圧(が図示の如く変り、最初は増加す
るが、やがてピークをもち、以後漸減しかつビーム電流
の増加に伴ないこの表面電位は全体として上昇する。
そして、ビーム電流値によっては電荷が溜りすぎて絶縁
膜の破壊電圧VDを越えてし捷う。
膜の破壊電圧VDを越えてし捷う。
即ち、ビーム電流■2の場合には注入量D2.D30間
でVDを越え、またビーム電流■3の場合は注入量D1
a D4の間でVDを越える。
でVDを越え、またビーム電流■3の場合は注入量D1
a D4の間でVDを越える。
注入量に対する絶縁膜表面電位の関係が第2図のように
なる理由、特にやがてピークをもち以後減少する理由は
明らかでないが、イオン注入によって酸化膜のSi、O
なとのボンディングが破壊され、このため電荷が動き易
くなって導電性がでてくるためと解される。
なる理由、特にやがてピークをもち以後減少する理由は
明らかでないが、イオン注入によって酸化膜のSi、O
なとのボンディングが破壊され、このため電荷が動き易
くなって導電性がでてくるためと解される。
そして上述した絶縁破壊を生じさせないためには所要と
する注入量り、を達成する間にVDを越えることのない
ビーム電流■、を用いればよいが、注入量はビーム電流
値と注入時間との積で規定されるので、ビーム電流を小
さくすれば注入時間が長くなる欠点がある。
する注入量り、を達成する間にVDを越えることのない
ビーム電流■、を用いればよいが、注入量はビーム電流
値と注入時間との積で規定されるので、ビーム電流を小
さくすれば注入時間が長くなる欠点がある。
本発明は上述した矛盾する欠点を解決するために、注入
量が増加するとやがて絶縁膜表面電位は減少する、該電
位は増加するだけではない点に着目し、注入量の増加に
伴ない、絶縁膜の破壊電圧を越えずしかもより大きな電
流値のビーム電流に順次切換えながら所定量のイオン注
入を行なうことにより、絶縁膜を破壊することなくしか
もイオン注入時間を短縮できるイオン注入法を提供する
ことを目的としている。
量が増加するとやがて絶縁膜表面電位は減少する、該電
位は増加するだけではない点に着目し、注入量の増加に
伴ない、絶縁膜の破壊電圧を越えずしかもより大きな電
流値のビーム電流に順次切換えながら所定量のイオン注
入を行なうことにより、絶縁膜を破壊することなくしか
もイオン注入時間を短縮できるイオン注入法を提供する
ことを目的としている。
第2図の特性から明らかなようにそして前述したように
、ビーム電流値が増加すると絶縁膜表面電位は全体とし
て上昇する。
、ビーム電流値が増加すると絶縁膜表面電位は全体とし
て上昇する。
しかし、各ビーム電流による表面電位は注入量に比例し
て一様増加するのではなく、成る注入量でピークに達し
た後は低下する。
て一様増加するのではなく、成る注入量でピークに達し
た後は低下する。
即ちビーム電流■2の場合には注入量D3を越えると破
壊電圧VD以下となり、筐たビーム電流■3の場合には
D4 を越えると同様にVD以下となるから、これ以後
はビーム電流I2■3を使用してよい。
壊電圧VD以下となり、筐たビーム電流■3の場合には
D4 を越えると同様にVD以下となるから、これ以後
はビーム電流I2■3を使用してよい。
本発明はこれを利用するものでその実施例を以下第3図
あ・よび第4図を参照して説明する。
あ・よび第4図を参照して説明する。
本発明のイオン注入法は基本的に破壊電圧を越えること
のない範囲で最大限のビーム電流を用いてイオン注入を
行なう。
のない範囲で最大限のビーム電流を用いてイオン注入を
行なう。
従って、第2図のようにビーム電流を■0.■2.I3
と3通りに設定可能な場合には、注入量D31ではビー
ム電流■1を用い、D3を越えたら■2に切換え、更に
D4を越えたら最大のビーム電流工、で目標値り、とな
る1でイオン注入を行なう。
と3通りに設定可能な場合には、注入量D31ではビー
ム電流■1を用い、D3を越えたら■2に切換え、更に
D4を越えたら最大のビーム電流工、で目標値り、とな
る1でイオン注入を行なう。
絶縁膜はその表面電位が破壊電圧VDに達すると直ちに
破壊されるというものではないが、第3図に示す実施例
では安全性を確保するためにV。
破壊されるというものではないが、第3図に示す実施例
では安全性を確保するためにV。
から10〜20多程度低い設定電圧■8でビーム電流を
切換えている。
切換えている。
つ1す、注入量D’3 (>D3 )−1では■1で注
入ヲ行ナイ、D’、 〜D’、 (>D、 )tテ
UI2−t−注入を行ない、v4以後は■3で注入を行
ない、D、に達したらイオン注入を完了する。
入ヲ行ナイ、D’、 〜D’、 (>D、 )tテ
UI2−t−注入を行ない、v4以後は■3で注入を行
ない、D、に達したらイオン注入を完了する。
かSる操作を行なうには、その都度表面電位を測定する
ことも考えられないではないが、予め第2図または第3
図の特性曲線を得てかくのが便利である。
ことも考えられないではないが、予め第2図または第3
図の特性曲線を得てかくのが便利である。
なわvD以上は絶縁破壊してし1つて特性曲線が得られ
々いように見えるがその様なことはなく、これは絶縁破
壊を生じない厚い酸化膜で測定してかくことが可能であ
る。
々いように見えるがその様なことはなく、これは絶縁破
壊を生じない厚い酸化膜で測定してかくことが可能であ
る。
勿論、破壊電圧VDは所定厚生のゲート酸化膜のそれを
用いる。
用いる。
捷たイオン注入量を監視する代りにイオン注入時間を監
視してもよい。
視してもよい。
この場合は、イオン注入量=ビーム電流×注入時間の表
穴によって、注入時間をイオン注入量に換算して切換時
点を選定する。
穴によって、注入時間をイオン注入量に換算して切換時
点を選定する。
さらにイオン注入をミニコンピユータ等を用いるイオン
注入装置で自動化するに際しては、本方法は非常に有効
である。
注入装置で自動化するに際しては、本方法は非常に有効
である。
第4図にその例を示す。本例では1ず時刻t。
でビーム電流■1 によるイオン注入を開始する。
このビーム電流11によるイオン注入の終期t1は第3
図を利用すればび4 =11(tl−to) から決定できる。
図を利用すればび4 =11(tl−to) から決定できる。
(さらに正確なtlはカレントインテグレータ等を用い
て注入量を直接測定して決定する。
て注入量を直接測定して決定する。
)t□以後は■2に切換え、t2以後は■3に切換え、
更に時刻t3でIB=Oとする。
更に時刻t3でIB=Oとする。
これら時刻j2 p j3はそれぞれ下式%式%)
)
から決定できる。
このようにすれば、(D’4−Iy3)釦よび(D5−
D’、 )は■1 より犬なる■2.■3でイオン注
入されるので、目標値D51での全イオン注入時間は単
に■1のみを用いる場合より短縮される。
D’、 )は■1 より犬なる■2.■3でイオン注
入されるので、目標値D51での全イオン注入時間は単
に■1のみを用いる場合より短縮される。
しかも、び、以後卦よびv4以後ではそれぞれ■2.■
3によっても破壊電圧V。
3によっても破壊電圧V。
を越えることはないので、絶縁膜を破壊することはない
。
。
以上述べた本発明のイオン注入法であれば、表面の絶縁
膜を通して半導体基板にイオン注入する際に、絶縁膜を
破壊することなくイオン注入時間を短縮できるので、注
入量が1015〜1016ions/crfL2以上に
高濃度となるMOSトランジスタのソース領域、ドレイ
ン領域の形成等に極めて有利である。
膜を通して半導体基板にイオン注入する際に、絶縁膜を
破壊することなくイオン注入時間を短縮できるので、注
入量が1015〜1016ions/crfL2以上に
高濃度となるMOSトランジスタのソース領域、ドレイ
ン領域の形成等に極めて有利である。
第1図は表面に絶縁膜を有する半導体基板の一例を示す
断面図、第2図は第1図の絶縁膜にあ・けるイオン注入
時の表面電位を示す特性図、第3図ち・よび第4図は本
発明の一実施例を示す図で、第3図はイオン注入時に釦
ける絶縁膜の表面電位を示す特性図、第4図はビーム電
流の切換えタイミングを示すタイムチャートである。 図面で1は半導体基板、2b、2cは絶縁膜、4.5は
ソース ドレイン拡散層である。
断面図、第2図は第1図の絶縁膜にあ・けるイオン注入
時の表面電位を示す特性図、第3図ち・よび第4図は本
発明の一実施例を示す図で、第3図はイオン注入時に釦
ける絶縁膜の表面電位を示す特性図、第4図はビーム電
流の切換えタイミングを示すタイムチャートである。 図面で1は半導体基板、2b、2cは絶縁膜、4.5は
ソース ドレイン拡散層である。
Claims (1)
- 1 表面に絶縁膜を有する半導体基板に不純物をイオン
注入するに際し、イオン注入量に対する絶縁膜表面電位
が、ある注入量でピークとなってそれ以上では減少しか
つ該表面電位は注入イオンビーム電流が犬なれば全体と
して高くなる特性を利用し、初めは該絶縁膜表面電位が
半導体基板との間で該絶縁膜の絶縁破壊を生じない程度
の小ビーム電流でイオン注入を行ない、注入量が増すに
つれて該絶縁膜表面電位が絶縁破壊を生じない程度でビ
ーム電流値を増加させて所定量のイオン注入を行なうこ
とを特徴とするイオン注入法。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP53133623A JPS5839376B2 (ja) | 1978-10-30 | 1978-10-30 | イオン注入法 |
| CA338,601A CA1131802A (en) | 1978-10-30 | 1979-10-26 | Method of ion implantation into a semiconductor substrate provided with an insulating film |
| US06/088,468 US4258077A (en) | 1978-10-30 | 1979-10-26 | Method of ion implantation into a semiconductor substrate provided with an insulating film |
| EP79302363A EP0010942B1 (en) | 1978-10-30 | 1979-10-29 | A method of ion implantation into a semiconductor substrate provided with an insulating film |
| DE7979302363T DE2962641D1 (en) | 1978-10-30 | 1979-10-29 | A method of ion implantation into a semiconductor substrate provided with an insulating film |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP53133623A JPS5839376B2 (ja) | 1978-10-30 | 1978-10-30 | イオン注入法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5561023A JPS5561023A (en) | 1980-05-08 |
| JPS5839376B2 true JPS5839376B2 (ja) | 1983-08-30 |
Family
ID=15109139
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP53133623A Expired JPS5839376B2 (ja) | 1978-10-30 | 1978-10-30 | イオン注入法 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US4258077A (ja) |
| EP (1) | EP0010942B1 (ja) |
| JP (1) | JPS5839376B2 (ja) |
| CA (1) | CA1131802A (ja) |
| DE (1) | DE2962641D1 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59170066U (ja) * | 1983-04-30 | 1984-11-14 | 三菱自動車工業株式会社 | ヘツドライニング張りワイヤ用ブラケツト |
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| DE3138960A1 (de) * | 1981-09-30 | 1983-04-14 | Siemens AG, 1000 Berlin und 8000 München | Verfahren zur erzeugung elektrisch leitender schichten |
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| US5264380A (en) * | 1989-12-18 | 1993-11-23 | Motorola, Inc. | Method of making an MOS transistor having improved transconductance and short channel characteristics |
| JPH04107831A (ja) * | 1990-08-27 | 1992-04-09 | Sharp Corp | 半導体装置の製造方法 |
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-
1978
- 1978-10-30 JP JP53133623A patent/JPS5839376B2/ja not_active Expired
-
1979
- 1979-10-26 US US06/088,468 patent/US4258077A/en not_active Expired - Lifetime
- 1979-10-26 CA CA338,601A patent/CA1131802A/en not_active Expired
- 1979-10-29 DE DE7979302363T patent/DE2962641D1/de not_active Expired
- 1979-10-29 EP EP79302363A patent/EP0010942B1/en not_active Expired
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Also Published As
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| EP0010942B1 (en) | 1982-04-28 |
| JPS5561023A (en) | 1980-05-08 |
| EP0010942A1 (en) | 1980-05-14 |
| US4258077A (en) | 1981-03-24 |
| CA1131802A (en) | 1982-09-14 |
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