JPS5882321A - 絶対温度比例電流発生回路 - Google Patents
絶対温度比例電流発生回路Info
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- JPS5882321A JPS5882321A JP56180597A JP18059781A JPS5882321A JP S5882321 A JPS5882321 A JP S5882321A JP 56180597 A JP56180597 A JP 56180597A JP 18059781 A JP18059781 A JP 18059781A JP S5882321 A JPS5882321 A JP S5882321A
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- JP
- Japan
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- transistor
- collector
- emitter
- circuit
- transistors
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-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05F—SYSTEMS FOR REGULATING ELECTRIC OR MAGNETIC VARIABLES
- G05F3/00—Non-retroactive systems for regulating electric variables by using an uncontrolled element, or an uncontrolled combination of elements, such element or such combination having self-regulating properties
- G05F3/02—Regulating voltage or current
- G05F3/08—Regulating voltage or current wherein the variable is DC
- G05F3/10—Regulating voltage or current wherein the variable is DC using uncontrolled devices with non-linear characteristics
- G05F3/16—Regulating voltage or current wherein the variable is DC using uncontrolled devices with non-linear characteristics being semiconductor devices
- G05F3/20—Regulating voltage or current wherein the variable is DC using uncontrolled devices with non-linear characteristics being semiconductor devices using diode- transistor combinations
- G05F3/26—Current mirrors
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は半導体素子の電流がその絶対Ｙ晶糺に依存す
る現象を利用した絶対温度比例電流発生回路に関するも
ので夕）る。
る現象を利用した絶対温度比例電流発生回路に関するも
ので夕）る。
第１図は従来のこの柚の回路を示す接続図で図において
Ｑｌ 、Ｑ２．Ｑ３．Ｑ５．Ｑ６ はそれぞれ塔・ｌ
、第２゜第３．第５．オ６の各トランジスタ、ＩＪｌｉ
ｊダイオード、Ｒ１，Ｒ２，Ｒ３，Ｒ４はそれぞれ抵抗
、Ｖｃｃは直流電源、ＧＮＤは接地を示す。図に示すと
おりトランジスタＱｌ、Ｑ３．Ｑ６ Ｕ第１の極性の
トランジスタで、トランジスタＱ２ 、Ｑｓは第２の特
性のトランジスタである。また抵抗Ｒ１，トランジスタ
Ｑｌ、Ｑ２． 抵抗Ｒ２の回路を仮にオｌの回路と称
し、トランジスタＱ５ 、抵抗Ｒ４の回路全第３の回路
という。トランジスタＱｌ 、Ｑｓ、Ｑｓのベースは並
列に接続され仮にこれをオｌの共通ペース回路という。
Ｑｌ 、Ｑ２．Ｑ３．Ｑ５．Ｑ６ はそれぞれ塔・ｌ
、第２゜第３．第５．オ６の各トランジスタ、ＩＪｌｉ
ｊダイオード、Ｒ１，Ｒ２，Ｒ３，Ｒ４はそれぞれ抵抗
、Ｖｃｃは直流電源、ＧＮＤは接地を示す。図に示すと
おりトランジスタＱｌ、Ｑ３．Ｑ６ Ｕ第１の極性の
トランジスタで、トランジスタＱ２ 、Ｑｓは第２の特
性のトランジスタである。また抵抗Ｒ１，トランジスタ
Ｑｌ、Ｑ２． 抵抗Ｒ２の回路を仮にオｌの回路と称
し、トランジスタＱ５ 、抵抗Ｒ４の回路全第３の回路
という。トランジスタＱｌ 、Ｑｓ、Ｑｓのベースは並
列に接続され仮にこれをオｌの共通ペース回路という。
ダイオードＤＩのアノードはトランジスタＱ２のベース
に接続される。
に接続される。
この回路に直流電源Ｖｃｃを接続すると、■Ｃｃ→Ｒ３
→Ｑ３のベース→Ｑ５のベース→Ｒ４→ＧＮＤの電流が
流れてＱｓはオンとなり、Ｖｃｃ −＋ Ｑｓのコレク
タ→Ｑ５のベース→Ｑ３のベース→Ｑ３のコレクタ→Ｄ
１→ＧＮＤの電流が流れてＱｓがオンとなりＱ２のベー
ス→Ｒ２の電流が流れてＱ２がオンとなりＱ６ のベー
スに電流が流れてＱ６がオンとなり、Ｑｌ がオンと
なる。この状態で、トランジスタＱ２とダイオードＤｉ
とにカレントミラーを構成する。
→Ｑ３のベース→Ｑ５のベース→Ｒ４→ＧＮＤの電流が
流れてＱｓはオンとなり、Ｖｃｃ −＋ Ｑｓのコレク
タ→Ｑ５のベース→Ｑ３のベース→Ｑ３のコレクタ→Ｄ
１→ＧＮＤの電流が流れてＱｓがオンとなりＱ２のベー
ス→Ｒ２の電流が流れてＱ２がオンとなりＱ６ のベー
スに電流が流れてＱ６がオンとなり、Ｑｌ がオンと
なる。この状態で、トランジスタＱ２とダイオードＤｉ
とにカレントミラーを構成する。
トランジスタＱ３ のコレクタ電流ｋＩとし、そのコレ
クタ重信をＶｃ 、エミッタ甫１位をＶＥ 、ダイオー
ドＤｉのアノード電位ｋ ＶＦとすれば、Ｖｃ ＝ Ｖ
ｃｃ−Ｒ３Ｉ、Ｖｇ ＝ ＶｒからＶｃ −ＶＥ： Ｖ
ｃ ｃ （（３Ｉ −Ｖｐ、・、 ｔｔ＋の関係で電流
■が定まる。ＶＦはＤｉがＱ２とカレントミラーを構成
している関係でほぼ一定に保たれるが、Ｖｃｃが変動す
ると式（１）の関係に従ってＶｃ Ｖｇが変動する。
クタ重信をＶｃ 、エミッタ甫１位をＶＥ 、ダイオー
ドＤｉのアノード電位ｋ ＶＦとすれば、Ｖｃ ＝ Ｖ
ｃｃ−Ｒ３Ｉ、Ｖｇ ＝ ＶｒからＶｃ −ＶＥ： Ｖ
ｃ ｃ （（３Ｉ −Ｖｐ、・、 ｔｔ＋の関係で電流
■が定まる。ＶＦはＤｉがＱ２とカレントミラーを構成
している関係でほぼ一定に保たれるが、Ｖｃｃが変動す
ると式（１）の関係に従ってＶｃ Ｖｇが変動する。
一般的に知られているトランジスタのアーリー効果（Ｅ
ａｒｌｙ ｅｆｆｅｃｔ ） により、トランジスタ
の（Ｖｃ−ＶＥ）が変化するとコレクタ市、流も変化す
る。
ａｒｌｙ ｅｆｆｅｃｔ ） により、トランジスタ
の（Ｖｃ−ＶＥ）が変化するとコレクタ市、流も変化す
る。
すなわち、電流ＩはトランジスタＱ３の絶対温度だけで
な（Ｖｃｃの変動によっても変動するため、安定した電
流が得られ力いという欠点があった。
な（Ｖｃｃの変動によっても変動するため、安定した電
流が得られ力いという欠点があった。
この発明は従来の回路における上述の欠点を除去するた
めになされたもので、′電流発生の基準となるトランジ
スタのＶ（！ ＶＥが電源電圧の変動により影舎されな
いような回路を提供することを目的としている。
めになされたもので、′電流発生の基準となるトランジ
スタのＶ（！ ＶＥが電源電圧の変動により影舎されな
いような回路を提供することを目的としている。
以下図面によりこの発明の詳細な説明する。
第２図はこの発明の一実施例を示すブロック図で、第１
図と同一符号は同−又は相当部分を示し同様に動作する
。Ｑ４は第２の極性の第４のトランジスタ、Ｑｌはオｌ
の極性のオフのトランジスタである。
図と同一符号は同−又は相当部分を示し同様に動作する
。Ｑ４は第２の極性の第４のトランジスタ、Ｑｌはオｌ
の極性のオフのトランジスタである。
トランジスタＱ４のコレクタはトランジスタＱ３のコレ
クタと接続されそのエミッタは接地と接続される。抵抗
Ｒ３、トランジスタＱ３．Ｑ４の回路を仮に第２の回路
と称し、Ｑ４のベースとＱ２のベースは接続されて第２
の共通ベース回路を構成し、トランジスタＱ７のベース
はトランジスタＱ５のエミッタに接続され、そのエミッ
タはトランジスタＱ３のコレクタに、そのコレクタは第
２の共通ベース回路にそれぞれ接続される。トランジス
タＱｌ。
クタと接続されそのエミッタは接地と接続される。抵抗
Ｒ３、トランジスタＱ３．Ｑ４の回路を仮に第２の回路
と称し、Ｑ４のベースとＱ２のベースは接続されて第２
の共通ベース回路を構成し、トランジスタＱ７のベース
はトランジスタＱ５のエミッタに接続され、そのエミッ
タはトランジスタＱ３のコレクタに、そのコレクタは第
２の共通ベース回路にそれぞれ接続される。トランジス
タＱｌ。
Ｑ６（！：Ｉ−ランジスタＱ３ とはカレントミラー
を構成し、かつトランジスタＱ２とトランジスタＱ４
ｒＱ７とはカレントミラーを構成する。Ｑ”＋Ｑ４ｖＣ
よって構成される第３の回路が起動回路として動作する
ことは第１図の場合と同様である。
を構成し、かつトランジスタＱ２とトランジスタＱ４
ｒＱ７とはカレントミラーを構成する。Ｑ”＋Ｑ４ｖＣ
よって構成される第３の回路が起動回路として動作する
ことは第１図の場合と同様である。
Ｑｓのコレクタ電位をＶｃ 、そのエミッタ電位會ＶＥ
とし、Ｑｓ、Ｑｓ、Ｑｌのペースエミッタ間電圧をそれ
ぞれＶＢＥ（Ｑｓ）Ｉ ＶＢＥ（Ｑｌｉ） ｌ ＶＢ
ｇ（Ｑｌ） トすればＶ、−ｖＢＥ（ｑ７） −”Ｅ
”ＢＥ（Ｑｓ）−ｖＢＥ（Ｑｓ）であるがｖＢ［Ｑ
ｓ）＝ｖＢＥ（Ｑｓ）”ｖＢＥ（Ｌｉ２） ””Ｃア
ル（Ｄ”’ＣＶｃ−ＶＥキーＶＢｇ（ｑｓ）−ｔ２１と
々すＶｃ−ＶＥの値がＶｃｃに依存せず常に−ＶＢＥ（
Ｑｓ） （”ＩＩＥ（Ｑｓ）又は−■Ｂ０６，７、と
同じ）で動作し、したがって電流■はトランジスタＱ３
の温度だけによって定まることになる。
とし、Ｑｓ、Ｑｓ、Ｑｌのペースエミッタ間電圧をそれ
ぞれＶＢＥ（Ｑｓ）Ｉ ＶＢＥ（Ｑｌｉ） ｌ ＶＢ
ｇ（Ｑｌ） トすればＶ、−ｖＢＥ（ｑ７） −”Ｅ
”ＢＥ（Ｑｓ）−ｖＢＥ（Ｑｓ）であるがｖＢ［Ｑ
ｓ）＝ｖＢＥ（Ｑｓ）”ｖＢＥ（Ｌｉ２） ””Ｃア
ル（Ｄ”’ＣＶｃ−ＶＥキーＶＢｇ（ｑｓ）−ｔ２１と
々すＶｃ−ＶＥの値がＶｃｃに依存せず常に−ＶＢＥ（
Ｑｓ） （”ＩＩＥ（Ｑｓ）又は−■Ｂ０６，７、と
同じ）で動作し、したがって電流■はトランジスタＱ３
の温度だけによって定まることになる。
また、第２図の回路は第１図の回路に比し実質的に増加
する素子はＱｌだけであり、かつトランジスタＱ７は通
常のＰＮ接合素子であるため集積回路化し易いという利
点がある。
する素子はＱｌだけであり、かつトランジスタＱ７は通
常のＰＮ接合素子であるため集積回路化し易いという利
点がある。
また、第２図においてＲ１、Ｒ３を短絡した場合も同様
に動作する。
に動作する。
第１図は従来の回路を示す接続図、第２図ｔまこの発明
の一実施例を示す接続図である。 Ｑｌ・・・オｌのトランジスタ、Ｑ２・・・第２のトラ
ンジスタ、Ｑｓ・・・第３のトランジスタ、Ｑ４・・・
第４のトランジスタ、Ｑｓ・・・第５のトランジスタ、
Ｑ６・・・オ６のトランジスタ、Ｑｌ・・・オフのトラ
ンジスタ。 なお、図中同一符号は同−又は相当部分を示す。 代理人 葛 野 侶 − （７） 第１図
の一実施例を示す接続図である。 Ｑｌ・・・オｌのトランジスタ、Ｑ２・・・第２のトラ
ンジスタ、Ｑｓ・・・第３のトランジスタ、Ｑ４・・・
第４のトランジスタ、Ｑｓ・・・第５のトランジスタ、
Ｑ６・・・オ６のトランジスタ、Ｑｌ・・・オフのトラ
ンジスタ。 なお、図中同一符号は同−又は相当部分を示す。 代理人 葛 野 侶 − （７） 第１図
Claims (1)
- オｌの極性のオｌのトランジスタのコレクタを第２の極
性の第２のトランジスタのコレクタに接続し上記オｌの
トランジスタのエミッタは抵抗を介して直流電源に上記
第２のトランジスタのエミッタは抵抗を介して接地にそ
れぞれ接続して構成したオｌの回路と、上記第１の極性
の第３のトランジスタのコレクタを上記第２の極性の第
４のトランジスタのコレクタに接続し上記第３のトラン
ジスタのエミッタは抵抗を介して上記直流電源に上記第
４のトランジスタのエミッタは接地にそれぞれ接続して
構成した第２の回路と、上記第２の極性の第５のトラン
ジスタのコレクタを上記直流電源にそのエミッタ全抵抗
ケ介して接地にそれぞれ接続して構成した第３０回路と
、上記オｌ、第３、及び第５の各トランジスタのベース
を並列に接続するオｌの共通ベース回路と、上記第２及
び第４のトランジスタのベースを接続する第２の共通ベ
ース回路と、上記刈・ｌの極性を有しそのエミッタは上
記′１７１の共通ベース回路にそのコレクタは接地にそ
のベースは上記第２のトランジスタのコレクタにそれぞ
れ接続されるオ６のトランジスタと、上記オｌの極性を
准しそのエミッタは上記第３のトランジスタのコレクタ
にそのコレクタは上記第２の共通ベース回路にそのベー
スは上記第５のトランジスタのエミッタにそれぞれ接続
されるオフのトランジスタとを備えた絶対７１ ｔＪＪ
ｊ比例電流発生回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56180597A JPS5882321A (ja) | 1981-11-10 | 1981-11-10 | 絶対温度比例電流発生回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56180597A JPS5882321A (ja) | 1981-11-10 | 1981-11-10 | 絶対温度比例電流発生回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5882321A true JPS5882321A (ja) | 1983-05-17 |
| JPH0259485B2 JPH0259485B2 (ja) | 1990-12-12 |
Family
ID=16086038
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56180597A Granted JPS5882321A (ja) | 1981-11-10 | 1981-11-10 | 絶対温度比例電流発生回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5882321A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4578633A (en) * | 1983-08-31 | 1986-03-25 | Kabushiki Kaisha Toshiba | Constant current source circuit |
| JP5942175B1 (ja) * | 2015-02-27 | 2016-06-29 | Ｓｉｍｐｌｅｘ Ｑｕａｎｔｕｍ株式会社 | 電流源回路 |
-
1981
- 1981-11-10 JP JP56180597A patent/JPS5882321A/ja active Granted
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4578633A (en) * | 1983-08-31 | 1986-03-25 | Kabushiki Kaisha Toshiba | Constant current source circuit |
| JP5942175B1 (ja) * | 2015-02-27 | 2016-06-29 | Ｓｉｍｐｌｅｘ Ｑｕａｎｔｕｍ株式会社 | 電流源回路 |
| WO2016136948A1 (ja) * | 2015-02-27 | 2016-09-01 | Ｓｉｍｐｌｅｘ Ｑｕａｎｔｕｍ株式会社 | 電流源回路 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0259485B2 (ja) | 1990-12-12 |
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